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AD9516-5
需要注意的是N个相同的值可以用不同的方式来获得，
如所示，N = 12的情况下，用户可以选择一个固定的
= 6 ，P = 2与B分频模式;使用的双模模式
2/3 A = 0 ， B = 6 ;或使用4/5双模模式与
A = 0 ， B = 3 。
锁定检测计数器（注册量0x018 [6 ： 5 ] ） 。锁定未标明
直到有连续PFD周期的可编程数
同的时间差小于所述锁定检测阈值。
该锁定检测电路继续指示一个锁直至时间
大于解锁阈值差异较大时在单个
随后的周期。该锁定检测正常工作，在期间
在PFD频率必须大于解锁阈值。
需要锁定的连续PFD周期数是
可编程（注册量0x018 [6 ： 5 ] ） 。
A和B计数器
B计数器必须≥3或旁路，不像R计数器，
A = 0实际上是零。当预分频器是双模模式，
A计数器必须小于B计数器。
最大输入频率为A或B计数器被反射
在最大预分频器的输出频率（ 300兆赫），该
在表2中指定，这是预分频器输入频率
（外部VCO或CLK）除以P。例如，一个双
对P = 8/9模式模模式下，如果外部是不允许的
VCO的频率大于2400兆赫，因为频
将要在A或B计数器是太高了。
当B计数器旁路（ B = 1 ） ， A计数器应
被设置为0，并产生隔膜整体等于预分频
设置，在该模式下P的可能的分频比是1，2 ，3，4 ，8，
16 ，和32 ，此模式是有用的，只有当外部VCO / VCXO
被使用，因为内部VCO的频率范围要求
整体反馈分大于32 。
虽然手动复位通常不需要， A和B
计数器有自己的复位位。可替代地， A和B的
计数器可以重置使用R ， A的共享的复位位，以及
B计数器。请注意，这些复位位是不是自我清除。
模拟锁定检测（ ALD ）
该
AD9516
提供了一个可以被选择用于在ALD功能
在使用LD引脚。有两个版本的ALD的，具体如下：
N沟道开漏锁定检测。这个信号需要
一个上拉电阻与正电源VS。的输出是
通常高短，低脉冲。锁定指示
由低电平脉冲信号的最小占空比。
P沟道开漏锁定检测。这个信号需要
一个下拉电阻接地。输出通常是低
短，高脉冲。锁定由指示
高向脉冲的最小占空比。
模拟锁定检测功能需要一个RC滤波器
提供一个逻辑电平指示锁定/解锁。
VS = 3.3V
AD9516-5
LD
ALD
R1
R2
V
OUT
C
07972-067
R，A和B计数器-SYNC引脚复位
将R， A和B计数器也可以通过同时复位
SYNC引脚。这个功能是通过寄存器0x019控制[7：6 ]
（见表49）。 SYNC引脚复位默认是禁用的。
图模拟锁定的38例检测过滤，使用
N沟道开漏驱动器
R和N分频器延迟
无论是R和n分频器具有可编程延迟单元。
这些延迟可以启用，允许调整阶段
PLL参考时钟与VCO或之间的关系
CLK 。每个延迟是由3位控制。总延迟
范围为约1毫微秒。见寄存器0x019表49 。
电流源数字锁定检测（ CSDLD ）
在PLL锁定序列，这是正常的DLD
信号给余下稳定之前进行切换的次数
当PLL被完全锁定，稳定。有可能是
应用中，理想的是具有唯一的DLD断言
之后PLL被牢固地锁定。这使得可以通过使用
电流源锁定检测功能。此功能设定
当它被选作从LD引脚控制输出
（寄存器0x01A [ 5 ： 0 ] ） 。
电流源锁定检测提供110 μA的电流
当DLD是真实的，它接地短路时， DLD是假的。
如果一个电容器连接到LD引脚，其充电的速率
由电流源在DLD真实时间被确定
但几乎是立刻，当DLD为假出院。通过
监测在LD引脚上的电压（在电容器的顶部） ，它是
可能得到一个逻辑高电平后才DLD一直
真足够长的时间。任何瞬间的DLD假
复位充电。通过选择适当大小的电容器，它是
能够延迟锁定检测指示直到PLL被锁定
在一个稳定的状态和锁定检测不喋喋不休。
锁定检测
数字锁定检测（ DLD ）
通过选择每个引脚上通过MUX的正确输出，
DLD功能，可以在LD ，状态进行提供，并
REFMON引脚。在DLD电路显示一个锁的时候时间
在PFD的输入的上升沿差小于一个
指定值（锁定阈值） 。锁定的损失被表示
当时间差超过特定值（在解锁
阈值） 。需要注意的是解锁阈值比更宽
锁阈值，这使得一些相位误差在过量的
发生锁定窗口，不喋喋不休的锁定指示灯。
锁定检测窗口时间取决于三个设置：
数字锁定检测窗口位（注册量0x018 [4] ） ，防反冲
脉冲宽度设定（寄存器0x017 [1 ：0]） ，见表2） ，以及
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