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纳米的ProASIC3快闪FPGA
t
EOUT
D
E
Q
t
ZL
, t
ZH
, t
HZ
, t
LZ
, t
ZLS
, t
ZHS
CLK
EOUT
D
D
Q
DOUT
CLK
t
EOUT
=最大值（T
EOUT
（r）的，吨
EOUT
(f))
VCC
D
VCC
E
50%
t
EOUT （R）的
50%
t
ZL
PAD
VTRIP
VOL
50%
t
EOUT （ F）
VCC
50%
t
HZ
90 ％ VCCI
50%
t
ZH
VCCI
VTRIP
10% V
CCI
50%
t
LZ
PAD
I / O接口
EOUT
VCC
D
VCC
E
50%
t
EOUT （R）的
50%
t
ZLS
VTRIP
VOL
50%
VCC
EOUT
PAD
50%
VOH
50%
t
ZHS
VTRIP
t
EOUT （ F）
图2-5
三态输出缓冲器时序模型和延迟（例如）
EV我SI O 4 N 1 1
2- 15
