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FLEX 6000可编程逻辑器件系列数据手册
漏极开路的5.0 V或3.3 V FLEX 6000器件输出引脚（有上拉
电阻在5.0 V电源）可驱动5.0 V CMOS输入引脚，
需要一个V
IH
3.5 V.当开漏引脚激活时，它会驱动为低电平。
当销处于非活动状态时，跟踪将被上拉至5.0 V的由电阻器。
开漏引脚将只驱动低或三态;它永远不会开很高。
的上升时间取决于上拉电阻与负载的值
阻抗。在我
OL
目前的规范时，应考虑
选择一个上拉电阻。
在5.0 -V FLEX 6000器件采用V输出引脚
CCIO
= 3.3 V或5.0 V （以
一个上拉电阻到5.0 V电源），也可以带动5.0 V CMOS输入
销。在这种情况下，上拉晶体管将关闭引脚电压时
超过3.3 V.因此，该引脚不必为漏极开路。
电源排序&热插拔
由于FLEX 6000系列器件可在混合电压使用
环境，他们已经专门容忍任何可能
上电顺序。在V
CCIO
和V
CCINT
电源层可以关
以任何顺序。
信号可以6000的设备之前和期间被打入3.3 -V FLEX
功率，而不会损坏器件。此外， FLEX 6000器件
不开车出去时开机。一旦操作条件达到
作为由用户指定的FLEX 6000器件工作。
IEEE标准。
1149.1 （JTAG）
边界扫描
支持
所有FLEX 6000器件提供符合JTAG BST电路
IEEE标准。 1149.1-1990规范。
表8
显示了JTAG指令
FLEX 6000器件。 JTAG BST之前或之后进行
配置，而不是在配置过程中（除非您禁用
在用户模式下JTAG支持） 。
1
SEE
应用笔记39 （ IEEE 1149.1 （ JTAG ）边界扫描
Altera器件测试）
关于JTAG BST的更多信息
电路。
表8. FLEX 6000 JTAG指令
JTAG指令
描述
SAMPLE / PRELOAD允许在器件引脚信号的快照被捕获，并在检查
正常的设备操作，并允许初始数据模式是在器件引脚输出。
EXTEST
绕行
允许外部电路和板级互连，以通过迫使测试被测试
模式，输出引脚和捕获测试结果在输入引脚。
地之间的1位旁路寄存器
TDI
和
TDO
销，其允许的BST
数据通过在选定的设备，以相邻的设备同步传
器件正常工作。
28
Altera公司。
