ADS42JB49
ADS42JB69
SLAS900C - 2012年10月 - 修订2013年7月
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时钟输入
该器件的时钟输入可驱动差分（正弦波， LVPECL或LVDS ）或单端（ LVCMOS ） ，与
小或在它们之间的性能没有差异。的时钟输入端的共模电压被设定为1.4V的
使用内部5 kΩ的电阻。该ADS42JB69和ADS42JB49的自偏压时钟输入可以通过驱动
变压器耦合，正弦波时钟源或由交流耦合， LVPECL和LVDS时钟源，如图
in
图87 ，图88 ，
和
图89 。
SEE
图90
用于与内部时钟缓冲器的详细信息。
0.1
m
F
CLKP
迪FF erential
正弦波
时钟输入
Z
o
0.1
m
F
CLKP
R
T
0.1
m
F
CLKM
设备
典型LVDS
时钟输入
Z
o
100
W
0.1
m
F
CLKM
设备
注释：R
T
=端接电阻，如果需要的话。
图87.差分正弦波时钟驱动
电路
Z
o
150
W
典型的LVPECL
时钟输入
Z
o
150
W
0.1
m
F
0.1
m
F
图88. LVDS时钟驱动电路
CLKP
100
W
CLKM
设备
图89. LVPECL时钟驱动电路
时钟缓冲器
L
PKG
2 NH
CLKP
C
BOND
1 pF的
R
ESR
100
W
L
PKG
2 NH
CLKM
C
BOND
1 pF的
R
ESR
100
W
20
W
C
EQ
C
EQ
5千瓦
1.4 V
20
W
5千瓦
注：C
EQ
是1 pF至3 pF和是时钟缓冲器的等效输入电容。
图90.内部时钟缓冲器
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