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的PSoC
3 ： CY8C34系列数据表
如果旁路模式被选择。请注意，实际的I / O引脚的电压
由所选择的驱动模式的组合来确定，并且
负载在销。例如，如果一个GPIO管脚被配置为
电阻上拉模式和，而脚悬空驱动为高，
在销测得的电压为高逻辑状态。如果同一
GPIO引脚在外部接地，则电压
不可测的引脚为逻辑低状态。
6.4.1驱动模式
每个GPIO和SIO引脚都可单独配置成一
在列出的8驱动模式
表6-6 。
三个配置位
用于每个引脚（DM [2：0 ]），并在PRTxDM [2： 0]
寄存器。
图6-11
描绘了基于引脚简图
每八个驱动模式。
表6-6
显示了I / O引脚的驱动
状态基于端口的数据寄存器的值或数字阵列信号
图6-11 。驱动模式
VDDIO
VDDIO
DR
PS
针
DR
PS
针
DR
PS
针
DR
PS
针
0.
高阻抗
类似物
1.高阻抗
数字
VDDIO
2.电阻
引体向上
VDDIO
3.电阻
下拉
VDDIO
DR
PS
针
DR
PS
针
DR
PS
针
DR
PS
针
4.开漏
,
硬盘低
5.漏极开路
,
高驱动器
6.强劲动力
7.电阻
上拉和下拉
表6-6 。驱动模式
图
0
1
2
3
4
5
6
7
驱动模式
高阻抗模拟
高阻抗数字
电阻
电阻
引体向上
[15]
下拉
[15]
PRT×DM2
0
0
0
0
1
1
1
1
PRT×DM1
0
0
1
1
0
0
1
1
PRT×DM0
0
1
0
1
0
1
0
1
PRT × DR = 1
高Z
高Z
清晰度高（ 5K ）
强高
高Z
强高
强高
清晰度高（ 5K ）
PRT × DR = 0
高Z
高Z
小强
RES低（ 5K ）
小强
高Z
小强
RES低（ 5K ）
开漏驱动器低
开漏输出，驱动大
强大的驱动器
电阻上拉和下拉
[15]
记
15.电阻上拉和下拉不可用SIO在稳压输出模式。
文件编号： 001-53304修订版* Q
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