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CY7C1380D
CY7C1380F
CY7C1382D
引脚德网络nitions
（续）
名字
TDO
I / O
描述
JTAG串行
串行数据输出到JTAG电路。
提供在TCK的下降沿数据。如果JTAG功能是
没有被利用，该引脚必须断开。该引脚上没有TQFP封装。
产量
同步
JTAG串行
串行数据，在到JTAG电路。
采样于TCK的上升沿。如果JTAG功能是不是被
输入
使用时，此引脚可断开或连接到V
DD
。该引脚上没有TQFP封装。
同步
JTAG串行
串行数据，在到JTAG电路。
采样于TCK的上升沿。如果JTAG功能是不是被
输入
使用时，此引脚可断开或连接到V
DD
。该引脚上没有TQFP封装。
同步
JTAG-
时钟
–
时钟输入JTAG的电路。
如果JTAG功能没有被使用，该引脚必须连接
到V
SS
。该引脚上没有TQFP封装。
未连接。
36M ， 72M ， 144M ， 288M ， 576M ， 1G和地址都是扩展引脚和内部不
连接到所述管芯。
输出寄存器。在下一时钟的上升沿，数据被
启用通过输出寄存器，到传播
在2.6纳秒（ 250 MHz器件） ，如果OE是低电平有效的数据总线。该
当SRAM被从一个新兴只发生异常
取消选择状态来选择状态;它的输出总是
的存取的第一个周期期间为三态。在第一周期之后
的访问时，输出由所述参考信号的控制。
连续的单个读周期总是得到支持。一旦SRAM
取消选择在时钟的上升由芯片选择，要么ADSP或
ADSC信号，其输出立即为三态。
TDI
TMS
TCK
NC
功能概述
所有同步输入都会通过由控制输入寄存器
在时钟的上升沿。所有数据输出通过输出
寄存器由时钟的上升沿来控制。最大
从时钟上升接入延迟（叔
CO
）为2.6纳秒（ 250 MHz器件） 。
CY7C1380D / CY7C1380F / CY7C1382D支持二次
使用线性或交错突发序列缓存在系统中。
交错的突发为了支持Pentium和i486
处理器。线性突发序列适合使用的处理器
线性突发序列。突发顺序是用户可选择的，并且
由采样MODE输入来确定。访问即可
无论使用哪种处理器地址选通（ ADSP ）或启动
控制器地址选通（ ADSC ） 。地址进展
通过脉冲串序列由ADV输入控制。一
2位片上环绕突发计数器捕捉到的第
在一阵顺序寻址和自动递增
解决了的突发访问的其余部分。
字节写操作均合格的字节写使能
（ BWE ）和字节写选择（ BW
X
）输入。全局写使能
（ GW ）将覆盖所有写字节输入和数据写入到所有四个
字节。所有的写操作都简化片上同步
自定时写电路。
三个同步片选（ CE
1
，CE
2
，CE
3
）和一个
异步输出使能（ OE ）为方便银行
选择和输出三态控制。如果CE ADSP被忽略
1
is
高。
单写访问发起的ADSP
当以下两个条件都为这种访问开始
满意在时钟的上升： （ 1 ） ADSP为低电平（2 ） CE
1
,
CE
2
和CE
3
都置为有效。地址提交给
A被加载到地址寄存器和地址
同时被输送到存储器阵列前进逻辑。
写信号（ GW ， BWE和BW
X
）和ADV输入是
在这第一个周期忽略。
ADSP触发写操作需要两个时钟周期来
完整的。如果网关被置为低电平的第二个时钟崛起，
提交的DQ的输入数据被写入到
存储器阵列中的相应的地址位置。如果是GW
高，则写操作被BWE和体重控制
X
信号。
CY7C1380D / CY7C1380F / CY7C1382D提供字节写
这是在写周期说明表中描述的能力。
断言字节写使能输入（ BWE ）的选择
字节写（ BW
X
）输入时，选择性地写入到只有所需的
字节。字节写操作字节时没有选择留
不变。一个同步自定时写入机制已
提供简化的写操作。
CY7C1380D / CY7C1380F / CY7C1382D是一种常见的I / O设备，
输出使能（ OE ）之前必须冷清HIGH
提交数据到DQS的输入。这样做的三态输出
驱动程序。为安全起见， DQS就会自动三态
每当一个写周期被检测到，无论OE的状态。
单一的读访问
当满足以下条件，该访问被启动
满意在时钟的上升： （ 1 ） ADSP或ADSC为低电平时，
（ 2 ） CE
1
，CE
2
，CE
3
都置为有效，和（3）的写
信号（ GW ， BWE ）都冷清HIGH 。如果ADSP被忽略
CE
1
为HIGH 。出现在地址输入地址（A ）
被存储到地址前进逻辑和地址
注册而被呈现到所述存储器阵列。该
对应的数据被使能传播到的输入
文件编号： 38-05543牧师* N
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