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Ultra37000 CPLD系列
逻辑框图
（续）
CY37384 / CY37384V （ 256引脚BGA）
时钟/
INPUT输入
1
4
4
12个I / O的
I / O
0
-I / O
11
12个I / O的
I / O
12
-I / O
23
I / O
24
-I / O
35
12个I / O的
逻辑
块
AA
逻辑
块
AB
逻辑
块
AC
逻辑
块
AD
12个I / O的
I / O
36
-I / O
47
逻辑
块
AE
逻辑
块
AF
12个I / O的
I / O
48
-I / O
59
I / O
60
-I / O
71
12个I / O的
逻辑
块
AG
逻辑
块
AH
逻辑
块
AI
逻辑
块
AJ
12个I / O的
I / O
84
-I / O
95
逻辑
块
AK
逻辑
块
AL
TDI
TCK
TMS
36
16
36
16
36
16
36
16
36
16
36
16
36
16
36
16
36
16
36
16
36
16
36
16
36
16
36
16
36
16
36
16
4
逻辑
块
BL
逻辑
块
BK
逻辑
块
BJ
逻辑
块
BI
逻辑
块
BH
逻辑
块
BG
逻辑
块
BF
逻辑
块
BE
逻辑
块
BD
逻辑
块
BC
逻辑
块
BB
逻辑
块
BA
12个I / O的
I / O
96
-I / O
107
12个I / O的
I / O
120
-I / O
143
12个I / O的
I / O
108
-I / O
131
12个I / O的
I / O
96
-I / O
119
12个I / O的
I / O
132
-I / O
155
12个I / O的
I / O
168
-I / O
191
12个I / O的
I / O
156
-I / O
179
12个I / O的
I / O
144
-I / O
167
PIM
36
16
36
16
36
16
36
16
36
16
12个I / O的
I / O
72
-I / O
83
36
16
36
16
36
16
JTAG TAP
调节器
TDO
96
96
文件编号： 38-03007牧师* D
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