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CYF2018V
CYF2036V
CYF2072V
图2.串行写入到配置寄存器
宽度扩展配置
CYF2072V的宽度可以被扩展以提供字宽
比36位更大。在宽度扩展模式下，所有的控制
线路输入是常见的，所有的标志都可以。空（满）
标志由AND运算每个FIFO的空（满）标志创建。
该技术避免了读取数据或将数据写入该
FIFO是“交错的”由一个时钟周期，由于变化
在RCLK和WCLK之间的偏移。
科幻gure 3
演示了一个
例如一个72位字宽的通过使用两个36位字
CYF2072Vs.
图3.使用两个CYF2072Vs的宽度扩展
DATAIN （ D）
72
36
36
写时钟（ WCLK ）
写使能（ WEN ）
CYF2072V
读时钟（ RCLK ）
读使能（ REN）
输出使能（ OE ）
CYF2072V
EF
FF
FF
EF
36
FF
EF
36
DATAOUT （ Q）
72
内存组织为不同端口尺寸
72兆位内存有不同的组织不同的端口
尺寸。
表6
示出了在FIFO的深度为所有端口大小。
请注意，对于所有端口的尺寸，四到八个位置不可用
用于写入数据，并用于防范假
空和满的标志同步。
表6.字长选择
PORTSZ [2 ：0]的
000
001
010
011
100
101
110
111
字长
×9
× 12
× 16
× 18
× 20
× 24
× 32
× 36
FIFO深度
8兆
4兆
4兆
4兆
2兆欧
2兆欧
2兆欧
2兆欧
内存大小
72兆位
48兆位
64兆位
72兆位
40兆位
48兆位
64兆位
72兆位
所提及的存储器大小是当设备被配置在
单队列模式。
文件编号： 001-68336修订版* C
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