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CY7C1386D
CY7C1387D
引脚德网络nitions
名字
A
0
, A
1
, A
I / O
描述
输入 -
用于选择的地址位置中的一个地址输入。
采样在CLK的上升沿
如果同步ADSP ADSC或低电平有效，和CE
1
，CE
2
和CE
3
采样活跃。 A 1： A 0被馈送到两个位
计数器。
BW
A
， BW
B
,
输入 -
字节写选择输入，低电平有效。
合格与BWE进行字节写入到SRAM中。采样
BW
C
， BW
D
同步的在CLK的上升沿。
GW
BWE
CLK
CE
1
输入 -
全局写使能输入，低电平有效。
当在CLK的上升沿，一个全局写断言低
同步进行（所有字节写入，无论价值的BW
X
和BWE ） 。
输入 -
字节写使能输入，低电平有效。
采样在CLK的上升沿。这个信号必须置
同步LOW进行字节写操作。
输入 -
时钟
时钟输入。
用于捕获所有的同步输入到设备中。还用于增加爆
在ADV为低电平时，一阵操作过程中的计数器。
输入 -
芯片使能1输入，低电平有效。
采样在CLK的上升沿。使用与CE联
2
同步和CE
3
选择或取消选择该设备。如果CE ADSP被忽略
1
为HIGH 。 CE
1
采样仅当一个
新的外部地址被加载。
输入 -
芯片使能2输入，高电平有效。
采样在CLK的上升沿。使用与CE联
1
同步和CE
3
选择或取消选择该设备。 CE
2
只有当一个新的外部地址被装入取样。
输入 -
芯片使能3输入，低电平有效。
采样在CLK的上升沿。使用与CE联
1
同步和CE
2
选择或取消选择该设备。未连接的BGA 。凡引用，CE
3
假设
活跃在该文件的BGA 。 CE
3
只有当一个新的外部地址被装入取样。
输入 -
输出使能，异步输入，低电平有效。
控制的I / O引脚的方向。当低，
异步的I / O引脚用作输出。当拉高高， DQ引脚处于三态，并作为输入数据
销。 OE是在读周期的第一个时钟从取消选择状态出现时被屏蔽。
输入 -
提前输入信号，采样CLK ，低电平有效的上升沿。
当断言，它
同步自动递增的猝发周期的地址。
输入 -
地址选通的处理器，采样CLK ，低电平有效的上升沿。
当断言
同步LOW时，呈现给设备的地址被捕获在地址寄存器中。 A1 ： A0还装
入脉冲串计数器。当ADSP和ADSC都断言，只有ADSP是公认的。 ASDP是
被忽略的时候CE
1
被拉高高。
输入 -
地址选通脉冲从控制器，采样CLK ，低电平有效的上升沿。
当断言
同步LOW时，呈现给设备的地址被捕获在地址寄存器中。 A1 ： A0还装
入脉冲串计数器。当ADSP和ADSC都断言，只有ADSP是公认的。
输入 -
ZZ睡眠输入，高电平有效。
当在非时间关键的睡眠置为高电平时，器件
异步状态与数据的完整性保护。正常工作时，该引脚为低电平。 ZZ引脚具有
内部上拉下来。
I / O-
双向数据I / O线。
作为输入，它们馈入由所述触发芯片上的数据寄存器
CLK的同步上升沿。作为输出，它们提供由指定包含在存储位置中的数据
地址在读周期的前一个时钟的上升呈现。引脚的方向
通过OE控制。当OE是低电平时，引脚用作输出。高电平时， DQS和DQP
X
被放置在一个三态状态。
电源
电源输入到该装置的核心。
地
I / O接地
I / O电源
供应
输入 -
STATIC
地面的装置的核心。
地面的I / O电路。
电源为I / O电路。
选择爆秩序。
当连接到GND选择线性突发序列。当连接到V
DD
或悬空
选择交错突发序列。这是一个带销，必须装置运行过程中保持不变。
模式引脚具有内部上拉起来。
CE
2
CE
3
OE
ADV
ADSP
ADSC
ZZ
的DQ ，
DQP
X
V
DD
V
SS
V
SSQ
V
DDQ
模式
文件编号： 38-05545牧师*
第34 7
