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Si5326
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TTENUATOR
特点
生成任意频率从2kHz
945 MHz和选择频率
从输入频率为1.4 GHz
2千赫至710兆赫
抖动超低抖动时钟输出
代低至0.3 ps的均方根
（ 50 kHz至80 MHz的）
具有可选的集成环路滤波器
环路带宽（ 60 Hz至8.4 kHz时）
满足OC- 192 GR- 253 -CORE抖动
特定网络阳离子
双时钟输入，手动或
自动控制无中断
开关（ LVPECL ， LVDS ， CML ，
CMOS ）
具有可选的双时钟输出
信号格式
支持ITU G.709和自定义
FEC比率（二百三十八分之二百五十五， 237分之255 ，
255/236)
LOL ， LOS ， FOS报警输出
数字控制输出相位
调整
I
2
C或SPI可编程
片上电压调节器
1.8 ±5％， 2.5 ±10％ ，或3.3伏± 10％的
手术
小尺寸： 6 ×6mm的36引脚QFN
无铅，符合RoHS标准
订货信息：
请参阅第65页。
引脚分配
CKOUT1–
CKOUT2+
CMODE
CKOUT2–
SONET / SDH OC- 48 / OC -192 / STM-
16 / STM-64的线卡
ITU G.709和自定义FEC线
牌
千兆/万兆以太网， 1/2/ 4/8 / 10G光纤
通道线卡
千兆/万兆以太网同步
光模块
无线基站
数据转换器时钟
xDSL的
PDH时钟合成
测试与测量
广播视频
GND
36 35 34 33 32 31 30 29 28
RST
NC
INT_C1B
C2B
VDD
XA
XB
GND
NC
1
2
3
4
5
6
7
8
9
10 11 12 13 14 15 16 17 18
NC
CKIN1+
RATE0
RATE1
CKIN2+
CKIN1–
CKIN2–
VDD
大声笑
27 SDI
26 A2_SS
25 A1
CKOUT1+
24 A0
23 SDA_SDO
22 SCL
21 CS_CA
20 INC。
12月19日
应用
VDD
NC
GND
PAD
描述
该Si5326是应用的抖动衰减精密时钟乘法器
需要分1 ps的抖动性能。该Si5326接收两个输入时钟范围
从2kHz至710兆赫，并产生两个输出时钟从2 kHz至
945 MHz和选择频率为1.4 GHz 。两个输出分频
分别从公共源。该Si5326也可以使用其晶体振荡器
作为一个时钟源的频率合成。该器件可提供几乎任何
跨越这个工作范围频率转换组合。该Si5326输入
时钟频率和时钟倍频比例是可编程通过I
2
C或
SPI接口。该Si5326基于Silicon Laboratories的第三代
DSPLL
技术，该技术在一个规定的频率合成和抖动衰减
高度集成的PLL的解决方案，消除了对外部VCXO和
环路滤波器组件。该DSPLL环路带宽是数字可编程，
提供抖动性能优化在应用程序级别。从操作
单1.8 ， 2.5或3.3 V电源供电， Si5326非常适合用于提供时钟
乘法和抖动衰减高性能定时应用。
1.0版9/10
版权所有 2010 Silicon Laboratories公司
NC
Si5326
