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HYS72D[32/64/128]3[00/20]GBR
录得双数据速率SDRAM模块
概观
1
1.1
概观
特点
184引脚注册的8字节双列直插式
DDR SDRAM模块“1U ”PC ，工作站和服务器主内存的应用
一个等级32M
×
72, 64M
×
72和两个队伍64M
×
72, 128M
×
72组织
JEDEC标准的双数据速率同步DRAM （ DDR SDRAM ），用一个单一的+ 2.5 V （ ± 0.2 V）电源
电源和单+ 2.6 V （ ± 0.1 V）电源供电DDR400
内置有256兆的DDR - SDRAM的我在P- TFBGA - 60-1封装
可编程CAS延迟，突发长度和换行序列（序列&交错）
自动刷新（ CBR）和自刷新
所有输入和输出SSTL_2兼容
重新驱动器使用的寄存器和PLL器件所有的输入信号。
串行存在检测为E
2
舞会
薄型模块的外形尺寸：
128.95 mm
×
28.58 mm
×
4.00 mm
133.35 mm
×
30.48 mm (1.2”)
×
4.00毫米（ 6.80毫米与堆叠组件）
一阶256MB和512MB两个队伍512MB和1GB的JEDEC标准参考设计：
PC2700注册的DIMM原卡A， B，C ，D
镀金触点
性能
-5
DDR400B
PC3200-3033
–6
DDR333B
PC2700–2533
166
166
133
-7
DDR266A
PC2100-2033
–
143
133
单位
—
—
兆赫
兆赫
兆赫
表1
产品型号代码的运行速度
速度等级组件
模块
马克斯。时钟
频率
@CL3
@CL2.5
@CL2
f
CK3
f
CK2.5
f
CK2
200
166
133
1.2
描述
该HYS72D [ 32/64/128 ] 3 [ 00/20 ] GBR是标准注册DIMM模块的低调版本
小于/等于1.2 “英寸（ 30.48毫米），高度为1U服务器应用程序。低调DIMM版本可供选择
为32M
×
72 （ 256MB ） ， 64M
×
72 （ 512MB ）和128M
×
72 （ 1 GB ） 。
存储器阵列的设计与双数据速率同步DRAM的ECC应用。所有的控制和
地址信号重新驱动使用的设备寄存器和PLL的时钟分配的DIMM 。这将减少
电容性负载到系统总线，但增加了一个周期的SDRAM的定时。各种去耦电容
安装在PC板上。该功能的DIMM串行存在检测基于串行é
2
使用PROM设备
2针I
2
C协议。前128字节被编程的配置数据和第二128字节是
提供给顾客。
数据表
6
修订版1.1 ， 2004-04
10102003-01E2-HPA8
