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512MB ， 1GB ， 2GB Registered DIMM内存模组
240针DDR2 DIMM注册时钟拓扑
DDR2 SDRAM
为0ns （标称）
PLL
DDR2 SDRAM
OUT1
120欧
CK0
120欧
IN
CK0
DDR2 SDRAM
Reg.A
120欧
C
反馈
反馈出
Reg.B
OUTN
C
120欧
注意：
1.
2.
3.
4.
时钟延迟从PLL时钟的任DDR2 SDRAM的输入的输入或寄存器将被设置为为0ns （标称值） 。
输入，输出和反馈时钟线从线端接到线所示，而不是从线到地。
只有一个PLL输出显示每个输出类型。任何额外的PLL输出将有线以类似的方式。
端接电阻为PLL的反馈路径的时钟都尽可能靠近PLL作为可能的输入引脚。
修订版1.3 2005年08月
