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TLV990 40
3 V , 10位, 40 MSPS区CCD模拟前端
SLAS326A - 2001年1月 - 修订2004年3月
特点
应用
D
单芯片CCD模拟前端
D
10位, 40 MSPS
, A / D转换器单3 -V
D
D
D
D
D
D
电源供电
超低功耗: 200 mW的典型, 2兆瓦
掉电模式
微分非线性误差:
& LT ;
±0.6
LSB典型
积分非线性误差: <
±1.75
最低位
典型
可编程增益放大器( PGA )用
0 dB至36 dB的增益范围( 0.045分贝/步)
自动或可编程光黑
水平和偏移校准数字
过滤器和坏点限制
附加的DAC外部模拟
环境
对于寄存器配置串行接口
内部基准电压
D
数字静态照相机
D
视频摄像机
PFB包装
( TOP VIEW )
36 35 34 33 32 31 30 29 28 27 26 25
STBY
RESET
CS
SDIN
SCLK
ADCCLK
BLKG
CP
CP
AVDD4
AGND4
OBCLP
D
D
D
48引脚TQFP封装
描述
AGND5
RBD
RMD
RPD
AV
DD5
V
SS
AV
DD1
AGND1
SR
SV
CLCCD
CLREF
37
38
39
40
41
42
43
44
45
46
47
48
1
2 3 4
5 6 7
8
9 10 11 12
TLV990-40PFB
24
23
22
21
20
19
18
17
16
15
14
13
OE
SCKP
DACO2
DACO1
AGND3
AV
DD3
DIGND
DIV
DD
D9
D8
D7
D6
该TLV990-40是一个完整的CCD和视频
信号处理器/数字转换器设计用于数字静止
摄像头和视频摄像机的应用。
该TLV990-40执行所有模拟处理必要最大化动态范围的功能,
校正与CCD传感器相关联的各种错误,然后进行数字化处理的结果与一个片
高速模拟 - 数字转换器(ADC ) 。
该TLV990-40的关键组件包括:用于CCD和模拟视频信号的输入钳位电路,
相关双取样(CDS ),可编程增益放大器( PGA),用0至36 -dB的增益范围内,两个内部
数字 - 模拟转换器(DAC),用于自动或可编程的光学黑色电平以及偏置校准,一
10位, 40 - MSPS的流水线模数转换器,方便微处理器接口的并行数据端口,串行端口
配置内部控制寄存器,两个额外的DAC,用于外部系统控制和内部参考
电压。
在先进的CMOS工艺设计, TLV990-40从一个正常的一个3 -V电源供电
200毫瓦在40 MSPS和2毫瓦掉电模式下的功耗。
它的非常高的吞吐量速率,单个3 -V的运算,非常低的功耗,并完全集成的模拟
处理电路,使得TLV990-40为电子的理想CCD和视频信号处理解决方案
视频摄像机的应用。
该器件采用48引脚TQFP封装,规定工作在-20 ° C至75 °C的工作温度
范围内。
请注意,一个重要的通知有关可用性,标准保修,并且在关键的应用程序中使用
德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
测试寄存器必须被设置为1011 40 MSPS的操作。
PRODUCTION数据信息为出版日期。
产品符合每德州仪器条款规范
标准保修。生产加工并不包括
所有测试参数。
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达拉斯,德克萨斯州75265
CCDIN
NC
AVDD2
AGND2
DGND
DVDD
D0
D1
D2
D3
D4
D5
版权
2004年,德州仪器
1
TLV990 40
3 V , 10位, 40 MSPS区CCD模拟前端
SLAS326A - 2001年1月 - 修订2004年3月
可选项
封装器件
TA
-20 ° C至75°C的
TQFP
( PFB )
TLV990-40PFB
功能框图
AVDD15
CLCCD
CLREF
RPD RBD
RMD
DVDD
DIVDD
OE
状态
LATCH
D0
诠释。参考文献。
1.2 V REF
CDS /
MUX
CCDIN
Σ
8-Bit
华助会
PGA
10
PGA
调节器
Σ
8-Bit
FDAC
10-Bit
ADC
D9
RESET
CLK
SV
SR
BLKG
OBCLP
STBY
光纤
像素限制
OFFSET
注册
OFFSET
注册
数字
平均器/
滤波器
定时
控制
逻辑
DACO1
8-Bit
DAC
DAC
REG
SCKP
CS
SCLK
SDIN
DACO2
8-Bit
DAC
DAC
REG
串行
PORT
VSS
AGND15
DGND
DIGND
2
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达拉斯,德克萨斯州75265
TLV990 40
3 V , 10位, 40 MSPS区CCD模拟前端
SLAS326A - 2001年1月 - 修订2004年3月
终端功能
终奌站
名字
ADCCLK
AGND1
AGND2
AGND3
AGND4
AGND5
AVDD1
AVDD2
AVDD3
AVDD4
AVDD5
BLKG
CLCCD
CCDIN
CLREF
CP
CS
D0 – D9
DACO1
DACO2
DGND
DIGND
DIVDD
DVDD
NC
OBCLP
OE
RBD
RESET
RMD
RPD
SDIN
SCKP
SCLK
SR
STBY
SV
VSS
25
44
4
20
32
37
43
3
19
33
41
36
47
1
48
34, 35
28
7–16
21
22
5
18
17
6
2
31
24
38
29
39
40
27
23
26
45
30
46
42
I
I
I
O
I
O
O
I
I
I
I
I
I
I
I
I
O
I
I
O
O
O
I
ADC时钟输入
模拟地内部CDS电路
内部PGA电路模拟地
内部DAC电路模拟地
内部ADC电路模拟地
内部REF电路模拟地
模拟电源电压为内部的CDS电路,3V的
模拟电源电压为内部PGA电路, 3 V
模拟电源电压为内部DAC电路, 3 V
模拟电源电压为内部ADC电路,3V的
模拟电源电压为内部ADC电路,3V的
控制输入。当BLKG被拉低的CDS操作被禁止。
CCD信号钳位控制输入
CCD输入
钳位基准电压输出
该引脚连接到AVDD 。
片选。在此输入一个逻辑低电平使能串口。
10位的三态ADC输出数据或偏移DAC的测试数据
数字 - 模拟转换器输出1
数字 - 模拟转换器输出2
数字地
数字接口电路接地
数字接口电路的电源电压, 1.8 V - 4.4 V
数字供电电压3 V
没有连接
光黑位和偏移校准控制输入。低电平有效。
输出数据使能。低电平有效。
外部去耦内部带隙基准
硬件复位输入,低电平有效。该信号强制所有内部寄存器复位
REF-输出外部去耦
REF +输出的外部去耦
串行数据输入到配置的内部寄存器
选择SCLK的极性。 0 - 低电平有效( SCLK时不运行的高点) , 1 - 高电平有效(低电平时
SCLK未运行)
串行时钟输入。此时钟同步串行数据传输。
CCD的参考电平的采样时钟输入
硬件关断控制输入,低电平有效
CCD信号电平采样时钟输入
硅衬底上,通常连接到模拟地
I / O
描述
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达拉斯,德克萨斯州75265
3
TLV990 40
3 V , 10位, 40 MSPS区CCD模拟前端
SLAS326A - 2001年1月 - 修订2004年3月
在工作自由空气的温度绝对最大额定值(除非另有说明)
电源电压, AV
DD
, DV
DD
, DIV
DD
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 0.3 V至6.5 V
模拟输入电压范围。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -0.3 V至AV
DD
+0.3 V
数字输入电压范围。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -0.3 V到DV
DD
+0.3 V
工作结温范围,T
J
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -40 ° C至150℃
工作的自由空气的温度范围内,T
A
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -20 ° C至75°C的
存储温度范围,T
英镑
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -65 ℃150 ℃的
铅温度1.6毫米(1/16英寸)的距离的情况下为10秒。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 260℃
超出“绝对最大额定值”列出的强调可能会造成永久性损坏设备。这些压力额定值只,和
该设备在这些或超出下标明的任何其他条件的功能操作“推荐工作条件”不
暗示。暴露于长时间处于最大绝对额定情况下会影响器件的可靠性。
推荐工作条件
电源
模拟电源电压
数字电源电压
数字接口的电源电压
AVDD
DVDD
DIVDD
2.7
2.7
1.8
3
3
最大
3.3
3.3
4.4
单位
V
V
V
数字输入, DIV
DD
= 3 V , DV
DD
= 3 V
高电平输入电压, VIH
低电平输入电压, VIL
输入ADCCLK频率
ADCCLK脉冲持续时间,时钟高,总重量( MCLKH )
ADCCLK脉冲持续时间,时钟低,总重量( MCLKL )
输入SCLK频率
SCLK脉冲持续时间,时钟高,总重量( SCLKH )
SCLK脉冲持续时间,时钟低,总重量( SCLKL )
12.5
12.5
12.5
12.5
40
0.8DIVDD
0.2DIVDD
40
最大
单位
V
V
兆赫
ns
ns
兆赫
ns
ns
4
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TLV990 40
3 V , 10位, 40 MSPS区CCD模拟前端
SLAS326A - 2001年1月 - 修订2004年3月
电气特性在推荐工作的自由空气的温度范围内,T
A
= 25°C,
AV
DD
DV =
DD
= 3V , ADCCLK = 40兆赫(除非另有说明)
设备总
参数
AVDD工作电流
DVDD工作电流
器件的功耗
功耗掉电模式
INL
DNL
全路积分非线性
全通道差分非线性
无丢失码
全通道的输出延迟
AVDD = DVDD = 2.7 V - 3.3 V ,
用最合适的方法
AVDD = DVDD = 2.7 V - 3.3 V ,
ADCCLK = 18 MSPS, 10位
测试条件
典型值
56
8
200
2
±1.75
±0.5
保证
6
CLK
周期
±2.15
±0.99
最大
单位
mA
mA
mW
mW
最低位
最低位
模拟数字转换器(ADC)的
参数
在CCD模式ADC的分辨率
满量程输入范围
转化率
测试条件
典型值
10
2
40
最大
单位
VP-P
兆赫
相关双采样(CDS)和可编程增益放大器( PGA)的
参数
CDS和PGA采样率
CDS的满量程输入范围
CDS的输入电容
最小PGA增益
最大PGA增益
PGA的增益分辨率
PGA编程代码解析
35
单端输入
4
0
36
0.045
10
1
37
测试条件
典型值
最大
40
1
单位
兆赫
V
pF
dB
dB
dB
内部的数字 - 模拟转换器(DAC),用于偏移校正
参数
DAC分辨率
INL
DNL
积分非线性
微分非线性
输出建立时间
以1 %的准确度
测试条件
典型值
8
±0.5
±0.5
80
最大
单位
最低位
最低位
ns
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达拉斯,德克萨斯州75265
5
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