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TFP501
PanelBus
HDCP数字接收机
SLDS127B - 2001年7月 - 修订2002年8月
D
支持UXGA分辨率(像素输出
D
D
D
D
D
速率高达165兆赫)
数字视频接口( DVI )和
高带宽数字内容保护
( HDCP )规格标准
1
加密的外部HDCP设备密钥
存储卓越的安全性和易于
实施
真彩色, 24位/像素, 48位双像素
输出模式, 16.7M色在1或2个像素
每时钟
激光微调( 50 Ω)输入级
最佳固定阻抗匹配
耐扭曲了一个像素时钟周期
(高时钟和数据抖动容限)
D
4倍过采样,可降低误码
D
D
D
D
D
价格和更好的性能在较长的
电缆
降低功耗从1.8 -V
核心操作使用3.3 V的I / O和
耗材
2
减少地面反弹使用时间
交错的像素输出
最低的噪声和最佳功耗
采用TI的100引脚TQFP PowerPAD
包装
先进的技术采用TI的0.18微米
EPIC - 5 CMOS工艺
支持热插拔检测
描述
该TFP501是德州仪器
PanelBus
平板显示产品,全面的家庭的一部分
端至端的DVI 1.0兼容的解决方案。主要是在台式机液晶显示器, DLP和LCD投影机的目标,
和数字电视中, TFP501发现需要与高速数字接口的应用程序中的任何设计
对数字内容的保护非常强大的,创新的加密方案的另一个好处。
该TFP501支持显示分辨率高达UXGA ,包括标准的HDTV格式, 24位真彩色
像素格式。该TFP501提供了设计的灵活性,每个时钟驱动一个或两个像素,支持TFT和DSTN
板,并提供了一种用于减少地面反射时间交错的象素输出一个选项。
使用PowerPad封装的先进技术成果同类最佳的功耗,封装和超低
接地电感。
该TFP501联合收割机
PanelBus
电路的创新和独特的实施与HDCP密钥保护
TI先进的0.18
m
EPIC - 5 CMOS工艺技术,彻底实现了安全,可靠,
低功率,低噪音,高速数字接口的解决方案。
请注意,一个重要的通知有关可用性,标准保修,并且在关键的应用程序中使用
德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
脚注:
1.
数字视频接口( DVI)规格是由数字显示工作组( DDWG )高速开发一种工业标准
数字连接数字显示器。高带宽数字内容保护系统( HDCP)是用于保护行业标准
从DVI输出被复制。 HDCP是由Intel公司开发的,并通过数字内容保护,LLC的许可。该
TFP501是兼容的DVI版本1.0和HDCP 1.0版规范。
该TFP501有一个内部稳压器提供了从外部提供3.3 V电源的1.8V内核电源。
2.
PanelBus ,
使用PowerPad和EPIC -5是德州仪器公司的注册商标。
PRODUCTION数据信息为出版日期。
产品符合每德州仪器条款规范
标准保修。生产加工并不包括
所有测试参数。
版权
2002年,德州仪器
邮政信箱655303
达拉斯,德克萨斯州75265
1
TFP501
PanelBus
HDCP数字接收机
SLDS127B - 2001年7月 - 修订2002年8月
TQFP封装
( TOP VIEW )
75
74
73
72
71
70
69
68
67
66
65
64
63
62
61
60
59
58
57
56
55
54
53
52
51
QO22
QO21
QO20
QO19
QO18
QO17
QO16
DGND
QO15
QO14
QO13
QO12
QO11
QO10
QO9
QO8
OGND
OV
DD
QO7
QO6
QO5
QO4
QO3
QO2
OGND
QO23
OV
DD
AGND
Rx2+
Rx2–
AV
DD
Rx1+
Rx1–
AV
DD
Rx0+
Rx0–
AV
DD
RXC +
RxC-
AV
DD
DDC_SCL
DDC_SDA
DDC_SA
PROM_SCL
PROM_SDA
PV
DD
1
保护地
PV
DD
2
OCK_INV
76
77
78
79
80
81
82
83
84
85
86
87
88
89
90
91
92
93
94
95
96
97
98
99
100
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
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50
49
48
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46
45
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39
38
37
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35
34
33
32
31
30
29
28
27
26
QO1
QO0
HSYNC
VSYNC
DE
OGND
ODCK
OV
DD
RSVD
CTL2
CTL1
DGND
DV
DD
QE23
QE22
QE21
QE20
QE19
QE18
QE17
QE16
OV
DD
OGND
QE15
QE14
2
DFO
PD
ST
PIXS
DGND
DV
DD
雄鹿
SCDT
PDO
QE0
QE1
QE2
QE3
QE4
QE5
QE6
QE7
OV
DD
OGND
QE8
QE9
QE10
QE11
QE12
QE13
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TFP501
PanelBus
HDCP数字接收机
SLDS127B - 2001年7月 - 修订2002年8月
功能框图
3.3 V
3.3 V
内部50
终止
1.8 V
调节器
RED [7 :0]的
数据恢复和
同步
Rx2+
Rx2-
Rx1+
Rx1-
Rx0+
Rx0-
+
_
通道2
LATCH
通道1
LATCH
CH 2 [9:0 ]
CTL2
RED [7 :0]的
CTL2
QE [23:0 ]
QO [23:0 ]
ODCK
DE
SCDT
CTL2
CTL1
VSYNC
HSYNC
+
_
CH1 [9:0 ]
T.M.D.S.
解码器
GRN [7:0 ]
CTL1
BLU [7:0 ]
VSYNC
HSYNC
GRN [7:0 ]
HDCP
解密CTL1
BLU [7:0 ]
VSYNC
HSYNC
PANEL
接口
+
_
通道0
LATCH
CH0 [9:0 ]
RXC +
RXC-
+
_
PLL
PROM_SCL
PROM_SDA
I2C主控I / F
对于EEPROM
密钥解密
RAM块
DDC_SCL
DDC_SDA
DDC_SA
I2C从I / F
对于DDC
I2C控制
注册
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3
TFP501
PanelBus
HDCP数字接收机
SLDS127B - 2001年7月 - 修订2002年8月
终端功能
终奌站
名字
AGND
AVDD
CTL [2: 1]
DDC_SA
DDC_SCL
DDC_SDA
DE
79
82, 85,
88, 91
67
41, 40
94
92
93
46
O
O
I
I / O
I / O
O
I / O
描述
模拟地对地参考和电流回路的模拟电路。
模拟VDD电源供电的模拟电路。名义上3.3 V.
旁路电容- 4.7
F
钽和0.01
F
陶瓷电容连接到地。
通用的控制信号,用于用户定义的控制。在正常模式下CTL1不关机
通过PDO 。
显示数据channel_serial地址, I2C从地址位A0用于显示数据通道( DDC ) 。请参考I2C
接口部分更多的细节。
显示数据channel_serial时钟I2C时钟的DDC 。外部上拉电阻= 10 kΩ和3.3 V
宽容。
显示数据channel_serial数据I2C数据的DDC 。外部上拉电阻= 10 kΩ和3.3 V电压。
输出数据使能,用于指示活动视频显示器与无源显示或消隐时间
间隔。在消隐,只有HSYNC, VSYNC和CTL1-2被发送。在活动显示的时间,或
nonblanking ,只有像素数据, QE [23:0 ]和QO [23:0 ]被发送。
高:主动显示间隔
低:消隐间隔
DFO
1
I
输出时钟数据格式,控件或者TFT和DSTN面板支持的输出时钟( ODCK )格式。为
TFT支持ODCK时钟继续运行。对于DSTN支持ODCK当DE为高只有时钟;其它 -
聪明, ODCK保持低电平时, DE为低。
高:支持DSTN / ODCK保持低电平时, DE =低。
低:支持TFT / ODCK连续运行。
DGND
DVDD
HSYNC
OCK_INV
5, 39, 68
6, 38
48
100
O
I
数字地面接地参考和电流回路的数字内核。
数字VDD电源供电的数字内核。名义上3.3 V.
水平同步输出
ODCK极性 - 选择ODCK边缘上的像素数据(QE [23:0 ]和QO [23: 0])和控制信号
( HSYNC , VSYNC , DE , CTL1-2 )被锁定。
普通模式:
高:锁存上升ODCK边输出数据。
低:锁存下降ODCK边输出数据。
ODCK
OGND
44
19, 28,
45, 58,
76
18, 29,
43, 57,
78
2
I
O
输出数据时钟像素时钟。所有的像素输出的QE [23:0 ]和QO [23: 0](如果在2像素/时钟模式)连同
DE, HSYNC, VSYNC和CTL [2: 1]被同步到该时钟。
输出驱动器接地的接地参考和电流回路的数字输出驱动器。
OVDD
输出驱动器的VDD -电源为输出驱动器。名义上3.3 V.
PD
电源下一个控制的TFP501掉电状态低电平信号。在关闭所有输出
缓冲区切换到高阻抗状态,并通过弱下拉带来的低。所有模拟电路
断电,所有输入被禁止,除了PD 。
如果PD悬空,内部上拉默认的TFP501正常运行。
高:正常运行
低:掉电
PDO
9
I
输出驱动器电源关闭,一个用于控制输出驱动器的低功耗状态低电平信号。
在输出驱动器断电时,输出驱动器(除SCDT和CTL1 )被驱动为高阻抗
状态。弱下拉慢慢拉这些输出低电平。当PDO是悬空的内部
拉默认的TFP501到正常操作状态。
高:在正常运行/输出驱动器。
低:输出驱动器电源关闭。
4
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TFP501
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HDCP数字接收机
SLDS127B - 2001年7月 - 修订2002年8月
终端功能(续)
终奌站
名字
保护地
PIXS
98
4
I
I / O
描述
PLL地面 - 地面基准和电流回报,内部PLL 。
像素选择,选择每个时钟输出模式一个或两个像素之间。在2像素/时钟模式下,即使
像素, QE [23: 0],并且奇数像素, QO [23: 0],输出串联于一个给定的时钟周期。在1个像素/时钟,
偶数和奇数像素输出顺序,一次一个地,同连第一像素,偶数像素的总线上,
QE [23:0 ] 。 (每行的第一个像素是像素0 ,偶数像素。每行中的第二像素的像素-1,奇数像素)。
高: 2像素/时钟
低: 1像素/时钟
PROM_SCL
PROM_SDA
PVDD (1, 2)
QE [ 0 : 7 ]
95
96
97, 99
10–17
O
I / O
I / O
EEPROM_serial时钟I2C时钟EEPROM接口的数据。外部上拉电阻= 10 kΩ和3.3 V
宽容。
EEPROM_serial数据I2C数据EEPROM接口的数据。外部上拉电阻= 10 kΩ和3.3 V
宽容。
PLL VDD -电源内部PLL 。名义上3.3 V.
即使是蓝色的像素输出,输出的偶数和奇数蓝色像素时,在1个像素/时钟模式。输出甚至只
蓝色像素的2像素/时钟模式时。输出数据被同步到所述输出数据时钟, ODCK 。
LSB : QE0 / 10针
MSB : QE7 / 17针
QE [ 8:15 ]
20–27
O
甚至绿色像素输出,输出的偶数和奇数绿色像素在1个像素/时钟模式。输出连
在2像素/时钟模式时,只有绿色像素。输出数据被同步到所述输出数据时钟, ODCK 。
LSB : QE8 / 20针
MSB : QE15 / 27针
QE [ 16时23分]
30–37
O
即使红色像素输出,输出的偶数和奇数红色像素时,在1个像素/时钟模式。输出甚至只
红色像素2像素/时钟模式时。输出数据被同步到所述输出数据时钟, ODCK 。
LSB : QE16 / 30针
MSB : QE23 / 37针
QO [0:7 ]
49–56
O
奇怪的蓝色像素输出,输出的多只蓝色像素时2像素/时钟模式。不使用时,并举行低,
在1个像素/时钟模式时。输出数据被同步到所述输出数据时钟, ODCK 。
LSB : QO0 / 49针
MSB : QO7 / 56针
QO [ 8:15 ]
59–66
O
奇怪的绿色像素输出,输出的多只绿色像素在2像素/时钟模式。不使用时,并举行低,
在1个像素/时钟模式时。输出数据被同步到所述输出数据时钟, ODCK 。
LSB : QO8 / 59针
MSB : QO15 / 66针
QO [ 16:23 ]
69–75,
77
O
奇怪的红色像素输出,输出的多只红色像素时2像素/时钟模式。不使用时,并保持低电平,
在1个像素/时钟模式。输出数据被同步到所述输出数据时钟, ODCK 。
LSB : QO16 / 69针
MSB : QO23 / 77针
RSVD
Rx2+
Rx2–
Rx1+
Rx1–
Rx0+
Rx0–
42
80
81
83
84
86
87
O
I
I
I
I
I
I
保留,必须置为高电平正常运行。
通道- 2 TMDS通道-2阳性接收器输入正端低电压差分信号输入
对。通道2接收消隐期间在有源显示和CTL2控制信号的红色的像素数据。
通道2负的接收器输入负的通道2 TMDS方低电压差分信号输入
对。
通道1 TMDS通道-1阳性接收器输入正端低电压差分信号输入
对。通道1接收消隐期间在有源显示和CTL1控制信号绿色像素数据。
通道1负的接收器输入负的通道1 TMDS方低电压差分信号输入
对。
通道0 TMDS通道0正接收器输入正端低电压差分信号输入
对。通道0接收消隐期间的活动显示和HSYNC , VSYNC控制信号蓝色像素的数据。
通道0负接收器输入负的通道0 TMDS方低电压差分信号输入
对。
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D
支持UXGA分辨率(像素输出
D
D
D
D
D
速率高达165兆赫)
数字视频接口( DVI )和
高带宽数字内容保护
( HDCP )规格标准
1
加密的外部HDCP设备密钥
存储卓越的安全性和易于
实施
真彩色, 24位/像素, 48位双像素
输出模式, 16.7M色在1或2个像素
每时钟
激光微调( 50 Ω)输入级
最佳固定阻抗匹配
耐扭曲了一个像素时钟周期
(高时钟和数据抖动容限)
D
4倍过采样,可降低误码
D
D
D
D
D
价格和更好的性能在较长的
电缆
降低功耗从1.8 -V
核心操作使用3.3 V的I / O和
耗材
2
减少地面反弹使用时间
交错的像素输出
最低的噪声和最佳功耗
采用TI的100引脚TQFP PowerPAD
包装
先进的技术采用TI的0.18微米
EPIC - 5 CMOS工艺
支持热插拔检测
描述
该TFP501是德州仪器
PanelBus
平板显示产品,全面的家庭的一部分
端至端的DVI 1.0兼容的解决方案。主要是在台式机液晶显示器, DLP和LCD投影机的目标,
和数字电视中, TFP501发现需要与高速数字接口的应用程序中的任何设计
对数字内容的保护非常强大的,创新的加密方案的另一个好处。
该TFP501支持显示分辨率高达UXGA ,包括标准的HDTV格式, 24位真彩色
像素格式。该TFP501提供了设计的灵活性,每个时钟驱动一个或两个像素,支持TFT和DSTN
板,并提供了一种用于减少地面反射时间交错的象素输出一个选项。
使用PowerPad封装的先进技术成果同类最佳的功耗,封装和超低
接地电感。
该TFP501联合收割机
PanelBus
电路的创新和独特的实施与HDCP密钥保护
TI先进的0.18
m
EPIC - 5 CMOS工艺技术,彻底实现了安全,可靠,
低功率,低噪音,高速数字接口的解决方案。
请注意,一个重要的通知有关可用性,标准保修,并且在关键的应用程序中使用
德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
脚注:
1.
数字视频接口( DVI)规格是由数字显示工作组( DDWG )高速开发一种工业标准
数字连接数字显示器。高带宽数字内容保护系统( HDCP)是用于保护行业标准
从DVI输出被复制。 HDCP是由Intel公司开发的,并通过数字内容保护,LLC的许可。该
TFP501是兼容的DVI版本1.0和HDCP 1.0版规范。
该TFP501有一个内部稳压器提供了从外部提供3.3 V电源的1.8V内核电源。
2.
PanelBus ,
使用PowerPad和EPIC -5是德州仪器公司的注册商标。
PRODUCTION数据信息为出版日期。
产品符合每德州仪器条款规范
标准保修。生产加工并不包括
所有测试参数。
版权
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1
TFP501
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TQFP封装
( TOP VIEW )
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QO22
QO21
QO20
QO19
QO18
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QO16
DGND
QO15
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QO12
QO11
QO10
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OGND
OV
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QO23
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AGND
Rx2+
Rx2–
AV
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Rx1+
Rx1–
AV
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Rx0+
Rx0–
AV
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RXC +
RxC-
AV
DD
DDC_SCL
DDC_SDA
DDC_SA
PROM_SCL
PROM_SDA
PV
DD
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保护地
PV
DD
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OCK_INV
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77
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80
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82
83
84
85
86
87
88
89
90
91
92
93
94
95
96
97
98
99
100
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
50
49
48
47
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45
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43
42
41
40
39
38
37
36
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34
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QO1
QO0
HSYNC
VSYNC
DE
OGND
ODCK
OV
DD
RSVD
CTL2
CTL1
DGND
DV
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QE22
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QE20
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DD
OGND
QE15
QE14
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DFO
PD
ST
PIXS
DGND
DV
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雄鹿
SCDT
PDO
QE0
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OV
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OGND
QE8
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QE10
QE11
QE12
QE13
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功能框图
3.3 V
3.3 V
内部50
终止
1.8 V
调节器
RED [7 :0]的
数据恢复和
同步
Rx2+
Rx2-
Rx1+
Rx1-
Rx0+
Rx0-
+
_
通道2
LATCH
通道1
LATCH
CH 2 [9:0 ]
CTL2
RED [7 :0]的
CTL2
QE [23:0 ]
QO [23:0 ]
ODCK
DE
SCDT
CTL2
CTL1
VSYNC
HSYNC
+
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CH1 [9:0 ]
T.M.D.S.
解码器
GRN [7:0 ]
CTL1
BLU [7:0 ]
VSYNC
HSYNC
GRN [7:0 ]
HDCP
解密CTL1
BLU [7:0 ]
VSYNC
HSYNC
PANEL
接口
+
_
通道0
LATCH
CH0 [9:0 ]
RXC +
RXC-
+
_
PLL
PROM_SCL
PROM_SDA
I2C主控I / F
对于EEPROM
密钥解密
RAM块
DDC_SCL
DDC_SDA
DDC_SA
I2C从I / F
对于DDC
I2C控制
注册
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TFP501
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SLDS127B - 2001年7月 - 修订2002年8月
终端功能
终奌站
名字
AGND
AVDD
CTL [2: 1]
DDC_SA
DDC_SCL
DDC_SDA
DE
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O
O
I
I / O
I / O
O
I / O
描述
模拟地对地参考和电流回路的模拟电路。
模拟VDD电源供电的模拟电路。名义上3.3 V.
旁路电容- 4.7
F
钽和0.01
F
陶瓷电容连接到地。
通用的控制信号,用于用户定义的控制。在正常模式下CTL1不关机
通过PDO 。
显示数据channel_serial地址, I2C从地址位A0用于显示数据通道( DDC ) 。请参考I2C
接口部分更多的细节。
显示数据channel_serial时钟I2C时钟的DDC 。外部上拉电阻= 10 kΩ和3.3 V
宽容。
显示数据channel_serial数据I2C数据的DDC 。外部上拉电阻= 10 kΩ和3.3 V电压。
输出数据使能,用于指示活动视频显示器与无源显示或消隐时间
间隔。在消隐,只有HSYNC, VSYNC和CTL1-2被发送。在活动显示的时间,或
nonblanking ,只有像素数据, QE [23:0 ]和QO [23:0 ]被发送。
高:主动显示间隔
低:消隐间隔
DFO
1
I
输出时钟数据格式,控件或者TFT和DSTN面板支持的输出时钟( ODCK )格式。为
TFT支持ODCK时钟继续运行。对于DSTN支持ODCK当DE为高只有时钟;其它 -
聪明, ODCK保持低电平时, DE为低。
高:支持DSTN / ODCK保持低电平时, DE =低。
低:支持TFT / ODCK连续运行。
DGND
DVDD
HSYNC
OCK_INV
5, 39, 68
6, 38
48
100
O
I
数字地面接地参考和电流回路的数字内核。
数字VDD电源供电的数字内核。名义上3.3 V.
水平同步输出
ODCK极性 - 选择ODCK边缘上的像素数据(QE [23:0 ]和QO [23: 0])和控制信号
( HSYNC , VSYNC , DE , CTL1-2 )被锁定。
普通模式:
高:锁存上升ODCK边输出数据。
低:锁存下降ODCK边输出数据。
ODCK
OGND
44
19, 28,
45, 58,
76
18, 29,
43, 57,
78
2
I
O
输出数据时钟像素时钟。所有的像素输出的QE [23:0 ]和QO [23: 0](如果在2像素/时钟模式)连同
DE, HSYNC, VSYNC和CTL [2: 1]被同步到该时钟。
输出驱动器接地的接地参考和电流回路的数字输出驱动器。
OVDD
输出驱动器的VDD -电源为输出驱动器。名义上3.3 V.
PD
电源下一个控制的TFP501掉电状态低电平信号。在关闭所有输出
缓冲区切换到高阻抗状态,并通过弱下拉带来的低。所有模拟电路
断电,所有输入被禁止,除了PD 。
如果PD悬空,内部上拉默认的TFP501正常运行。
高:正常运行
低:掉电
PDO
9
I
输出驱动器电源关闭,一个用于控制输出驱动器的低功耗状态低电平信号。
在输出驱动器断电时,输出驱动器(除SCDT和CTL1 )被驱动为高阻抗
状态。弱下拉慢慢拉这些输出低电平。当PDO是悬空的内部
拉默认的TFP501到正常操作状态。
高:在正常运行/输出驱动器。
低:输出驱动器电源关闭。
4
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TFP501
PanelBus
HDCP数字接收机
SLDS127B - 2001年7月 - 修订2002年8月
终端功能(续)
终奌站
名字
保护地
PIXS
98
4
I
I / O
描述
PLL地面 - 地面基准和电流回报,内部PLL 。
像素选择,选择每个时钟输出模式一个或两个像素之间。在2像素/时钟模式下,即使
像素, QE [23: 0],并且奇数像素, QO [23: 0],输出串联于一个给定的时钟周期。在1个像素/时钟,
偶数和奇数像素输出顺序,一次一个地,同连第一像素,偶数像素的总线上,
QE [23:0 ] 。 (每行的第一个像素是像素0 ,偶数像素。每行中的第二像素的像素-1,奇数像素)。
高: 2像素/时钟
低: 1像素/时钟
PROM_SCL
PROM_SDA
PVDD (1, 2)
QE [ 0 : 7 ]
95
96
97, 99
10–17
O
I / O
I / O
EEPROM_serial时钟I2C时钟EEPROM接口的数据。外部上拉电阻= 10 kΩ和3.3 V
宽容。
EEPROM_serial数据I2C数据EEPROM接口的数据。外部上拉电阻= 10 kΩ和3.3 V
宽容。
PLL VDD -电源内部PLL 。名义上3.3 V.
即使是蓝色的像素输出,输出的偶数和奇数蓝色像素时,在1个像素/时钟模式。输出甚至只
蓝色像素的2像素/时钟模式时。输出数据被同步到所述输出数据时钟, ODCK 。
LSB : QE0 / 10针
MSB : QE7 / 17针
QE [ 8:15 ]
20–27
O
甚至绿色像素输出,输出的偶数和奇数绿色像素在1个像素/时钟模式。输出连
在2像素/时钟模式时,只有绿色像素。输出数据被同步到所述输出数据时钟, ODCK 。
LSB : QE8 / 20针
MSB : QE15 / 27针
QE [ 16时23分]
30–37
O
即使红色像素输出,输出的偶数和奇数红色像素时,在1个像素/时钟模式。输出甚至只
红色像素2像素/时钟模式时。输出数据被同步到所述输出数据时钟, ODCK 。
LSB : QE16 / 30针
MSB : QE23 / 37针
QO [0:7 ]
49–56
O
奇怪的蓝色像素输出,输出的多只蓝色像素时2像素/时钟模式。不使用时,并举行低,
在1个像素/时钟模式时。输出数据被同步到所述输出数据时钟, ODCK 。
LSB : QO0 / 49针
MSB : QO7 / 56针
QO [ 8:15 ]
59–66
O
奇怪的绿色像素输出,输出的多只绿色像素在2像素/时钟模式。不使用时,并举行低,
在1个像素/时钟模式时。输出数据被同步到所述输出数据时钟, ODCK 。
LSB : QO8 / 59针
MSB : QO15 / 66针
QO [ 16:23 ]
69–75,
77
O
奇怪的红色像素输出,输出的多只红色像素时2像素/时钟模式。不使用时,并保持低电平,
在1个像素/时钟模式。输出数据被同步到所述输出数据时钟, ODCK 。
LSB : QO16 / 69针
MSB : QO23 / 77针
RSVD
Rx2+
Rx2–
Rx1+
Rx1–
Rx0+
Rx0–
42
80
81
83
84
86
87
O
I
I
I
I
I
I
保留,必须置为高电平正常运行。
通道- 2 TMDS通道-2阳性接收器输入正端低电压差分信号输入
对。通道2接收消隐期间在有源显示和CTL2控制信号的红色的像素数据。
通道2负的接收器输入负的通道2 TMDS方低电压差分信号输入
对。
通道1 TMDS通道-1阳性接收器输入正端低电压差分信号输入
对。通道1接收消隐期间在有源显示和CTL1控制信号绿色像素数据。
通道1负的接收器输入负的通道1 TMDS方低电压差分信号输入
对。
通道0 TMDS通道0正接收器输入正端低电压差分信号输入
对。通道0接收消隐期间的活动显示和HSYNC , VSYNC控制信号蓝色像素的数据。
通道0负接收器输入负的通道0 TMDS方低电压差分信号输入
对。
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