SN74ALS166
并联负载8位移位寄存器
SDAS156D - 1982年4月 - 修订2000年8月
D
D
D
D
同步加载
直接重写清除
并行 - 串行转换
封装选择包括塑料
小外形封装（ D）和收缩型小外形
（ DB ）封装和标准塑料（N ） DIP
D， DB ，或N包装
（ TOP VIEW ）
描述
该SN74ALS166并行负载8位移位寄存器
与大多数其他的TTL逻辑系列兼容。
所有的输入缓冲，以降低驱动器
要求。输入钳位二极管最小化
开关瞬态和简化系统设计。
SER
A
B
C
D
CLK INH
CLK
GND
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
V
CC
SH / LD
H
Q
H
G
F
E
CLR
这些并行的或串行输入，串行输出寄存器有一个芯片上77等效门复杂性。他们
功能门控时钟（ CLK和CLK INH）输入和压倒一切的清除（ CLR ）输入。并行或串行输入
模式由移位/负载（ SH / LD）的输入确定。当高， SH / LD使串行数据（ SER ）输入
和夫妇的八个触发器串行移位每个时钟脉冲。当低，并行（宽边）数据
（ A-H）的输入使能和同步加载发生的下一个时钟脉冲。在并行加载，串行
数据流被抑制。时钟是通过一个实现在时钟脉冲的低电平到高电平的边缘
二输入正-NOR门，允许一个输入端被用作一个时钟使能或时钟禁止功能。控股
无论是时钟输入高抑制计时;持有或低使其他时钟输入。这允许
系统时钟是自由运行的，并且寄存器可以在命令与时钟输入被停止。 CLK INH
应改变成高电平，只有当CLK为高电平。缓冲的CLR覆盖所有其他投入，包括
CLK和设置所有的触发器设置为零。
该SN74ALS166的特点是操作从0℃至70℃。
功能表
输入
CLR
L
H
H
H
H
H
SH / LD
X
X
L
H
H
X
CLK INH
X
L
L
L
L
H
CLK
X
L
↑
↑
↑
↑
SER
X
X
X
H
L
X
并行
一... H
X
X
一... H
X
X
X
国内
输出
QA
L
QA0
a
H
L
QA0
QB
L
QB0
b
QAN
QAN
QB0
产量
QH
L
QH0
h
QGN
QGN
QH0
请注意，一个重要的通知有关可用性，标准保修，并且在关键的应用程序中使用
德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
版权
2000年，德州仪器
PRODUCTION数据信息为出版日期。
产品符合每德州仪器条款规范
标准保修。生产加工并不包括
所有测试参数。
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达拉斯，德克萨斯州75265
1
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并联负载8位移位寄存器
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逻辑符号
CLR
SH / LD
CLK INH
CLK
SER
A
B
C
D
E
F
G
H
6
7
1
2
3
4
5
10
11
12
14
13
QH
9
15
R
SRG8
M1 [ SHIFT]
M2 [ LOAD ]
≥1
C3/1
1, 3D
2, 3D
2, 3D
这个符号是按照ANSI / IEEE标准91-1984和IEC出版617-12 。
逻辑图（正逻辑）
SER
1
SH / LD
15
A
2
B
3
C
4
D
5
E
10
F
11
G
12
H
14
CLR
9
R
1A
C1
1S
R
1A
C1
1S
R
1A
C1
1S
R
1A
C1
1S
R
1A
C1
1S
R
1A
C1
1S
R
1A
C1
1S
R
1A
C1
1S
13
QH
7
CLK
CLK INH 6
2
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SN74ALS166
并联负载8位移位寄存器
SDAS156D - 1982年4月 - 修订2000年8月
典型清除，移位，负载，抑制和移位序列
CLK
CLK INH
CLR
SER
SH / LD
A
B
C
D
并行
输入
E
F
G
H
QH
串行移位
明确
H
L
H
L
H
L
H
H
H
抑制
负载
H
L
H
L
H
L
H
串行移位
在工作自由空气的温度范围内绝对最大额定值（除非另有说明）
电源电压范围，V
CC
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -0.5V至7V的
输入电压范围，V
I
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -0.5V至7V的
封装的热阻抗，
θ
JA
（见注1 ） ：D包。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 73 ° C / W
DB包。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 82 ° C / W
N包装， 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 67 ° C / W
存储温度范围，T
英镑
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -65 ℃150 ℃的
超出“绝对最大额定值”列出的强调可能会造成永久性损坏设备。这些压力额定值只，和
该设备在这些或超出下标明的任何其他条件的功能操作“推荐工作条件”不
暗示。暴露于长时间处于最大绝对额定情况下会影响器件的可靠性。
注1 ：该封装的热阻抗的计算按照JESD 51-7 。
推荐工作条件
民
VCC
VIH
VIL
IOH
IOL
TA
电源电压
高电平输入电压
低电平输入电压
高电平输出电流
低电平输出电流
工作自由空气的温度
0
4.5
2
0.8
–0.4
8
70
喃
5
最大
5.5
单位
V
V
V
mA
mA
°C
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3
SN74ALS166
并联负载8位移位寄存器
SDAS156D - 1982年4月 - 修订2000年8月
电气特性在推荐工作的自由空气的温度范围内（除非
另有说明）
参数
VIK
VOH
VOL
II
IIH
IIL
IO =
VCC = 4.5 V ，
VCC = 4.5 V至5.5 V ，
VCC = 4 5 V
4.5
VCC = 5.5 V ，
VCC = 5.5 V ，
VCC = 5.5 V ，
VCC = 5.5 V ，
测试条件
II = -18毫安
IOH = -0.4毫安
IOL = 4毫安
IOL = 8毫安
VI = 7 V
VI = 2.7 V
VI = 0.4 V
VO = 2.25 V
–30
民
VCC–2
0.25
0.35
0.4
0.5
0.1
20
–0.1
–112
TYP
最大
–1.5
单位
V
V
V
mA
A
mA
mA
ICC
VCC = 5.5 V ，
见注2
14
24
mA
所有典型值是在VCC = 5V ， TA = 25 ℃。
输出条件已被选定，以产生一个电流，其值接近1的一半真短路输出电流， IOS的。
注2 ：在4.5 V适用于SER和所有其他投入，除了时钟，接地，国际刑事法院是经过时钟转换为0 V至4.5 V.测
时序要求在推荐工作的自由空气的温度范围内（除非另有
说明）
民
fclock
tw
时钟频率
CLR低
脉冲持续时间
CLK高
CLK低
SH / LD
TSU
th
CLK ↑之前设置时间
↑
保持时间， CLK ↑数据后，
数据
CLR不活跃
9
10
10
16
7
11
3
ns
ns
ns
最大
45
单位
兆赫
开关特性在推荐工作条件（除非另有说明）
（参见图1）
参数
FMAX
的TPH1
TPLH
的TPH1
所有典型值是在VCC = 5V ， TA = 25 ℃。
CLR
CLK
QH
QH
从
（输入）
TO
（输出）
民
45
4
2
2
9
7
9
14
12
13
TYP
最大
单位
兆赫
ns
ns
4
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SN74ALS166
并联负载8位移位寄存器
SDAS156D - 1982年4月 - 修订2000年8月
参数测量信息
TEST
点
从输出
被测
CL = 50 pF的
（见注一）
RL = 500
试验台的同步输入
数据输入
为测试
H
串行输入
SH / LD
0V
4.5 V
输出检测过
（见注B）
QH在TN + 1
QH在TN + 1
电路负载下测试输出
总重量（清）
CLR
（见注C）
3.5 V
1.3 V
1.3 V
0.3 V
tn
1.3 V
总重量（CLK）
数据输入
（见测试表）
的TPH1
输出QH
VOL
电压波形
注意事项： A.
B.
C.
D.
E.
CL包括探针和夹具电容。
被传播延迟时间（ tPLH的和的TPH1 ）的TN + 1测量。正确的换挡数据的TN + 8 ，验证与功能测试。
之前，各试验用的清除脉冲被施加。
TN =位时间的时钟转换前，后的TN + 1 =位一次一个时钟过渡，经过八年的时钟转换TN + 8 =位时间。
时钟脉冲具有以下特点：总重量（时钟）
≤
20纳秒和PRR = 1 MHz的。的清除脉冲具有以下
特点： TW （全部清除）
≤
20纳秒。
F.所有脉冲发生器具有以下特点： ZO
≈
50
;
TR = TF = 2纳秒。测试的fmax当占空比= 50 ％ 。
1.3 V
TSU
1.3 V
TPLH
TN + 1 （见注D）
tn
1.3 V
th
1.3 V
TSU
1.3 V
的TPH1
VOH
TN + 1
3.5 V
1.3 V
0.3 V
th
3.5
1.3 V
0.3 V
CLK
（见注E）
图1.负载电路和电压波形
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达拉斯，德克萨斯州75265
5
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并联负载8位移位寄存器
SDAS156D - 1982年4月 - 修订2000年8月
D
D
D
D
同步加载
直接重写清除
并行 - 串行转换
封装选择包括塑料
小外形封装（ D）和收缩型小外形
（ DB ）封装和标准塑料（N ） DIP
D， DB ，或N包装
（ TOP VIEW ）
描述
该SN74ALS166并行负载8位移位寄存器
与大多数其他的TTL逻辑系列兼容。
所有的输入缓冲，以降低驱动器
要求。输入钳位二极管最小化
开关瞬态和简化系统设计。
SER
A
B
C
D
CLK INH
CLK
GND
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
V
CC
SH / LD
H
Q
H
G
F
E
CLR
这些并行的或串行输入，串行输出寄存器有一个芯片上77等效门复杂性。他们
功能门控时钟（ CLK和CLK INH）输入和压倒一切的清除（ CLR ）输入。并行或串行输入
模式由移位/负载（ SH / LD）的输入确定。当高， SH / LD使串行数据（ SER ）输入
和夫妇的八个触发器串行移位每个时钟脉冲。当低，并行（宽边）数据
（ A-H）的输入使能和同步加载发生的下一个时钟脉冲。在并行加载，串行
数据流被抑制。时钟是通过一个实现在时钟脉冲的低电平到高电平的边缘
二输入正-NOR门，允许一个输入端被用作一个时钟使能或时钟禁止功能。控股
无论是时钟输入高抑制计时;持有或低使其他时钟输入。这允许
系统时钟是自由运行的，并且寄存器可以在命令与时钟输入被停止。 CLK INH
应改变成高电平，只有当CLK为高电平。缓冲的CLR覆盖所有其他投入，包括
CLK和设置所有的触发器设置为零。
该SN74ALS166的特点是操作从0℃至70℃。
功能表
输入
CLR
L
H
H
H
H
H
SH / LD
X
X
L
H
H
X
CLK INH
X
L
L
L
L
H
CLK
X
L
↑
↑
↑
↑
SER
X
X
X
H
L
X
并行
一... H
X
X
一... H
X
X
X
国内
输出
QA
L
QA0
a
H
L
QA0
QB
L
QB0
b
QAN
QAN
QB0
产量
QH
L
QH0
h
QGN
QGN
QH0
请注意，一个重要的通知有关可用性，标准保修，并且在关键的应用程序中使用
德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
版权
2000年，德州仪器
PRODUCTION数据信息为出版日期。
产品符合每德州仪器条款规范
标准保修。生产加工并不包括
所有测试参数。
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1
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并联负载8位移位寄存器
SDAS156D - 1982年4月 - 修订2000年8月
逻辑符号
CLR
SH / LD
CLK INH
CLK
SER
A
B
C
D
E
F
G
H
6
7
1
2
3
4
5
10
11
12
14
13
QH
9
15
R
SRG8
M1 [ SHIFT]
M2 [ LOAD ]
≥1
C3/1
1, 3D
2, 3D
2, 3D
这个符号是按照ANSI / IEEE标准91-1984和IEC出版617-12 。
逻辑图（正逻辑）
SER
1
SH / LD
15
A
2
B
3
C
4
D
5
E
10
F
11
G
12
H
14
CLR
9
R
1A
C1
1S
R
1A
C1
1S
R
1A
C1
1S
R
1A
C1
1S
R
1A
C1
1S
R
1A
C1
1S
R
1A
C1
1S
R
1A
C1
1S
13
QH
7
CLK
CLK INH 6
2
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SN74ALS166
并联负载8位移位寄存器
SDAS156D - 1982年4月 - 修订2000年8月
典型清除，移位，负载，抑制和移位序列
CLK
CLK INH
CLR
SER
SH / LD
A
B
C
D
并行
输入
E
F
G
H
QH
串行移位
明确
H
L
H
L
H
L
H
H
H
抑制
负载
H
L
H
L
H
L
H
串行移位
在工作自由空气的温度范围内绝对最大额定值（除非另有说明）
电源电压范围，V
CC
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -0.5V至7V的
输入电压范围，V
I
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -0.5V至7V的
封装的热阻抗，
θ
JA
（见注1 ） ：D包。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 73 ° C / W
DB包。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 82 ° C / W
N包装， 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 67 ° C / W
存储温度范围，T
英镑
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -65 ℃150 ℃的
超出“绝对最大额定值”列出的强调可能会造成永久性损坏设备。这些压力额定值只，和
该设备在这些或超出下标明的任何其他条件的功能操作“推荐工作条件”不
暗示。暴露于长时间处于最大绝对额定情况下会影响器件的可靠性。
注1 ：该封装的热阻抗的计算按照JESD 51-7 。
推荐工作条件
民
VCC
VIH
VIL
IOH
IOL
TA
电源电压
高电平输入电压
低电平输入电压
高电平输出电流
低电平输出电流
工作自由空气的温度
0
4.5
2
0.8
–0.4
8
70
喃
5
最大
5.5
单位
V
V
V
mA
mA
°C
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3
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并联负载8位移位寄存器
SDAS156D - 1982年4月 - 修订2000年8月
电气特性在推荐工作的自由空气的温度范围内（除非
另有说明）
参数
VIK
VOH
VOL
II
IIH
IIL
IO =
VCC = 4.5 V ，
VCC = 4.5 V至5.5 V ，
VCC = 4 5 V
4.5
VCC = 5.5 V ，
VCC = 5.5 V ，
VCC = 5.5 V ，
VCC = 5.5 V ，
测试条件
II = -18毫安
IOH = -0.4毫安
IOL = 4毫安
IOL = 8毫安
VI = 7 V
VI = 2.7 V
VI = 0.4 V
VO = 2.25 V
–30
民
VCC–2
0.25
0.35
0.4
0.5
0.1
20
–0.1
–112
TYP
最大
–1.5
单位
V
V
V
mA
A
mA
mA
ICC
VCC = 5.5 V ，
见注2
14
24
mA
所有典型值是在VCC = 5V ， TA = 25 ℃。
输出条件已被选定，以产生一个电流，其值接近1的一半真短路输出电流， IOS的。
注2 ：在4.5 V适用于SER和所有其他投入，除了时钟，接地，国际刑事法院是经过时钟转换为0 V至4.5 V.测
时序要求在推荐工作的自由空气的温度范围内（除非另有
说明）
民
fclock
tw
时钟频率
CLR低
脉冲持续时间
CLK高
CLK低
SH / LD
TSU
th
CLK ↑之前设置时间
↑
保持时间， CLK ↑数据后，
数据
CLR不活跃
9
10
10
16
7
11
3
ns
ns
ns
最大
45
单位
兆赫
开关特性在推荐工作条件（除非另有说明）
（参见图1）
参数
FMAX
的TPH1
TPLH
的TPH1
所有典型值是在VCC = 5V ， TA = 25 ℃。
CLR
CLK
QH
QH
从
（输入）
TO
（输出）
民
45
4
2
2
9
7
9
14
12
13
TYP
最大
单位
兆赫
ns
ns
4
邮政信箱655303
达拉斯，德克萨斯州75265
SN74ALS166
并联负载8位移位寄存器
SDAS156D - 1982年4月 - 修订2000年8月
参数测量信息
TEST
点
从输出
被测
CL = 50 pF的
（见注一）
RL = 500
试验台的同步输入
数据输入
为测试
H
串行输入
SH / LD
0V
4.5 V
输出检测过
（见注B）
QH在TN + 1
QH在TN + 1
电路负载下测试输出
总重量（清）
CLR
（见注C）
3.5 V
1.3 V
1.3 V
0.3 V
tn
1.3 V
总重量（CLK）
数据输入
（见测试表）
的TPH1
输出QH
VOL
电压波形
注意事项： A.
B.
C.
D.
E.
CL包括探针和夹具电容。
被传播延迟时间（ tPLH的和的TPH1 ）的TN + 1测量。正确的换挡数据的TN + 8 ，验证与功能测试。
之前，各试验用的清除脉冲被施加。
TN =位时间的时钟转换前，后的TN + 1 =位一次一个时钟过渡，经过八年的时钟转换TN + 8 =位时间。
时钟脉冲具有以下特点：总重量（时钟）
≤
20纳秒和PRR = 1 MHz的。的清除脉冲具有以下
特点： TW （全部清除）
≤
20纳秒。
F.所有脉冲发生器具有以下特点： ZO
≈
50
;
TR = TF = 2纳秒。测试的fmax当占空比= 50 ％ 。
1.3 V
TSU
1.3 V
TPLH
TN + 1 （见注D）
tn
1.3 V
th
1.3 V
TSU
1.3 V
的TPH1
VOH
TN + 1
3.5 V
1.3 V
0.3 V
th
3.5
1.3 V
0.3 V
CLK
（见注E）
图1.负载电路和电压波形
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5
SN74ALS166
并联负载8位移位寄存器
SDAS156D - 1982年4月 - 修订2000年8月
D
D
D
D
同步加载
直接重写清除
并行 - 串行转换
封装选择包括塑料
小外形封装（ D）和收缩型小外形
（ DB ）封装和标准塑料（N ） DIP
D， DB ，或N包装
（ TOP VIEW ）
描述
该SN74ALS166并行负载8位移位寄存器
与大多数其他的TTL逻辑系列兼容。
所有的输入缓冲，以降低驱动器
要求。输入钳位二极管最小化
开关瞬态和简化系统设计。
SER
A
B
C
D
CLK INH
CLK
GND
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
V
CC
SH / LD
H
Q
H
G
F
E
CLR
这些并行的或串行输入，串行输出寄存器有一个芯片上77等效门复杂性。他们
功能门控时钟（ CLK和CLK INH）输入和压倒一切的清除（ CLR ）输入。并行或串行输入
模式由移位/负载（ SH / LD）的输入确定。当高， SH / LD使串行数据（ SER ）输入
和夫妇的八个触发器串行移位每个时钟脉冲。当低，并行（宽边）数据
（ A-H）的输入使能和同步加载发生的下一个时钟脉冲。在并行加载，串行
数据流被抑制。时钟是通过一个实现在时钟脉冲的低电平到高电平的边缘
二输入正-NOR门，允许一个输入端被用作一个时钟使能或时钟禁止功能。控股
无论是时钟输入高抑制计时;持有或低使其他时钟输入。这允许
系统时钟是自由运行的，并且寄存器可以在命令与时钟输入被停止。 CLK INH
应改变成高电平，只有当CLK为高电平。缓冲的CLR覆盖所有其他投入，包括
CLK和设置所有的触发器设置为零。
该SN74ALS166的特点是操作从0℃至70℃。
功能表
输入
CLR
L
H
H
H
H
H
SH / LD
X
X
L
H
H
X
CLK INH
X
L
L
L
L
H
CLK
X
L
↑
↑
↑
↑
SER
X
X
X
H
L
X
并行
一... H
X
X
一... H
X
X
X
国内
输出
QA
L
QA0
a
H
L
QA0
QB
L
QB0
b
QAN
QAN
QB0
产量
QH
L
QH0
h
QGN
QGN
QH0
请注意，一个重要的通知有关可用性，标准保修，并且在关键的应用程序中使用
德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
版权
2000年，德州仪器
PRODUCTION数据信息为出版日期。
产品符合每德州仪器条款规范
标准保修。生产加工并不包括
所有测试参数。
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1
SN74ALS166
并联负载8位移位寄存器
SDAS156D - 1982年4月 - 修订2000年8月
逻辑符号
CLR
SH / LD
CLK INH
CLK
SER
A
B
C
D
E
F
G
H
6
7
1
2
3
4
5
10
11
12
14
13
QH
9
15
R
SRG8
M1 [ SHIFT]
M2 [ LOAD ]
≥1
C3/1
1, 3D
2, 3D
2, 3D
这个符号是按照ANSI / IEEE标准91-1984和IEC出版617-12 。
逻辑图（正逻辑）
SER
1
SH / LD
15
A
2
B
3
C
4
D
5
E
10
F
11
G
12
H
14
CLR
9
R
1A
C1
1S
R
1A
C1
1S
R
1A
C1
1S
R
1A
C1
1S
R
1A
C1
1S
R
1A
C1
1S
R
1A
C1
1S
R
1A
C1
1S
13
QH
7
CLK
CLK INH 6
2
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SN74ALS166
并联负载8位移位寄存器
SDAS156D - 1982年4月 - 修订2000年8月
典型清除，移位，负载，抑制和移位序列
CLK
CLK INH
CLR
SER
SH / LD
A
B
C
D
并行
输入
E
F
G
H
QH
串行移位
明确
H
L
H
L
H
L
H
H
H
抑制
负载
H
L
H
L
H
L
H
串行移位
在工作自由空气的温度范围内绝对最大额定值（除非另有说明）
电源电压范围，V
CC
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -0.5V至7V的
输入电压范围，V
I
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -0.5V至7V的
封装的热阻抗，
θ
JA
（见注1 ） ：D包。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 73 ° C / W
DB包。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 82 ° C / W
N包装， 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 67 ° C / W
存储温度范围，T
英镑
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -65 ℃150 ℃的
超出“绝对最大额定值”列出的强调可能会造成永久性损坏设备。这些压力额定值只，和
该设备在这些或超出下标明的任何其他条件的功能操作“推荐工作条件”不
暗示。暴露于长时间处于最大绝对额定情况下会影响器件的可靠性。
注1 ：该封装的热阻抗的计算按照JESD 51-7 。
推荐工作条件
民
VCC
VIH
VIL
IOH
IOL
TA
电源电压
高电平输入电压
低电平输入电压
高电平输出电流
低电平输出电流
工作自由空气的温度
0
4.5
2
0.8
–0.4
8
70
喃
5
最大
5.5
单位
V
V
V
mA
mA
°C
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3
SN74ALS166
并联负载8位移位寄存器
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电气特性在推荐工作的自由空气的温度范围内（除非
另有说明）
参数
VIK
VOH
VOL
II
IIH
IIL
IO =
VCC = 4.5 V ，
VCC = 4.5 V至5.5 V ，
VCC = 4 5 V
4.5
VCC = 5.5 V ，
VCC = 5.5 V ，
VCC = 5.5 V ，
VCC = 5.5 V ，
测试条件
II = -18毫安
IOH = -0.4毫安
IOL = 4毫安
IOL = 8毫安
VI = 7 V
VI = 2.7 V
VI = 0.4 V
VO = 2.25 V
–30
民
VCC–2
0.25
0.35
0.4
0.5
0.1
20
–0.1
–112
TYP
最大
–1.5
单位
V
V
V
mA
A
mA
mA
ICC
VCC = 5.5 V ，
见注2
14
24
mA
所有典型值是在VCC = 5V ， TA = 25 ℃。
输出条件已被选定，以产生一个电流，其值接近1的一半真短路输出电流， IOS的。
注2 ：在4.5 V适用于SER和所有其他投入，除了时钟，接地，国际刑事法院是经过时钟转换为0 V至4.5 V.测
时序要求在推荐工作的自由空气的温度范围内（除非另有
说明）
民
fclock
tw
时钟频率
CLR低
脉冲持续时间
CLK高
CLK低
SH / LD
TSU
th
CLK ↑之前设置时间
↑
保持时间， CLK ↑数据后，
数据
CLR不活跃
9
10
10
16
7
11
3
ns
ns
ns
最大
45
单位
兆赫
开关特性在推荐工作条件（除非另有说明）
（参见图1）
参数
FMAX
的TPH1
TPLH
的TPH1
所有典型值是在VCC = 5V ， TA = 25 ℃。
CLR
CLK
QH
QH
从
（输入）
TO
（输出）
民
45
4
2
2
9
7
9
14
12
13
TYP
最大
单位
兆赫
ns
ns
4
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参数测量信息
TEST
点
从输出
被测
CL = 50 pF的
（见注一）
RL = 500
试验台的同步输入
数据输入
为测试
H
串行输入
SH / LD
0V
4.5 V
输出检测过
（见注B）
QH在TN + 1
QH在TN + 1
电路负载下测试输出
总重量（清）
CLR
（见注C）
3.5 V
1.3 V
1.3 V
0.3 V
tn
1.3 V
总重量（CLK）
数据输入
（见测试表）
的TPH1
输出QH
VOL
电压波形
注意事项： A.
B.
C.
D.
E.
CL包括探针和夹具电容。
被传播延迟时间（ tPLH的和的TPH1 ）的TN + 1测量。正确的换挡数据的TN + 8 ，验证与功能测试。
之前，各试验用的清除脉冲被施加。
TN =位时间的时钟转换前，后的TN + 1 =位一次一个时钟过渡，经过八年的时钟转换TN + 8 =位时间。
时钟脉冲具有以下特点：总重量（时钟）
≤
20纳秒和PRR = 1 MHz的。的清除脉冲具有以下
特点： TW （全部清除）
≤
20纳秒。
F.所有脉冲发生器具有以下特点： ZO
≈
50
;
TR = TF = 2纳秒。测试的fmax当占空比= 50 ％ 。
1.3 V
TSU
1.3 V
TPLH
TN + 1 （见注D）
tn
1.3 V
th
1.3 V
TSU
1.3 V
的TPH1
VOH
TN + 1
3.5 V
1.3 V
0.3 V
th
3.5
1.3 V
0.3 V
CLK
（见注E）
图1.负载电路和电压波形
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5
QQ：2880707522 复制
