SN65LVDS94
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SLLS298F - 1998年5月 - 修订2006年1月
LVDS SerDes接收
特点
4:28数据通道扩展最高可达1.904
每秒千兆比特的吞吐量
适用于点至点子系统
通信具有非常低的EMI
4个数据通道和时钟低电压
差分通道，并在28个数据和
时钟输出低电压TTL输出通道
采用单3.3V电源和
250毫瓦（典型值）
5V容限输入SHTDN
时钟上升沿触发输出
总线引脚容忍4 kV的ESD HBM
封装在超薄紧缩小外形
包20英里端子节距
消耗<1毫瓦禁用时
广相位锁定输入频率范围
20 MHz至68 MHz的
所需的PLL无需外部元件
达到或超过ANSI的要求
EIA / TIA -644标准
工业温度合格
T
A
= -40 ° C至85°C
更换为DS90CR286
DGG包装
（ TOP VIEW ）
D22
D23
D24
GND
D25
D26
D27
LVDSGND
A0M
A0P
A1M
A1P
LVDSV
CC
LVDSGND
A2M
A2P
CLKINM
CLKINP
A3M
A3P
LVDSGND
PLLGND
PLLV
CC
PLLGND
shtdn
CLKOUT
D0
GND
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
56
55
54
53
52
51
50
49
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
V
CC
D21
D20
D19
GND
D18
D17
D16
V
CC
D15
D14
D13
GND
D12
D11
D10
V
CC
D9
D8
D7
GND
D6
D5
D4
D3
V
CC
D2
D1
描述
该SN65LVDS94 LVDS SERDES （串行器/解串器）接收器包含四个串行输入7位并行输出移位
寄存器，一个7×时钟合成器，和5的低电压差分信号（LVDS）线在一个单个的接收器
集成电路。这些功能允许接收从兼容发射机同步数据，如对
SN65LVDS93和SN65LVDS95 ，超五类平衡线对导线和扩展到了28位单端
在较低的传输速率的LVTTL同步数据。
当接收时，高速LVDS数据被接收并加载到寄存器中的速率的七倍
LVDS输入时钟（ CLKIN ） 。然后，数据被卸载到一个28位宽的LVTTL并行总线在CLKIN速率。一
锁相环时钟合成电路产生一个7×时钟为内部时钟和输出时钟的
扩展的数据。在SN65LVDS94呈现在输出时钟（ CLKOUT ）的上升沿有效数据。
请注意，一个重要的通知有关可用性，标准保修，并在得克萨斯州的关键应用程序使用
仪器的半导体产品和免责条款及其出现在此数据表的末尾。
PRODUCTION数据信息为出版日期。
产品符合占德州条款规范
仪器标准保修。生产加工过程中不
不一定包括所有参数进行测试。
版权所有 1998-2006，德州仪器
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这些器件具有有限的内置ESD保护。引线应短接在一起或设备放置在导电泡棉
储存或搬运过程中，以防止对静电损坏MOS大门。
描述（续）
该SN65LVDS94仅需要5线的端接电阻的差分输入和很少或没有控制。
数据总线出现相同的输入处的发射器和接收器的输出与所述数据
传输对用户透明的（多个） 。唯一的用户干预是可能使用的关机/清除
（ SHTDN ）低电平有效的输入，以抑制所述时钟和关断的LVDS接收器更低的功耗。低
这个信号电平将清除所有内部寄存器，以一个较低的水平。
该SN65LVDS94的特点是工作在-40 ° C的环境空气温度为85°C 。
功能框图
串行输入/并行输出
移位寄存器
A0P
在串行
A0M
CLK
A，B ， ...摹
D0
D1
D2
D3
D4
D6
D7
串行输入/并行输出
移位寄存器
A1P
在串行
A1M
CLK
A，B ， ...摹
串行输入/并行输出
移位寄存器
A2P
在串行
A2M
CLK
A，B ， ...摹
D8
D9
D12
D13
D14
D15
D18
串行输入/并行输出
移位寄存器
A3P
在串行
A3M
CLK
A，B ， ...摹
D19
D20
D21
D22
D24
D25
D26
控制逻辑
shtdn
D27
D5
D10
D11
D16
D17
D23
7 ×时钟/ PLL
CLK
CLKINP
CLOCK IN
CLKINM
CLOCK OUT
CLKOUT
2
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CLKIN
前一个周期
A0
D0-1
D7
D6
当前周期
D4
D3
D2
D1
D0
D7+1
下一个周期
A1
D86-1
D18
D15
D14
D13
D12
D9
D8
D18+1
A2
D19-1
D26
D25
D24
D22
D21
D20
D19
D26+1
A3
D27-1
D23
D17
D16
D11
D10
D5
D27
D23+1
CLKOUT
Dn
Dn-1
Dn
Dn+1
图1. SN65LVDS94加载和移位序列
等效输入和输出示意图说明
V
CC
V
CC
V
CC
300 k
300 k
50
50
D输出
ANP
ANM
shtdn
7V
7V
300 k
7V
7V
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绝对最大额定值
在工作自由空气的温度（除非另有说明）
V
CC (2)
电源电压范围
电压范围内的任何终端（除了SHTDN ）
电压范围在SHTDN终端
总线引脚（ 3A级）
静电放电
(3)
总线引脚（ 2B类）
所有引脚（ 3A级）
所有引脚（ 2B类）
连续总功率耗散
T
A
T
英镑
工作自由空气的温度范围内
存储温度范围
从案例10引线温度1.6毫米（ 1/16英寸）
秒
(1)
(2)
(3)
(1)
单位
0.3 V至24 V
-0.5 V到V
CC
+ 0.5 V
-0.5 V到V
CC
+ 3 V
4千伏
200 V
3千伏
200 V
（见耗散额定值表）
-40 ° C至85°C
-65 ℃150 ℃的
260°C
超出上述绝对最大额定值强调可能会造成永久性损坏设备。这些压力额定值
止，并在规定的操作指示的装置，在这些或超出任何其他条件的功能操作
条件是不是暗示。暴露于长时间处于最大绝对额定情况下会影响器件的可靠性。
所有电压值都是相对于GND端子，除非另有说明。
该评级是使用MIL- STD- 883C的方法， 3015.7测量。
额定功耗表
包
DGG
(1)
T
A
≤
25°C
额定功率
1377毫瓦
降额因子
(1)
上述牛逼
A
= 25°C
11毫瓦/°C的
T
A
= 70°C
额定功率
882毫瓦
T
A
= 85°C
额定功率
717毫瓦
这是结到环境的热阻的倒数时，板装且没有空气流动。
推荐工作条件
民
V
CC
V
IH
V
IL
|V
ID
|
V
IC
见
图2
和
科幻gure 3
T
A
电源电压
高电平输入电压（ SHTDN ）
低电平输入电压（ SHTDN ）
差分输入电压幅度
VID
2
喃
3.3
最大
3.6
0.8
单位
3
2
0.1
0.6
VID
2
V
共模输入电压
2.4
*
V
CC
-0.8
工作自由空气的温度
-40
85
°C
时序要求
民
t
c
(1)
喃
t
c
最大
50
单位
ns
输入时钟周期
t
c
被定义为至少32000个时钟周期的平均持续时间。
14.7
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电气特性
在推荐工作条件（除非另有说明）
参数
V
IT +
V
IT-
V
OH
V
OL
正向差分输入电压阈值
负向差动输入电压
门槛
(2)
高电平输出电压
低电平输出电压
I
OH
= -4毫安
I
OL
= 4毫安
禁用，所有输入打开
启用后， ANP在1 V和ANM 1.4
V,
t
c
= 15.38纳秒
启用，C
L
= 8 PF（ 5位） ，
最坏情况下的图案，看
图4中，
t
c
= 15.38纳秒
I
IH
I
IL
I
IN
I
OZ
(1)
(2)
高电平输入电流（ SHTDN ）
低电平输入电流（ SHTDN ）
输入电流（ A和CLKIN输入）
高阻抗输出电流
V
IH
= V
CC
V
IL
= 0 V
0 V
≤
V
I
≤
2.4 V
V
O
= 0 V或V
CC
62
-100
2.4
0.4
280
84
测试条件
民
典型值
(1)
最大
100
mV
V
V
A
mA
单位
I
CC
静态电流（平均值）
107
±20
±20
±20
±10
mA
A
A
A
A
所有典型值是V
CC
= 3.3 V ，T
A
= 25°C.
代数约定，其中，所述较少阳性（更负）限制被指定最小值，使用本数据表中的
只有负向输入电压阈值。
开关特性
在推荐工作条件（除非另有说明）
参数
t
su
t
h
t
RSKM
t
d
数据建立时间， D0到D27到
CLKOUT
数据保持时间， CLKOUT为D0到
D27
接收器输入偏移保证金
(1)
见
图6
延迟时间，输入时钟输出时钟，看
图6
测试条件
最小值典型值
(1)
最大
4
C
L
= 8 pF的
SEE
图5
4
t
c
= 15.38毫微秒（ ± 0.2 ％ ） ，
|输入时钟抖动| <50 PS
(2)
t
c
= 15.38毫微秒（ ± 0.2 ％ ）
T
A
= 0 ° C至85°C
T
A
= -40 ℃至0 ℃下
490
390
3.7
±80
ps
±300
1
400
3
0.43 t
c
ms
ns
ns
ns
6
800
ps
ns
6
ns
单位
t
C（ O）
t
c
= 15.38 + 0.75罪（ 2π500E3t ）± 0.05纳秒，
改变输出时钟周期，从周期看
图7
周期
(3)
t
c
= 15.38 + 0.75罪（ 2 ≠ 3E6t ） ± 0.05纳秒，
SEE
图7
启用时间， SHTDN锁相
禁止时间， SHTDN为关闭状态
输出转换时间（t
r
或T
f
)
输出时钟脉冲的持续时间
SEE
图8
SEE
图9
C
L
= 8 pF的
t
en
t
DIS
t
t
t
w
(1)
(2)
(3)
tc
-ts小时。
t
RSKM
可分配给发射器和互连倾斜和时钟抖动的时序余量。它由下式定义
14
|输入时钟抖动|是在输入时钟周期的变化的幅度。
t
C（ O）
是在从一个循环的输出时钟的周期，以观察到超过15000次循环的下一个周期的变化。
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