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集成电路
PCA9540
2通道我
2
多路复用器
产品speci fi cation
1999年12月15日
飞利浦
半导体
飞利浦半导体
产品speci fi cation
2通道我
2
多路复用器
PCA9540
特点
1 - 2双向翻译多路复用器
通过我的频道选择
2
C总线
工作电源电压为2.5 3.6 V
工作温度范围0 ° C至70℃
电与取消所有多通道
低导通电阻
描述
该PCA9540是1-的-2的双向平移复用器，
经由I控制
2
C总线。在SCL / SDA上游对扇出至
2 SCX / SDX下游对，或信道。只有一个SCX / SDX
信道被选择的时间，通过对所述的内容决定
可编程控制寄存器。
多路转换器的选通门被构造成使得在V
DD
销可用于限制最大高电压将是
通过了PCA9540 。这允许使用不同的总线
电压每SCX / SDX对，让3.3 V部分可以
与5 V ，无任何额外保护通信。
外部上拉电阻，可以拉车到所需的电压
级别此通道。
引脚配置
SCL
SDA
V
DD
SD0
1
2
3
4
8
7
6
5
SC1
SD1
V
SS
SC0
SW00491
引脚说明
针
数
1
2
3
4
5
6
7
8
符号
SCL
SDA
V
DD
SD0
SC0
V
SS
SD1
SC1
功能
串行时钟线
串行数据线
电源电压
串行数据0
串行时钟0
供应地
串行数据
串行时钟1
订购信息
套餐
8引脚塑料SO
8引脚塑料TSSOP
温度范围
0 ° C至+ 70°C
0 ° C至+ 70°C
订货编号
PCA9540D
PCA9540PW DH
图号
SOT96-1
SOT505-1
1999年12月15日
2
853–2185 22852
飞利浦半导体
产品speci fi cation
2通道我
2
多路复用器
PCA9540
框图
SC0
SC1
SD0
SD1
V
SS
V
DD
POWER- ON
RESET
SCL
输入
滤波器
SDA
I
2
C总线
控制
SW00492
1999年12月15日
3
飞利浦半导体
产品speci fi cation
2通道我
2
多路复用器
PCA9540
频道选择
一个SC0x / SD0x下游对或通道，被选中的
控制寄存器的内容。该寄存器被后写入
PCA9540已得到解决。在2个LSB的控制字节是
用于确定哪个信道要被选择。当一个信道
被选择时，后一个终止条件具有信道将被激活
被放置在我
2
C总线。这将确保所有SCX / SDX行会
处于HIGH状态时，信道被激活，从而没有
在连接时产生错误的情况。
控制字节
7
X
X
X
6
X
X
X
5
X
X
X
4
X
X
X
3
X
X
X
2
0
1
1
1
X
0
0
0
X
0
1
选
通道
无
0 （ SC0 / SD0 ）
1 （ SC1 / SD1 ）
我的特征
2
C总线
在我
2
C总线是2路， 2路不同芯片之间的通信
或模块。两条线是串行数据线（SDA）和串行
时钟线（SCL） 。两条线必须连接到正电源
通过一个上拉电阻器，当连接到装置的输出级。
数据传输可以启动只有当总线不忙。
位传输
每个时钟脉冲期间的一个数据位被传输。在数据
SDA线必须在时钟的高电平期间保持稳定
脉冲作为此时的变化，所述数据线将被解释为
控制信号（见图1） 。
SDA
控制寄存器
7
X
6
X
5
X
4
X
3
X
2
B2
1
B1
0
B0
SCL
数据线
稳定的;
数据有效
变化
DATA的
允许
SW00363
通道选择位
（读/写）
图1.位传输
SW00497
上电复位
在上电期间的控制寄存器默认为全零引起
所有通道被取消。
START和STOP条件
数据和时钟线保持高电平时，总线不忙。一
HIGH到LOW数据线的过渡，而时钟为高电平时
定义为启动条件（ S） 。的由低到高的跳变
数据线，而时钟高电平被定义为停止条件（P）的
（参见图2） 。
系统CON组fi guration
所述的装置产生的消息是一个“发送部” ，一个设备接收
是“接收器” 。控制该消息的设备是
“主”和由主机控制的器件是
“奴隶” （见图3） 。
SDA
SDA
SCL
S
启动条件
P
停止条件
SCL
SW00365
启动和停止条件图2.定义
SDA
SCL
主
发射器/
接收器
SLAVE
接收器
SLAVE
发射器/
接收器
主
发射机
主
发射器/
接收器
I
2
C
多路复用器
SLAVE
SW00366
图3.系统配置
1999年12月15日
4
飞利浦半导体
产品speci fi cation
2通道我
2
多路复用器
PCA9540
应答
的起始，并从发送器到接收器的停止条件之间传输的数据字节的数目不限。每个8位字节
其次是一个确认位。确认位为高电平把总线上的传输，而主机产生的
额外的应答时钟脉冲。
这是写给必须产生一个从接收器每个字节的接收一个应答信号。另外一个主机必须产生一个
已同步输出从机发送的每个字节的接收后确认。应答器件必须拉低
在应答时钟脉冲SDA线，从而使SDA线在应答时钟的高期间，
脉冲，建立时间和保持时间，必须考虑到。
一个主接收机必须由不产生应答上已同步输出的最后一个字节的数据的结束信号到发射机
奴隶。在这种情况下，发射器必须保持数据线为高电平，使主机产生一个停止条件。
数据输出
由发射器
无应答
数据输出
通过接收器
应答
从SCL
主
S
启动条件
1
2
8
9
时钟脉冲
承认
SW00368
图4.确认在我
2
C总线
从机地址
1
1
1
0
0
0
0
固定
硬件中选择
SW00564
图5.从地址
SDA
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
SCL
1
2
3
4
5
6
7
8
9
1
2
3
4
5
6
7
8
9
从机地址
控制寄存器
SDA
S
1
1
1
0
0
0
0
0
读/写
A
X
X
X
X
X
B2
B1
B0
A
P
启动条件
应答
从机
应答
从机
上一个频道
t
pv
新通道
SW00498
图6.写控制寄存器
从机地址
控制寄存器
最后字节
SDA
S
1
1
1
0
0
0
0
1
读/写
A
X
X
X
X
X
B2
B1
B0
NA
P
停止条件
启动条件
应答
从机
不应答
从主
SW00499
图7.读控制寄存器
1999年12月15日
5
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