PCA6107
远程8位I C和SMBus低功耗I / O扩展器
与中断输出，复位和配置寄存器
2
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SCPS139B - 2006年1月 - 修订2006年10月
特点
低待机电流消耗
1
A
最大
I
2
C到并行端口扩展器
漏极开路低电平有效中断输出
低电平有效的复位输入
操作的电源电压范围
2.3 V至5.5 V
5 V容限I / O端口
400 kHz的快速I
2
C总线
三个硬件地址引脚允许使用
多达8个器件上的I
2
C / SMBus的
输入/输出配置寄存器
极性反转寄存器
内部上电复位
在P0高阻抗漏极开路
动力与配置的所有通道
输入
开机时无毛刺
在SCL / SDA输入噪声滤波器
锁存输出，大电流驱动
最大能力可直接驱动LED
闭锁性能超过100mA的每
JESD 78 ， II类
ESD保护超过JESD 22
- 2000 -V人体模型（ A114 -A ）
- 200 -V机型号（ A115 -A ）
- 1000 -V带电器件模型（ C101 ）
DW包装
（ TOP VIEW ）
INT
SCL
SDA
A0
A1
A2
P0
P1
GND
1
2
3
4
5
6
7
8
9
18
17
16
15
14
13
12
11
10
V
CC
V
CC
RESET
P7
P6
P5
P4
P3
P2
描述/订购信息
这8位I / O扩展为双线双向总线（我
2
C）是专为2.3 V至5.5 V V
CC
操作。它
提供通用的远程I / O扩展通过我大多数微控制器系列
2
C接口[串行
时钟（SCL）和串行数据（SDA） 。
订购信息
T
A
包
(1)
40管
-40 ° C至85°C
SOIC - DW
2000年卷
250的卷轴
(1)
订购型号
PCA6107DW
PCA6107DWG4
PCA6107DWR
PCA6107DWRG4
PCA6107DWT
PCA6107
顶部端标记
包装图纸，标准包装数量，热数据，符号和PCB设计指南可在
www.ti.com/sc/package 。
请注意，一个重要的通知有关可用性，标准保修，并在得克萨斯州的关键应用程序使用
仪器的半导体产品和免责条款及其出现在此数据表的末尾。
PRODUCTION数据信息为出版日期。
产品符合占德州条款规范
仪器标准保修。生产加工过程中不
不一定包括所有参数进行测试。
版权所有 2006年，德州仪器
PCA6107
远程8位I
2
C和SMBus的低功耗I / O扩展器
与中断输出，复位和配置寄存器
SCPS139B - 2006年1月 - 修订2006年10月
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描述/订购信息（续）
该PCA6107包含一个8位配置（输入或输出选择） ，输入端口，输出端口和极性
反转（高电平有效）寄存器。在上电时，I / O引脚配置为输入。然而，该系统主
可以通过写I / O配置位将I / O作为输入或输出。对于每个输入的数据或
输出被保持在相应的输入或输出寄存器。所述输入端口寄存器的极性可以反转
与极性反转寄存器。所有寄存器可以由系统主机读取。
该系统主机可以通过发送一个复位超时或其他操作不当的情况下的PCA6107
低的低有效复位（ RESET ）输入。上电复位会将寄存器默认状态，并
初始化I
2
C / SMBus的状态机。断言RESET导致同样的复位/初始化发生不
depowering的一部分。
当任何输入状态与其对应的PCA6107漏极开路中断（INT ）输出被激活
输入端口寄存器状态和用于指示到系统主器件的输入状态发生了变化。
INT可以连接到微控制器的中断输入。通过该线路上发送一个中断信号，该
远程I / O可以通知微控制器是否存在及其端口的输入数据，而不必通过通信
在我
2
C总线。因此， PCA6107可保持简单的从设备。
该器件的输出（锁定）具有大电流驱动能力可直接驱动LED 。该器件具有低的
电流消耗和高阻抗漏极开路输出引脚， P0 。
三个硬件引脚（ A0，A1和A2 ）来编程和改变固定我
2
C类地址，允许多达8
设备共享同一I
2
C总线或SMBus 。
终端功能
终奌站
号
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
名字
INT
SCL
SDA
A0
A1
A2
P0
P1
GND
P2
P3
P4
P5
P6
P7
RESET
V
CC
V
CC
描述
中断输出。连接到V
CC
通过上拉电阻。
串行时钟总线。连接到V
CC
通过上拉电阻。
串行数据总线。连接到V
CC
通过上拉电阻。
地址输入。直接连接到V
CC
或地面。
地址输入。直接连接到V
CC
或地面。
地址输入。直接连接到V
CC
或地面。
P-端口的输入/输出。漏极开路的设计结构。连接到V
CC
通过上拉电阻。
P-端口的输入/输出。推拉式的设计结构。
地
P-端口的输入/输出。推拉式的设计结构。
P-端口的输入/输出。推拉式的设计结构。
P-端口的输入/输出。推拉式的设计结构。
P-端口的输入/输出。推拉式的设计结构。
P-端口的输入/输出。推拉式的设计结构。
P-端口的输入/输出。推拉式的设计结构。
低电平有效复位输入。连接到V
CC
通过上拉电阻如果没有使用有效的连接。
电源电压
电源电压
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逻辑图（正逻辑）
INT
1
打断
逻辑
LP滤波器
A0
A1
A2
SCL
SDA
4
5
6
2
3
输入
滤波器
I
2
C总线
控制
移
注册
8位
I / O
PORT
P7P0
写脉冲
V
CC
RESET
GND
17, 18
16
9
POWER- ON
RESET
读脉冲
A.
所有I / O设置为输入复位。
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远程8位I
2
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与中断输出，复位和配置寄存器
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P0的简化原理图
DATA FROM
移位寄存器
DATA FROM
移位寄存器
写配置
脉冲
写脉冲
CON组fi guration
注册
D
FF
Q
输出端口
注册资料
D
FF
Q
C
K
Q
P0
ESD保护二极管
输入
PORT
注册
D
Q
FF
C
K
Q
产量
PORT
注册
GND
输入端口
注册资料
读脉冲
C
K
Q
DATA FROM
移位寄存器
写脉冲极性
D
Q
FF
极性
注册资料
C
K
Q
极性
逆温
注册
A.
在上电或复位后，所有寄存器恢复到默认值。
4
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与中断输出，复位和配置寄存器
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作者： P1到P7简化原理图
DATA FROM
移位寄存器
DATA FROM
移位寄存器
写配置
脉冲
写脉冲
CON组fi guration
注册
D
Q
FF
C
K
Q
D
Q
FF
输出端口
注册资料
V
CC
P1到P7
ESD保护二极管
输入
PORT
注册
D
Q
FF
GND
输入端口
注册资料
C
K
Q
产量
PORT
注册
读脉冲
C
K
Q
DATA FROM
移位寄存器
写脉冲极性
D
Q
FF
极性
注册资料
C
K
Q
极性
逆温
注册
A.
在上电或复位后，所有寄存器恢复到默认值。
I
2
C接口
在双向I
2
C总线由串行时钟（ SCL）和串行数据（ SDA）线。两条线必须是
当连接到装置的输出级通过上拉电阻连接到正电源。数据
传输可以启动只有当总线不忙。
I
2
这种装置C的通信是由一个主，从高至低跳变对发送启动条件启动
在SDA输入/输出，而SCL输入为高电平（见
图1）。
启动条件后，设备地址
字节发送， MSB在前，包括数据方向位（R / W） 。
接收到有效地址字节之后，该装置带有一个确认（ACK）响应，低的在SDA
输入/输出的ACK时钟脉冲的高过程中。从设备的地址输入（ A0 -A2 ）
不能开始和停止条件之间变化。
在我
2
C总线中，只有一个数据位在每个时钟脉冲期间传送。 SDA线上的数据必须保持
高脉冲的时钟周期，因为改变此时的数据线中的稳定将被解释为控制
命令（启动或停止） （见
图2）。
停止条件，在SDA输入由低到高的跳变/输出，而SCL输入为高电平，由发送
主人（见
图1）。
任何数量的数据字节可以从发射机传送到开始和停止之间的接收器
条件。每个8位字节后面跟着一个ACK位。发射前必须释放SDA线
接收器可以发送一个ACK位。应答的器件必须在ACK期间拉低SDA线
时钟脉冲，使SDA线为高脉冲在ACK相关的时钟周期的过程中是稳定的低（见
图3）。
当从机接收器处理，它必须产生一个ACK每收到一个字节后。同样，
主机必须产生，它接收从机发送一个字节后的ACK 。建立和保持
时间必须得到满足，以确保其正常工作。
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