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NCN6001

小巧智能卡

接口IC

该NCN6001是致力于智能卡集成电路

接口应用。该设备处理任何类型的智能卡

通过一个简单的，灵活的微控制器接口。最重要的是，

由于内置的芯片选择管脚，几个成色剂可以是

并联连接。

该装置特别适合于低成本，低功率

应用程序，从非常高的延长电池的使用寿命来

低静态电流。

特点

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TSSOP20

DTB后缀

CASE 948E

100 ％兼容于ISO 7816-3 ， EMV和GIE -CB标准

完全兼容GSM

广泛的电池供电电压范围： 2.7 < V

＆ LT ; 5.5 V

可编程CRD_VCC供应拉手1.8 V ， 3.0 V或5.0 V

卡操作

可编程的兴衰卡时钟斜坡

可编程卡时钟分频器

内置芯片选择逻辑可并行连接操作

ESD保护卡销（ 8.0 kV时，人体模型）

支持高达40MHz的输入时钟

内置可编程CRD_CLK停止函数处理运行或

低状态

可编程CRD_CLK斜坡应对宽工作

频带

快CRD_VCC导通和关断序列

这些无铅器件*

标记图

NCN

6001

ALYWG

A =大会地点

=晶圆地段

Y =年

W =工作周

= Pb-Free包装

（注：微球可在任一位置）

引脚连接

I / O 1

INT 2

3 CLK_IN

MOSI 4

CLK_SPI 5

EN_RPU 6

MISO 7

CS 8

Lout_L 10

（ TOP VIEW ）

20 CRD_IO

19 CRD_RST

18 CRD_DET

17 CRD_CLK

16 GND

15 C4 / S0

14 C8 / S1

13 CRD_VCC

12 Lout_H

11 PWR_GND

典型应用

电子商务接口

自动取款机（ATM ），智能卡

销售终端（POS ）系统的点

收费电视系统

订购信息

设备

NCN6001DTBR2

包

航运

TSSOP- 20 * 2500磁带&卷轴

NCN6001DTBR2G TSSOP- 20 * 2500磁带&卷轴

。有关磁带和卷轴规格，

包括部分方向和磁带大小，请

请参阅我们的磁带和卷轴包装规格

宣传册， BRD8011 / D 。

*这个包本身是无铅。

出版订单号：

NCN6001/D

*有关我们的无铅战略和焊接细节，更多的信息请

下载安森美半导体焊接与安装技术

参考手册， SOLDERRM / D 。

半导体元件工业有限责任公司， 2006年

2006年1月 - 第3版

NCN6001

微控制器

47 k

GND

CLK_IN

MOSI

CLK_SPI

MISO

EN_RPU

Lout_L

CRD_CLK

CRD_VCC

C4/S0

C8/S1

GND

PWR_GND

I / O

INT

CRD_DET

CRD_IO

CRD_RST

GND

SWA

SWB

I / O

RST

CLK

GND

ISO7816

18 CRD_DET

500 k

MISO

MOSI

CLK_SPI

3国

双通道8位

移位寄存器

地址译码

DC / DC转换器

10 Lout_L

12 Lout_H

13 CRD_VCC

11 PWR_GND

GND

逻辑控制

15 C4 / S0

14 C8 / S1

19 CRD_RST

17 CRD_CLK

20 CRD_IO

20 k

地

GND

CRD_VCC

GND

SMARTCARD_C

Lout_H

NCN6001

GND

图1.典型应用

50 k

INT

中断块

可编程

卡检测

ISO7816 SEQUENCER

CLK_IN

EN_RPU

时钟

分频器

I / O

20 k

图2.框图

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卡针脚DRIVER

NCN6001

引脚功能及说明

针

名字

I / O

TYPE

输入/输出

上拉

描述

该引脚被连接到一个外部微控制器接口。双向电平

翻译适应智能卡与单片机之间的串行I / O信号。

所述电平转换器被使能时的CS = L ，子地址已被选择和

系统工作于异步模式。当同步卡在使用时，该引脚

被断开，数据和事务发生与MISO B3寄存器。

内部上拉电阻连接在

侧被激活，并且可见

选择芯片只。

该引脚被激活LOW时，卡已经插入并CRD_DET引脚检测。

类似地，当CRD_VCC输出过载产生一个中断时，或者当

该卡已经被提取无论是交易状态（运行或待机）。

INT信号被复位为高，根据表7和图11中。另一方面，在

引脚被强制为逻辑高电平输入电压V时，

低于2.0 V.

内置施密特触发器接收器，使该引脚适用于大类型的时钟

信号（图30）。该引脚可以连接到任何微控制器主时钟，

或一个晶体信号，以驱动外部智能卡。该信号被馈送到内部

时钟选择电路及转换为CRD_CLK销在任一相同的频率，或

由2或4分频，根据编程模式。

注：该芯片保证了EMV占空比为50％时，时钟分频比为1/2或

1/4,

即使当CLK_IN信号是由ISO规定的45％到55％的范围内，并

EMV规范。

但必须指出，在印刷电路板的水平，以最小化从拾取噪声来

CLK_IN线。

主出从入：从外部微控制器的SPI数据输入。该字节的内容

四种可能的中间处与所选芯片的使用编程的地址，以及

对于一个给定的接口代码。

时钟信号同步SPI数据传输。内置施密特触发器接收器

使此引脚具有宽范围的输入时钟信号（图30）相兼容。这个时钟

是完全独立的CLK_IN信号和不与数据起到任何作用

交易。

该引脚用于根据这里下面来激活I / O内部上拉电阻

真表：

EN_RPU =低

→

I / O上拉电阻断开

EN_RPU =高

→

I / O上拉电阻连接

当两个或两个以上NCN6001芯片共用相同的I / O总线，一个芯片只应有

启用内部上拉电阻，以避免I / O线的任意超载。

此外，当异步和同步卡由所述接口来处理，

激活I / O的上拉电阻，必须优选是与相关联的所述一个

异步电路

另一方面，由于没有内部上拉偏置电阻内置于芯片中，销6必须

连接到正确的电压电平，以确保逻辑功能是满意的。

主入从出：从NCN6001 SPI数据输出。该字节携带状态

的接口，所述串行传输所根据编程模式实现

（表2），使用相同的CLK_SPI信号和相同的MOSI时间帧期间。该

三高位[ B7 ： B5 ]有没有意义，由微控制器被丢弃。一

外置4.7千瓦下拉电阻可能需要避免的误区

脚在高阻状态7电压。

该引脚同步SPI通信，并提供了该芯片的地址和

选择的功能。

所有的NCN6001功能，编程和卡交易，将被禁用时，

CS = H。

该引脚被连接到NCN6001电源电压，并且必须被旁路到地

由10

mF/6.0

V的电容。

由于钽电容具有较高的ESR ，使用低ESR的陶瓷类型

（ MURATA X5R ， RESR和小于100毫瓦），强烈推荐。

高侧外部电感连接在这个引脚和Lout_L /引脚12之间

提供在DC / DC功能。流入到该电感器中的电流在内部感测和

没有外部分流电阻。通常情况下， Lout的= 22

mH的，

与ESR < 2.0

产生一个

良好的能效表现，最多65毫安直流输出负载。

注：电感器的尺寸应以处理在450 mA峰值电流

DC / DC操作（见COILCRAFT制造商的数据手册）。

INT

产量

上拉

CLK_IN

时钟输入

高阻抗

MOSI

输入

CLK_SPI

输入

EN_RPU

输入，逻辑

MISO

产量

输入

动力

Lout_H

动力

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NCN6001

引脚功能及说明

针

名字

PWR_GND

TYPE

动力

描述

该引脚的电源地与相关联的内置的DC / DC转换器，并且必须

连接与接地引脚16接地在一起，系统使用质量好的

接地平面建议避免上的逻辑信号线的尖峰。

高侧外部电感连接在该引脚与Lout_H之间

激活的DC / DC功能。内置的NMOS和PMOS器件提供

切换功能连同CRD_VCC电压整流（图17）。

该引脚提供电源外置卡。它是逻辑电平“1” CRD_IO ，

CRD_RST ， CRD_C4 ， CRD_C8和CRD_CLK信号。

由DC / DC外部电感Lout储存的能量必须由被平滑

MF /低

ESR的电容，跨CRD_VCC和GND相连。采用陶瓷型

电容（ MURATA X5R ， ESR < 50毫瓦），强烈推荐。中的一个的情况下

ü CRD_VCC

VLOW

电压时， NCN6001检测情况，并反馈

在该状态位的信息。该设备不采取任何进一步的行动，尤其是

在DC / DC转换器既不停止也不重新由NCN6001编程。这是由

外部微处理器来处理这种情况。

然而，当CRD_VCC过载时， NCN6001切断直流/直流

转换器运行关机ISO序列和报告故障的状态

因为从这个引脚到负载高瞬态电流，必须注意观察，在

PCB水平，以尽量减少该系列ESR和ESL寄生值。该NCN6001演示

主板提供了一个较好的PCB布局实例。

辅助混合的模拟/数字线路来处理任何一个同步卡，或作为芯片选择

【鉴别】（ MISO ，位0 ）：参见图9引脚通过一个漏极开路阶段的带动下，

上拉电阻被连接到CRD_VCC供给。当销被用作逻辑

输入（异步卡），正逻辑条件适用：

连接到GND

→

逻辑=零

连接到V

或悬空

→

逻辑=一

内置的加速器电路可确保输出正向的上升时间是完全符合

在ISO / EMV规范。

注意：

销能够读取的逻辑电平，当芯片工作的

异步接口，但并非意在从外部读出的数据

卡时，在同步模式下操作。它只是返回的逻辑状态

在写指令卡强制。

Lout_L

动力

CRD_VCC

动力

C8/S0

I / O

C4/S1

I / O

辅助混合的模拟/数字线路来处理任何一个同步卡，或作为芯片选择

【鉴别】（ MISO ，第1位）：参见图9引脚通过一个漏极开路阶段的带动下，

上拉电阻被连接到CRD_VCC供给。当销被用作逻辑

输入（异步卡），正逻辑条件适用：

连接到GND

→

逻辑=零

连接到V

或悬空

→

逻辑=一

内置的加速器电路可确保输出正向的上升时间是完全符合

在ISO / EMV规范。

注意：

销能够读取的逻辑电平，当芯片工作的

异步接口，但并非意在从外部读出的数据

卡时，在同步模式下操作。它只是返回的逻辑状态

在写指令卡强制。

地

信号

逻辑低电平模拟信号应连接到接地端子。该引脚

必须从外部连接到PWR_GND销12设计者必须确保没有

高瞬态电流与流入该引脚为低信号电流流过。

该引脚连接到卡连接器的CLK引脚。该CRD_CLK信号来

从时钟选择电路的输出。一个内部有源下拉NMOS器件这一力量

引脚，以在任CRD_VCC启动顺序地上，或当CRD_VCC = 0 V.

上升和下降斜率，无论是FAST这个信号还是慢，可以通过编程

MOSI消息（表2）。

但必须指出，在印刷电路板的水平，以最小化从拾取噪声来

CRD_CLK线。

CRD_CLK

产量

http://onsemi.com

NCN6001

引脚功能及说明

针

名字

CRD_DET

TYPE

输入

描述

从外部卡连接器传来的信号被用于检测的存在下

卡。内置的上拉电阻低电流源偏置该引脚为高电平，使之成为低电平有效，

假设外部开关的一侧连接到地。内置的数字滤波器

保护系统免受电压尖峰出现在此引脚。

的信号的极性是可编程的MOSI信息，根据所述逻辑

状态示出表2中。在另一方面，反馈信息的意思

包含在MISO寄存器位b 4 ，取决于操作的SPI模式作为

这里，定义如下：

SPI普通模式： MISO位B4是高插入卡时，无论是

该卡的极性检测开关。

SPI特殊模式： MISO位B4复制卡的逻辑状态检测开关的

描绘此处的下方，用于处理所述检测开关的极性无论是：

CRD_DET =低

→

MISO / B4 =低

CRD_DET =高

→

MISO / B4 =高

在这两种情况下，该芯片必须被编程，以控制所述右逻辑状态（表2）。

由于由芯片提供的偏置电流非常低，典型地5.0

毫安，

护理必须

观察以避免低阻抗或交叉耦合时，该引脚为在打开状态。

该引脚连接到卡连接器的RESET引脚。电平转换适应

从微控制器向外部卡的RESET信号。输出电流

内部限制到15毫安。

当CS =低，硬连接到地时的卡是CRD_RST验证

停用，并通过内部有源下拉电路。

但必须指出，在印刷电路板设计的水平，以避免该信号之间的交叉耦合

和CRD_CLK时钟。

该引脚处理连接到卡连接器的串行I / O引脚。双向

电平转换器适配卡与单片机之间的串行I / O信号。一

内部有源下拉MOS器件的力量将此引脚接地时任

CRD_VCC启动顺序，或者当CRD_VCC = 0 V的CRD_IO引脚的电流

内部限制到15毫安。

但必须指出，在印刷电路板设计的水平，以避免该信号之间的交叉耦合

和CRD_CLK时钟。

CRD_RST

产量

CRD_IO

I / O

上拉

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