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E2D0020-39-93
半导体
半导体
MSM9810
8通道混合OKI ADPCM型语音合成LSI
这个版本: 1999年9月
MSM9810
上一版本: 1997年5月
N
ew
概述
的MSM9810是一个8信道混合语音合成集成电路,向其中加入高达128兆比特的ROM和/
或EPROM存储语音数据可以直接从外部连接。
该设备是直的8位PCM再现,非线性8位PCM再现, 4比特的ADPCM
播放和4位ADPCM2播放可选,并提供两声道立体声输出
音量控制。该MSM9810包含一个14位D / A转换器和低通滤波器。
的MSM9810可以很容易地通过连接语音数据存储器配置的系统中,功率
放大器和CPU外部。
特点
非线性8位PCM /直8位PCM / 4位ADPCM / 4位ADPCM2
串行输入或并行输入选择
段控制表功能
8声道混音功能
主时钟频率
: 4.096兆赫
=采样频率
: 4.0千赫, 5.3千赫, 6.4千赫, 8.0千赫, 10.6千赫,
12.8千赫, 16.0千赫, 21.2千赫, 25.6kHz , 32.0kHz
短语的最大数量: 256
输出通道
: L / R 2通道
内置音量控制功能(每个输出通道)
内置14位D / A转换器
内置低通滤波器
:数字滤波器
包装:
64 - pin塑料QFP ( QFP64 -P - 1414-0.80 - BK ) (产品名称: MSM9810GS - BK )
1/31
RA23
RA0
净资产收益率
半导体
框图
RD7
RD0
D7/SD
D6/SI
D5/SO
D4/UD
D3/SR3
D2/SR2
D1/SR1
D0/SR0
RCS
CS
WR
RD
CMD
串行
NCR / BUSY
8位锁存器
8
23位多路复用器
8
中央处理器
接口
数据
调节器
23位的地址
计数器
ADPCM
合成
PCM
合成
16
TEST1
TEST2
TEST3
TEST4
8
PAN
注册
16 * 9 MPY
XT
OSC
XT
时序控制器
14-Bit
DAC
14-Bit
DAC
MSM9810
2/31
RESET
DV
DD
DGND
LDAO
AV
DD
AGND RDAO
半导体
MSM9810
引脚配置(顶视图)
64 RA23
63 RA22
62 RA21
61 RA20
59 RA17
58 RA16
57 RA15
56 RA14
55 RA13
54 RA12
53 RA11
52 RA10
50 RA19
49 RA18
60 RA0
51 RA9
DGND
AGND
TEST4
LDAO
RDAO
AV
DD
DV
DD
RCS
TEST1
1
2
3
4
5
6
7
8
9
48 DV
DD
47 RA8
46 RA7
45 RA6
44 RA5
43 RA4
42 RA3
41 RA2
40 RA1
39
净资产收益率
38 RD0
37 RD1
36 RD2
35 RD3
34 RD4
33 RD5
NC 17
WR
18
NCR / BUSY 19
CS
20
D0 / SR0 21
D1 / SR1 22
D2 / SR2 23
D3 / SR3 24
D4 / UD 25
D5 / SO 26
D6 / SI 27
D7 / SD 28
RESET
29
RD7 30
RD6 31
DGND 32
TEST2 10
XT 11
XT
12
TEST3 13
SERIAL 14
CMD
15
RD
16
NC :无连接
64 - pin塑料QFP
3/31
半导体
MSM9810
引脚说明
40-47, 49-64
符号
RA23-RA0
TYPE
O
RCS
脚是"H" 。
数据引脚用于外部存储器。下拉电阻内部
30, 31, 33-38
39
8
RD7-RD0
净资产收益率
RCS
I
O
I
连接到这些引脚。这些下拉电阻变为有效时,
RCS
销是"H" ,并且变得无效时
RCS
脚是"L" 。
输出使能引脚用于外部存储器。
当该引脚为"L" , RA23到RA0和
净资产收益率
引脚输出地址数据和
输出使能信号。
当该引脚为"H" , RA23到RA0和
净资产收益率
引脚变为高阻抗。
选择引脚命令数据或子命令的数据。
15
CMD
I
当该引脚为"H" ,子命令的输入选择。当该引脚为"L" ,
命令输入被选择。
一个上拉电阻内部连接到该引脚。
16
18
20
RD
WR
CS
I
I
I
读引脚CPU接口。
一个上拉电阻内部连接到该引脚。
写引脚CPU接口。
一个上拉电阻内部连接到该引脚。
片选引脚CPU接口。当
CS
是"H" ,
WR
信号是不
本IC输入。一个上拉电阻内部连接到该引脚。
CPU接口选择。当SERIAL是"H" ,串行输入接口
14
串行
I
选择。
当它是"L" ,并行输入接口被选择。
数据总线管脚为CPU接口时,选择并行输入接口。
WR
是"L" ,这个引脚用作数据输入引脚。
28
D7/SD
I / O
RD
是"L" ,这个引脚用作通道状态数据输出引脚。
当选择串行输入接口,此引脚用作串行数据
输入引脚。
数据总线管脚为CPU接口时,选择并行输入接口。
WR
是"L" ,这个引脚用作数据输入引脚。
27
D6/SI
I / O
RD
是"L" ,这个引脚用作通道状态输出引脚。
当选择串行输入接口,此引脚用作串行时钟
输入引脚。
数据总线管脚为CPU接口时,选择并行输入接口。
WR
是"L" ,这个引脚用作数据输入引脚。
26
D5/SO
I / O
RD
是"L" ,这个引脚用作通道状态输出引脚。
当选择串行输入接口,此引脚用作通道状态
输出引脚。
描述
地址引脚用于外部存储器。这些引脚变为高阻
4/31
半导体
MSM9810
符号
TYPE
描述
数据总线管脚为CPU接口时,选择并行输入接口。
WR
是"L" ,这个引脚用作数据输入引脚。
RD
是"L" ,这个引脚用作通道状态输出引脚。
25
D4/UD
I / O
当选择串行输入接口,此引脚用作通道状态
selecter引脚。
当UD为"H" ,通道8通5顷输出到SR3直通SR0 ,分别。
当UD是"L" , 4通道直通输出第一至SR3通SR0分别。
数据总线管脚为CPU接口时,选择并行输入接口。
WR
是"L" ,这个引脚用作数据输入引脚。
RD
是"L" ,这个引脚用作通道状态输出引脚。
24
23
22
21
4
5
11
D3/SR3
D2/SR2
I / O
D1/SR1
D0/SR0
LDA0
RDA0
XT
O
O
I
当选择串行输入接口,此引脚用作通道状态
输出引脚。
当UD为"H" ,通道8通5顷输出到SR3直通SR0 ,分别。
当UD是"L" , 4通道直通输出第一至SR3通SR0分别。
左侧D / A输出引脚。
右侧的D / A输出引脚。
晶体或陶瓷振荡器连接。
约1MW的反馈电阻连接XT之间
XT 。
必要时,输入外部时钟到这个引脚。
晶体或陶瓷振荡器连接。
当外部时钟时,此引脚开路。
当该引脚为"L"水平, LSI初始化。此时,振荡
stopsand D / A输出为GND电平。
信道状态选择引脚。
当该引脚为"H" , NCR信号输出。当它是"L" ,
信号
输出。
引脚IC测试。适用"L"水平这两个引脚。
12
29
XT
RESET
O
I
19
9
10
13
3
7, 48
6
1, 32
2
NCR / BUSY
TEST1
TEST2
TEST3
TEST4
DV
DD
AV
DD
DGND
AGND
I
I
I
下拉电阻内部连接到这些引脚。
引脚IC测试。适用"L"水平这两个引脚。
电源引脚。
GND引脚。
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联系人:刘先生
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