MK50H25
高速
链路层控制器
高级数据
第1节 - 特点
系统时钟速率高达33 MHz的( MK50H25 -
33 ) , 25兆赫( MK50H25 - 25 )或16MHz
( MK50H25 - 16 ) 。
数据速率高达20 Mbps的持续
( MK50H25 - 33 )或高达51 Mbps的突发
片上DMA控制,具有可编程的突发
长度。
高达13.3兆字节/秒的DMA传输速率US-
荷兰国际集团可选5 SYSCLK DMA周期( 150纳秒)为
33 MHz的系统时钟。
完整的2级实现兼容
与X.25 LAPB , LAPD的ISDN , X.32 , X.75和
协议。
处理所有的错误恢复,排序,和S
和U帧控制。
引脚对引脚以及与建筑兼容
MK5025 ( X.25 / LAPD ) , MK5027 ( CCS # 7 )和
MK5029(SDLC).
缓冲区管理,包括:
- 初始化块
- 独立的接收和发送戒指
- 变量描述符环和窗口大小。
独立的64字节发送和接收FIFO 。
可编程发送FIFO保持关闭水
标记。
处理所有的HDLC帧格式:
- 零位插入和删除
- FCS( CRC)的产生和检测
- 帧定界具有标志
可编程单或扩展地址
与控制领域。
五个可编程的定时器/计数器: T1 , T3 ,
TP , N1,N2
可编程最小帧间隔上
标志之间传输(数
帧)。
- 从1到62的标志进行编程
帧
可选的FCS码(CRC)的16或32位,并
经过整个FCS的缓冲。
测试设备:
- 内部环回
- 静音环回
- 可选的内部数据时钟发生器
- 自我测试。
可编程的全双工或半双工操作
1994年7月
DIP48
PLCC 52
可编程看门狗定时器的RCLK
和TCLK (检测没有数据时钟)
选项使接收到的数据是有效的
奇字节对齐的,除了标准的偶数
字节对齐。
可提供52引脚PLCC , 84引脚PLCC (使用
与外部ROM ) ,或48引脚DIP封装。
第2节 - 简介
SGS集团 - 汤姆森MK502H5链路层CON-
控制器是一个亲一个VLSI半导体器件
志愿组织完整的链路级数据通信
控制符合1984年和1988年CCITT
X·25的版本。该MK50H25将执行
帧格式化包括:帧定界
标志,透明度(所谓的“位填充” ) ,错误
收回重发,序列号
控制, S(监督)和U (无编号)
帧控制,加FCS( CRC)的生成和
检测。该MK50H25还支持X.75和
X.32 (与它的XID帧支持),以及赎罪
GLE通道ISDN LAPD (其支持的用户界面
框架和扩展寻址能力) 。
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MK50H25
描述
(续)
为了增加灵活性,透明的方式提供
没有链路层的HDLC传输机制
支持。这种灵活的透明模式可能
轻松地进入和退出,而不会影响
X.25链路状态或保存的链路状态变量
该MK50H25 。在这种模式下没有协议的流程 -
ING完成,它是由用户来照顾
上层软件。单个或扩展地址
礼服场过滤和控制字段的处理是
在透明模式可选支持。
其中一个MK50H25的突出特点
是它的缓存器管理,它包括芯片上
双通道DMA 。此功能允许用户
接收和发送在多个数据帧
时间。 (传统的串行通信CON-
控制芯片加上一个独立的DMA芯片将处理
数据在一个时间只有一个街区。 )的
DIP48引脚连接
( TOP VIEW )
MK50H25将移动接收的多个块
和发送数据直接流入和流出的存储器
通过主机的总线。可能是系统CON-
成形为MK50H25示于图1中。
该MK50H25可以与任何的几个使用
流行的16位和8位微处理器,如
68020, 68000, 6800, Z8000, Z80, 8086, 8088,
80186 , 80286 , 80386SX等。
该MK50H25可以在操作要么全部或
半双工模式。在半双工模式下, RTS
并提供CTS调制解调器控制引脚。在全
双工模式,这些引脚成为用户编程
序的I / O引脚。在MK50H25所有信号引脚
为TTL兼容。这具有的优点
使身体的MK50H25独立
界面。如示于图1中,线路驱动器和
接收器被用于对电连接
物理层。
VSS -GND
DAL07
DAL06
DAL05
DAL04
DAL03
DAL02
DAL01
DAL00
读
INTR
DALI
DALO
DAS
BMO , BYTE , BUSRE L
BMI , BUSAKO
HOLD , BUSRQ
ALE , AS
HLDA
CS
ADR
准备
RESET
VSS -GND
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
48
47
46
45
44
43
42
41
的VCC (+ 5V)
DAL08
DAL09
DAL10
DAL11
DAL12
DAL13
DAL14
DAL15
A16
A17
A18
A19
A20
A21
A22
A23
RD
DSR , CTS
TD
系统时钟
RCLK
DTR , RTS
TCLK
M
K
5
0
H
2
5
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
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MK50H25
表1:
引脚说明
图例:
I
仅输入
IO
输入/输出
OD
漏极开路(无内部上拉)
注意:
O
3S
只有输出
3-State
引脚输出,显示在方括号52引脚PLCC封装。
PIN码( S)
2-9
40-47
[2-10
44-51]
10
[11]
TYPE
IO/3S
描述
时间复用的数据/地址总线。中的一个地址部
存储器转移, DAL<15 : 00>包含存储器的低16位
地址。
在一个存储器传输的数据部分, DAL<15 : 00>包含读取
或写入数据,这取决于传输的类型。
读指示操作,该总线控制器正在执行的类型
在一个总线事务。读由MK50H25从动仅当它是
BUS MASTER 。 READ是有效的整个总线交易过程中,是
三态在其他时间。
MK50H25作为总线从站:
READ =高 - 数据被放置在DAL线的芯片。
读= LOW - 数据采取关闭DAL线由芯片。
MK50H25作为总线主:
读= HIGH - 数据采取关闭DAL线由芯片。
READ =低 - 数据被放置在DAL线的芯片。
中断是一个关注断线,指示一个或一个以上的
以下CSR0状态标志设置:小姐, MERR , RINT ,色彩或PINT 。
中断是由CSR0<09> , INEA = 1启用。
DAL IN是一个外部总线收发器控制线。 DALI是由驱动
MK50H25仅当它是BUS MASTER 。 DALI是断言的
当它从DAL线的数据部分中读出MK50H25
阅读转移。 DALI写传输过程中不被肯定。
DAL OUT为外部总线收发器控制线。 DALO由从动
MK50H25仅当它是BUS MASTER 。 DALO有效时
当它一读的地址部分在驱动DAL线MK50H25
转让或写传输的时间。
DATA STROBE是定义了一个总线事务中的数据部分。根据定义,
数据是稳定的,有效的从低到DAS的高过渡。该信号是
由MK50H25驱动,而它的总线主控器。在总线
从操作,此引脚用作输入。在所有其他时间的信号是
三态。
I / O引脚15和16均通过CSR4 。如果CSR4的06位被置
到1 ,销15变为输入BUSREL和所使用的宿主的信号
在MK50H25终止DMA突发当前的总线传输后有
完成。如果位06是明确的话引脚15为输出,表现为
下面描述用于销16 。
引脚15和16是可编程的,通过CSR4 ( BCON )的00位。
如果CSR4<00> BCON = 0,
I / O引脚15 = BMO (O / 3S )
I / O引脚16 = BM1 (O / 3S )
字节MASK<1 : 0>指示在DAL字节(S)以进行读或写
在此总线事务。 MK50H25驱动这些线路只作为总线
硕士。 MK50H25忽略时,它是一个公交车从站的BM线。
字节选择完成,如下表中所述。
BM1
BM0
传输类型
低
低
整个单词
低
高
高字节
( DAL<15 : 08> )
高
低
低字节
( DAL<07 : 00> )
高
高
无
信号名称
DAL<15 : 00>
读
IO/3S
INTR
11
[12]
12
[13]
O / OD
DALI
O/3S
DALO
13
[14]
O/3S
DAS
14
[15]
IO/3S
BMO
字节
BUSREL
15
[16]
IO/3S
BM1
BUSAKO
16
[18]
O/3S
4/64
MK50H25
表1:
引脚说明(续)
信号名称
PIN码( S)
TYPE
描述
如果CSR4<00> BCON = 1,
I / O引脚15 =字节( O / 3S )
I / O引脚16 = BUSAKO ( O)
字节选择是通过使用字节行并在DAL<00>锁定
总线事务的地址部分。 MK50H25驱动器只能按字节作为一个巴士
法师并忽略它,当一个总线从。字节选择做概述
在下面的表中。
字节
DAL<00>
传输类型
低
低
整个单词
低
高
非法条件
高
低
低字节
高
高
高字节
BUSAKO是一个总线请求菊花链输出。如果MK50H25不要求
公共汽车和收到HLDA , BUSAKO将驱动为低电平。如果MK50H25是
要求公交车,当它接收到HLDA , BUSAKO仍将维持高位
注:所有传输都是整个单词,除非MK50H25配置为8位
操作。
HOLD
BUSRQ
17
[19]
IO / OD
引脚17是通过位CSR4 0配置。
如果CSR4<00> BCON = 0,
I / O引脚17 = HOLD
HOLD请求被提出,通过MK50H25当它需要一个DMA周期内,如果
HLDA是无效的,而不管HOLD引脚的先前状态。 HOLD是
保持低电平整个随后的总线事务。
如果CSR4<00> BCON = 1,
I / O引脚17 = BUSRQ
BUSRQ被认定通过MK50H25当它需要一个DMA周期,如果事先
在BUSRQ引脚的状态是高HLDA无效。 BUSRQ保持低电平
对于整个随后的总线事务。
地址选通脉冲的有效电平是通过CSR4可编程的。
而这一信号是在发生了一个总线传输的地址部分的
断言水平。这个信号由MK50H25驱动,而它是总线
MASTER 。在其他时间,信号为三态。
如果CSR4<01>艾康= 0,
I / O引脚18 = ALE
地址锁存使能用于解复用DAL线和定义
转移的地址部分。由于ALE ,从高信号转换
在向转印的地址部分中低并保持低
数据部分。
如果CSR4<01>艾康= 1,
I / O引脚18 = AS
作为AS ,该信号脉冲低的总线传输的地址部分中。
低到AS的高转变可以由从属装置来选通
地址加到寄存器。
AS是ALE有效的倒置。
保存肯定是拿回应。当HLDA是低
针对持有MK50H25的说法,该MK50H25是公交车
硕士。只有当HOLD已被释放HLDA应无效
由MK50H25 。
片选指示,当低时,该MK50H25是从设备
用于数据传输。 CS必须在整个交易无效。
地址选择寄存器地址或端口的寄存器数据端口。它
必须在整个传输的数据部分有效并且仅由
该芯片在CS为低电平。
ADR
PORT
低
寄存器DATA PORT
高
注册地址端口
当MK50H25是一个总线主控, READY是一个异步
从总线内存该内存将接受一个数据确认
写周期或该存储器已经戴上在一读周期的DAL线数据。
ALE
AS
18
[20]
O/3S
HLDA
19
[21]
I
CS
ADR
20
[22]
21
[23]
I
I
准备
22
[24]
IO / OD
5/64