飞思卡尔半导体公司
通过订购此文件
MC68EN302/D
微处理器和内存
科技集团
MC68EN302
产品简介
集成多协议处理器，带有以太网
飞思卡尔半导体公司...
摩托罗拉引入了一个版本众所周知的MC68302集成多协议处理器（ IMP）的同
以太网和DRAM控制器。它被称为MC68EN302 ，并且扩展装置的基础上，一个家庭
MC68302.
该以太网控制器具有一个16位的接口，驻留在68000总线，并提供完整的IEEE 802.3
兼容性。的编程模型是从标准68302编程模型通过。在DRAM
控制器从MC68306产物通过。它得到了增强，支持奇偶校验和外部总线的主人。
该MC68EN302是装在低轮廓144的TQFP 。
MC68EN302
MC68302
1常规 -
用途
DMA
通道
3定时器
和
另外
特点
打断
调节器
JTAG
IEEE 1149.1
68000
MC68000
系统总线
6 DMA
频道
1152字节
双端口
内存
外设
公共汽车
模块总线
调节器
微码
通讯
调节器
（ RISC）的
其他
串行
频道
ETHERNET
调节器
3系列
频道
DRAM
调节器
图1. MC68EN302框图
本文件包含有关正在开发中的产品信息。摩托罗拉保留不另行通知变更或终止本产品的权利。
半导体产品信息
MOTOROLA ， 1995年
欲了解更多有关该产品，
转到： www.freescale.com
飞思卡尔半导体公司
功能列表
下面的功能被纳入MC68EN302设备：
现有三大SCC的加以太网络通道的满装
以太网通道完全符合IEEE 802.3规范。
支持数据速率高达10 Mbps 。
支持“ 68302 ”风格的编程模型。
片描述符较低的处理器总线的带宽需求。
独立的128字节FIFO的发送和接收。
自动重传的内部（从而释放处理器总线） 。
接收FIFO的内部自动冲洗过程中的碰撞（从而释放处理器总线） 。
动态总线宽度支持8位器件
无缝的动态内存控制器无需外部总线主控
地址木星支持外部总线主控使用的DRAM控制器
完全的IEEE 1149.1 JTAG标准
144 TQFP封装的高达25 MHz的
飞思卡尔半导体公司...
以太网控制器
以太网控制器包括一个以太网协议的核心，发送和接收FIFO ，以及一个16位的宽
数据/控制接口至68000总线（参见图2）。以太网协议的核心（EPC）的提供
与IEEE 802.3以太网标准兼容。发送和接收FIFO允许自动处理
碰撞和由EPC碰撞的片段，以及它们还为可能遇到的总线等待时间
由DMA通道。独立的DMA信道用于发送和接收数据路径。双端口RAM
用于片上缓冲器描述符。缓冲区描述符的控制（ BDC ）模块更新缓冲区
描述符。控制状态寄存器用于直接控制所有的以太网控制器的块组成。
以太网的特点
不会影响现有的SCC性能
802.3 MAC层支持
兼容68160 EEST （双绞线/ AUI ）
两个专用的以太网DMA通道，发送和接收
全双工（交换）以太网支持
高达10 Mb / s的操作（ 20 Mb / s的全双工）
128字节FIFO的发送和接收
无CPU或总线所需的开销上接收或发送帧的碰撞
64项CAM与哈希选项
128的内部缓冲区描述符
执行取景功能
2
MC68EN302产品信息
摩托罗拉
欲了解更多有关该产品，
转到： www.freescale.com
飞思卡尔半导体公司
模块总线控制器
该MC68EN302模块总线控制器提供基本的接口能力的模块总线，以及基本
系统的责任。模块总线控制器的特点是：
之间的内部68000总线和模块的总线接口。
提供动态总线宽度，使用68302核心的芯片选择逻辑。
处理中断的以太网控制器和DRAM控制器。
总线控制从外部来源，模块总线，以及MC68EN302核心的协调。
国内
飞思卡尔半导体公司...
302总线
MC68EN302
B
U
F
F
E
R
S
国内
68000 BUS
P
A
D
S
外
68000 BUS
模块
公共汽车
调节器
模块总线
以太网和
DRAM控制器
图3. BusStructure
DRAM控制器
提供两个CAS线
提供两个RAS线（两家银行的支持）
标准地址总线DRAM地址复用
可编程至3个等待状态
为100 ns在20 MHz的DRAM零等待状态
80纳秒频率为25 MHz DRAM零等待状态
RAS之前CAS刷新，并在系统复位刷新支持
4
MC68EN302产品信息
摩托罗拉
欲了解更多有关该产品，
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飞思卡尔半导体公司
可编程刷新周期的预充电期间
RAS线是分开的四个芯片选择
刷新隐藏的巴士访问
写保护选项
每家银行的可编程大小从128K字节到8Mbytes
地址23地址0
BLOCKHIT0
地址
复
DRAM地址
BLOCKHIT1
飞思卡尔半导体公司...
地址
解码
AS
UDS
LDS
读/写
CLK
RAS / CAS
GENERATION
AMUX
RAS1 ， RAS0
CAS1 ， CAS0
DRAM_RW
RFRESH
定时器
图4. DRAM控制器
MC68EN302应用
该MC68EN302面向低端路由和桥接应用。它从三个鳞癌
MC68302 ，加上附加的以太网接口给它总共四个串行接口。
由于MC68EN302兼具3的SCC以及一个以太网接口，这将是一种极好的
选择在一个ISDN到以太网路由器。
对远程访问拨号中，所述MC68EN302可以在一个拨号调制解调器，将连接到一个用于
以太网LAN 。
低端桥梁
摩托罗拉
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5
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引入了一个版本众所周知的MC68302集成多协议处理器（ IMP）的同
以太网和DRAM控制器。它被称为MC68EN302 ，并且扩展装置的基础上，一个家庭
MC68302.
该以太网控制器具有一个16位的接口，驻留在68000总线，并提供完整的IEEE 802.3
兼容性。的编程模型是从标准68302编程模型通过。在DRAM
控制器从MC68306产物通过。它得到了增强，支持奇偶校验和外部总线的主人。
该MC68EN302是装在低轮廓144的TQFP 。
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用途
DMA
通道
3定时器
和
另外
特点
打断
调节器
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IEEE 1149.1
68000
MC68000
系统总线
6 DMA
频道
1152字节
双端口
内存
外设
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模块总线
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微码
通讯
调节器
（ RISC）的
其他
串行
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3系列
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调节器
图1. MC68EN302框图
本文件包含有关正在开发中的产品信息。
飞思卡尔
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1995
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现有三大SCC的加以太网络通道的满装
以太网通道完全符合IEEE 802.3规范。
支持数据速率高达10 Mbps 。
支持“ 68302 ”风格的编程模型。
片描述符较低的处理器总线的带宽需求。
独立的128字节FIFO的发送和接收。
自动重传的内部（从而释放处理器总线） 。
接收FIFO的内部自动冲洗过程中的碰撞（从而释放处理器总线） 。
动态总线宽度支持8位器件
无缝的动态内存控制器无需外部总线主控
地址木星支持外部总线主控使用的DRAM控制器
完全的IEEE 1149.1 JTAG标准
144 TQFP封装的高达25 MHz的
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以太网控制器
以太网控制器包括一个以太网协议的核心，发送和接收FIFO ，以及一个16位的宽
数据/控制接口至68000总线（参见图2）。以太网协议的核心（EPC）的提供
与IEEE 802.3以太网标准兼容。发送和接收FIFO允许自动处理
碰撞和由EPC碰撞的片段，以及它们还为可能遇到的总线等待时间
由DMA通道。独立的DMA信道用于发送和接收数据路径。双端口RAM
用于片上缓冲器描述符。缓冲区描述符的控制（ BDC ）模块更新缓冲区
描述符。控制状态寄存器用于直接控制所有的以太网控制器的块组成。
以太网的特点
不会影响现有的SCC性能
802.3 MAC层支持
兼容68160 EEST （双绞线/ AUI ）
两个专用的以太网DMA通道，发送和接收
全双工（交换）以太网支持
高达10 Mb / s的操作（ 20 Mb / s的全双工）
128字节FIFO的发送和接收
无CPU或总线所需的开销上接收或发送帧的碰撞
64项CAM与哈希选项
128的内部缓冲区描述符
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模块总线控制器
该MC68EN302模块总线控制器提供基本的接口能力的模块总线，以及基本
系统的责任。模块总线控制器的特点是：
之间的内部68000总线和模块的总线接口。
提供动态总线宽度，使用68302核心的芯片选择逻辑。
处理中断的以太网控制器和DRAM控制器。
总线控制从外部来源，模块总线，以及MC68EN302核心的协调。
国内
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68000 BUS
P
A
D
S
外
68000 BUS
模块
公共汽车
调节器
模块总线
以太网和
DRAM控制器
图3. BusStructure
DRAM控制器
提供两个CAS线
提供两个RAS线（两家银行的支持）
标准地址总线DRAM地址复用
可编程至3个等待状态
为100 ns在20 MHz的DRAM零等待状态
80纳秒频率为25 MHz DRAM零等待状态
RAS之前CAS刷新，并在系统复位刷新支持
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可编程刷新周期的预充电期间
RAS线是分开的四个芯片选择
刷新隐藏的巴士访问
写保护选项
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地址23地址0
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地址
复
DRAM地址
BLOCKHIT1
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解码
AS
UDS
LDS
读/写
CLK
RAS / CAS
GENERATION
AMUX
RAS1 ， RAS0
CAS1 ， CAS0
DRAM_RW
RFRESH
定时器
图4. DRAM控制器
MC68EN302应用
该MC68EN302面向低端路由和桥接应用。它从三个鳞癌
MC68302 ，加上附加的以太网接口给它总共四个串行接口。
由于MC68EN302兼具3的SCC以及一个以太网接口，这将是一种极好的
选择在一个ISDN到以太网路由器。
对远程访问拨号中，所述MC68EN302可以在一个拨号调制解调器，将连接到一个用于
以太网LAN 。
低端桥梁
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微处理器和内存
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集成多协议处理器，带有以太网
飞思卡尔半导体公司...
摩托罗拉引入了一个版本众所周知的MC68302集成多协议处理器（ IMP）的同
以太网和DRAM控制器。它被称为MC68EN302 ，并且扩展装置的基础上，一个家庭
MC68302.
该以太网控制器具有一个16位的接口，驻留在68000总线，并提供完整的IEEE 802.3
兼容性。的编程模型是从标准68302编程模型通过。在DRAM
控制器从MC68306产物通过。它得到了增强，支持奇偶校验和外部总线的主人。
该MC68EN302是装在低轮廓144的TQFP 。
MC68EN302
MC68302
1常规 -
用途
DMA
通道
3定时器
和
另外
特点
打断
调节器
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IEEE 1149.1
68000
MC68000
系统总线
6 DMA
频道
1152字节
双端口
内存
外设
公共汽车
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调节器
微码
通讯
调节器
（ RISC）的
其他
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频道
DRAM
调节器
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半导体产品信息
MOTOROLA ， 1995年
欲了解更多有关该产品，
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功能列表
下面的功能被纳入MC68EN302设备：
现有三大SCC的加以太网络通道的满装
以太网通道完全符合IEEE 802.3规范。
支持数据速率高达10 Mbps 。
支持“ 68302 ”风格的编程模型。
片描述符较低的处理器总线的带宽需求。
独立的128字节FIFO的发送和接收。
自动重传的内部（从而释放处理器总线） 。
接收FIFO的内部自动冲洗过程中的碰撞（从而释放处理器总线） 。
动态总线宽度支持8位器件
无缝的动态内存控制器无需外部总线主控
地址木星支持外部总线主控使用的DRAM控制器
完全的IEEE 1149.1 JTAG标准
144 TQFP封装的高达25 MHz的
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以太网控制器
以太网控制器包括一个以太网协议的核心，发送和接收FIFO ，以及一个16位的宽
数据/控制接口至68000总线（参见图2）。以太网协议的核心（EPC）的提供
与IEEE 802.3以太网标准兼容。发送和接收FIFO允许自动处理
碰撞和由EPC碰撞的片段，以及它们还为可能遇到的总线等待时间
由DMA通道。独立的DMA信道用于发送和接收数据路径。双端口RAM
用于片上缓冲器描述符。缓冲区描述符的控制（ BDC ）模块更新缓冲区
描述符。控制状态寄存器用于直接控制所有的以太网控制器的块组成。
以太网的特点
不会影响现有的SCC性能
802.3 MAC层支持
兼容68160 EEST （双绞线/ AUI ）
两个专用的以太网DMA通道，发送和接收
全双工（交换）以太网支持
高达10 Mb / s的操作（ 20 Mb / s的全双工）
128字节FIFO的发送和接收
无CPU或总线所需的开销上接收或发送帧的碰撞
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该MC68EN302模块总线控制器提供基本的接口能力的模块总线，以及基本
系统的责任。模块总线控制器的特点是：
之间的内部68000总线和模块的总线接口。
提供动态总线宽度，使用68302核心的芯片选择逻辑。
处理中断的以太网控制器和DRAM控制器。
总线控制从外部来源，模块总线，以及MC68EN302核心的协调。
国内
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B
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P
A
D
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外
68000 BUS
模块
公共汽车
调节器
模块总线
以太网和
DRAM控制器
图3. BusStructure
DRAM控制器
提供两个CAS线
提供两个RAS线（两家银行的支持）
标准地址总线DRAM地址复用
可编程至3个等待状态
为100 ns在20 MHz的DRAM零等待状态
80纳秒频率为25 MHz DRAM零等待状态
RAS之前CAS刷新，并在系统复位刷新支持
4
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可编程刷新周期的预充电期间
RAS线是分开的四个芯片选择
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每家银行的可编程大小从128K字节到8Mbytes
地址23地址0
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地址
复
DRAM地址
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地址
解码
AS
UDS
LDS
读/写
CLK
RAS / CAS
GENERATION
AMUX
RAS1 ， RAS0
CAS1 ， CAS0
DRAM_RW
RFRESH
定时器
图4. DRAM控制器
MC68EN302应用
该MC68EN302面向低端路由和桥接应用。它从三个鳞癌
MC68302 ，加上附加的以太网接口给它总共四个串行接口。
由于MC68EN302兼具3的SCC以及一个以太网接口，这将是一种极好的
选择在一个ISDN到以太网路由器。
对远程访问拨号中，所述MC68EN302可以在一个拨号调制解调器，将连接到一个用于
以太网LAN 。
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