IS24C32-2/3
IS24C64-2/3
65,536位/ 32,768位2线串行
CMOS EEPROM
特点
低功耗CMOS技术
- 待机电流小于2微安（ 5.5V ）
- 读取电流（典型值）小于1mA （ 5.5V ）
- 写电流（典型值）小于3mA （ 5.5V ）
低电压工作
- IS24C64-2 & IS24C32-2 ： VCC = 1.8V至5.5V
- IS24C64-3 & IS24C32-3 ： VCC = 2.5V至5.5V
100千赫（ 1.8V）和400 kHz （ 5V ）的兼容性
硬件数据保护
- 写保护引脚
连续读取功能
过滤输入以抑制噪声
ISSI
8引脚PDIP和8引脚SOIC封装
自写的时间周期自动清除
- 5毫秒@ 2.5V
组织：
- IS24C64-2和IS24C64-3 ： 8192x8
- IS24C32-2和IS24C32-3 ： 4096x8
32字节页写缓冲
两线串行接口
- 双向数据传输协议
高可靠性
- 耐力： 1,000,000次循环
- 数据保存：100年
商业和工业温度范围
初步信息
2000年3月
产品发售概述
部件号
IS24C64-2
IS24C64-3
IS24C32-2
IS24C32-3
电压
1.8V-5.5V
2.5V-5.5V
1.8V-5.5V
2.5V-5.5V
速度
100千赫
400千赫
100千赫
400千赫
待机ICC
< 2 μA
< 2 μA
< 2 μA
< 2 μA
阅读ICC
1毫安
1毫安
1毫安
1毫安
写ICC
3毫安
3毫安
3毫安
3毫安
温度
C，我
C，我
C，我
C，我
描述
该IS24C64-2是1.8V （ 1.8V - 5.5V ） 64K位（ 8192 ×8 ）
电可擦除PROM ， IS24C64-3是2.5V （ 2.5V
5.5V ） 64K位（ 8192 ×8 ），电可擦除PROM ，
IS24C32-2是1.8V （ 1.8V - 5.5V ） 32K位（ 4096 ×8 ）
电可擦除PROM和IS24C32-3为2.5V
（ 2.5V - 5.5V ） 32K位（ 4096 ×8 ），电可擦除
舞会。
该IS24CXX （ IS24C64-2 ， IS24C64-3 ， IS24C32-2和
IS24C32-3 ）家族是一种低成本，低电压的2线
串行EEPROM 。它采用ISSI公司的先进制造
的CMOS EEPROM技术，并提供了一个低功率
和低电压操作。该IS24CXX系列的特性
写保护功能，并提供8引脚DIP和
8引脚SOIC封装。
本文件包含的初步信息数据。 ISSI保留随时更改其产品在任何时候，恕不另行通知，以改进设计和提供合适的
最好的产品。我们假设它可能出现在本出版物中的任何错误不承担任何责任。 版权所有1999年，集成的芯片解决方案，公司
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功能框图
ISSI
高压
发电机，
定时控制&
VCC
8
SDA
SCL
WP
5
7
X
解码器
6
控制
逻辑
从机地址
寄存器&
比较
字地址
计数器
EEPROM
ARRAY
Y
解码器
GND
4
确认
时钟
DI / O
＆ GT ;
NMOS
数据
注册
引脚说明
A0-A2
SDA
SCL
WP
VCC
GND
地址输入
串行地址/数据I / O
串行时钟输入
写保护输入
电源
地
引脚配置
8引脚DIP和SOIC
A0
A1
A2
GND
1
2
3
4
8
7
8
5
VCC
WP
SCL
SDA
SCL
这个输入时钟引脚用于同步数据
传送到从设备。
SDA
在SDA是用来传送地址的双向销
和数据移入和移出器件。 SDA引脚是一个开放的
漏极开路输出，可以是线或与其它漏极开路
或集电极开路输出。 SDA总线
需要
上拉
电阻到Vcc 。
与24C16 。当引脚是硬连接，有多达
8 32K / 64K设备可以在一个单一的总线寻址
系统。当该引脚不硬连接，默认A0，
A1和A2是零..
WP
WP是写保护引脚。如果WP引脚连接到VCC
上半阵变成写保护（读
只） 。当WP接GND或悬空正常的读/
写操作被允许到设备。
A0, A1, A2
时，A0 ，A1和A2分别是器件地址输入
有线或左未连接的硬件兼容性
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设备操作
该IS24CXX系列采用串行通信和
支持双向2线总线传输协议。
ISSI
2线总线
两线总线被定义为一个串行数据线（SDA ）和串行
时钟线（ SCL ） 。该协议定义了发送的数据的任何设备
到SDA总线作为发射器，以及所述接收设备作为
接收器。总线由主器件产生控制
在SCL ，控制总线访问并产生STOP和
启动条件。该IS24CXX是总线上的从器件。
这些位必须与它们对应的硬连线
输入引脚。在A2 ， A1和A0引脚使用内部
专有电路，偏置他们到一个逻辑低状态
如果该引脚被允许浮动。
从机地址的最后一位指定是否读
或写操作将被执行。当此位被设置
为1时，选择了读操作，而当设定为0时，一
被选择的写入动作。
在主机发送一个START条件和
从地址字节，该IS24CXX监视总线和
响应一个应答（ SDA线）时，其
地址匹配的传输从机地址。该
IS24CXX在第九个时钟拉低SDA线
周期，这表明它收到的8位数据。该
IS24CXX然后进行读或写操作
根据R / W位的状态。
总线协议：
当总线空闲数据传输，可以只启动
- 在一次数据传输，数据线必须保持稳定
每当时钟线为高。任何变化
数据线在时钟线为高电平将被解释
作为一个起始或停止条件。
该数据线的状态代表有效数据之后，当
启动条件，数据线是稳定的持续时间
的时钟信号的高电平期间。在数据
SDA线可能会在的低电平期间改变
时钟信号。没有每个数据位对应一个时钟脉冲。每
数据传输开始于一个起始条件和
终止一个停止条件。
写操作
字节写
在字节写模式下，主设备发送启动
条件和从器件地址信息（用R / W
设置为0）到从设备。之后，从器件产生
一个应答，主器件发送两字节的地址是
是要被写入的地址指针
IS24CXX 。接收后，从一个应答
从站，该主站装置发送要写入的数据字节
到地址存储单元。该IS24CXX承认
再一次和法师产生停止条件，
此时，装置开始其内部编程
周期。而这个内循环过程中，该装置
不会响应来自主器件的任何请求。
启动条件
起始条件之前的所有命令的设备
而被定义为高到SDA时低的跳变
SCL为高电平。该IS24CXX监视SDA和SCL
线，不会响应，直到启动条件满足。
停止条件
停止条件定义为从低到高
SDA过渡时， SCL为高电平。所有操作都必须
结束与停止条件。
页写
该IS24CXX能32字节页写操作。
一个页面 - 写开始以相同的方式作为一个字节
写的，但不是终止内部写周期后
第一个数据字被传输时，主设备可以
传输多达31个字节。每接收数据后，
总之， IS24CXX立即与响应
确认在SDA线，以及五个低位数据
字地址位内部递增1 ，而
数据地址的五个高阶位保持
常数。如果主设备要发送超过
32个字，之前发出的停止条件，地址
计数器将“翻身”，而先前写入的数据会
被覆盖。一旦所有的32个字节被接收，并且
STOP状态已发送的法师，内部
编程周期开始。在这点上，所有接收到的数据
被写入到IS24CXX在单个写入循环。所有输入
被禁用，直到内部写周期的完成。
应答
一个成功的数据传输后，每个接收设备是
需要产生一个应答。该确认
器件拉低SDA线。
设备寻址
法师通过发送START开始传输
条件。然后主机发送特定的地址
从设备被请求。从（图5）的地址是8位。
该地址的四个最显著位被固定为
1010的IS24CXX 。
在32K / 64K使用三个器件地址位A2 ， A1 ，
A0允许多达八个在同一总线上的设备。
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应答查询
的输入的无效，可用于利用
典型的写周期时间。一旦停止条件是
发出以指示主机的写操作结束时，该
IS24CXX启动内部写周期。 ACK投票可以
立即启动。这涉及到发卡启动
条件后面的从机地址进行写操作。
如果IS24CXX仍忙于写操作，无
ACK被返回。如果IS24CXX已完成
写操作时，将ACK返回和主机可以
然后继续进行下一个读或写操作。
ISSI
顺序读取
连续读取可以启动无论是作为当前
地址读或随机地址读。后
IS24CXX发送起始字节序列，主设备
现在产生确认，表示它需要
从IS24CXX附加数据。该IS24CXX继续
应答信号接收到输出数据的每个。该
主设备终止连续读操作
拉SDA高（无应答）表示
最后一个数据字被读出，接着为STOP条件。
数据输出是连续的，与从地址的数据
N跟从地址的数据的n + 1，......等等。
地址计数器加一自动，允许
要在连续读取整个存储器的内容
连续读操作。当存储器地址
边界（ 8191为IS24C64-2和IS24C64-3 ; 4095
IS24C32-2和IS24C32-3 ）达到时，地址计数器
“滑过”到地址0 ，并且IS24CXX - 2继续
确认接收的输出数据为每个。 （参考
图10.连续读操作启动了
随机地址读出图）。
读操作
读出操作都在相同的方式启动
WRITE操作，不同的是在该读/写位
从地址被设置为“1”。有三个读
操作选项：当前地址读，随机地址
读和连续读。
当前地址读
该IS24CXX包含一个内部地址计数器
保持最后一个字节的访问的地址，
递增一。例如，如果先前的操作
在读或写操作，给
地址位置n，则内部地址计数器会
增量地址位置N + 1 。当IS24CXX
接收器件寻址字节与读
操作（读/写位设置为“1 ” ）时，它会响应一个
确认并发送存储在8位的数据字
地址位置的n + 1 。主器件不会承认
转移，而是产生一个停止条件和
IS24CXX中止传输。如果“n”为最后一个字节
存储器，然后从位置“0”中的数据将
传输。 （请参考图8，当前地址读
图。 ）
随机访问读
选择性的读操作允许主设备
随机选择一个存储位置为READ
操作。主设备首先执行一个“哑”
通过发送起始条件，从写操作
位置的地址和字地址它希望
读取。在IS24CXX后确认字地址，
主器件重新发送起始条件和
从机地址，此时的R / W位设置为1。该
IS24CXX然后用它的应答信号并发送
数据请求。主器件不发送
承认，而是产生一个停止条件。 （请参阅
图9.随机地址读图）
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图1.典型的系统总线配置
VCC
ISSI
SDA
SCL
主
发射器/
接收器
IS24Cxx
图2.输出应答
从SCL
主
1
8
9
数据输出
从
发射机
t
AA
t
AA
数据输出
从
接收器
确认
图3.启动和停止条件
停止
条件
SDA
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开始
条件
SCL
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