集成
电路
系统公司
ICS85314I-11
L
OW
S
KEW
, 1-
TO
-5
D
。微分
-
TO
-2.5V / 3.3V LVPECL F
ANOUT
B
UFFER
F
EATURES
5差分2.5V / 3.3V LVPECL输出
可选的差分CLKX ， nCLKx输入
CLK0 ， nCLK0和CLK1 ， nCLK1对可以接受
以下差分输入级： LVPECL ， LVDS ， LVHSTL ，
HCSL ， SSTL
最大输出频率： 700MHz的
任何转换单端输入信号为3.3V
LVPECL电平与NCLK输入电阻偏置
输出偏斜： 30PS （最大值）
部分到部分偏斜： 350ps （最大）
传播延迟： 1.8ns （最大值）
RMS相位抖动@ 155.52MHz （ 12kHz的 - 20MHz的） ：
0.05ps （典型值）
LVPECL模工作电压范围：
V
CC
= 2.375V至3.8V ，V
EE
= 0V
-40 ° C至85°C的工作环境温度
可在标准和无铅符合RoHS标准
套餐
G
ENERAL
D
ESCRIPTION
该ICS85314I - 11是一种低偏移，高perfor-
曼斯1至5差分至2.5V / 3.3V LVPECL
HiPerClockS
扇出缓冲器和HiPerClockS的成员
家族高性能时钟解决方案
ICS 。该ICS85314I - 11具有两个可选的昼夜温差
髓鞘时钟输入。在CLK0 ， nCLK0和CLK1 ， nCLK1
对可以接受最标准的差分输入级。该
时钟使能内部同步以消除欠幅脉冲时钟
在异步断言上的输出脉冲/
时钟的无效使能引脚。
IC
S
保证输出部分，以部分偏移特性使
在ICS85314I - 11非常适合那些要求苛刻的应用程序以及
定义的性能和可重复性。
B
LOCK
D
IAGRAM
nCLK_EN
D
Q
CK
CLK0
nCLK0
CLK1
nCLK1
CLK_SEL
Q2
nQ2
Q3
nQ3
Q4
nQ4
P
IN
A
SSIGNMENT
Q0
nQ0
Q1
nQ1
Q2
nQ2
Q3
nQ3
Q4
nQ4
1
2
3
4
5
6
7
8
9
10
20
19
18
17
16
15
14
13
12
11
V
CC
nCLK_EN
V
CC
nCLK1
CLK1
版权所有
nCLK0
CLK0
CLK_SEL
V
EE
0
0
1
1
Q0
nQ0
Q1
nQ1
ICS85314I-11
20引脚TSSOP
6.5毫米X 4.4毫米X 0.92毫米包体
G封装
顶视图
ICS85314I-11
20引脚SOIC
7.5毫米X 12.8毫米X 2.3毫米包主体
男包
顶视图
85314AGI-11
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1
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集成
电路
系统公司
ICS85314I-11
L
OW
S
KEW
, 1-
TO
-5
D
。微分
-
TO
-2.5V / 3.3V LVPECL F
ANOUT
B
UFFER
TYPE
描述
差分输出对。 LVPECL接口电平。
差分输出对。 LVPECL接口电平。
差分输出对。 LVPECL接口电平。
差分输出对。 LVPECL接口电平。
差分输出对。 LVPECL接口电平。
负电源引脚。
时钟选择输入。当HIGH ，选择CLK1 ， nCLK1投入。
下拉低电平时，选择CLK0 ， nCLK0投入。
LVTTL / LVCMOS接口电平。
下拉非INVER婷差分时钟输入。
上拉
INVER婷差分时钟输入。
不要连接。
输入
输入
下拉非INVER婷差分时钟输入。
上拉
INVER婷差分时钟输入。
T
ABLE
1. P
IN
D
ESCRIPTIONS
数
1, 2
3, 4
5, 6
7, 8
9 , 10
11
12
13
14
15
16
17
18, 20
名字
Q0 ， nQ0
Q1 ， NQ1
Q2 ， NQ2
Q3 ， nQ3
Q4 ， nQ4
V
EE
CLK_SEL
CLK0
nCLK0
版权所有
CLK1
nCLK1
V
CC
产量
产量
产量
产量
产量
动力
输入
输入
输入
正电源引脚。
同步时钟使能。低电平时，时钟输出时钟跟随
19
nCLK_EN
输入
下拉输入。高时，Q输出被强制低， NQ输出被强制
高。 LVTTL / LVCMOS接口电平。
注意：
上拉和下拉
是指内部输入电阻。见表2 ，引脚特性，为典型值。
动力
T
ABLE
2. P
IN
C
极特
符号
C
IN
R
上拉
R
下拉
参数
输入电容
输入上拉电阻
输入下拉电阻
测试条件
最低
典型
4
51
51
最大
单位
pF
kΩ
kΩ
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L
OW
S
KEW
, 1-
TO
-5
D
。微分
-
TO
-2.5V / 3.3V LVPECL F
ANOUT
B
UFFER
输入
输出
选定的源
CLK0 ， nCLK0
CLK1 ， nCLK1
CLK0 ， nCLK0
Q0:Q4
启用
启用
残疾人;低
nQ0 ： nQ4
启用
启用
残疾人; HIGH
T
ABLE
3A 。
ONTROL
I
NPUT
F
油膏
T
ABLE
nCLK_EN
0
0
1
CLK_SEL
0
1
0
1
1
CLK1 ， nCLK1
残疾人;低
残疾人; HIGH
nCLK_EN开关后，时钟输出被禁用或启用之后下降的输入时钟边沿
如图1中所示。
在主动模式下，输出的状态是CLK0 ， nCLK0和CLK1 ， nCLK1输入的函数
如表3B中所述。
残
启用
nCLK0 ， nCLK1
CLK0 ， CLK1
nCLK_EN
nQ0 ： nQ4
Q0:Q4
F
IGURE
1. nCLK_EN牛逼
即时通信
D
IAGRAM
T
ABLE
3B 。
LOCK
I
NPUT
F
油膏
T
ABLE
输入
CLK0或CLK1
0
1
nCLK0或nCLK1
1
0
Q0:Q4
低
高
输出
nQ0 ： nQ4
高
低
输入到输出模式
差分至差分
差分至差分
极性
非铟（Inver）婷
非铟（Inver）婷
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L
OW
S
KEW
, 1-
TO
-5
D
。微分
-
TO
-2.5V / 3.3V LVPECL F
ANOUT
B
UFFER
4.6V
-0.5V到V
CC
+ 0.5 V
50mA
100mA
73.2 ℃/ W（ 0 LFPM ）
-65 ℃150 ℃的
注：如果运行条件超出绝对下上市
最大额定值可能会造成永久性损坏
装置。这些评价只强调规范。实用
产物在这些条件下或在任何条件操作BE-
彼处那些在上市
DC特性
or
AC Character-
istics
是不是暗示。暴露在绝对最大额定值
长时间条件可能会影响产品的可靠性。
A
BSOLUTE
M
AXIMUM
R
ATINGS
电源电压，V
CC
输入，V
I
输出，我
O
连续电流
浪涌电流
封装的热阻抗，
θ
JA
贮藏温度，T
英镑
T
ABLE
4A 。 P
OWER
S
UPPLY
DC
极特
,
V
CC
= 2.375V
TO
3.8V, V
EE
= 0V ，T
A
= -40°C
TO
85°C
符号
V
CC
I
EE
参数
电源电压
电源电流
测试条件
最低
2.375
典型
3.3
最大
3.8
80
单位
V
mA
T
ABLE
4B 。 LVCMOS / LVTTL DC
极特
,
V
CC
= 2.375V
TO
3.8V, V
EE
= 0V ，T
A
= -40°C
TO
85°C
符号
V
IH
V
IL
I
IH
I
IL
参数
输入高电压
输入低电压
输入高电流
输入低电平电流
nCLK_EN ， CLK_SEL
nCLK_EN ， CLK_SEL
CLK_SEL ， nCLK_EN
CLK_SEL ， nCLK_EN
V
IN
= V
CC
= 3.8V
V
CC
= 3.8V, V
IN
= 0V
-5
测试条件
最低
2
-0.3
典型
最大
V
CC
+ 0.3
0.8
150
单位
V
V
A
A
T
ABLE
4C 。
。微分
DC
极特
,
V
CC
= 2.375V
TO
3.8V, V
EE
= 0V ，T
A
= -40°C
TO
85°C
符号
I
IH
I
IL
V
PP
参数
输入高电流
输入低电平电流
nCLK0 ， nCLK1
CLK0 ， CLK1
nCLK0 ， nCLK1
CLK0 ， CLK1
测试条件
V
CC
= V
IN
= 3.8V
V
CC
= V
IN
= 3.8V
V
CC
= 3.8V, V
IN
= 0V
V
CC
= 3.8V, V
IN
= 0V
-150
-5
1.3
V
CC
- 0.85
最低
典型
最大
150
150
单位
A
A
A
A
V
V
峰 - 峰值输入电压
0.15
共模输入电压;
0.5
V
CMR
注1,2
注1 ：对于单端应用程序的最大输入电压为CLKX ， nCLKx为V
CC
+ 0.3V.
注2 ：共模电压定义为V
IH
.
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S
KEW
, 1-
TO
-5
D
。微分
-
TO
-2.5V / 3.3V LVPECL F
ANOUT
B
UFFER
测试条件
最低
V
CC
- 1.4
V
CC
- 2.0
0.6
典型
最大
V
CC
- 0.9
V
CC
- 1.7
1.0
单位
V
V
V
T
ABLE
4D 。 LVPECL DC
极特
,
V
CC
= 2.375V
TO
3.8V, V
EE
= 0V ，T
A
= -40°C
TO
85°C
符号参数
V
OH
V
OL
V
摇摆
输出高电压;注1
输出低电压;注1
峰至峰输出电压摆幅
注1 ：输出端接50
Ω
到V
CC
- 2V.
T
ABLE
5. AC - C
极特
,
V
CC
= 2.375V
TO
3.8V, V
EE
= 0V ，T
A
= -40°C
TO
85°C
符号参数
f
最大
tp
LH
t
SK （ O）
tjit （O）
t
SK （PP）的
t
S
t
H
t
R
/ t
F
输出频率
传输延迟，从低到高;
注1
输出偏斜;注2： 5
RMS相位抖动（随机） ;
注4
帕吨至帕吨倾斜;注3 ， 5
建立时间
保持时间
输出上升/下降时间
测试条件
最低
典型
最大
700
≤ 700MHz的
1.0
1.4
1.8
30
积分范围：
（ 12kHz的 - 为20MHz ）
nCLK_EN到CLK
nCLK_EN到CLK
20 ％至80％
50
50
200
700
55
0.05
350
单位
兆赫
ns
ps
ps
ps
ps
ps
ps
ps
ODC
输出占空比
≤ 700MHz的
45
在f测量所有参数
最大
除非另有说明。
的周期到周期抖动的输入将等于抖动的输出。票面T不加抖动
注1 ：从差动输入交叉点到差动输出交叉点测定。
注2 ：定义为输出之间的偏移，在相同的电源电压，并以相等的负载条件。
测得的输出差分交叉点。
注3 ：定义为扭曲在不同的设备输出，在相同的电源电压下工作的
并且以相同的负载条件。使用同一类型的每个设备上的输入，输出被测量
在差分交叉点。
注4 ：请参考相位噪声图。
注5 ：此参数定义符合JEDEC标准65 。
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L
OW
S
KEW
, 1-
TO
-5
D
。微分
-
TO
-2.5V / 3.3V LVPECL F
ANOUT
B
UFFER
F
EATURES
5差分2.5V / 3.3V LVPECL输出
可选的差分CLKX ， nCLKx输入
CLK0 ， nCLK0和CLK1 ， nCLK1对可以接受
以下差分输入级： LVPECL ， LVDS ， LVHSTL ，
HCSL ， SSTL
最大输出频率： 700MHz的
任何转换单端输入信号为3.3V
LVPECL电平与NCLK输入电阻偏置
输出偏斜： 30PS （最大值）
部分到部分偏斜： 350ps （最大）
传播延迟： 1.8ns （最大值）
RMS相位抖动@ 155.52MHz （ 12kHz的 - 20MHz的） ：
0.05ps （典型值）
LVPECL模工作电压范围：
V
CC
= 2.375V至3.8V ，V
EE
= 0V
-40 ° C至85°C的工作环境温度
可在标准和无铅符合RoHS标准
套餐
G
ENERAL
D
ESCRIPTION
该ICS85314I - 11是一种低偏移，高perfor-
曼斯1至5差分至2.5V / 3.3V LVPECL
HiPerClockS
扇出缓冲器和HiPerClockS的成员
家族高性能时钟解决方案
ICS 。该ICS85314I - 11具有两个可选的昼夜温差
髓鞘时钟输入。在CLK0 ， nCLK0和CLK1 ， nCLK1
对可以接受最标准的差分输入级。该
时钟使能内部同步以消除欠幅脉冲时钟
在异步断言上的输出脉冲/
时钟的无效使能引脚。
IC
S
保证输出部分，以部分偏移特性使
在ICS85314I - 11非常适合那些要求苛刻的应用程序以及
定义的性能和可重复性。
B
LOCK
D
IAGRAM
nCLK_EN
D
Q
CK
CLK0
nCLK0
CLK1
nCLK1
CLK_SEL
Q2
nQ2
Q3
nQ3
Q4
nQ4
P
IN
A
SSIGNMENT
Q0
nQ0
Q1
nQ1
Q2
nQ2
Q3
nQ3
Q4
nQ4
1
2
3
4
5
6
7
8
9
10
20
19
18
17
16
15
14
13
12
11
V
CC
nCLK_EN
V
CC
nCLK1
CLK1
版权所有
nCLK0
CLK0
CLK_SEL
V
EE
0
0
1
1
Q0
nQ0
Q1
nQ1
ICS85314I-11
20引脚TSSOP
6.5毫米X 4.4毫米X 0.92毫米包体
G封装
顶视图
ICS85314I-11
20引脚SOIC
7.5毫米X 12.8毫米X 2.3毫米包主体
男包
顶视图
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L
OW
S
KEW
, 1-
TO
-5
D
。微分
-
TO
-2.5V / 3.3V LVPECL F
ANOUT
B
UFFER
TYPE
描述
差分输出对。 LVPECL接口电平。
差分输出对。 LVPECL接口电平。
差分输出对。 LVPECL接口电平。
差分输出对。 LVPECL接口电平。
差分输出对。 LVPECL接口电平。
负电源引脚。
时钟选择输入。当HIGH ，选择CLK1 ， nCLK1投入。
下拉低电平时，选择CLK0 ， nCLK0投入。
LVTTL / LVCMOS接口电平。
下拉非INVER婷差分时钟输入。
上拉
INVER婷差分时钟输入。
不要连接。
输入
输入
下拉非INVER婷差分时钟输入。
上拉
INVER婷差分时钟输入。
T
ABLE
1. P
IN
D
ESCRIPTIONS
数
1, 2
3, 4
5, 6
7, 8
9 , 10
11
12
13
14
15
16
17
18, 20
名字
Q0 ， nQ0
Q1 ， NQ1
Q2 ， NQ2
Q3 ， nQ3
Q4 ， nQ4
V
EE
CLK_SEL
CLK0
nCLK0
版权所有
CLK1
nCLK1
V
CC
产量
产量
产量
产量
产量
动力
输入
输入
输入
正电源引脚。
同步时钟使能。低电平时，时钟输出时钟跟随
19
nCLK_EN
输入
下拉输入。高时，Q输出被强制低， NQ输出被强制
高。 LVTTL / LVCMOS接口电平。
注意：
上拉和下拉
是指内部输入电阻。见表2 ，引脚特性，为典型值。
动力
T
ABLE
2. P
IN
C
极特
符号
C
IN
R
上拉
R
下拉
参数
输入电容
输入上拉电阻
输入下拉电阻
测试条件
最低
典型
4
51
51
最大
单位
pF
kΩ
kΩ
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L
OW
S
KEW
, 1-
TO
-5
D
。微分
-
TO
-2.5V / 3.3V LVPECL F
ANOUT
B
UFFER
输入
输出
选定的源
CLK0 ， nCLK0
CLK1 ， nCLK1
CLK0 ， nCLK0
Q0:Q4
启用
启用
残疾人;低
nQ0 ： nQ4
启用
启用
残疾人; HIGH
T
ABLE
3A 。
ONTROL
I
NPUT
F
油膏
T
ABLE
nCLK_EN
0
0
1
CLK_SEL
0
1
0
1
1
CLK1 ， nCLK1
残疾人;低
残疾人; HIGH
nCLK_EN开关后，时钟输出被禁用或启用之后下降的输入时钟边沿
如图1中所示。
在主动模式下，输出的状态是CLK0 ， nCLK0和CLK1 ， nCLK1输入的函数
如表3B中所述。
残
启用
nCLK0 ， nCLK1
CLK0 ， CLK1
nCLK_EN
nQ0 ： nQ4
Q0:Q4
F
IGURE
1. nCLK_EN牛逼
即时通信
D
IAGRAM
T
ABLE
3B 。
LOCK
I
NPUT
F
油膏
T
ABLE
输入
CLK0或CLK1
0
1
nCLK0或nCLK1
1
0
Q0:Q4
低
高
输出
nQ0 ： nQ4
高
低
输入到输出模式
差分至差分
差分至差分
极性
非铟（Inver）婷
非铟（Inver）婷
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OW
S
KEW
, 1-
TO
-5
D
。微分
-
TO
-2.5V / 3.3V LVPECL F
ANOUT
B
UFFER
4.6V
-0.5V到V
CC
+ 0.5 V
50mA
100mA
73.2 ℃/ W（ 0 LFPM ）
-65 ℃150 ℃的
注：如果运行条件超出绝对下上市
最大额定值可能会造成永久性损坏
装置。这些评价只强调规范。实用
产物在这些条件下或在任何条件操作BE-
彼处那些在上市
DC特性
or
AC Character-
istics
是不是暗示。暴露在绝对最大额定值
长时间条件可能会影响产品的可靠性。
A
BSOLUTE
M
AXIMUM
R
ATINGS
电源电压，V
CC
输入，V
I
输出，我
O
连续电流
浪涌电流
封装的热阻抗，
θ
JA
贮藏温度，T
英镑
T
ABLE
4A 。 P
OWER
S
UPPLY
DC
极特
,
V
CC
= 2.375V
TO
3.8V, V
EE
= 0V ，T
A
= -40°C
TO
85°C
符号
V
CC
I
EE
参数
电源电压
电源电流
测试条件
最低
2.375
典型
3.3
最大
3.8
80
单位
V
mA
T
ABLE
4B 。 LVCMOS / LVTTL DC
极特
,
V
CC
= 2.375V
TO
3.8V, V
EE
= 0V ，T
A
= -40°C
TO
85°C
符号
V
IH
V
IL
I
IH
I
IL
参数
输入高电压
输入低电压
输入高电流
输入低电平电流
nCLK_EN ， CLK_SEL
nCLK_EN ， CLK_SEL
CLK_SEL ， nCLK_EN
CLK_SEL ， nCLK_EN
V
IN
= V
CC
= 3.8V
V
CC
= 3.8V, V
IN
= 0V
-5
测试条件
最低
2
-0.3
典型
最大
V
CC
+ 0.3
0.8
150
单位
V
V
A
A
T
ABLE
4C 。
。微分
DC
极特
,
V
CC
= 2.375V
TO
3.8V, V
EE
= 0V ，T
A
= -40°C
TO
85°C
符号
I
IH
I
IL
V
PP
参数
输入高电流
输入低电平电流
nCLK0 ， nCLK1
CLK0 ， CLK1
nCLK0 ， nCLK1
CLK0 ， CLK1
测试条件
V
CC
= V
IN
= 3.8V
V
CC
= V
IN
= 3.8V
V
CC
= 3.8V, V
IN
= 0V
V
CC
= 3.8V, V
IN
= 0V
-150
-5
1.3
V
CC
- 0.85
最低
典型
最大
150
150
单位
A
A
A
A
V
V
峰 - 峰值输入电压
0.15
共模输入电压;
0.5
V
CMR
注1,2
注1 ：对于单端应用程序的最大输入电压为CLKX ， nCLKx为V
CC
+ 0.3V.
注2 ：共模电压定义为V
IH
.
85314AGI-11
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4
REV 。 2005年5月24日
集成
电路
系统公司
ICS85314I-11
L
OW
S
KEW
, 1-
TO
-5
D
。微分
-
TO
-2.5V / 3.3V LVPECL F
ANOUT
B
UFFER
测试条件
最低
V
CC
- 1.4
V
CC
- 2.0
0.6
典型
最大
V
CC
- 0.9
V
CC
- 1.7
1.0
单位
V
V
V
T
ABLE
4D 。 LVPECL DC
极特
,
V
CC
= 2.375V
TO
3.8V, V
EE
= 0V ，T
A
= -40°C
TO
85°C
符号参数
V
OH
V
OL
V
摇摆
输出高电压;注1
输出低电压;注1
峰至峰输出电压摆幅
注1 ：输出端接50
Ω
到V
CC
- 2V.
T
ABLE
5. AC - C
极特
,
V
CC
= 2.375V
TO
3.8V, V
EE
= 0V ，T
A
= -40°C
TO
85°C
符号参数
f
最大
tp
LH
t
SK （ O）
tjit （O）
t
SK （PP）的
t
S
t
H
t
R
/ t
F
输出频率
传输延迟，从低到高;
注1
输出偏斜;注2： 5
RMS相位抖动（随机） ;
注4
帕吨至帕吨倾斜;注3 ， 5
建立时间
保持时间
输出上升/下降时间
测试条件
最低
典型
最大
700
≤ 700MHz的
1.0
1.4
1.8
30
积分范围：
（ 12kHz的 - 为20MHz ）
nCLK_EN到CLK
nCLK_EN到CLK
20 ％至80％
50
50
200
700
55
0.05
350
单位
兆赫
ns
ps
ps
ps
ps
ps
ps
ps
ODC
输出占空比
≤ 700MHz的
45
在f测量所有参数
最大
除非另有说明。
的周期到周期抖动的输入将等于抖动的输出。票面T不加抖动
注1 ：从差动输入交叉点到差动输出交叉点测定。
注2 ：定义为输出之间的偏移，在相同的电源电压，并以相等的负载条件。
测得的输出差分交叉点。
注3 ：定义为扭曲在不同的设备输出，在相同的电源电压下工作的
并且以相同的负载条件。使用同一类型的每个设备上的输入，输出被测量
在差分交叉点。
注4 ：请参考相位噪声图。
注5 ：此参数定义符合JEDEC标准65 。
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