集成
电路
系统公司
ICS8431-01
200MH
Z
, L
OW
J
伊特尔
,
LVPECL F
Characteristic低频
S
YNTHESIZER
F
EATURES
完全集成的PLL
差分LVPECL 3.3V输出
200MHz的输出频率
48 ％至52 ％的占空比
晶体振荡器接口
扩频时钟（ SSC）固定在1 /2％调制
适用于需要超低电磁干扰的环境中。 Typical10dB EMI
还原反应可以用扩频调制来实现
LVTTL / LVCMOS控制输入
PLL旁路模式，支持在线检测和片上
功能块特性
28引脚SOIC
2PS的RMS周期到周期抖动
18ps的典型周期到周期抖动
0°至85℃ ambiant工作温度
G
ENERAL
D
ESCRIPTION
该ICS8431-01是一种通用的时钟
频率合成器的IA64 / 32应用程序和
HiPerClockS
在HiPerClockS 系列高成员
从ICS性能的时钟解决方案。该
ICS8431-01由一个独立的小
带宽PLL时间通道。一个16.666MHz晶振用于
作为输入到芯片上的振荡器。 M个被配置成
产生200MHz的固定输出频率。
,&6
的ICS8431-01支持四个可编程功能
的工作模式。这四种模式被扩频
时钟（SSC ），非扩频时钟和2测试
标签：这是由SSC_CTL [0 1]的控制模式。非
像其他的合成器，该ICS8431-01可以马上
改变扩频操作，而不必重新设置
该设备。
在SSC的模式中，输出时钟被调制，以
实现在电磁干扰的减小。在PLL旁路测试中的一个
模式时，PLL被断开作为源到
差分输出允许外部源是
connnected到TEST_I / O引脚。这是为IN-有用
电路测试并允许差分输出来驱动
在整个系统中的时钟树中的一个较低的频率。在
其他的PLL旁路模式时，振荡器分频器用作
源都M和的F out除以2，这是非常有用的
用于表征振荡器和内部隔断。
B
LOCK
D
IAGRAM
XTAL1
OSC
XTAL2
÷
16
P
IN
A
SSIGNMENT
nc
nc
nc
nc
nc
nc
nc
nc
nc
SSC_CTL0
SSC_CTL1
VEE
TEST_I / O
VDD
1
2
3
4
5
6
7
8
9
10
11
12
13
14
28
27
26
25
24
23
22
21
20
19
18
17
16
15
nc
VDDI
XTAL2
XTAL1
nc
nc
VDDA
VEE
版权所有
nc
VDDO
FOUT
NFOUT
VEE
PLL
相
探测器
VCO
÷
M
÷
2
FOUT
NFOUT
TEST_I / O
SSC_CTL0
SSC_CTL1
SSC
控制
逻辑
ICS8431-01
28引脚SOIC
男包
顶视图
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1
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电路
系统公司
ICS8431-01
200MH
Z
, L
OW
J
伊特尔
,
LVPECL F
Characteristic低频
S
YNTHESIZER
TYPE
未使用
输入
动力
输入/
产量
动力
动力
产量
动力
储备
动力
动力
输入
动力
上拉
描述
未使用的引脚。
SSC控制引脚。 LVTTL / LVCMOS接口电平。
接地引脚的核心和测试输出。
如表3中的功能表中定义编程..
电源引脚核心和测试输出。
接地引脚输出。
这些差分输出主要输出驱动器的合成。
它们与封端的正参考的LVPECL兼容
逻辑。
电源引脚输出。
储销。
接地引脚。
PLL电源引脚。
晶体振荡器的输入。
输入和核心供电引脚。连接到3.3V 。
T
ABLE
1. P
IN
D
ESCRIPTIONS
数
1-9, 19,
23, 24, 28
10, 11
12
13
14, 27
15
16, 17
18
20
21
22
25, 26
27
名字
nc
SSC_CTL0,
SSC_CTL1
GND
TEST_ I / O
VDD
GND
nFOUT ， FOUT
VDDO
版权所有
VEE
VDDA
XTAL1 ， XTAL2
VDDI
T
ABLE
2. P
IN
C
极特
符号
CIN
RPULLUP
RPULLDOWN
参数
输入引脚电容
输入上拉电阻
输入下拉电阻
51
51
测试条件
最低
典型
最大
4
单位
pF
K
K
T
ABLE
3. SSC
ONTROL
I
NPUTS
F
油膏
T
ABLE
输入
SSC_CTL1 SSC_CTL0
0
0
1
1
0
1
0
1
TEST_I / O
来源
国内
PLL
外
PLL
SSC
残
启用
残
残
输出
FOUT ，
TEST_I / O
NFOUT
值为fXTAL
÷
16
值为fXTAL
÷
32
÷
M
200MHz
高阻
TEST CLK
200MHz
输入
高阻
操作模式
PLL旁路;振荡器，振荡器， M和N
分频器测试模式。注1
Default SSC; Modulation Factor = ½ Percent
诊断模式;注1
(1MHz
≤
TEST CLK
≤
200MHz)
无SSC调制
注1 ：在内部调试和表征用途。
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ICS8431-01
200MH
Z
, L
OW
J
伊特尔
,
LVPECL F
Characteristic低频
S
YNTHESIZER
4.6V
-0.5V到VDD + 0.5V
-0.5V至VDDO + 0.5V
0 ° C至85°C
-65 ℃150 ℃的
A
BSOLUTE
M
AXIMUM
R
ATINGS
电源电压
输入
输出
工作环境温度
储存温度
超出上述绝对最大额定值强调可能会造成永久性损坏设备。这些评级
只强调规范和产品在这些条件下的功能操作或超出所列任何条件
该
DC特性
or
AC特性
是不是暗示。暴露在绝对最大额定值条件下工作
期间可能会影响产品的可靠性。
T
ABLE
4A 。 P
OWER
S
UPPLY
DC
极特
,
VDD = VDDA = VDDI = VDDO = 3.3V ± 5 ％ ，T
A
= 0°C
TO
85°C
符号
VDD
VDDO
VDDA
VDDI
IEE
参数
电源电压
输出电源电压
模拟电源电压
输入电源电压
测试条件
最低
3.135
3.135
3.135
3.135
典型
3.3
3.3
3.3
3.3
最大
3.465
3.465
3.465
3.465
140
单位
V
V
V
V
mA
T
ABLE
4B 。 LVCMOS / LVTTL DC
极特
,
VDD = VDDA = VDDI = VDDO = 3.3V ± 5 ％ ，T
A
= 0°C
TO
85°C
符号
VIH
参数
输入高电压
SSC_CTL0,
SSC_CTL1,
TEST_I / O
SSC_CTL0,
SSC_CTL1,
TEST_I / O
SSC_CTL0,
SSC_CTL1,
test_io
SSC_CTL0,
SSC_CTL1,
test_io
测试条件
3.135V
≤
VDD
≤
3.465V
3.135V
≤
VDD
≤
3.465V
最低
2
典型
最大
VDD + 0.3
单位
V
VIL
输入低电压
-0.3
0.8
V
IIH
输入高电流
VDD = VIN = 3.465V
5
A
IIL
输入低电平电流
VDD = 3.465V ， VIN = 0V
-150
A
T
ABLE
4C 。 LVPECL DC
极特
,
VDD = VDDA = VDDI = VDDO = 3.3V ± 5 ％ ，T
A
= 0°C
TO
85°C
符号
VOH
VOL
参数
输出高电压;注1
输出低电压;注1
测试条件
最低
VDDO - 1.28
VDDO - 2.0
600
700
典型
最大
VDDO - 0.980
VDDO - 1.7
850
单位
V
V
mV
VSWING峰峰值输出电压摆幅
注1 ：输出端接50
以VDDO - 2V 。
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Z
, L
OW
J
伊特尔
,
LVPECL F
Characteristic低频
S
YNTHESIZER
测试条件
最低
典型
16.666
-50
-100
+50
+100
100
50
3
10
3
0
每年@ 25℃
-5
18
7
32
7
70
+5
最大
单位
兆赫
PPM
PPM
W
pF
pF
nH
°C
PPM
T
ABLE
5. C
RYSTAL
C
极特
参数
振荡模式
频率
频率容差
频率稳定度
驱动电平
等效串联电阻（ESR ）
分流Capacitiance
负载Capacitiance
系列引脚电感
工作温度范围
老化
基本
T
ABLE
6. AC - C
极特
,
VDD = VDDA = VDDI = VDDO = 3.3V ± 5 ％ ，T
A
= 0°C
TO
85°C ， 16.666MH
Z
C
RYSTAL
符号
TPERIOD
参数
平均输出周期;注2：
周期到周期抖动;注2：
输出占空比;注2：
输出上升时间;注： 1 ， 2
输出下降时间;注： 1 ， 2
铬石英晶体输入范围
SSC调制频率;
注1,2
SSC调制系数;
注1,2
光谱还原;注： 1 ， 2
测试条件
FOUT = 200 MHz的
FOUT = 200 MHz的
FOUT = 200 MHz的
20 ％至80％
20 ％至80％
48
300
300
14
30
0.4
7
10
10
450
450
16.666
最低
4995
18
典型
最大
5005
30
52
600
600
18
33.33
0.6
单位
ps
ps
%
ps
ps
兆赫
千赫
%
dB
ms
t
它（ CC）
ODC
tR
tF
值为fXTAL
Fm
FMF
SSCred
tstable
上电到稳定的时钟输出
注1 ：扩频时钟启用。
注2 ：输出端接50
以VDDO - 2V 。
t
JIT （ CC ） ， TR ，TF ， ODC符合JEDEC JESD65定义。
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电路
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200MH
Z
, L
OW
J
伊特尔
,
LVPECL F
Characteristic低频
S
YNTHESIZER
P
ARAMETER
M
EASUREMENT
I
载文信息
80%
80%
VSWING
20%
时钟输入
和产出
20%
t
上升
和
t
秋天
F
IGURE
1 — I
NPUT
X_CLK ， 1X_FOUT
O
安输出
S
LEW
R
ATES
nX_CLK ， n1X_FOUT
t
周期
n
t
周期
n+1
t
JIT （ CC ） =
t
周期n -
t
周期n + 1个
F
IGURE
2 — C
YCLE
-
TO
-C
YCLE
J
伊特尔
nX_CLK ， n1X_FOUT
X_CLK ， 1X_FOUT
脉冲宽度（
t
PW ）
t
期
ODC =
t
pw
t
期
F
IGURE
3 - ODC &
t
期
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