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位置：首页 > IC型号导航 > 首字符D型号页 > 首字符D的型号第170页 > DS80C400
DS80C400
网络微控制器
www.maxim-ic.com
概述
在DS80C400网络微控制器提供了最高
集成的8051器件。外设包括：
一个10/100以太网MAC ，三个串行端口，一个CAN 2.0B
控制器， 1 -Wire主机和64个I / O引脚。
以允许访问的网络中，一个完整的应用程序 -
提供访问的TCP IPv4 / 6网络栈和操作系统
在ROM中。网络堆栈最多支持32个并发
TCP连接，并且能够通过转移到5Mbps的
以太网MAC 。其最大的系统时钟频率
75MHz的结果仅有54ns的最小指令周期。
获得大的程序或数据存储区是
简化支持多达24位寻址方案
以连续内存16MB 。
为了加速微控制器之间的数据传输
记忆中， DS80C400提供了四个数据指针，
每一个都可以被配置为自动递增
或者在执行某些数据指针相关的减
指令。在DS80C400的硬件数学加速器
进一步增加的32位和16位的速度乘
和除法运算以及高速移位，
归一化和累加功能。
该
高速微控制器用户指南
和
快速
微控制器用户指南： DS80C400补充
应
在此数据表结合使用。
在同时下载：
www.maxim-ic.com/microcontrollers 。
特点
§
高性能架构
仅有54ns单8051个指令周期
DC至75MHz的时钟速率
平16MB地址空间
四个数据指针，可自动递增/
递减和选择加速数据移动
16位/ 32位算术加速器
多层次的网络和I / O
10/100以太网媒体访问控制器（MAC）
CAN 2.0B控制器
1 - Wire网络控制器
三个全双工硬件串行端口
多达8个双向8位端口（64位I / O
销）
坚固的ROM固件
支持以太网网络引导使用DHCP
和TFTP
全，应用访问的TCP / IP网络协议栈
支持IPv4和IPv6
实现UDP ， TCP ， DHCP ， ICMP和IGMP
基于优先级抢占式任务调度
MAC地址可以任选地被从IEEE-后天
注册的DS2502 -E48
10/100以太网MAC
灵活的IEEE 802.3 MII （个10 / 100Mbps ）和ENDEC
（ 10Mbps的）接口允许选择的PHY
低功耗工作
超低功耗的睡眠模式与魔包
和唤醒帧检测
8kB片的Tx / Rx包数据存储器，带有缓冲
控制单元，减轻CPU负荷
半双工或全双工操作与流程控制
多播/广播地址过滤VLAN
支持
全功能的CAN 2.0B控制器
15信息中心
支持标准（ 11位）和扩展（ 29位）
标识和全球掩膜
媒体字节过滤，支持DeviceNet ，SDS和
高层CAN协议
自动波特率模式和SIESTA低功耗模式
完备的主系统逻辑
16个中断源，6个外部
4个16位定时器/计数器
2倍/ 4倍时钟倍频器降低电磁
干扰（EMI）的
可编程看门狗定时器
振荡器失效检测
可编程时钟的IrDA
§
§
§
应用
工业控制/自动化
环境监测
网络传感器
自动售货机
家庭/办公自动化
交易/支付
码头
数据转换器（串行 -
以太网， CAN-用于─
以太网）
远程数据采集
设备
§
订购信息
部分
DS80C400-FNY
§
PIN的
包
100 LQFP
温度范围
-40 ° C至+ 85°C
最大时钟
速度
75MHz
1 - Wire是Dallas Semiconductor的注册商标。
魔包是Advanced Micro Devices公司的商标。
DeviceNet是开放设备网络供应商协会， Inc.的商标。
产品特点继续第32页。
引脚配置在数据资料的最后。
注意：
该器件的一些修订可能偏离称为勘误表公布的规格。任何器件的多个版本
可能同时获得通过不同的销售渠道。欲了解器件勘误表的信息，请点击这里：
www.maxim-ic.com/errata 。
1 96
REV ： 102103
DS80C400网络微控制器
绝对最大额定值
对任何输入引脚相电压范围对地
在任何输出引脚相电压范围对地
在V电压范围
CC3
相对于地
在V电压范围
CC1
相对于地
工作温度范围
结温
存储温度范围
焊接温度
-0.5V至+ 5.5V
-0.5V至（Ⅴ
CC3
+ 0.5)V
-0.5V至+ 3.6V
-0.3V至+ 2.0V
-40 ° C至+ 85°C
+ 150 ° C最大
-55 ° C至+ 160°C
见IPC / JEDEC J- STD- 020A
超出“绝对最大额定值”，强调可能会造成永久性损坏设备。这些压力额定值只，
并且该设备在这些或超出了规范的业务部门所标明的任何其他条件的功能操作
不是暗示。暴露在绝对最大额定值条件下工作会影响器件的可靠性。
DC电气特性（注1 ）
(V
CC3
= 3.0V至3.6V ，V
CC1
= 1.8V ±10 ％ ，T
A
= -40 ° C至+ 85°C ）。
参数
电源电压（V
CC3
） （注2 ）
电源失效报警（V
CC3
） （注3）
掉电复位电压（V
CC3
） （注3）
活动模式电流（V
CC3
） （注4 ）
空闲模式电流（V
CC3
） （注4 ）
停止模式电流（V
CC3
） （不4 ）
停止模式电流，使能带隙（V
CC3
） （注4 ）
电源电压（V
CC1
） （注2 ）
电源失效报警（V
CC1
） （注5 ）
掉电复位电压（V
CC1
） （注5 ）
活动模式电流（V
CC1
） （注4 ）
空闲模式电流（V
CC1
） （注4 ）
停止模式电流（V
CC1
） （注4 ）
停止模式电流，使能带隙（V
CC1
） （注4 ）
输入低电平
输入低电平为XTAL1 ， RST ， OW
输入高电平
输入高电平XTAL1 ， RST ， OW
输出低电流端口1 ， 3-7在V
OL
= 0.4V
输出低电流的端口0 ， 2 ， TX_EN ， TXD [ 3 ： 0 ] ， MDC ， MDIO ，
RSTOL ，
ALE ，
PSEN ，
而3-7端口（如下列任何适用于：
A21A0,
WR ， RD ， CE0-7 ， PCE0-3 ）
在V
OL
= 0.4V （注6 ）
低输出电流为OW ，
OWSTP
在V
OL
= 0.4V
输出大电流端口1 ， 3-7在V
OH
= V
CC3
- 0.4V （注7 ）
输出大电流端口1 ， 3-7在V
OH
= V
CC3
- 0.4V （注8 ）
高输出电流为端口0 ， 2 ， TX_EN ， TXD [ 3 ： 0 ] ， MDC ， MDIO ，
RSTOL ，
ALE ，
PSEN ，
而3-7端口（如下列任何适用于：
A21A0,
WR ， RD ， CE0-7 ， PCE0-3 ）
在V
OH
= V
CC3
- 0.4V （注6,9 ）
输入低电平电流的1-7端口在0.4V （注10 ）
逻辑1到0跳变电流的端口1 ， 3-7 （注11 ）
输入漏电流，端口0总线模式，V
IL
= 0.8V （注12 ）
输入漏电流，端口0总线模式，V
IH
= 2.0V （注12 ）
输入漏电流，输入模式（注13 ）
RST下拉电阻
符号
V
CC3
V
PFW3
V
RST3
I
CC3
I
IDLE3
I
STOP3
I
SPBG3
V
CC1
V
PFW1
V
RST1
I
CC1
I
IDLE1
I
STOP1
I
SPBG1
V
IL1
V
IL2
V
IH1
V
IH2
I
OL1
I
OL2
I
OL3
I
OH1
I
OH2
I
OH3
I
IL
I
TL
I
TH0
I
TL0
I
L
R
RST
-50
-650
20
-200
-15
50
民
3.0
2.85
2.76
典型值
3.3
3.00
2.90
16
7
1
100
1.8
1.60
1.55
27
20
0.2
0.2
最大
3.6
3.15
3.05
35
15
10
150
1.98
1.68
1.63
50
40
10
10
0.8
1.0
单位
V
V
V
mA
mA
mA
mA
V
V
V
mA
mA
mA
mA
V
V
V
V
mA
mA
mA
mA
mA
mA
mA
mA
mA
mA
mA
kW
VCC3
VCC1
1.62
1.52
1.47
2.0
2.4
6
12
10
10
20
16
-75
-8
-16
-20
-400
50
-50
0
100
-50
-4
-8
-10
200
-20
15
200
注1 ：
规格为-40 ° C的设计，而不是生产测试保证。
注2 ：
用户应注意，这部分是经过测试，保证工作下来到V
CC3
= 3.0V和V
CC1
= 1.62V ，而在复位
阈值，这些耗材，V
RST3
和V
RST1
分别可以是高于或低于那些点。当一个给定的复位阈值
供给大于保证的最低工作电压时，该复位阈值，应考虑的最小工作
由于执行点停止，一旦器件进入复位状态。当对于一个给定的电源复位阈值小于下
保证的最低工作电压时，存在一电压范围内，可以进行供给， （Ⅴ
RST3
＆ LT ; V
CC3
< 1.62V ）或（Ⅴ
RST1
＆ LT ; V
CC1
＆ LT ;
3.0V ），其中处理器的操作不被保证，并且复位跳闸点还没有达到。这不应该是在一个问题
2 96
DS80C400网络微控制器
大多数的应用，但应考虑时，必须始终保持正确的操作。对于这些应用，它可以是
理想的是使用一个更精确的外部复位。
注3 ：
而规格为V
PFW3
和V
RST3
重叠，硬件的设计使得它使得这是不可能的。在范围
定，在这两个电压之间的保证分离。
注4 ：
与XTAL1 ，V 75MHz的时钟源电流测量
CC3
= 3.6V, V
CC1
= 2.0V,
EA
和RST = 0V ，端口0 = V
CC3
，所有其他引脚
断开。
注5 ：
而规格为V
PFW1
和V
RST1
重叠，硬件的设计使得它使得这是不可能的。在范围
定，会出现这两个电压之间的有保证的分离。
注6 ：
某些引脚具有较强的驱动能力时使用，以解决外部存储器。这些销和相关联的存储器
接口功能（在括号中）如下：端口3.6-3.7 （WR ，
RD）
端口4 （ CE0-3 ， A16 - A19 ） ，港口5.4-5.7 （ PCE0-3 ） ，港口6.0-6.5
（ CE4-7 ， A20 ， A21 ） ，端口7 （解复用模式A0 - A7 ） 。
注7 ：
这种测量方法反映了I / O上拉状态太弱，仍然存在以下的瞬间强烈的0到1端口引脚驱动器（V
OH2
） 。该I / O
引脚状态可以通过应用RST = V实现
CC3.
注8 ：
在测量过程中体现一个0到1的I / O模式转换的瞬间强大的端口引脚驱动。在此期间，一个单触发器
电路驱动的硬盘为两个时钟周期的端口。弱上拉器件（V
OH1
）仍然有效继强大的双时钟周期
驾驶。如果一个端口4或6引脚功能在存储器模式为0引脚状态和SFR位包含一个1 ，改变了针对一个I / O的
模式（通过写P4CNT ，例如）不使两个周期的强上拉。
注9 ：
P3口3.6 （ WR ）和3.7 （ RD）具有比普通驱动器上拉强只有一个下面的过渡系统时钟周期
或
WR
or
RD
从0到1 。
注10 ：
这是从外部电路以保持在一个I / O引脚上的逻辑低电平所需的电流而相应的端口锁存器置位以
1.这是必需的，以仅在当前
HOLD
低电平;从1变为0上的I / O引脚也必须克服过渡
电流。
注11 ：
继0到1单次超时，当被拉到I / O模式转型的源端口的电流下降到外部。它达到一个
最大约为2V 。
注12 ：
在外部寻址模式中，弱锁存器用于保持销，直到这样的时间上之前的驱动状态下的端口
0管脚由外部存储器源驱动。
注13 ：
在OW销在V （当被配置为输出一个1）
IN
= 5.5V,
EA ， MUX ，
和所有的MII输入（ TXCLK ， RXCLK ， RX_DV ， RX_ER ， RXD [ 3：0] ，
CRS ， COL ， MDIO ）在V
IN
= 3.6V.
AC电气特性（复用的地址/数据总线）
（注1 ）
(V
CC3
= 3.0V至3.6V ，V
CC1
= 1.8V ±10 ％ ，T
A
= -40 ° C至+ 85°C ）。
参数
外部晶振频率
时钟Mutliplier 2x模式
时钟倍频4x模式
外部时钟振荡器频率
时钟Mutliplier 2x模式
时钟倍频4x模式
ALE脉冲宽度
端口0指令地址有效到ALE低
地址保持ALE低后
ALE低到有效指令
ALE低
PSEN
低
PSEN
脉冲宽度
PSEN
低到有效指令
输入指令后保持
PSEN
输入指令后浮
PSEN
P0口的地址为有效指令
端口2 ， 4 ， 6地址或端口4 CE为有效
指令
PSEN
低到地址浮
符号
1 / t
CLK
75MHz
民
最大
可变时钟
民
最大
4
40
16
37.5
11
18.75
DC
75
16
37.5
11
18.75
t
CLCL
+ t
CHCl 3
- 5
t
CHCl 3
- 5
t
CLCH
- 2
2t
CLCL
+ t
CLCH
- 19
t
CLCH
- 3
2t
CLCL
- 5
2t
CLCL
-17
0
t
CLCL
- 5
3t
CLCL
- 19
3t
CLCL
+ t
CLCH
- 19
0
单位
兆赫
1 / t
CLK
15.0
1.7
4.7
14.3
3.7
21.7
9.7
0
8.3
21.0
27.7
0
兆赫
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
t
LHLL
t
AVLL
t
LLAX
t
LLIV
t
LLPL
t
PLPH
t
PLIV
t
PXIX
t
AVIV0
t
AVIV2
t
PLAZ
注1 ：
规格为-40 ° C的设计，而不是生产测试保证。
注2 ：
所有参数均适用于商用和工业温度的操作，除非另有说明。
注3 ：
t
CLCL
, t
CLCH
, t
CHCl 3
与内部系统时钟相关，并且与外部时钟（叔时间周期
CLK
）中所定义的
外部时钟振荡器（ XTAL1 ）特性
表。
注4 ：
该预先计算75MHz的最小值/最大值的定时规范假设一个确切的占空比为50％ 。
注5 ：
所有保证与80pF的除外端口0 ，端口2的负载电容的信号，
ALE ， PSEN ， RD ，
和
WR
100pF电容。下列信号，
当配置为内存接口，还有一个特点100pF电容负载：端口4 （ CE0-3 ， A16 - A19 ） ，港口5.4-5.7 （
PCE0-3),
港口6.0-6.5 （ CE4-7 ， A20 ， A21 ） ，端口7 （解复用模式A0 - A7 ） 。
注6 ：
对于高频操作时，特别要注意的接口存储器器件的浮倍，以避免总线
争。
注7 ：
在时序图引用的XTAL ， XTAL1或CLK信号来帮助确定事件的相对发生，而不是
determing绝对信号的定时相对于所述外部时钟。
3 96
DS80C400网络微控制器
外部时钟振荡器（ XTAL1 ）特性
参数
时钟振荡器周期
时钟对称性在0.5× V
CC3
时钟上升时间
时钟下降时间
符号
t
CLK
t
CH
t
CR
t
CF
民
最大
SEE
外部时钟
振荡器频率
0.45 t
CLK
0.55 t
CLK
3
3
单位
ns
ns
ns
外部时钟驱动
t
CF
t
CR
XTAL1
t
CH
t
CLK
t
CL
系统时钟的时间段（T
CLCL
, t
CHCl 3
, t
CLCH
)
系统时钟选择
4X/2X
1
0
X
X
CD1
0
0
1
1
CD0
0
0
0
1
系统时钟
周期T
CLCL
t
CLK
/ 4
t
CLK
/ 2
t
CLK
256 t
CLK
系统时钟HIGH （T
CHCl 3
）和
系统时钟为低电平（T
CLCH
)
民
最大
0.45 (t
CLK
/ 4)
0.55 (t
CLK
/ 4)
0.45 (t
CLK
/ 2)
0.55 (t
CLK
/ 2)
0.45 t
CLK
0.55 t
CLK
0.45 (256 t
CLK ）
0.55 (256 t
CLK ）
注1 ：
图20
示出的系统时钟选择一个详细的说明和图示。
注2 ：
当一个外部时钟振荡器一起使用的默认系统时钟选择（ CD1 ： CD0 = 10b）的，所述
最小/最大系统时钟高（T
CHCl 3
）和系统时钟为低电平（T
CLCH
）期间直接相关的时钟振荡器的占空比。
MOVX特性（复用的地址/数据总线） （注1 ）
(V
CC3
= 3.0V至3.6V ，V
CC1
= 1.8V ±10 ％ ，T
A
= -40
°C
至+ 85°C ）。
参数
MOVX ALE脉冲宽度
端口0 MOVX地址有效
到ALE低
端口0 MOVX地址保持
ALE低后
RD
脉冲宽度（或P3.7
PSEN ）
WR
脉冲宽度（ P3.6 ）
RD
（或P3.7
PSEN ）
低
有效的数据在
数据保持后
RD
（或P3.7
PSEN ）
高
符号
t
LHLL2
民
t
CLCL
+ t
CHCl 3
- 5
2t
CLCL
- 5
6t
CLCL
- 5
t
CHCl 3
- 5
t
CLCL
- 6
5t
CLCL
- 6
t
CLCH
- 2
t
CLCL
- 2
5t
CLCL
- 2
2t
CLCL
- 5
（ 4乘C
ST
) t
CLCL
- 3
2t
CLCL
- 5
（ 4乘C
ST
) t
CLCL
- 3
2t
CLCL
- 17
（ 4乘C
ST
) t
CLCL
- 17
-2
最大
单位
ns
延长值
C
ST
（ MD2 ： 0 ）
C
ST
= 0
1 C
ST
3
4
C
ST
7
C
ST
= 0
1 C
ST
3
4
C
ST
7
C
ST
= 0
1 C
ST
3
4
C
ST
7
C
ST
= 0
1
C
ST
7
C
ST
= 0
1
C
ST
7
C
ST
= 0
1
C
ST
7
t
AVLL2
t
LLAX2
和T
LLAX3
t
RLRH
t
WLWH
t
RLDV
t
RHDX
ns
ns
ns
ns
ns
ns
4 96
DS80C400网络微控制器
参数
数据浮动后
RD
（或P3.7
PSEN ）
高
ALE低到有效数据中
P0口的地址有效数据
In
端口2 ， 4 ， 6地址，端口4
CE或港口5 PCE为有效
DATA IN
ALE低（ RD或
PSEN ）
or
WR
低
P0口的地址为（ RD或
PSEN ）
or
WR
低
端口2,4地址，端口4 CE，
端口5 PCE ，以（ RD或
PSEN ）
or
WR
低
数据有效到
WR
过渡
数据保持后
WR
高
RD
低到地址浮
（ RD或
PSEN ）
or
WR
高
ALE
（ RD或
PSEN ）
or
WR
高
端口4 CE或端口5 PCE
高
符号
t
RHDZ
民
最大
t
CLCL
- 5
2t
CLCL
- 5
6t
CLCL
- 5
2t
CLCL
+ t
CLCH
- 19
（ 4乘C
ST
+ 1) t
CLCL
- 19
（ 4乘C
ST
+ 5) t
CLCL
- 19
3t
CLCL
- 19
（ 4乘C
ST
+ 2)t
CLCL
- 19
（ 4乘C
ST
+ 10)t
CLCL
- 19
3t
CLCL
+ t
CLCH
- 19
（ 4乘C
ST
+ 2)t
CLCL
+ t
CLCH
-
19
（ 4乘C
ST
+ 10)t
CLCL
+ t
CLCH
-
20
t
CLCH
+ 6
t
CLCL
+ 6
5t
CLCL
+ 6
单位
ns
延长值
C
ST
（ MD2 ： 0 ）
C
ST
= 0
1 C
ST
3
4
C
ST
7
C
ST
= 0
1 C
ST
3
4
C
ST
7
C
ST
= 0
1 C
ST
3
4
C
ST
7
C
ST
= 0
1 C
ST
3
4
C
ST
7
ns
C
ST
= 0
1
C
ST
3
4
C
ST
7
C
ST
= 0
1
C
ST
3
4
C
ST
7
C
ST
= 0
1
C
ST
3
4
C
ST
7
C
ST
= 0
1
C
ST
3
4
C
ST
7
0 C
ST
7
C
ST
= 0
1
C
ST
3
4
C
ST
7
C
ST
= 0
1
C
ST
3
4
C
ST
7
t
LLDV
ns
t
AVDV0
ns
t
AVDV2
ns
t
LLWL
t
AVWL0
t
AVWL2
t
QVWX
t
WHQX
t
RLAZ
t
CLCH
- 3
t
CLCL
- 3
5t
CLCL
- 3
t
CLCL
- 5
2t
CLCL
- 6
10t
CLCL
- 6
t
CLCL
+ t
CLCH
- 5
2t
CLCL
+ t
CLCH
- 5
10t
CLCL
+ t
CLCH
- 5
0
t
CLCL
- 4
2
CLCL
- 7
6t
CLCL
- 7
0
ns
ns
ns
ns
（注2 ）
7
t
CLCL
+ 4
5t
CLCL
+ 4
t
CHCl 3
+ 13
t
CLCL
+ t
CHCl 3
+ 13
5t
CLCL
+ t
CHCl 3
+ 13
ns
t
WHLH
t
WHLH2
t
CLCL
- 3
5t
CLCL
- 3
t
CHCl 3
-5
t
CLCL
+ t
CHCl 3
- 5
5t
CLCL
+ t
CHCl 3
- 5
ns
注1 ：
规格为-40 ° C的设计，而不是生产测试保证。
注2 ：
对于一条MOVX读操作时，在ALE的下降沿时，端口0是由一个弱闩锁保持，直到由外部存储器过载。
注3 ：
所有参数均适用于商用和工业温度的操作，除非另有说明。
注4 ：
CST是因为由CKCON寄存器的MD2 ， MD1和MD0位决定了延长周期值。吨
CLCL
, t
CLCH
, t
CHCl 3
是时候
与内部系统时钟相关联的周期和相关的外部时钟。见
系统时钟的时间周期
表。
注5 ：
特点与80pF的负载电容，除了P0口的所有信号，端口2 ， ALE ，
PSEN ， RD ，
和
WR
100pF电容。以下
信号，当配置为内存接口，还有一个特点100pF电容负载：端口4 （ CE0-3 ， A16 - A19 ） ，港口5.4-5.7
（ PCE0-3 ） ，港口6.0-6.5 （ CE4-7 ， A20 ， A21 ） ，端口7 （解复用模式A0 - A7 ） 。
注6 ：
在时序图引用的XTAL ， XTAL1 ，或CLK信号是帮助确定事件的相对发生，而不是
determing绝对信号的定时相对于所述外部时钟。
5 96
DS80C400
网络微控制器
www.maxim-ic.com
概述
在DS80C400网络微控制器提供了最高
集成的8051器件。外设包括：
一个10/100以太网MAC ，三个串行端口，一个CAN 2.0B
控制器， 1 -Wire主机和64个I / O引脚。
以允许访问的网络中，一个完整的应用程序 -
提供访问的TCP IPv4 / 6网络栈和操作系统
在ROM中。网络堆栈最多支持32个并发
TCP连接，并且能够通过转移到5Mbps的
以太网MAC 。其最大的系统时钟频率
75MHz的结果仅有54ns的最小指令周期。
获得大的程序或数据存储区是
简化支持多达24位寻址方案
以连续内存16MB 。
为了加速微控制器之间的数据传输
记忆中， DS80C400提供了四个数据指针，
每一个都可以被配置为自动递增
或者在执行某些数据指针相关的减
指令。在DS80C400的硬件数学加速器
进一步增加的32位和16位的速度乘
和除法运算以及高速移位，
归一化和累加功能。
该
高速微控制器用户指南
和
快速
微控制器用户指南： DS80C400补充
应
在此数据表结合使用。
在同时下载：
www.maxim-ic.com/microcontrollers 。
特点
§
高性能架构
仅有54ns单8051个指令周期
DC至75MHz的时钟速率
平16MB地址空间
四个数据指针，可自动递增/
递减和选择加速数据移动
16位/ 32位算术加速器
多层次的网络和I / O
10/100以太网媒体访问控制器（MAC）
CAN 2.0B控制器
1 - Wire网络控制器
三个全双工硬件串行端口
多达8个双向8位端口（64位I / O
销）
坚固的ROM固件
支持以太网网络引导使用DHCP
和TFTP
全，应用访问的TCP / IP网络协议栈
支持IPv4和IPv6
实现UDP ， TCP ， DHCP ， ICMP和IGMP
基于优先级抢占式任务调度
MAC地址可以任选地被从IEEE-后天
注册的DS2502 -E48
10/100以太网MAC
灵活的IEEE 802.3 MII （个10 / 100Mbps ）和ENDEC
（ 10Mbps的）接口允许选择的PHY
低功耗工作
超低功耗的睡眠模式与魔包
和唤醒帧检测
8kB片的Tx / Rx包数据存储器，带有缓冲
控制单元，减轻CPU负荷
半双工或全双工操作与流程控制
多播/广播地址过滤VLAN
支持
全功能的CAN 2.0B控制器
15信息中心
支持标准（ 11位）和扩展（ 29位）
标识和全球掩膜
媒体字节过滤，支持DeviceNet ，SDS和
高层CAN协议
自动波特率模式和SIESTA低功耗模式
完备的主系统逻辑
16个中断源，6个外部
4个16位定时器/计数器
2倍/ 4倍时钟倍频器降低电磁
干扰（EMI）的
可编程看门狗定时器
振荡器失效检测
可编程时钟的IrDA
§
§
§
应用
工业控制/自动化
环境监测
网络传感器
自动售货机
家庭/办公自动化
交易/支付
码头
数据转换器（串行 -
以太网， CAN-用于─
以太网）
远程数据采集
设备
§
订购信息
部分
DS80C400-FNY
§
PIN的
包
100 LQFP
温度范围
-40 ° C至+ 85°C
最大时钟
速度
75MHz
1 - Wire是Dallas Semiconductor的注册商标。
魔包是Advanced Micro Devices公司的商标。
DeviceNet是开放设备网络供应商协会， Inc.的商标。
产品特点继续第32页。
引脚配置在数据资料的最后。
注意：
该器件的一些修订可能偏离称为勘误表公布的规格。任何器件的多个版本
可能同时获得通过不同的销售渠道。欲了解器件勘误表的信息，请点击这里：
www.maxim-ic.com/errata 。
1 96
REV ： 102103
DS80C400网络微控制器
绝对最大额定值
对任何输入引脚相电压范围对地
在任何输出引脚相电压范围对地
在V电压范围
CC3
相对于地
在V电压范围
CC1
相对于地
工作温度范围
结温
存储温度范围
焊接温度
-0.5V至+ 5.5V
-0.5V至（Ⅴ
CC3
+ 0.5)V
-0.5V至+ 3.6V
-0.3V至+ 2.0V
-40 ° C至+ 85°C
+ 150 ° C最大
-55 ° C至+ 160°C
见IPC / JEDEC J- STD- 020A
超出“绝对最大额定值”，强调可能会造成永久性损坏设备。这些压力额定值只，
并且该设备在这些或超出了规范的业务部门所标明的任何其他条件的功能操作
不是暗示。暴露在绝对最大额定值条件下工作会影响器件的可靠性。
DC电气特性（注1 ）
(V
CC3
= 3.0V至3.6V ，V
CC1
= 1.8V ±10 ％ ，T
A
= -40 ° C至+ 85°C ）。
参数
电源电压（V
CC3
） （注2 ）
电源失效报警（V
CC3
） （注3）
掉电复位电压（V
CC3
） （注3）
活动模式电流（V
CC3
） （注4 ）
空闲模式电流（V
CC3
） （注4 ）
停止模式电流（V
CC3
） （不4 ）
停止模式电流，使能带隙（V
CC3
） （注4 ）
电源电压（V
CC1
） （注2 ）
电源失效报警（V
CC1
） （注5 ）
掉电复位电压（V
CC1
） （注5 ）
活动模式电流（V
CC1
） （注4 ）
空闲模式电流（V
CC1
） （注4 ）
停止模式电流（V
CC1
） （注4 ）
停止模式电流，使能带隙（V
CC1
） （注4 ）
输入低电平
输入低电平为XTAL1 ， RST ， OW
输入高电平
输入高电平XTAL1 ， RST ， OW
输出低电流端口1 ， 3-7在V
OL
= 0.4V
输出低电流的端口0 ， 2 ， TX_EN ， TXD [ 3 ： 0 ] ， MDC ， MDIO ，
RSTOL ，
ALE ，
PSEN ，
而3-7端口（如下列任何适用于：
A21A0,
WR ， RD ， CE0-7 ， PCE0-3 ）
在V
OL
= 0.4V （注6 ）
低输出电流为OW ，
OWSTP
在V
OL
= 0.4V
输出大电流端口1 ， 3-7在V
OH
= V
CC3
- 0.4V （注7 ）
输出大电流端口1 ， 3-7在V
OH
= V
CC3
- 0.4V （注8 ）
高输出电流为端口0 ， 2 ， TX_EN ， TXD [ 3 ： 0 ] ， MDC ， MDIO ，
RSTOL ，
ALE ，
PSEN ，
而3-7端口（如下列任何适用于：
A21A0,
WR ， RD ， CE0-7 ， PCE0-3 ）
在V
OH
= V
CC3
- 0.4V （注6,9 ）
输入低电平电流的1-7端口在0.4V （注10 ）
逻辑1到0跳变电流的端口1 ， 3-7 （注11 ）
输入漏电流，端口0总线模式，V
IL
= 0.8V （注12 ）
输入漏电流，端口0总线模式，V
IH
= 2.0V （注12 ）
输入漏电流，输入模式（注13 ）
RST下拉电阻
符号
V
CC3
V
PFW3
V
RST3
I
CC3
I
IDLE3
I
STOP3
I
SPBG3
V
CC1
V
PFW1
V
RST1
I
CC1
I
IDLE1
I
STOP1
I
SPBG1
V
IL1
V
IL2
V
IH1
V
IH2
I
OL1
I
OL2
I
OL3
I
OH1
I
OH2
I
OH3
I
IL
I
TL
I
TH0
I
TL0
I
L
R
RST
-50
-650
20
-200
-15
50
民
3.0
2.85
2.76
典型值
3.3
3.00
2.90
16
7
1
100
1.8
1.60
1.55
27
20
0.2
0.2
最大
3.6
3.15
3.05
35
15
10
150
1.98
1.68
1.63
50
40
10
10
0.8
1.0
单位
V
V
V
mA
mA
mA
mA
V
V
V
mA
mA
mA
mA
V
V
V
V
mA
mA
mA
mA
mA
mA
mA
mA
mA
mA
mA
kW
VCC3
VCC1
1.62
1.52
1.47
2.0
2.4
6
12
10
10
20
16
-75
-8
-16
-20
-400
50
-50
0
100
-50
-4
-8
-10
200
-20
15
200
注1 ：
规格为-40 ° C的设计，而不是生产测试保证。
注2 ：
用户应注意，这部分是经过测试，保证工作下来到V
CC3
= 3.0V和V
CC1
= 1.62V ，而在复位
阈值，这些耗材，V
RST3
和V
RST1
分别可以是高于或低于那些点。当一个给定的复位阈值
供给大于保证的最低工作电压时，该复位阈值，应考虑的最小工作
由于执行点停止，一旦器件进入复位状态。当对于一个给定的电源复位阈值小于下
保证的最低工作电压时，存在一电压范围内，可以进行供给， （Ⅴ
RST3
＆ LT ; V
CC3
< 1.62V ）或（Ⅴ
RST1
＆ LT ; V
CC1
＆ LT ;
3.0V ），其中处理器的操作不被保证，并且复位跳闸点还没有达到。这不应该是在一个问题
2 96
DS80C400网络微控制器
大多数的应用，但应考虑时，必须始终保持正确的操作。对于这些应用，它可以是
理想的是使用一个更精确的外部复位。
注3 ：
而规格为V
PFW3
和V
RST3
重叠，硬件的设计使得它使得这是不可能的。在范围
定，在这两个电压之间的保证分离。
注4 ：
与XTAL1 ，V 75MHz的时钟源电流测量
CC3
= 3.6V, V
CC1
= 2.0V,
EA
和RST = 0V ，端口0 = V
CC3
，所有其他引脚
断开。
注5 ：
而规格为V
PFW1
和V
RST1
重叠，硬件的设计使得它使得这是不可能的。在范围
定，会出现这两个电压之间的有保证的分离。
注6 ：
某些引脚具有较强的驱动能力时使用，以解决外部存储器。这些销和相关联的存储器
接口功能（在括号中）如下：端口3.6-3.7 （WR ，
RD）
端口4 （ CE0-3 ， A16 - A19 ） ，港口5.4-5.7 （ PCE0-3 ） ，港口6.0-6.5
（ CE4-7 ， A20 ， A21 ） ，端口7 （解复用模式A0 - A7 ） 。
注7 ：
这种测量方法反映了I / O上拉状态太弱，仍然存在以下的瞬间强烈的0到1端口引脚驱动器（V
OH2
） 。该I / O
引脚状态可以通过应用RST = V实现
CC3.
注8 ：
在测量过程中体现一个0到1的I / O模式转换的瞬间强大的端口引脚驱动。在此期间，一个单触发器
电路驱动的硬盘为两个时钟周期的端口。弱上拉器件（V
OH1
）仍然有效继强大的双时钟周期
驾驶。如果一个端口4或6引脚功能在存储器模式为0引脚状态和SFR位包含一个1 ，改变了针对一个I / O的
模式（通过写P4CNT ，例如）不使两个周期的强上拉。
注9 ：
P3口3.6 （ WR ）和3.7 （ RD）具有比普通驱动器上拉强只有一个下面的过渡系统时钟周期
或
WR
or
RD
从0到1 。
注10 ：
这是从外部电路以保持在一个I / O引脚上的逻辑低电平所需的电流而相应的端口锁存器置位以
1.这是必需的，以仅在当前
HOLD
低电平;从1变为0上的I / O引脚也必须克服过渡
电流。
注11 ：
继0到1单次超时，当被拉到I / O模式转型的源端口的电流下降到外部。它达到一个
最大约为2V 。
注12 ：
在外部寻址模式中，弱锁存器用于保持销，直到这样的时间上之前的驱动状态下的端口
0管脚由外部存储器源驱动。
注13 ：
在OW销在V （当被配置为输出一个1）
IN
= 5.5V,
EA ， MUX ，
和所有的MII输入（ TXCLK ， RXCLK ， RX_DV ， RX_ER ， RXD [ 3：0] ，
CRS ， COL ， MDIO ）在V
IN
= 3.6V.
AC电气特性（复用的地址/数据总线）
（注1 ）
(V
CC3
= 3.0V至3.6V ，V
CC1
= 1.8V ±10 ％ ，T
A
= -40 ° C至+ 85°C ）。
参数
外部晶振频率
时钟Mutliplier 2x模式
时钟倍频4x模式
外部时钟振荡器频率
时钟Mutliplier 2x模式
时钟倍频4x模式
ALE脉冲宽度
端口0指令地址有效到ALE低
地址保持ALE低后
ALE低到有效指令
ALE低
PSEN
低
PSEN
脉冲宽度
PSEN
低到有效指令
输入指令后保持
PSEN
输入指令后浮
PSEN
P0口的地址为有效指令
端口2 ， 4 ， 6地址或端口4 CE为有效
指令
PSEN
低到地址浮
符号
1 / t
CLK
75MHz
民
最大
可变时钟
民
最大
4
40
16
37.5
11
18.75
DC
75
16
37.5
11
18.75
t
CLCL
+ t
CHCl 3
- 5
t
CHCl 3
- 5
t
CLCH
- 2
2t
CLCL
+ t
CLCH
- 19
t
CLCH
- 3
2t
CLCL
- 5
2t
CLCL
-17
0
t
CLCL
- 5
3t
CLCL
- 19
3t
CLCL
+ t
CLCH
- 19
0
单位
兆赫
1 / t
CLK
15.0
1.7
4.7
14.3
3.7
21.7
9.7
0
8.3
21.0
27.7
0
兆赫
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
t
LHLL
t
AVLL
t
LLAX
t
LLIV
t
LLPL
t
PLPH
t
PLIV
t
PXIX
t
AVIV0
t
AVIV2
t
PLAZ
注1 ：
规格为-40 ° C的设计，而不是生产测试保证。
注2 ：
所有参数均适用于商用和工业温度的操作，除非另有说明。
注3 ：
t
CLCL
, t
CLCH
, t
CHCl 3
与内部系统时钟相关，并且与外部时钟（叔时间周期
CLK
）中所定义的
外部时钟振荡器（ XTAL1 ）特性
表。
注4 ：
该预先计算75MHz的最小值/最大值的定时规范假设一个确切的占空比为50％ 。
注5 ：
所有保证与80pF的除外端口0 ，端口2的负载电容的信号，
ALE ， PSEN ， RD ，
和
WR
100pF电容。下列信号，
当配置为内存接口，还有一个特点100pF电容负载：端口4 （ CE0-3 ， A16 - A19 ） ，港口5.4-5.7 （
PCE0-3),
港口6.0-6.5 （ CE4-7 ， A20 ， A21 ） ，端口7 （解复用模式A0 - A7 ） 。
注6 ：
对于高频操作时，特别要注意的接口存储器器件的浮倍，以避免总线
争。
注7 ：
在时序图引用的XTAL ， XTAL1或CLK信号来帮助确定事件的相对发生，而不是
determing绝对信号的定时相对于所述外部时钟。
3 96
DS80C400网络微控制器
外部时钟振荡器（ XTAL1 ）特性
参数
时钟振荡器周期
时钟对称性在0.5× V
CC3
时钟上升时间
时钟下降时间
符号
t
CLK
t
CH
t
CR
t
CF
民
最大
SEE
外部时钟
振荡器频率
0.45 t
CLK
0.55 t
CLK
3
3
单位
ns
ns
ns
外部时钟驱动
t
CF
t
CR
XTAL1
t
CH
t
CLK
t
CL
系统时钟的时间段（T
CLCL
, t
CHCl 3
, t
CLCH
)
系统时钟选择
4X/2X
1
0
X
X
CD1
0
0
1
1
CD0
0
0
0
1
系统时钟
周期T
CLCL
t
CLK
/ 4
t
CLK
/ 2
t
CLK
256 t
CLK
系统时钟HIGH （T
CHCl 3
）和
系统时钟为低电平（T
CLCH
)
民
最大
0.45 (t
CLK
/ 4)
0.55 (t
CLK
/ 4)
0.45 (t
CLK
/ 2)
0.55 (t
CLK
/ 2)
0.45 t
CLK
0.55 t
CLK
0.45 (256 t
CLK ）
0.55 (256 t
CLK ）
注1 ：
图20
示出的系统时钟选择一个详细的说明和图示。
注2 ：
当一个外部时钟振荡器一起使用的默认系统时钟选择（ CD1 ： CD0 = 10b）的，所述
最小/最大系统时钟高（T
CHCl 3
）和系统时钟为低电平（T
CLCH
）期间直接相关的时钟振荡器的占空比。
MOVX特性（复用的地址/数据总线） （注1 ）
(V
CC3
= 3.0V至3.6V ，V
CC1
= 1.8V ±10 ％ ，T
A
= -40
°C
至+ 85°C ）。
参数
MOVX ALE脉冲宽度
端口0 MOVX地址有效
到ALE低
端口0 MOVX地址保持
ALE低后
RD
脉冲宽度（或P3.7
PSEN ）
WR
脉冲宽度（ P3.6 ）
RD
（或P3.7
PSEN ）
低
有效的数据在
数据保持后
RD
（或P3.7
PSEN ）
高
符号
t
LHLL2
民
t
CLCL
+ t
CHCl 3
- 5
2t
CLCL
- 5
6t
CLCL
- 5
t
CHCl 3
- 5
t
CLCL
- 6
5t
CLCL
- 6
t
CLCH
- 2
t
CLCL
- 2
5t
CLCL
- 2
2t
CLCL
- 5
（ 4乘C
ST
) t
CLCL
- 3
2t
CLCL
- 5
（ 4乘C
ST
) t
CLCL
- 3
2t
CLCL
- 17
（ 4乘C
ST
) t
CLCL
- 17
-2
最大
单位
ns
延长值
C
ST
（ MD2 ： 0 ）
C
ST
= 0
1 C
ST
3
4
C
ST
7
C
ST
= 0
1 C
ST
3
4
C
ST
7
C
ST
= 0
1 C
ST
3
4
C
ST
7
C
ST
= 0
1
C
ST
7
C
ST
= 0
1
C
ST
7
C
ST
= 0
1
C
ST
7
t
AVLL2
t
LLAX2
和T
LLAX3
t
RLRH
t
WLWH
t
RLDV
t
RHDX
ns
ns
ns
ns
ns
ns
4 96
DS80C400网络微控制器
参数
数据浮动后
RD
（或P3.7
PSEN ）
高
ALE低到有效数据中
P0口的地址有效数据
In
端口2 ， 4 ， 6地址，端口4
CE或港口5 PCE为有效
DATA IN
ALE低（ RD或
PSEN ）
or
WR
低
P0口的地址为（ RD或
PSEN ）
or
WR
低
端口2,4地址，端口4 CE，
端口5 PCE ，以（ RD或
PSEN ）
or
WR
低
数据有效到
WR
过渡
数据保持后
WR
高
RD
低到地址浮
（ RD或
PSEN ）
or
WR
高
ALE
（ RD或
PSEN ）
or
WR
高
端口4 CE或端口5 PCE
高
符号
t
RHDZ
民
最大
t
CLCL
- 5
2t
CLCL
- 5
6t
CLCL
- 5
2t
CLCL
+ t
CLCH
- 19
（ 4乘C
ST
+ 1) t
CLCL
- 19
（ 4乘C
ST
+ 5) t
CLCL
- 19
3t
CLCL
- 19
（ 4乘C
ST
+ 2)t
CLCL
- 19
（ 4乘C
ST
+ 10)t
CLCL
- 19
3t
CLCL
+ t
CLCH
- 19
（ 4乘C
ST
+ 2)t
CLCL
+ t
CLCH
-
19
（ 4乘C
ST
+ 10)t
CLCL
+ t
CLCH
-
20
t
CLCH
+ 6
t
CLCL
+ 6
5t
CLCL
+ 6
单位
ns
延长值
C
ST
（ MD2 ： 0 ）
C
ST
= 0
1 C
ST
3
4
C
ST
7
C
ST
= 0
1 C
ST
3
4
C
ST
7
C
ST
= 0
1 C
ST
3
4
C
ST
7
C
ST
= 0
1 C
ST
3
4
C
ST
7
ns
C
ST
= 0
1
C
ST
3
4
C
ST
7
C
ST
= 0
1
C
ST
3
4
C
ST
7
C
ST
= 0
1
C
ST
3
4
C
ST
7
C
ST
= 0
1
C
ST
3
4
C
ST
7
0 C
ST
7
C
ST
= 0
1
C
ST
3
4
C
ST
7
C
ST
= 0
1
C
ST
3
4
C
ST
7
t
LLDV
ns
t
AVDV0
ns
t
AVDV2
ns
t
LLWL
t
AVWL0
t
AVWL2
t
QVWX
t
WHQX
t
RLAZ
t
CLCH
- 3
t
CLCL
- 3
5t
CLCL
- 3
t
CLCL
- 5
2t
CLCL
- 6
10t
CLCL
- 6
t
CLCL
+ t
CLCH
- 5
2t
CLCL
+ t
CLCH
- 5
10t
CLCL
+ t
CLCH
- 5
0
t
CLCL
- 4
2
CLCL
- 7
6t
CLCL
- 7
0
ns
ns
ns
ns
（注2 ）
7
t
CLCL
+ 4
5t
CLCL
+ 4
t
CHCl 3
+ 13
t
CLCL
+ t
CHCl 3
+ 13
5t
CLCL
+ t
CHCl 3
+ 13
ns
t
WHLH
t
WHLH2
t
CLCL
- 3
5t
CLCL
- 3
t
CHCl 3
-5
t
CLCL
+ t
CHCl 3
- 5
5t
CLCL
+ t
CHCl 3
- 5
ns
注1 ：
规格为-40 ° C的设计，而不是生产测试保证。
注2 ：
对于一条MOVX读操作时，在ALE的下降沿时，端口0是由一个弱闩锁保持，直到由外部存储器过载。
注3 ：
所有参数均适用于商用和工业温度的操作，除非另有说明。
注4 ：
CST是因为由CKCON寄存器的MD2 ， MD1和MD0位决定了延长周期值。吨
CLCL
, t
CLCH
, t
CHCl 3
是时候
与内部系统时钟相关联的周期和相关的外部时钟。见
系统时钟的时间周期
表。
注5 ：
特点与80pF的负载电容，除了P0口的所有信号，端口2 ， ALE ，
PSEN ， RD ，
和
WR
100pF电容。以下
信号，当配置为内存接口，还有一个特点100pF电容负载：端口4 （ CE0-3 ， A16 - A19 ） ，港口5.4-5.7
（ PCE0-3 ） ，港口6.0-6.5 （ CE4-7 ， A20 ， A21 ） ，端口7 （解复用模式A0 - A7 ） 。
注6 ：
在时序图引用的XTAL ， XTAL1 ，或CLK信号是帮助确定事件的相对发生，而不是
determing绝对信号的定时相对于所述外部时钟。
5 96
DS80C400
网络微控制器
www.maxim-ic.com
概述
在DS80C400网络微控制器提供了最高
集成的8051器件。外设包括：
一个10/100以太网MAC ，三个串行端口，一个CAN 2.0B
控制器， 1 -Wire主机和64个I / O引脚。
以允许访问的网络中，一个完整的应用程序 -
提供访问的TCP IPv4 / 6网络栈和操作系统
在ROM中。网络协议栈支持最多32个
同时的TCP连接，并且能够转移到
通过以太网MAC 5Mbps的。它的最大系统 -
达75MHz的最小指令时钟频率
仅有54ns周期时间。进入大型程序或数据
内存方面简化了24位寻址
最多支持连续内存16MB方案。
为了加速微控制器之间的数据传输
记忆中， DS80C400提供了四个数据指针，
每一个都可以被配置为自动递增
或者在执行某些数据指针相关的减
指令。在DS80C400的硬件数学加速器
进一步增加的32位和16位的速度乘
和除法运算以及高速移位，
归一化和累加功能。
高速微控制器用户指南和高速
微控制器用户指南：网络微控制器补充
应与本数据表一起使用。
下载
无论是在：
www.maxim-ic.com/user_guides 。
特点
§
高性能架构
仅有54ns单8051个指令周期
DC至75MHz的时钟速率
平16MB地址空间
四个数据指针，可自动递增/
递减和选择加速数据移动
16位/ 32位算术加速器
多层次的网络和I / O
10/100以太网媒体访问控制器（MAC）
CAN 2.0B控制器
1 - Wire网络控制器
三个全双工硬件串行端口
多达8个双向8位端口（64位I / O
销）
坚固的ROM固件
支持以太网网络引导使用DHCP
和TFTP
全，应用访问的TCP / IP网络协议栈
支持IPv4和IPv6
实现UDP ， TCP ， DHCP ， ICMP和IGMP
基于优先级抢占式任务调度
MAC地址可以任选地被从IEEE-后天
注册的DS2502 -E48
10/100以太网MAC
灵活的IEEE 802.3 MII （个10 / 100Mbps ）和ENDEC
（ 10Mbps的）接口允许选择的PHY
低功耗工作
超低功耗的睡眠模式与魔包
和唤醒帧检测
8kB片的Tx / Rx包数据存储器，带有缓冲
控制单元，减轻CPU负荷
半双工或全双工操作与流程控制
多播/广播地址过滤VLAN
支持
全功能的CAN 2.0B控制器
15信息中心
支持标准（ 11位）和扩展（ 29位）
标识和全球掩膜
媒体字节过滤，支持DeviceNet ，SDS和
高层CAN协议
自动波特率模式和SIESTA低功耗模式
完备的主系统逻辑
16个中断源，6个外部
4个16位定时器/计数器
2倍/ 4倍时钟倍频器降低电磁
干扰（EMI）的
可编程看门狗定时器
振荡器失效检测
可编程时钟的IrDA
§
§
§
应用
工业控制/自动化
环境监测
网络传感器
自动售货机
家庭/办公自动化
数据转换器（ Serial-
至以太网， CAN-用于─
以太网）
远程数据采集
设备
交易/支付
码头
§
订购信息
部分
DS80C400-FNY
DS80C400-FNY+
温度范围
-40 ° C至+ 85°C
-40 ° C至+ 85°C
PIN- PACKAGE
100 LQFP
100 LQFP
§
+表示无铅/符合RoHS标准的器件。
1 - Wire是Dallas半导体公司的注册商标。
魔包是Advanced Micro公司的注册商标
设备公司
DeviceNet是开放设备网络供应商协会， Inc.的商标。
产品特点继续第32页。
引脚配置在数据资料的最后。
注意：
该器件的一些修订可能偏离称为勘误表公布的规格。任何器件的多个版本
可能同时获得通过不同的销售渠道。欲了解器件勘误表的信息，请点击这里：
www.maxim-ic.com/errata 。
1 97
REV ： 060805
DS80C400网络微控制器
绝对最大额定值
对任何输入引脚对地的电压范围............... .... ............................................. ..- 0.5V至+ 5.5V
在任何输出引脚对地...... .... .......................................... ..- 0.5V电压范围（V
CC3
+ 0.5)V
在V电压范围
CC3
相对于地面............................................ ............................... ..- 0.5V至+ 3.6V
在V电压范围
CC1
相对于地面............................................ ............................... ..- 0.3V至+ 2.0V
工作温度Range………………………………………………………………………………..-40°C至+ 85°C
连接点Temperature……………………………………………………………………………………………..+150°C最大
储存温度Range………………………………………………………………………………...-55°C至+ 160°C
焊接温度.................................................................. 。见IPC / JEDEC J- STD- 020规范
超出“绝对最大额定值”，强调可能会造成永久性损坏设备。这些压力额定值只，
并且该设备在这些或超出了规范的业务部门所标明的任何其他条件的功能操作
不是暗示。暴露在绝对最大额定值条件下工作会影响器件的可靠性。
DC电气特性（注1 ）
(V
CC3
= 3.0V至3.6V ，V
CC1
= 1.8V ±10 ％ ，T
A
= -40 ° C至+ 85°C ）。
参数
电源电压（V
CC3
） （注2 ）
电源失效报警（V
CC3
） （注3）
掉电复位电压（V
CC3
） （注3）
活动模式电流（V
CC3
） （注4 ）
空闲模式电流（V
CC3
） （注4 ）
停止模式电流（V
CC3
） （不4 ）
停止模式电流，使能带隙（V
CC3
） （注4 ）
电源电压（V
CC1
） （注2 ）
电源失效报警（V
CC1
） （注5 ）
掉电复位电压（V
CC1
） （注5 ）
活动模式电流（V
CC1
） （注4 ）
空闲模式电流（V
CC1
） （注4 ）
停止模式电流（V
CC1
） （注4 ）
停止模式电流，使能带隙（V
CC1
） （注4 ）
输入低电平
输入低电平为XTAL1 ， RST ， OW
输入高电平
输入高电平XTAL1 ， RST ， OW
输出低电流端口1 ， 3-7在V
OL
= 0.4V
输出低电流的端口0 ， 2 ， TX_EN ， TXD [ 3 ： 0 ] ， MDC ， MDIO ，
RSTOL ，
ALE ，
PSEN ，
而3-7端口（如下列任何适用于：
A21–A0,
WR ， RD ， CE0-7 ， PCE0-3 ）
在V
OL
= 0.4V （注6 ）
低输出电流为OW ，
OWSTP
在V
OL
= 0.4V
输出大电流端口1 ， 3-7在V
OH
= V
CC3
- 0.4V （注7 ）
输出大电流端口1 ， 3-7在V
OH
= V
CC3
- 0.4V （注8 ）
高输出电流为端口0 ， 2 ， TX_EN ， TXD [ 3 ： 0 ] ， MDC ， MDIO ，
RSTOL ，
ALE ，
PSEN ，
而3-7端口（如下列任何适用于：
A21–A0,
WR ， RD ， CE0-7 ， PCE0-3 ）
在V
OH
= V
CC3
- 0.4V （注6,9 ）
输入低电平电流的1-7端口在0.4V （注10 ）
逻辑1到0跳变电流的端口1 ， 3-7 （注11 ）
输入漏电流，端口0总线模式，V
IL
= 0.8V （注12 ）
输入漏电流，端口0总线模式，V
IH
= 2.0V （注12 ）
输入漏电流，输入模式（注13 ）
RST下拉电阻
符号
V
CC3
V
PFW3
V
RST3
I
CC3
I
IDLE3
I
STOP3
I
SPBG3
V
CC1
V
PFW1
V
RST1
I
CC1
I
IDLE1
I
STOP1
I
SPBG1
V
IL1
V
IL2
V
IH1
V
IH2
I
OL1
I
OL2
I
OL3
I
OH1
I
OH2
I
OH3
I
IL
I
TL
I
TH0
I
TL0
I
L
R
RST
-50
-650
20
-200
-15
50
民
3.0
2.85
2.76
典型值
3.3
3.00
2.90
16
7
1
100
1.8
1.60
1.55
27
20
0.2
0.2
最大
3.6
3.15
3.05
35
15
10
150
1.98
1.68
1.63
50
40
10
10
0.8
1.0
单位
V
V
V
mA
mA
mA
mA
V
V
V
mA
mA
mA
mA
V
V
V
V
mA
mA
mA
mA
mA
mA
mA
mA
mA
mA
mA
kW
VCC3
VCC1
1.62
1.52
1.47
2.0
2.4
6
12
10
10
20
16
-75
-8
-16
-20
-400
50
-50
0
100
-50
-4
-8
-10
200
-20
15
200
注1 ：
规格为-40 ° C的设计，而不是生产测试保证。
注2 ：
用户应注意，这部分是经过测试，保证工作下来到V
CC3
= 3.0V和V
CC1
= 1.62V ，而在复位
阈值，这些耗材，V
RST3
和V
RST1
分别可以是高于或低于那些点。当一个给定的复位阈值
供给大于保证的最低工作电压时，该复位阈值，应考虑的最小工作
由于执行点停止，一旦器件进入复位状态。当对于一个给定的电源复位阈值小于下
保证的最低工作电压时，存在一电压范围内，可以进行供给， （Ⅴ
RST3
＆ LT ; V
CC3
< 1.62V ）或（Ⅴ
RST1
＆ LT ; V
CC1
＆ LT ;
3.0V ），其中处理器的操作不被保证，并且复位跳闸点还没有达到。这不应该是在一个问题
2 97
DS80C400网络微控制器
大多数的应用，但应考虑时，必须始终保持正确的操作。对于这些应用，它可以是
理想的是使用一个更精确的外部复位。
注3 ：
而规格为V
PFW3
和V
RST3
重叠，硬件的设计使得它使得这是不可能的。在范围
定，在这两个电压之间的保证分离。
注4 ：
与XTAL1 ，V 75MHz的时钟源电流测量
CC3
= 3.6V, V
CC1
= 2.0V,
EA
和RST = 0V ，端口0 = V
CC3
，所有其他引脚
断开。
注5 ：
而规格为V
PFW1
和V
RST1
重叠，硬件的设计使得它使得这是不可能的。在范围
定，会出现这两个电压之间的有保证的分离。
注6 ：
某些引脚具有较强的驱动能力时使用，以解决外部存储器。这些销和相关联的存储器
接口功能（在括号中）如下：端口3.6-3.7 （WR ，
RD）
端口4 （ CE0-3 ， A16 - A19 ） ，港口5.4-5.7 （ PCE0-3 ） ，港口6.0-6.5
（ CE4-7 ， A20 ， A21 ） ，端口7 （解复用模式A0 - A7 ） 。
注7 ：
这种测量方法反映了I / O上拉状态太弱，仍然存在以下的瞬间强烈的0到1端口引脚驱动器（V
OH2
） 。该I / O
引脚状态可以通过应用RST = V实现
CC3.
注8 ：
在测量过程中体现一个0到1的I / O模式转换的瞬间强大的端口引脚驱动。在此期间，一个单触发器
电路驱动的硬盘为两个时钟周期的端口。弱上拉器件（V
OH1
）仍然有效继强大的双时钟周期
驾驶。如果一个端口4或6引脚功能在存储器模式为0引脚状态和SFR位包含一个1 ，改变了针对一个I / O的
模式（通过写P4CNT ，例如）不使两个周期的强上拉。
注9 ：
P3口3.6 （ WR ）和3.7 （ RD）具有比普通驱动器上拉强只有一个下面的过渡系统时钟周期
或
WR
or
RD
从0到1 。
注10 ：
这是从外部电路以保持在一个I / O引脚上的逻辑低电平所需的电流而相应的端口锁存器置位以
1.这是必需的，以仅在当前
HOLD
低电平;从1变为0上的I / O引脚也必须克服过渡
电流。
注11 ：
继0到1单次超时，当被拉到I / O模式转型的源端口的电流下降到外部。它达到一个
最大约为2V 。
注12 ：
在外部寻址模式中，弱锁存器用于保持销，直到这样的时间上之前的驱动状态下的端口
0管脚由外部存储器源驱动。
注13 ：
在OW销在V （当被配置为输出一个1）
IN
= 5.5V,
EA ， MUX ，
和所有的MII输入（ TXCLK ， RXCLK ， RX_DV ， RX_ER ， RXD [ 3：0] ，
CRS ， COL ， MDIO ）在V
IN
= 3.6V.
AC电气特性（复用的地址/数据总线）
（注1 ）
(V
CC3
= 3.0V至3.6V ，V
CC1
= 1.8V ±10 ％ ，T
A
= -40 ° C至+ 85°C ）。
参数
外部晶振频率
时钟Mutliplier 2x模式
时钟倍频4x模式
外部时钟振荡器频率
时钟Mutliplier 2x模式
时钟倍频4x模式
ALE脉冲宽度
端口0指令地址有效到ALE低
地址保持ALE低后
ALE低到有效指令
ALE低
PSEN
低
PSEN
脉冲宽度
PSEN
低到有效指令
输入指令后保持
PSEN
输入指令后浮
PSEN
P0口的地址为有效指令
端口2 ， 4 ， 6地址或端口4 CE为有效
指令
PSEN
低到地址浮
符号
1 / t
CLK
75MHz
民
最大
可变时钟
民
最大
4
40
16
37.5
11
18.75
DC
75
16
37.5
11
18.75
t
CLCL
+ t
CHCl 3
- 5
t
CHCl 3
- 5
t
CLCH
- 2
2t
CLCL
+ t
CLCH
- 19
t
CLCH
- 3
2t
CLCL
- 5
2t
CLCL
-17
0
t
CLCL
- 5
3t
CLCL
- 19
3t
CLCL
+ t
CLCH
- 19
0
单位
兆赫
1 / t
CLK
15.0
1.7
4.7
14.3
3.7
21.7
9.7
0
8.3
21.0
27.7
0
兆赫
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
t
LHLL
t
AVLL
t
LLAX
t
LLIV
t
LLPL
t
PLPH
t
PLIV
t
PXIX
t
AVIV0
t
AVIV2
t
PLAZ
注1 ：
规格为-40 ° C的设计，而不是生产测试保证。
注2 ：
所有参数均适用于商用和工业温度的操作，除非另有说明。
注3 ：
t
CLCL
, t
CLCH
, t
CHCl 3
与内部系统时钟相关，并且与外部时钟（叔时间周期
CLK
）中所定义的
外部时钟振荡器（ XTAL1 ）特性
表。
注4 ：
该预先计算75MHz的最小值/最大值的定时规范假设一个确切的占空比为50％ 。
注5 ：
所有保证与80pF的除外端口0 ，端口2的负载电容的信号，
ALE ， PSEN ， RD ，
和
WR
100pF电容。下列信号，
当配置为内存接口，还有一个特点100pF电容负载：端口4 （ CE0-3 ， A16 - A19 ） ，港口5.4-5.7 （
PCE0-3),
港口6.0-6.5 （ CE4-7 ， A20 ， A21 ） ，端口7 （解复用模式A0 - A7 ） 。
注6 ：
对于高频操作时，特别要注意的接口存储器器件的浮倍，以避免总线
争。
注7 ：
在时序图引用的XTAL ， XTAL1或CLK信号来帮助确定事件的相对发生，而不是
determing绝对信号的定时相对于所述外部时钟。
3 97
DS80C400网络微控制器
外部时钟振荡器（ XTAL1 ）特性
参数
时钟振荡器周期
时钟对称性在0.5× V
CC3
时钟上升时间
时钟下降时间
符号
t
CLK
t
CH
t
CR
t
CF
民
最大
SEE
外部时钟
振荡器频率
0.45 t
CLK
0.55 t
CLK
3
3
单位
ns
ns
ns
外部时钟驱动
t
CF
t
CR
XTAL1
t
CH
t
CLK
t
CL
系统时钟的时间段（T
CLCL
, t
CHCl 3
, t
CLCH
)
系统时钟选择
4X/2X
1
0
X
X
CD1
0
0
1
1
CD0
0
0
0
1
系统时钟
周期T
CLCL
t
CLK
/ 4
t
CLK
/ 2
t
CLK
256 t
CLK
系统时钟HIGH （T
CHCl 3
）和
系统时钟为低电平（T
CLCH
)
民
最大
0.45 (t
CLK
/ 4)
0.55 (t
CLK
/ 4)
0.45 (t
CLK
/ 2)
0.55 (t
CLK
/ 2)
0.45 t
CLK
0.55 t
CLK
0.45 (256 t
CLK ）
0.55 (256 t
CLK ）
注1 ：
图20
示出的系统时钟选择一个详细的说明和图示。
注2 ：
当一个外部时钟振荡器一起使用的默认系统时钟选择（ CD1 ： CD0 = 10b）的，所述
最小/最大系统时钟高（T
CHCl 3
）和系统时钟为低电平（T
CLCH
）期间直接相关的时钟振荡器的占空比。
MOVX特性（复用的地址/数据总线） （注1 ）
(V
CC3
= 3.0V至3.6V ，V
CC1
= 1.8V ±10 ％ ，T
A
= -40
°C
至+ 85°C ）。
参数
MOVX ALE脉冲宽度
端口0 MOVX地址有效
到ALE低
端口0 MOVX地址保持
ALE低后
RD
脉冲宽度（或P3.7
PSEN ）
WR
脉冲宽度（ P3.6 ）
RD
（或P3.7
PSEN ）
低
有效的数据在
数据保持后
RD
（或P3.7
PSEN ）
高
符号
t
LHLL2
民
t
CLCL
+ t
CHCl 3
- 5
2t
CLCL
- 5
6t
CLCL
- 5
t
CHCl 3
- 5
t
CLCL
- 6
5t
CLCL
- 6
t
CLCH
- 2
t
CLCL
- 2
5t
CLCL
- 2
2t
CLCL
- 5
（ 4乘C
ST
) t
CLCL
- 3
2t
CLCL
- 5
（ 4乘C
ST
) t
CLCL
- 3
2t
CLCL
- 17
（ 4乘C
ST
) t
CLCL
- 17
-2
最大
单位
ns
延长值
C
ST
（ MD2 ： 0 ）
C
ST
= 0
1 C
ST
3
4
C
ST
7
C
ST
= 0
1 C
ST
3
4
C
ST
7
C
ST
= 0
1 C
ST
3
4
C
ST
7
C
ST
= 0
1
C
ST
7
C
ST
= 0
1
C
ST
7
C
ST
= 0
1
C
ST
7
t
AVLL2
t
LLAX2
和T
LLAX3
t
RLRH
t
WLWH
t
RLDV
t
RHDX
ns
ns
ns
ns
ns
ns
4 97
DS80C400网络微控制器
参数
数据浮动后
RD
（或P3.7
PSEN ）
高
ALE低到有效数据中
P0口的地址有效数据
In
端口2 ， 4 ， 6地址，端口4
CE或港口5 PCE为有效
DATA IN
ALE低（ RD或
PSEN ）
or
WR
低
P0口的地址为（ RD或
PSEN ）
or
WR
低
端口2,4地址，端口4 CE，
端口5 PCE ，以（ RD或
PSEN ）
or
WR
低
数据有效到
WR
过渡
数据保持后
WR
高
RD
低到地址浮
（ RD或
PSEN ）
or
WR
高
ALE
（ RD或
PSEN ）
or
WR
高
端口4 CE或端口5 PCE
高
符号
t
RHDZ
民
最大
t
CLCL
- 5
2t
CLCL
- 5
6t
CLCL
- 5
2t
CLCL
+ t
CLCH
- 19
（ 4乘C
ST
+ 1) t
CLCL
- 19
（ 4乘C
ST
+ 5) t
CLCL
- 19
3t
CLCL
- 19
（ 4乘C
ST
+ 2)t
CLCL
- 19
（ 4乘C
ST
+ 10)t
CLCL
- 19
3t
CLCL
+ t
CLCH
- 19
（ 4乘C
ST
+ 2)t
CLCL
+ t
CLCH
-
19
（ 4乘C
ST
+ 10)t
CLCL
+ t
CLCH
-
20
t
CLCH
+ 6
t
CLCL
+ 6
5t
CLCL
+ 6
单位
ns
延长值
C
ST
（ MD2 ： 0 ）
C
ST
= 0
1 C
ST
3
4
C
ST
7
C
ST
= 0
1 C
ST
3
4
C
ST
7
C
ST
= 0
1 C
ST
3
4
C
ST
7
C
ST
= 0
1 C
ST
3
4
C
ST
7
ns
C
ST
= 0
1
C
ST
3
4
C
ST
7
C
ST
= 0
1
C
ST
3
4
C
ST
7
C
ST
= 0
1
C
ST
3
4
C
ST
7
C
ST
= 0
1
C
ST
3
4
C
ST
7
0 C
ST
7
C
ST
= 0
1
C
ST
3
4
C
ST
7
C
ST
= 0
1
C
ST
3
4
C
ST
7
t
LLDV
ns
t
AVDV0
ns
t
AVDV2
ns
t
LLWL
t
AVWL0
t
AVWL2
t
QVWX
t
WHQX
t
RLAZ
t
CLCH
- 3
t
CLCL
- 3
5t
CLCL
- 3
t
CLCL
- 5
2t
CLCL
- 6
10t
CLCL
- 6
t
CLCL
+ t
CLCH
- 5
2t
CLCL
+ t
CLCH
- 5
10t
CLCL
+ t
CLCH
- 5
0
t
CLCL
- 4
2
CLCL
- 7
6t
CLCL
- 7
0
ns
ns
ns
ns
（注2 ）
7
t
CLCL
+ 4
5t
CLCL
+ 4
t
CHCl 3
+ 13
t
CLCL
+ t
CHCl 3
+ 13
5t
CLCL
+ t
CHCl 3
+ 13
ns
t
WHLH
t
WHLH2
t
CLCL
- 3
5t
CLCL
- 3
t
CHCl 3
-5
t
CLCL
+ t
CHCl 3
- 5
5t
CLCL
+ t
CHCl 3
- 5
ns
注1 ：
规格为-40 ° C的设计，而不是生产测试保证。
注2 ：
对于一条MOVX读操作时，在ALE的下降沿时，端口0是由一个弱闩锁保持，直到由外部存储器过载。
注3 ：
所有参数均适用于商用和工业温度的操作，除非另有说明。
注4 ：
CST是因为由CKCON寄存器的MD2 ， MD1和MD0位决定了延长周期值。吨
CLCL
, t
CLCH
, t
CHCl 3
是时候
与内部系统时钟相关联的周期和相关的外部时钟。见
系统时钟的时间周期
表。
注5 ：
特点与80pF的负载电容，除了P0口的所有信号，端口2 ， ALE ，
PSEN ， RD ，
和
WR
100pF电容。以下
信号，当配置为内存接口，还有一个特点100pF电容负载：端口4 （ CE0-3 ， A16 - A19 ） ，港口5.4-5.7
（ PCE0-3 ） ，港口6.0-6.5 （ CE4-7 ， A20 ， A21 ） ，端口7 （解复用模式A0 - A7 ） 。
注6 ：
在时序图引用的XTAL ， XTAL1 ，或CLK信号是帮助确定事件的相对发生，而不是
determing绝对信号的定时相对于所述外部时钟。
5 97
19-4658 ;第七版; 6/09
可提供评估板
DS80C400
网络微控制器
www.maxim-ic.com
概述
在DS80C400网络微控制器提供了最高
集成的8051器件。外设包括：
一个10/100以太网MAC ，三个串行端口，一个CAN 2.0B
控制器， 1 -Wire主机和64个I / O引脚。
以允许访问的网络中，一个完整的应用程序 -
提供访问的TCP IPv4 / 6网络栈和操作系统
在ROM中。网络协议栈支持最多32个
同时的TCP连接，并且能够转移到
通过以太网MAC 5Mbps的。它的最大系统 -
达75MHz的最小指令时钟频率
仅有54ns周期时间。进入大型程序或数据
内存方面简化了24位寻址
最多支持连续内存16MB方案。
为了加速微控制器之间的数据传输
记忆中， DS80C400提供了四个数据指针，
每一个都可以被配置为自动递增
或者在执行某些数据指针相关的减
指令。在DS80C400的硬件数学加速器
进一步增加的32位和16位的速度乘
和除法运算以及高速移位，
归一化和累加功能。
高速微控制器用户指南和高速
微控制器用户指南：网络微控制器补充
应与本数据表一起使用。
下载
无论是在：
www.maxim-ic.com/user_guides 。
特点
高性能架构
仅有54ns单8051个指令周期
DC至75MHz的时钟速率
平16MB地址空间
四个数据指针，可自动递增/
递减和选择加速数据移动
16位/ 32位算术加速器
多层次的网络和I / O
10/100以太网媒体访问控制器（MAC）
CAN 2.0B控制器
1 - Wire网络控制器
三个全双工硬件串行端口
多达8个双向8位端口（64位I / O
销）
坚固的ROM固件
支持以太网网络引导使用DHCP
和TFTP
全，应用访问的TCP / IP网络协议栈
支持IPv4和IPv6
实现UDP ， TCP ， DHCP ， ICMP和IGMP
基于优先级抢占式任务调度
MAC地址可以任选地被从IEEE-后天
注册的DS2502 -E48
10/100以太网MAC
灵活的IEEE 802.3 MII （个10 / 100Mbps ）和ENDEC
（ 10Mbps的）接口允许选择的PHY
低功耗工作
超低功耗的睡眠模式与魔包
和唤醒帧检测
8kB片的Tx / Rx包数据存储器，带有缓冲
控制单元，减轻CPU负荷
半双工或全双工操作与流程控制
多播/广播地址过滤VLAN
支持
全功能的CAN 2.0B控制器
15信息中心
支持标准（ 11位）和扩展（ 29位）
标识和全球掩膜
媒体字节过滤，支持DeviceNet
，SDS和
高层CAN协议
自动波特率模式和SIESTA低功耗模式
完备的主系统逻辑
16个中断源，6个外部
4个16位定时器/计数器
2倍/ 4倍时钟倍频器降低电磁
干扰（EMI）的
可编程看门狗定时器
振荡器失效检测
可编程时钟的IrDA
应用
工业控制/自动化
环境监测
网络传感器
自动售货机
家庭/办公自动化
数据转换器（ Serial-
至以太网， CAN-用于─
以太网）
远程数据采集
设备
交易/支付
码头
订购信息
部分
DS80C400-FNY
DS80C400-FNY+
温度范围
-40 ° C至+ 85°C
-40 ° C至+ 85°C
PIN- PACKAGE
100 LQFP
100 LQFP
+表示无铅（Pb ） - 免费/符合RoHS标准的封装。
的1-Wire是Maxim Integrated Products ，Inc.的注册商标。
魔包是Advanced Micro Devices ，Inc.的注册商标。
DeviceNet是开放设备网络供应商协会， Inc.的商标。
产品特点继续第32页。
引脚配置在数据资料的最后。
注意：
该器件的一些修订可能偏离称为勘误表公布的规格。任何器件的多个版本
可能同时获得通过不同的销售渠道。欲了解器件勘误表的信息，请点击这里：
www.maxim-ic.com/errata 。
1 97
DS80C400网络微控制器
绝对最大额定值
对任何输入引脚对地的电压范围............... .... ............................................. ..- 0.5V至+ 5.5V
在任何输出引脚对地...... .... .......................................... ..- 0.5V电压范围（V
CC3
+ 0.5V)
在V电压范围
CC3
相对于地面............................................ ............................... ..- 0.5V至+ 3.6V
在V电压范围
CC1
相对于地面............................................ ............................... ..- 0.3V至+ 2.0V
工作温度Range………………………………………………………………………………..-40°C至+ 85°C
连接点Temperature……………………………………………………………………………………………..+150°C最大
储存温度Range………………………………………………………………………………...-55°C至+ 160°C
焊接温度.................................................................. 。见IPC / JEDEC J- STD- 020规范
超出“绝对最大额定值”，强调可能会造成永久性损坏设备。这些压力额定值只，
并且该设备在这些或超出了规范的业务部门所标明的任何其他条件的功能操作
不是暗示。暴露在绝对最大额定值条件下工作会影响器件的可靠性。
DC电气特性（注1 ）
(V
CC3
= 3.0V至3.6V ，V
CC1
= 1.8V ±10 ％ ，T
A
= -40 ° C至+ 85°C ）。
参数
电源电压（V
CC3
） （注2 ）
电源失效报警（V
CC3
） （注3）
掉电复位电压（V
CC3
） （注3）
活动模式电流（V
CC3
） （注4 ）
空闲模式电流（V
CC3
） （注4 ）
停止模式电流（V
CC3
） （不4 ）
停止模式电流，使能带隙（V
CC3
） （注4 ）
电源电压（V
CC1
） （注2 ）
电源失效报警（V
CC1
） （注5 ）
掉电复位电压（V
CC1
） （注5 ）
活动模式电流（V
CC1
） （注4 ）
空闲模式电流（V
CC1
） （注4 ）
停止模式电流（V
CC1
） （注4 ）
停止模式电流，使能带隙（V
CC1
） （注4 ）
输入低电平
输入低电平为XTAL1 ， RST ， OW
输入高电平
输入高电平XTAL1 ， RST ， OW
输出低电流端口1 ， 3-7在V
OL
= 0.4V
输出低电流的端口0 ， 2 ， TX_EN ， TXD [ 3 ： 0 ] ， MDC ， MDIO ，
RSTOL ，
ALE ，
PSEN ，
而3-7端口（如下列任何适用于：
A21–A0,
WR ， RD ， CE0-7 ， PCE0-3 ）
在V
OL
= 0.4V （注6 ）
低输出电流为OW ，
OWSTP
在V
OL
= 0.4V
输出大电流端口1 ， 3-7在V
OH
= V
CC3
- 0.4V （注7 ）
输出大电流端口1 ， 3-7在V
OH
= V
CC3
- 0.4V （注8 ）
高输出电流为端口0 ， 2 ， TX_EN ， TXD [ 3 ： 0 ] ， MDC ， MDIO ，
RSTOL ，
ALE ，
PSEN ，
而3-7端口（如下列任何适用于：
A21–A0,
WR ， RD ， CE0-7 ， PCE0-3 ）
在V
OH
= V
CC3
- 0.4V （注6,9 ）
输入低电平电流的1-7端口在0.4V （注10 ）
逻辑1到0跳变电流的端口1 ， 3-7 （注11 ）
输入漏电流，端口0总线模式，V
IL
= 0.8V （注12 ）
输入漏电流，端口0总线模式，V
IH
= 2.0V （注12 ）
输入漏电流，输入模式（注13 ）
RST下拉电阻
VCC3
VCC1
符号
V
CC3
V
PFW3
V
RST3
I
CC3
I
IDLE3
I
STOP3
I
SPBG3
V
CC1
V
PFW1
V
RST1
I
CC1
I
IDLE1
I
STOP1
I
SPBG1
V
IL1
V
IL2
V
IH1
V
IH2
I
OL1
I
OL2
I
OL3
I
OH1
I
OH2
I
OH3
I
IL
I
TL
I
TH0
I
TL0
I
L
R
RST
-50
-650
20
-200
-15
50
民
3.0
2.85
2.76
典型值
3.3
3.00
2.90
16
7
1
100
1.8
1.60
1.55
27
20
0.2
0.2
最大
3.6
3.15
3.05
35
15
10
150
1.98
1.68
1.63
50
40
10
10
0.8
1.0
单位
V
V
V
mA
mA
A
A
V
V
V
mA
mA
mA
mA
V
V
V
V
mA
mA
mA
A
mA
mA
A
A
A
A
A
k
1.62
1.52
1.47
2.0
2.4
6
12
10
10
20
16
-75
-8
-16
-20
-400
50
-50
0
100
-50
-4
-8
-10
200
-20
15
200
注1 ：
规格为-40 ° C的设计，而不是生产测试保证。
注2 ：
用户应注意，这部分是经过测试，保证工作下来到V
CC3
= 3.0V和V
CC1
= 1.62V ，而在复位
阈值，这些耗材，V
RST3
和V
RST1
分别可以是高于或低于那些点。当一个给定的复位阈值
供给大于保证的最低工作电压时，该复位阈值，应考虑的最小工作
由于执行点停止，一旦器件进入复位状态。当对于一个给定的电源复位阈值小于下
保证的最低工作电压时，存在一电压范围内，可以进行供给， （Ⅴ
RST3
＆ LT ; V
CC3
< 1.62V ）或（Ⅴ
RST1
＆ LT ; V
CC1
＆ LT ;
3.0V ），其中处理器的操作不被保证，并且复位跳闸点还没有达到。这不应该是在一个问题
2 97
DS80C400网络微控制器
大多数的应用，但应考虑时，必须始终保持正确的操作。对于这些应用，它可以是
理想的是使用一个更精确的外部复位。
注3 ：
而规格为V
PFW3
和V
RST3
重叠，硬件的设计使得它使得这是不可能的。在范围
定，在这两个电压之间的保证分离。
注4 ：
与XTAL1 ，V 75MHz的时钟源电流测量
CC3
= 3.6V, V
CC1
= 2.0V,
EA
和RST = 0V ，端口0 = V
CC3
，所有其他引脚
断开。
注5 ：
而规格为V
PFW1
和V
RST1
重叠，硬件的设计使得它使得这是不可能的。在范围
定，会出现这两个电压之间的有保证的分离。
注6 ：
某些引脚具有较强的驱动能力时使用，以解决外部存储器。这些销和相关联的存储器
接口功能（在括号中）如下：端口3.6-3.7 （WR ，
RD）
端口4 （ CE0-3 ， A16 - A19 ） ，港口5.4-5.7 （ PCE0-3 ） ，港口6.0-6.5
（ CE4-7 ， A20 ， A21 ） ，端口7 （解复用模式A0 - A7 ） 。
注7 ：
这种测量方法反映了I / O上拉状态太弱，仍然存在以下的瞬间强烈的0到1端口引脚驱动器（V
OH2
） 。该I / O
引脚状态可以通过应用RST = V实现
CC3.
注8 ：
在测量过程中体现一个0到1的I / O模式转换的瞬间强大的端口引脚驱动。在此期间，一个单触发器
电路驱动的硬盘为两个时钟周期的端口。弱上拉器件（V
OH1
）仍然有效继强大的双时钟周期
驾驶。如果一个端口4或6引脚功能在存储器模式为0引脚状态和SFR位包含一个1 ，改变了针对一个I / O的
模式（通过写P4CNT ，例如）不使两个周期的强上拉。
注9 ：
P3口3.6 （ WR ）和3.7 （ RD）具有比普通驱动器上拉强只有一个下面的过渡系统时钟周期
或
WR
or
RD
从0到1 。
注10 ：
这是从外部电路以保持在一个I / O引脚上的逻辑低电平所需的电流而相应的端口锁存器置位以
1.这是必需的，以仅在当前
HOLD
低电平;从1变为0上的I / O引脚也必须克服过渡
电流。
注11 ：
继0到1单次超时，当被拉到I / O模式转型的源端口的电流下降到外部。它达到一个
最大约为2V 。
注12 ：
在外部寻址模式中，弱锁存器用于保持销，直到这样的时间上之前的驱动状态下的端口
0管脚由外部存储器源驱动。
注13 ：
在OW销在V （当被配置为输出一个1）
IN
= 5.5V,
EA ， MUX ，
和所有的MII输入（ TXCLK ， RXCLK ， RX_DV ， RX_ER ， RXD [ 3：0] ，
CRS ， COL ， MDIO ）在V
IN
= 3.6V.
AC电气特性（复用的地址/数据总线）
（注1 ）
(V
CC3
= 3.0V至3.6V ，V
CC1
= 1.8V ±10 ％ ，T
A
= -40 ° C至+ 85°C ）。
参数
外部晶振频率
时钟Mutliplier 2x模式
时钟倍频4x模式
外部时钟振荡器频率
时钟Mutliplier 2x模式
时钟倍频4x模式
ALE脉冲宽度
端口0指令地址有效到ALE低
地址保持ALE低后
ALE低到有效指令
ALE低
PSEN
低
PSEN
脉冲宽度
PSEN
低到有效指令
输入指令后保持
PSEN
输入指令后浮
PSEN
P0口的地址为有效指令
端口2 ， 4 ， 6地址或端口4 CE为有效
指令
PSEN
低到地址浮
符号
1 / t
CLK
75MHz
民
最大
可变时钟
民
最大
4
40
16
37.5
11
18.75
DC
75
16
37.5
11
18.75
t
CLCL
+ t
CHCl 3
- 5
t
CHCl 3
- 5
t
CLCH
- 2
2t
CLCL
+ t
CLCH
- 19
t
CLCH
- 3
2t
CLCL
- 5
2t
CLCL
-17
0
t
CLCL
- 5
3t
CLCL
- 19
3t
CLCL
+ t
CLCH
- 19
0
单位
兆赫
1 / t
CLK
15.0
1.7
4.7
14.3
3.7
21.7
9.7
0
8.3
21.0
27.7
0
兆赫
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
t
LHLL
t
AVLL
t
LLAX
t
LLIV
t
LLPL
t
PLPH
t
PLIV
t
PXIX
t
AVIV0
t
AVIV2
t
PLAZ
注1 ：
规格为-40 ° C的设计，而不是生产测试保证。
注2 ：
所有参数均适用于商用和工业温度的操作，除非另有说明。
注3 ：
t
CLCL
, t
CLCH
, t
CHCl 3
与内部系统时钟相关，并且与外部时钟（叔时间周期
CLK
）中所定义的
外部时钟振荡器（ XTAL1 ）特性
表。
注4 ：
该预先计算75MHz的最小值/最大值的定时规范假设一个确切的占空比为50％ 。
注5 ：
所有保证与80pF的除外端口0 ，端口2的负载电容的信号，
ALE ， PSEN ， RD ，
和
WR
100pF电容。下列信号，
当配置为内存接口，还有一个特点100pF电容负载：端口4 （ CE0-3 ， A16 - A19 ） ，港口5.4-5.7 （
PCE0-3),
港口6.0-6.5 （ CE4-7 ， A20 ， A21 ） ，端口7 （解复用模式A0 - A7 ） 。
注6 ：
对于高频操作时，特别要注意的接口存储器器件的浮倍，以避免总线
争。
注7 ：
在时序图引用的XTAL ， XTAL1或CLK信号来帮助确定事件的相对发生，而不是
determing绝对信号的定时相对于所述外部时钟。
3 97
DS80C400网络微控制器
外部时钟振荡器（ XTAL1 ）特性
参数
时钟振荡器周期
时钟对称性在0.5× V
CC3
时钟上升时间
时钟下降时间
符号
t
CLK
t
CH
t
CR
t
CF
民
最大
SEE
外部时钟
振荡器频率
0.45 t
CLK
0.55 t
CLK
3
3
单位
ns
ns
ns
外部时钟驱动
t
CF
t
CR
XTAL1
t
CH
t
CLK
t
CL
系统时钟的时间段（T
CLCL
, t
CHCl 3
, t
CLCH
)
系统时钟选择
4X/2X
1
0
X
X
CD1
0
0
1
1
CD0
0
0
0
1
系统时钟
周期T
CLCL
t
CLK
/ 4
t
CLK
/ 2
t
CLK
256 t
CLK
系统时钟HIGH （T
CHCl 3
）和
系统时钟为低电平（T
CLCH
)
民
最大
0.45 (t
CLK
/ 4)
0.55 (t
CLK
/ 4)
0.45 (t
CLK
/ 2)
0.55 (t
CLK
/ 2)
0.45 t
CLK
0.55 t
CLK
0.45 (256 t
CLK ）
0.55 (256 t
CLK ）
注1 ：
图20
示出的系统时钟选择一个详细的说明和图示。
注2 ：
当一个外部时钟振荡器一起使用的默认系统时钟选择（ CD1 ： CD0 = 10b）的，所述
最小/最大系统时钟高（T
CHCl 3
）和系统时钟为低电平（T
CLCH
）期间直接相关的时钟振荡器的占空比。
MOVX特性（复用的地址/数据总线） （注1 ）
(V
CC3
= 3.0V至3.6V ，V
CC1
= 1.8V ±10 ％ ，T
A
= -40
C
至+ 85°C ）。
参数
MOVX ALE脉冲宽度
端口0 MOVX地址有效
到ALE低
端口0 MOVX地址保持
ALE低后
RD
脉冲宽度（或P3.7
PSEN ）
WR
脉冲宽度（ P3.6 ）
RD
（或P3.7
PSEN ）
低
有效的数据在
数据保持后
RD
（或P3.7
PSEN ）
高
符号
t
LHLL2
民
t
CLCL
+ t
CHCl 3
- 5
2t
CLCL
- 5
6t
CLCL
- 5
t
CHCl 3
- 5
t
CLCL
- 6
5t
CLCL
- 6
t
CLCH
- 2
t
CLCL
- 2
5t
CLCL
- 2
2t
CLCL
- 5
（ 4乘C
ST
) t
CLCL
- 3
2t
CLCL
- 5
（ 4乘C
ST
) t
CLCL
- 3
2t
CLCL
- 17
（ 4乘C
ST
) t
CLCL
- 17
-2
最大
单位
ns
延长值
C
ST
（ MD2 ： 0 ）
C
ST
= 0
1 C
ST
3
4
C
ST
7
C
ST
= 0
1 C
ST
3
4
C
ST
7
C
ST
= 0
1 C
ST
3
4
C
ST
7
C
ST
= 0
1
C
ST
7
C
ST
= 0
1
C
ST
7
C
ST
= 0
1
C
ST
7
t
AVLL2
t
LLAX2
和T
LLAX3
t
RLRH
t
WLWH
t
RLDV
t
RHDX
ns
ns
ns
ns
ns
ns
4 97
DS80C400网络微控制器
参数
数据浮动后
RD
（或P3.7
PSEN ）
高
ALE低到有效数据中
P0口的地址有效数据
In
端口2 ， 4 ， 6地址，端口4
CE或港口5 PCE为有效
DATA IN
ALE低（ RD或
PSEN ）
or
WR
低
P0口的地址为（ RD或
PSEN ）
or
WR
低
端口2,4地址，端口4 CE，
端口5 PCE ，以（ RD或
PSEN ）
or
WR
低
数据有效到
WR
过渡
数据保持后
WR
高
RD
低到地址浮
（ RD或
PSEN ）
or
WR
高
ALE
（ RD或
PSEN ）
or
WR
高
端口4 CE或端口5 PCE
高
符号
t
RHDZ
民
最大
t
CLCL
- 5
2t
CLCL
- 5
6t
CLCL
- 5
2t
CLCL
+ t
CLCH
- 19
（ 4乘C
ST
+ 1) t
CLCL
- 19
（ 4乘C
ST
+ 5) t
CLCL
- 19
3t
CLCL
- 19
（ 4乘C
ST
+ 2)t
CLCL
- 19
（ 4乘C
ST
+ 10)t
CLCL
- 19
3t
CLCL
+ t
CLCH
- 19
（ 4乘C
ST
+ 2)t
CLCL
+ t
CLCH
-
19
（ 4乘C
ST
+ 10)t
CLCL
+ t
CLCH
-
20
t
CLCH
+ 6
t
CLCL
+ 6
5t
CLCL
+ 6
单位
ns
延长值
C
ST
（ MD2 ： 0 ）
C
ST
= 0
1 C
ST
3
4
C
ST
7
C
ST
= 0
1 C
ST
3
4
C
ST
7
C
ST
= 0
1 C
ST
3
4
C
ST
7
C
ST
= 0
1 C
ST
3
4
C
ST
7
ns
C
ST
= 0
1
C
ST
3
4
C
ST
7
C
ST
= 0
1
C
ST
3
4
C
ST
7
C
ST
= 0
1
C
ST
3
4
C
ST
7
C
ST
= 0
1
C
ST
3
4
C
ST
7
0 C
ST
7
C
ST
= 0
1
C
ST
3
4
C
ST
7
C
ST
= 0
1
C
ST
3
4
C
ST
7
t
LLDV
ns
t
AVDV0
ns
t
AVDV2
ns
t
LLWL
t
AVWL0
t
AVWL2
t
QVWX
t
WHQX
t
RLAZ
t
CLCH
- 3
t
CLCL
- 3
5t
CLCL
- 3
t
CLCL
- 5
2t
CLCL
- 6
10t
CLCL
- 6
t
CLCL
+ t
CLCH
- 5
2t
CLCL
+ t
CLCH
- 5
10t
CLCL
+ t
CLCH
- 5
0
t
CLCL
- 4
2
CLCL
- 7
6t
CLCL
- 7
0
ns
ns
ns
ns
（注2 ）
7
t
CLCL
+ 4
5t
CLCL
+ 4
t
CHCl 3
+ 13
t
CLCL
+ t
CHCl 3
+ 13
5t
CLCL
+ t
CHCl 3
+ 13
ns
t
WHLH
t
WHLH2
t
CLCL
- 3
5t
CLCL
- 3
t
CHCl 3
-5
t
CLCL
+ t
CHCl 3
- 5
5t
CLCL
+ t
CHCl 3
- 5
ns
注1 ：
规格为-40 ° C的设计，而不是生产测试保证。
注2 ：
对于一条MOVX读操作时，在ALE的下降沿时，端口0是由一个弱闩锁保持，直到由外部存储器过载。
注3 ：
所有参数均适用于商用和工业温度的操作，除非另有说明。
注4 ：
CST是因为由CKCON寄存器的MD2 ， MD1和MD0位决定了延长周期值。吨
CLCL
, t
CLCH
, t
CHCl 3
是时候
与内部系统时钟相关联的周期和相关的外部时钟。见
系统时钟的时间周期
表。
注5 ：
特点与80pF的负载电容，除了P0口的所有信号，端口2 ， ALE ，
PSEN ， RD ，
和
WR
100pF电容。以下
信号，当配置为内存接口，还有一个特点100pF电容负载：端口4 （ CE0-3 ， A16 - A19 ） ，港口5.4-5.7
（ PCE0-3 ） ，港口6.0-6.5 （ CE4-7 ， A20 ， A21 ） ，端口7 （解复用模式A0 - A7 ） 。
注6 ：
在时序图引用的XTAL ， XTAL1 ，或CLK信号是帮助确定事件的相对发生，而不是
determing绝对信号的定时相对于所述外部时钟。
5 97
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