DM93L14四锁存
1989年6月
修订后的1999年11月
DM93L14
四锁存
概述
该DM93L14是一种多功能4位锁存器设计
在高速数字通用存储应用
系统。所有输出都主动拉电路提供
高电容驱动器，并提供在低阻抗
这两个逻辑状态良好的抗干扰能力。
特点
s
可作为单个输入端D锁存器或置位/复位
锁存器
s
低电平有效使能输入门
s
压倒一切的主复位
订购代码：
订单号
DM93L14N
包装数
N14A
包装说明
14引脚塑料双列直插式封装（ PDIP ） ， JEDEC MS- 001 ，宽0.300
逻辑符号
接线图
V
CC
=
PIN码16
GND
=
引脚8
引脚说明
引脚名称
E
D0
D3
S0
S3
MR
Q0
Q3
描述
使能输入（低电平有效）
数据输入
设置输入（低电平有效）
主复位输入（低电平有效）
锁存器输出
1999仙童半导体公司
DS009612
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DM93L14
功能说明
该DM93L14由四个锁存器具有共同的
低电平有效使能输入，低电平有效复位硕士
输入。当Enable变为高电平，数据存在于
锁存器存储和锁存器的状态不再
受了S
n
和D
n
输入。在主复位时，
启动覆盖所有其他输入条件强迫所有
锁存器输出低电平。四个锁存器可运行
ated以两种模式中的一种：
D- TYPE LATCH -对于D型操作的S输入端
锁存保持为低。而常见的启用是活跃的
锁存器输出和D输入。信息存在于
锁存器的输出被存储在锁存器，当使能变为
高。
SET /复位锁存器，在置位/复位操作时，
常见的启用是低一个锁存器在D复位由低
输入，并且可以通过一个低的S输入端置，如果D输入
为HIGH 。如果S和D投入低， D输入会
支配和锁存器复位。当Enable
变高时，锁存器保持以显示前最后的状态
ablement 。锁存操作的两种模式示于
真值表。
真值表
MR
H
H
H
H
H
H
H
H
L
E
L
L
H
L
L
L
L
H
X
D
L
H
X
L
H
L
H
X
X
S
L
L
X
L
L
H
H
X
X
Q
n
L
L
Q
n-1
L
H
L
Q
n-1
Q
n-1
L
RESET
R / S模式
手术
D模式
H
=
高电压电平
L
=
低电压电平
X
=
非物质
Q
n1
=
上一页输出状态
Q
n
=
当前输出状态
逻辑图
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2
DM93L14
电气特性
在推荐工作的自由空气的温度范围内（除非另有说明）
符号
V
I
V
OH
V
OL
I
I
I
IH
I
IL
I
OS
I
CC
参数
输入钳位电压
高电平输出电压
低电平输出电压
输入电流最大@
输入电压
高电平输入电流
低电平输入电流
短路
输出电流
电源电流
注2 ：
所有标准被定在V
CC
=
5V ，T
A
=
25°C
注3 ：
不超过一个的输出应在同一时间被短路，并且持续时间应不超过一秒钟。
注4 ：
I
CC
测量时，所有输出开路和接地所有输入。
条件
V
CC
=
分钟，我
I
= 10
mA
V
CC
=
分钟，我
OH
=
最大，
V
IL
=
马克斯，V
IH
=
民
V
CC
=
分钟，我
OL
=
最大，
V
IH
=
分钟，V
IL
=
最大
V
CC
=
马克斯，V
I
=
5.5V
V
CC
=
马克斯，V
I
=
2.4V
V
CC
=
马克斯，V
I
=
0.3V
V
CC
=
最大
（注3）
V
CC
=
马克斯（注4 ）
输入
D
n
输入
D
n
民
典型值
（注2 ）
最大
1.5
单位
V
V
2.4
0.3
1
20
30
400
600
2.5
25
16.5
V
mA
A
A
mA
mA
开关特性
V
CC
= +
5.0V ，T
A
= +25°C
（见波形和负载配置）
符号
t
PLH
t
PHL
t
PLH
t
PHL
t
PLH
t
PHL
传播延迟
E至Q
n
传播延迟
D
n
以Q
n
传播延迟，MR到Q
n
传播延迟，S
n
以Q
n
参数
民
最大
45
36
30
30
30
33
单位
ns
ns
ns
ns
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4
DM93L14四锁存
物理尺寸
英寸（毫米），除非另有说明
14引脚塑料双列直插式封装（ PDIP ） ， JEDEC MS- 001 ，宽0.300
包装数N14A
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其中， （ a）打算通过外科手术移植到
体，或（b ）支持或维持生命，和（c） ，其故障
执行时，依照正确使用
在标签规定的使用说明，可说明原因
sonably预计将造成显著伤害
用户。
5
在生命支持任何组件2.关键部件
设备或系统，其未能履行可说明原因
sonably预期造成的生命支持故障
装置或系统，或影响其安全性或有效性。
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