DM74ALS165 8位并行输入/串行输出移位寄存器
1986年1月
修订后的2000年2月
DM74ALS165
8位并行输入/串行输出移位寄存器
概述
该DM74ALS165是一个8位串行寄存器，当
主频，移向串行输出，Q数据
H
。平行于
访问每个阶段由八个单独直接提供
是由一个低的水平，在以SH / LD使能数据输入
输入。该DM74ALS165还具有时钟功能抑制
化和互补串行输出，Q
H
.
时钟由低到高的转变来实现
而SH / LD保持高电平， CLK INH是CLK输入
保持低电平。 CLK和CLK INH的（功能的时钟
抑制）的输入是可以互换的。由于低CLK输入
和CLK INH低到高的转变也将accom-
司马策时钟， CLK INH应改为高
水平仅在CLK输入为高。并行加载
当SH / LD举行高抑制。并行输入
寄存器使能，而SH / LD为低indepen-
dently CLK ， CLK INH ，或SER投入的水平。
特点
s
互补输出
s
直接重写负载（数据）输入
s
门控时钟输入
s
并行 - 串行数据转换
订购代码：
订单号
DM74ALS165M
DM74ALS165N
包装数
M16A
N16E
包装说明
16引脚小外形集成电路（ SOIC ） ， JEDEC MS- 012 ， 0.150窄
16引脚塑料双列直插式封装（ PDIP ） ， JEDEC MS- 001 ，宽0.300
在磁带和卷轴可用的设备也。通过附加的后缀字母“X”的订货代码指定。
接线图
功能表
输入
移动/时钟时钟串行并行
负载抑制
L
H
H
H
H
H
H
X
L
L
L
↑
↑
H
X
L
↑
↑
L
L
X
X
X
H
L
H
L
X
一... H
一... H
X
X
X
X
X
X
国内
输出
Q
A
a
Q
A0
H
L
H
L
Q
A0
Q
B
b
Q
B0
Q
An
Q
An
Q
An
Q
An
Q
B0
产量
Q
H
h
Q
H0
Q
Gn
Q
Gn
Q
Gn
Q
Gn
Q
H0
H
=
高水平（稳态） ，
L
=
低电平（稳态）
X
=
不在乎（任何输入，包括过渡）
↑ =
从低到高的电平转变
一... H
=
稳态输入的输入A至H级，分别为
Q
A0
, Q
B0
, Q
H0
=
Q的水平
A
, Q
B
或Q
H
分别前
表示稳态输入条件建立
Q
An
, Q
Gn
=
Q的水平
A
或Q
G
分别之前的最近
↑
时钟的过渡
2000仙童半导体公司
DS006712
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DM74ALS165
绝对最大额定值
（注1 ）
电源电压
输入电压
工作自由空气的温度范围
存储温度范围
典型
θ
JA
N包装
男包
74.0°C/W
104.0°C/W
7V
7V
0℃至
+70°C
65°C
to
+150°C
注1 ：
“绝对最大额定值”，超出该值的
该装置的安全性不能得到保证。该设备不应该
在这些限制操作。在电气定义的参数值
特性表不能保证在绝对最大额定值。
“推荐工作条件”表将定义的条件
器件的实际工作。
推荐工作条件
符号
V
CC
V
IH
V
IL
I
OH
I
OL
f
时钟
t
W
电源电压
高电平输入电压
低电平输入电压
高电平输出电流
低电平输出电流
时钟频率
脉冲持续时间
CLK高
CLK低
负载
t
SU
t
SU
t
H
T
A
建立时间
建立时间
保持时间
经营自由空气温度
SH / LD
数据
CLK INH
↓
CLK前
串行之前CLK
45
11
11
12
10
10
11
10
4
0
70
ns
ns
ns
°C
ns
参数
民
4.5
2
0.8
0.4
8
典型值
5
最大
5.5
单位
V
V
V
mA
mA
兆赫
电气特性
在推荐工作的自由空气的温度范围内（除非另有说明）
符号
V
IK
V
OH
V
OL
I
I
I
IH
I
IL
I
O
（注3）
I
CC
参数
输入钳位电压
高层
输出电压
低层
输出电压
输入电流在最大输入电压V
CC
=
5.5V, V
I
=
7V
高电平输入电流
低电平输入电流
输出驱动电流
电源电流
V
CC
=
5.5V, V
I
=
2.7V
V
CC
=
5.5V, V
I
=
0.4V
V
CC
=
5.5V, V
O
=
2.25V
V
CC
=
5.5V （注4 ）
30
16
条件
V
CC
=
4.5V ，我
I
= 18
mA
I
OH
= 0.4
mA
V
CC
=
4.5V至5.5V
V
CC
=
4.5V
I
OL
=
4毫安
I
OL
=
8毫安
V
CC
2
0.25
0.35
0.4
0.5
0.1
20
0.1
112
24
民
典型值
（注2 ）
最大
1.5
单位
V
V
V
mA
A
mA
mA
mA
注2 ：
所有典型值是在V
CC
=
5V ，T
A
=
25°C.
注3 ：
输出条件已被选定，以产生一个电流，其值接近1的一半的真实输出短路电流的，我
OS
.
注4 ：
与输出开路时，CLK INH和CLK在4.5V ，而施加到SH / LD输入一个时钟脉冲时，我
CC
与并行输入端在4.5V第一测量
然后用并行输入端接地。
3
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DM74ALS165
物理尺寸
英寸（毫米），除非另有说明
16引脚小外形集成电路（ SOIC ） ， JEDEC MS- 012 ， 0.150窄
包装数M16A
5
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