CH7013A
CHRONTEL
数码电脑电视编码器
特点
引脚和功能与CH7003兼容
通用数字接口接收的YCrCb （ CCIR601
或656 ）或RGB （15， 16或24位）视频中的两个数据
非隔行扫描和隔行扫描格式
真实比例
TM
渲染引擎支持undescan
各种图形分辨率运营
增强的文本锐利度和适应性闪烁去除
多达5行的滤波
增强的点蠕动控制和面积减少
完全通过串口编程
支持NTSC ， NTSC - EIA （日本）和PAL （B ，D ，
G，H， I，M和N）的电视制式
提供复合，S -Video和SCART输出
自动检测电视存在
支持VBI直通
可编程电源管理
9位视频DAC输出
完整的Windows和DOS驱动程序软件
提供的44引脚PLCC ， 44引脚TQFP
概述
Chrontel公司的CH7013A数字PC到TV编码器是一个待机动
单独的集成电路，它提供一个个人计算机99兼容的
解决方案的电视输出。它提供了一个通用的数字输入
端口从兼容VGA接受一个像素的数据流
控制器（或等同物）和将其转换成直
NTSC或PAL电视制式。
该电路集成了数字NTSC / PAL编码器与9-
位DAC接口，以及新的自适应闪烁过滤和高
精度低抖动锁相环创造卓越
质量的视频。通过它的TrueScale
TM
缩放和脱离
闪烁引擎， CH7013A支持完整的垂直和
水平欠能力和工作在5个不同
决议包括640×480 800×600和。
随着全一个新的通用数字接口
可编程性使CH7013A理想的系统级
PC解决方案。所有的功能可由软件编程
通过串行端口，以使完整的PC溶液
使用电视机作为主显示器。
专利号5781241
专利号5914753
LINE
内存
YUV - RGB转换器
RGB- YUV
变流器
数字
D [15:0]
像素数据
输入
接口
真正规模
标度&闪烁削减
发动机
NTSC / PAL
编码器
＆放大器;过滤器
/ R
三重
DAC
C / G
CVBS / B
系统时钟
RSET
串行控制块
PLL
时序&同步信号发生器
时钟
数据
ADDR
XCLK
H
V
XI XO / FIN CSYNC P- OUT BCO
图1 ：功能框图
201-0000-041
1.0版，
6/14/2000
1
CHRONTEL
表1.引脚说明
44-Pin
PLCC
21-15
13-12,
10-4
CH7013A
TYPE
In
44Pin
TQFP
15,14,
13,12,
11,10,
9,7,6,
4,3,
2,1,
44,43,42
37
符号
D15-D0
数字像素输入
描述
这些管脚接受任一8,12 ，或16位数字象素数据流
复用的位或16位非复用格式，通过输入确定的
模式设置（见
寄存器和编程
部分） 。输入D0 - D7
在8位复用模式下运行时使用。输入D0 - D11是
用在12位模式下运行时。输入端D0 - D15时使用
在16位模式下运行。的数据结构和时序对
每种模式在数字输入端口的部分描述。
OUT
P- OUT
像素时钟输出
该CH7013A ，在主模式下运行，提供了一个像素的数据
时钟信号提供给VGA控制器。该引脚提供像素时钟
输出信号（可调整为X， 2X或3X）到VGA控制器（见
上一节
数字视频接口
和
寄存器和编程
为
更多详细信息） 。这个引脚上的容性负载应保持在
最低限度。
43
1
39
In
XCLK
像素时钟输入
在一个纯粹主模式下操作时，P- OUT信号应
连接到XCLK输入引脚。在伪主模式下运行，
在P -OUT时钟被用作参考频率，以及一个信号锁定
此输出（在1X， 1 / 2X，或1 / 3X在P -OUT频率）被输入到
XCLK引脚。在从模式下运行， CH7013A接受外部
像素时钟输入该引脚。这个引脚上的容性负载应为
保持在最低限度。
3
41
IN / OUT
V
垂直同步输入/输出
该管脚接受来自VGA控制器的垂直同步信号，或
输出一个垂直同步到VGA控制器。在容性负载上
此管脚应保持在最低限度。
2
40
IN / OUT
H
水平同步输入/输出
该管脚接受来自VGA控制器，或输出的水平同步
水平同步的VGA控制器。在这个电容性负载
针应保持在最低限度。
41
35
OUT
BCO
缓冲时钟输出
该引脚提供14.31818 MHz晶振输入的缓冲输出
频率的其他设备，并保持活动在任何时候（包括
掉电） 。该输出也可以选择为其他频率
（见
寄存器和编程） 。
38
32
In
XI
晶振输入
并联谐振14.31818兆赫（ ± 50 PPM ）的晶体应该是
附XI和XO / FIN之间。然而，如果外部CMOS时钟
附着到XO / FIN ，第十一应连接到地。
39
33
In
XO / FIN
晶振输出或外部FREF
一14.31818兆赫（ ± 50 PPM ）的晶体可能XO / FIN之间的连接
和XI 。外部CMOS兼容时钟可以连接到
XO / FIN作为替代。
4
201-0000-041
1.0版，
6/14/2000
CHRONTEL
表1.引脚说明
44-Pin
PLCC
30
CH7013A
TYPE
In
44Pin
TQFP
24
符号
RSET
参考电阻
描述
A 360
电阻用短而宽的走线应附
之间的RSET和地面。没有任何其他的连接应使
该引脚。
亮度输出
A 75
终端电阻短走线应附
与Y和地面，以获得最佳的性能。
在正常的操作
28
22
OUT
/ R
模式不是SCART等，该引脚输出亮度的视频信号。在
SCART模式下，该引脚输出的红色信号。
27
21
OUT
C / G
色度输出
A 75
终端电阻短走线应附
间C和接地，以获得最佳的性能。
在正常的操作
模式不是SCART等，该引脚输出的色度视频信号。在
SCART模式下，该引脚输出绿色信号。
26
20
OUT
CVBS / B
复合视频输出
A 75
终端电阻短走线应附
之间CVBS和接地，以获得最佳的性能。在正常
比SCART等操作模式，该引脚输出复合
视频信号。在SCART模式下，该引脚输出的蓝色信号。
复合同步输出
A 75
终端电阻短走线应附
之间CSYNC和接地，以获得最佳的性能。在SCART
模式下，该引脚输出的复合同步信号。
串行数据（外接上拉必填）
该引脚用作串行接口的串行数据引脚（见
该
串口操作
一节） 。
33
27
In
时钟
串行时钟（内部上拉）
该引脚用作串行接口的串行时钟引脚（见
该
串口操作
一节） 。
35
29
In
ADDR
串行地址选择（内部上拉）
该引脚为串行地址选择，其对应于1和0位
串行设备地址（见
串口操作
节
详细信息） ，创建一个地址选择如下：
ADDR
1
0
40
34
动力
AGND
串行地址选择
1110101 = 75H = 117
1110110 = 76H = 118
23
17
OUT
CSYNC
32
26
IN / OUT
数据
模拟地
这些引脚提供的模拟部分的接地参考
CH7013A ，并且必须被连接到系统接地，以防止
闭锁。参阅
应用信息
部分信息
适当的电源去耦。
37
31
动力
AVDD
模拟电源电压
这些引脚提供5V电源CH7013A的模拟部分。
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数码电脑电视编码器
特点
引脚和功能与CH7003兼容
通用数字接口接收的YCrCb （ CCIR601
或656 ）或RGB （15， 16或24位）视频中的两个数据
非隔行扫描和隔行扫描格式
真实比例
TM
渲染引擎支持undescan
各种图形分辨率运营
增强的文本锐利度和适应性闪烁去除
多达5行的滤波
增强的点蠕动控制和面积减少
完全通过串口编程
支持NTSC ， NTSC - EIA （日本）和PAL （B ，D ，
G，H， I，M和N）的电视制式
提供复合，S -Video和SCART输出
自动检测电视存在
支持VBI直通
可编程电源管理
9位视频DAC输出
完整的Windows和DOS驱动程序软件
提供的44引脚PLCC ， 44引脚TQFP
概述
Chrontel公司的CH7013A数字PC到TV编码器是一个待机动
单独的集成电路，它提供一个个人计算机99兼容的
解决方案的电视输出。它提供了一个通用的数字输入
端口从兼容VGA接受一个像素的数据流
控制器（或等同物）和将其转换成直
NTSC或PAL电视制式。
该电路集成了数字NTSC / PAL编码器与9-
位DAC接口，以及新的自适应闪烁过滤和高
精度低抖动锁相环创造卓越
质量的视频。通过它的TrueScale
TM
缩放和脱离
闪烁引擎， CH7013A支持完整的垂直和
水平欠能力和工作在5个不同
决议包括640×480 800×600和。
随着全一个新的通用数字接口
可编程性使CH7013A理想的系统级
PC解决方案。所有的功能可由软件编程
通过串行端口，以使完整的PC溶液
使用电视机作为主显示器。
专利号5781241
专利号5914753
LINE
内存
YUV - RGB转换器
RGB- YUV
变流器
数字
D [15:0]
像素数据
输入
接口
真正规模
标度&闪烁削减
发动机
NTSC / PAL
编码器
＆放大器;过滤器
/ R
三重
DAC
C / G
CVBS / B
系统时钟
RSET
串行控制块
PLL
时序&同步信号发生器
时钟
数据
ADDR
XCLK
H
V
XI XO / FIN CSYNC P- OUT BCO
图1 ：功能框图
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表1.引脚说明
44-Pin
PLCC
21-15
13-12,
10-4
CH7013A
TYPE
In
44Pin
TQFP
15,14,
13,12,
11,10,
9,7,6,
4,3,
2,1,
44,43,42
37
符号
D15-D0
数字像素输入
描述
这些管脚接受任一8,12 ，或16位数字象素数据流
复用的位或16位非复用格式，通过输入确定的
模式设置（见
寄存器和编程
部分） 。输入D0 - D7
在8位复用模式下运行时使用。输入D0 - D11是
用在12位模式下运行时。输入端D0 - D15时使用
在16位模式下运行。的数据结构和时序对
每种模式在数字输入端口的部分描述。
OUT
P- OUT
像素时钟输出
该CH7013A ，在主模式下运行，提供了一个像素的数据
时钟信号提供给VGA控制器。该引脚提供像素时钟
输出信号（可调整为X， 2X或3X）到VGA控制器（见
上一节
数字视频接口
和
寄存器和编程
为
更多详细信息） 。这个引脚上的容性负载应保持在
最低限度。
43
1
39
In
XCLK
像素时钟输入
在一个纯粹主模式下操作时，P- OUT信号应
连接到XCLK输入引脚。在伪主模式下运行，
在P -OUT时钟被用作参考频率，以及一个信号锁定
此输出（在1X， 1 / 2X，或1 / 3X在P -OUT频率）被输入到
XCLK引脚。在从模式下运行， CH7013A接受外部
像素时钟输入该引脚。这个引脚上的容性负载应为
保持在最低限度。
3
41
IN / OUT
V
垂直同步输入/输出
该管脚接受来自VGA控制器的垂直同步信号，或
输出一个垂直同步到VGA控制器。在容性负载上
此管脚应保持在最低限度。
2
40
IN / OUT
H
水平同步输入/输出
该管脚接受来自VGA控制器，或输出的水平同步
水平同步的VGA控制器。在这个电容性负载
针应保持在最低限度。
41
35
OUT
BCO
缓冲时钟输出
该引脚提供14.31818 MHz晶振输入的缓冲输出
频率的其他设备，并保持活动在任何时候（包括
掉电） 。该输出也可以选择为其他频率
（见
寄存器和编程） 。
38
32
In
XI
晶振输入
并联谐振14.31818兆赫（ ± 50 PPM ）的晶体应该是
附XI和XO / FIN之间。然而，如果外部CMOS时钟
附着到XO / FIN ，第十一应连接到地。
39
33
In
XO / FIN
晶振输出或外部FREF
一14.31818兆赫（ ± 50 PPM ）的晶体可能XO / FIN之间的连接
和XI 。外部CMOS兼容时钟可以连接到
XO / FIN作为替代。
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CHRONTEL
表1.引脚说明
44-Pin
PLCC
30
CH7013A
TYPE
In
44Pin
TQFP
24
符号
RSET
参考电阻
描述
A 360
电阻用短而宽的走线应附
之间的RSET和地面。没有任何其他的连接应使
该引脚。
亮度输出
A 75
终端电阻短走线应附
与Y和地面，以获得最佳的性能。
在正常的操作
28
22
OUT
/ R
模式不是SCART等，该引脚输出亮度的视频信号。在
SCART模式下，该引脚输出的红色信号。
27
21
OUT
C / G
色度输出
A 75
终端电阻短走线应附
间C和接地，以获得最佳的性能。
在正常的操作
模式不是SCART等，该引脚输出的色度视频信号。在
SCART模式下，该引脚输出绿色信号。
26
20
OUT
CVBS / B
复合视频输出
A 75
终端电阻短走线应附
之间CVBS和接地，以获得最佳的性能。在正常
比SCART等操作模式，该引脚输出复合
视频信号。在SCART模式下，该引脚输出的蓝色信号。
复合同步输出
A 75
终端电阻短走线应附
之间CSYNC和接地，以获得最佳的性能。在SCART
模式下，该引脚输出的复合同步信号。
串行数据（外接上拉必填）
该引脚用作串行接口的串行数据引脚（见
该
串口操作
一节） 。
33
27
In
时钟
串行时钟（内部上拉）
该引脚用作串行接口的串行时钟引脚（见
该
串口操作
一节） 。
35
29
In
ADDR
串行地址选择（内部上拉）
该引脚为串行地址选择，其对应于1和0位
串行设备地址（见
串口操作
节
详细信息） ，创建一个地址选择如下：
ADDR
1
0
40
34
动力
AGND
串行地址选择
1110101 = 75H = 117
1110110 = 76H = 118
23
17
OUT
CSYNC
32
26
IN / OUT
数据
模拟地
这些引脚提供的模拟部分的接地参考
CH7013A ，并且必须被连接到系统接地，以防止
闭锁。参阅
应用信息
部分信息
适当的电源去耦。
37
31
动力
AVDD
模拟电源电压
这些引脚提供5V电源CH7013A的模拟部分。
201-0000-041
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