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CDCE913
CDCEL913
SCAS849A - 2007年6月 - 修订2007年8月
可编程1 - PLL VCXO时钟合成器，具有1.8 V， 2.5 V和3.3 V输出
1
特点
可编程时钟发生器的会员
家庭
–
CDCE913 / CDCEL913 ： 1 - PLL ， 3输出
- CDCE925 / CDCEL925 ： 2 - PLL ， 5输出
- CDCE937 / CDCEL937 ： 3 -PLL ， 7输出
- CDCE949 / CDCEL949 ： 4 -PLL ， 9输出
在系统可编程和EEPROM
- 串行可编程挥发性注册
- 非易失性EEPROM来存储客户
环境
灵活的输入时钟概念
- 外部晶振： 8 MHz至32 MHz的
- 片上VCXO ：拉动范围± 150 ppm的
- 单端LVCMOS高达160 MHz的
自由选择的输出频率高达
230兆赫
低噪声PLL内核
- PLL环路滤波器元件集成
- 低周期抖动（典型值50 PS）
2345
灵活的时钟驱动器
- 三种用户自定义控制输入
[ S0 / S1 / S2 ]例如， SSC的选择，
开关频率，输出使能或
掉电
- 可编程SSC调制
- 启用0 -PPM时钟发生器
- 产生共同的时钟频率
使用TI-达芬奇，OMAP ， DSP的
- 生成高度精确的时钟为
视频，音频， USB ， IEEE1394 ， RFID ，
蓝牙 ， WLAN ，以太网和
全球定位系统
1.8 V器件电源
单独的输出电源引脚
- CDCE913 ： 3.3 V和2.5 V
- CDCEL913 ： 1.8 V
宽温度范围-40 ° C至85°C
包装采用TSSOP
为了方便开发和编程工具包
PLL设计和编程（ TI Pro的时钟 ）
应用
V
DD
V
CTR
GND
D- TV，STB ， IP -STB ， DVD播放器， DVD刻录机，
打印机
V
DDOUT
LV
CMOS
晶体或
时钟输入
VCXO
XO
LVCMOS
3
EEPROM
程序设计
和
控制寄存器
PLL
与SSC
Y1
分频器
和
产量
控制
LV
CMOS
Y2
S2 / S1 / S0或
SDA / SCL
LV
CMOS
Y3
鑫/ CLK
S0
V
DD
V
CTR
GND
V
DDOUT
V
DDOUT
1
2
3
4
5
6
7
14
13
12
11
10
9
8
XOUT
S1/SDA
S2/SCL
Y1
GND
Y2
Y3
1
2
3
4
5
请注意，一个重要的通知有关可用性，标准保修，并且在关键的应用程序中使用
德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
达芬奇， OMAP ，亲时钟是德州仪器的商标。
Bluetooth是Bluetooth SIG的商标。
I2C是飞利浦电子公司的商标。
以太网是Xerox Corporattion的商标。
2007 ，德州仪器
PRODUCTION数据信息为出版日期。
产品符合占德州条款规范
仪器标准保修。生产加工过程中不
不一定包括所有参数进行测试。
CDCE913
CDCEL913
SCAS849A - 2007年6月 - 修订2007年8月
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这些器件具有有限的内置ESD保护。引线应短接在一起或设备放置在导电泡棉
储存或搬运过程中，以防止对静电损坏MOS大门。
描述
该CDCE913和CDCEL913是模块化的，基于PLL的低成本，高性能，可编程时钟
合成器，乘法器和除法器。它们产生高达从单个输入频率3输出时钟。每
输出可在系统编程的任何时钟频率高达230 MHz时，使用集成的配置
PLL 。
该CDCx913有单独的输出电源引脚，V
DDOUT
，这是1.8 V的CDCEL913和2.5 V至3.3 V的
CDCE913.
输入接受外部晶振或LVCMOS时钟信号。如果一个外部晶体的情况下，芯片上的负载
电容足以满足大多数应用。负载电容值的可编程范围为020 pF的。
此外，片上的VCXO是可选择的，它允许到外部的输出频率的同步
控制信号，即PWM信号。
深的M / N分频器比率允许一代的零ppm的音频/视频，网络（WLAN ，蓝牙，
从如以太网， GPS）或接口（ USB ， IEEE1394 ，记忆棒）的时钟， 27 MHz参考输入
频率。
该PLL支持SSC （扩频时钟） 。 SSC可以是中心扩频或向下蔓延时钟是
一种常用的技术，以减少电磁干扰（EMI） 。
基于PLL频率和分频器设置，内部环路滤波器元件的自动
调整，以达到高稳定和优化抖动传递特性。
设备支持的非易失性的EEPROM编写用于设备到应用的容易定制。
它是预设为出厂默认配置（见
默认设备配置
部分） 。它可以是
重新编程为不同的应用程序配置PCB组装，或之前重新编程通过系统
编程。所有的设备设置均通过SDA / SCL总线， 2线串行接口。
三个可编程控制输入， S0，S1和S2中，可用于选择不同的频率，或者改变SSC的
设置降低EMI ，或其它控制功能，如，禁止输出为低电平，输出三态，断电， PLL
旁路等）。
该CDCx913工作在1.8 - V环境。它的特点是操作温度范围为-40 ° C至85°C
终端功能的CDCE913 ， CDCEL913
终奌站
名字
Y1–Y3
鑫/ CLK
XOUT
V
CTRL
V
DD
V
DDOUT
GND
S0
SDA/S1
SCL/S2
PIN TSSOP14
11, 9, 8
1
14
4
3
6, 7
5, 10
2
13
12
I / O
O
I
O
I
动力
动力
地
I
I / O或I
I
LVCMOS输出
晶体振荡器输入或LVCMOS时钟输入（通过SDA / SCL总线可选）
晶体振荡器的输出（悬空或不使用时拉）
VCXO控制电压（悬空或不使用时拉）
该设备1.8 V电源
CDCEL913 ：
1.8 V电源所有输出
CDCE913 ：
3.3 V或2.5 V电源所有输出
地
用户可编程控制输入S0 ; LVCMOS输入;内部上拉500K
SDA ：
双向串行数据输入/输出（缺省配置） ， LVCMOS的内部
上拉;或
S1:
用户可编程控制输入; LVCMOS输入;内部上拉500K
SCL ：
串行时钟输入端LVCMOS （默认配置） ，内部上拉500K或
S2:
用户可编程控制输入; LVCMOS输入;内部上拉500K
描述
2
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CDCE913 CDCEL913
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CDCE913
CDCEL913
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V
DD
GND
输入时钟
Pdiv1
10-Bit
LV
CMOS
V
DDOUT
M1
V
CTR
鑫/ CLK
VCXO
XO
Y1
XOUT
EEPROM
S0
S1/SDA
S2/SCL
程序设计
和
SDA / SCL
注册
与SSC
PLL旁路
MUX1
LVCMOS
PLL 1
Pdiv2
7-Bit
Pdiv3
7-Bit
LV
CMOS
M2
Y2
LV
CMOS
M3
Y3
绝对最大额定值
在工作自由空气的温度范围内（除非另有说明）
(1)
价值
V
DD
V
I
V
O
I
I
I
O
T
英镑
T
J
(1)
(2)
电源电压范围
输入电压范围
(2)
输出电压范围
(2)
单位
V
V
V
mA
mA
°C
°C
-0.5 2.5
-0.5到V
DD
+ 0.5
-0.5到V
DD
+ 0.5
20
50
-65到150
125
输入电流（V
I
< 0 ，V
I
＆ GT ; V
DD
)
连续输出电流
存储温度范围
最高结温
强调超越那些在列
绝对最大额定值
可能对器件造成永久性损坏。这些压力额定值
该设备在这些或超出下标明的任何其他条件，仅及功能操作
推荐工作
条件
是不是暗示。暴露于长时间处于最大绝对额定情况下会影响器件的可靠性。
如果输入和输出钳位电流额定值是所观察到的输入和输出负电压额定值可能被超过。
封装热阻的TSSOP （ PW ）封装
(1) (2)
在工作自由空气的温度范围内（除非另有说明）
参数
气流
（ LFM ）
0
T
JA
热阻结到环境
150
250
500
T
JC
(1)
(2)
热阻结到外壳
–
TSSOP14
° C / W
112
105
102
97
46
封装的热阻抗的计算按照JESD 51 JEDEC2S2P （高K板） 。
对于最新的封装和订购信息，请参阅封装选项附录本文档的末尾，或见TI
网站：
www.ti.com 。
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CDCE913 CDCEL913
3
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推荐工作条件
民
V
DD
V
O
V
IL
V
IH
V
I
（脱粒）
喃
1.8
最大
1.9
3.6
1.9
0.3 V
DD
单位
V
V
V
V
V
器件的电源电压
YX输出电源电压CDCE913 ，V
DDOUT
YX输出电源电压CDCEL913 ，V
DDOUT
低电平输入电压LVCMOS
高电平输入电压LVCMOS
输入电压阈值LVCMOS
输入电压范围为S0
输入电压范围S1，S2， SDA，SCL ; V
我（脱粒）
= 0.5 V
DD
输入电压范围CLK
输出电流（ V
DDOUT
= 3.3 V)
输出电流（ V
DDOUT
= 2.5 V)
输出电流（ V
DDOUT
= 1.8 V)
输出负载LVCMOS
工作自由空气的温度
1.7
2.3
1.7
0.7 V
DD
0.5 V
DD
0
0
0
1.9
3.6
1.9
±12
±10
±8
15
–40
85
V
我（多个）
V
我（CLK）
I
OH
/I
OL
C
L
T
A
V
V
mA
pF
°C
推荐的石英/ VCXO规格
(1)
民
f
XTAL
ESR
f
PR
C
0
/C
1
C
L
(1)
(2)
晶振输入频率范围（基本模式）
等效串联电阻
牵引范围（0V
≤
V
CTRL
≤
1.8 V)
(2)
频率控制电压，V
CTRL
Pullability比
片上，在XIN和XOUT负载电容
0
±120
0
±150
VDD
220
20
pF
8
喃
27
最大
32
100
单位
兆赫
PPM
V
有关VCXO配置，推荐水晶的详细信息，请参阅申请报告（ SCAA085 ） 。
牵引范围取决于晶型，片上晶体负载电容和PCB杂散电容;最小的牵引范围± 120 ppm的
适用于晶体中的申请报告（ SCAA085 ）上市。
EEPROM规格
民
EEcyc
EEret
EEPROM的编程周期
数据保留
100
10
典型值
1000
最大
单位
周期
岁月
4
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CDCE913 CDCEL913
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CDCE913
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时序要求
在电源电压，负载和工作的自由空气的温度范围内推荐
民
CLK_IN要求
f
CLK
t
r
/ t
f
LVCMOS时钟输入频率
PLL旁路模式
PLL模式
0
8
40%
标准
模式
民
SDA / SCL时序要求（见
图12）
f
SCL
t
SU （ START）
t
H（ START）
t
W（ SCLL ）
t
W（ SCLH ）
t
H（ SDA ）
t
SU（ SDA ）
t
r
t
f
t
SU（ STOP）
t
公共汽车
SCL时钟频率
启动安装程序时（ SCL ，SDA前低至高）
开始保持时间（ SDA后低SCL为低电平）
SCL为低电平脉冲持续时间
SCL高电平脉冲持续时间
SDA保持时间（ SDA后SCL为低电平有效）
SDA建立时间
SCL / SDA输入上升时间
SCL / SDA输入下降时间
停止建立时间
一个停止和启动条件之间的总线空闲时间
4
4.7
0
4.7
4
4.7
4
0
250
1000
300
0.6
1.3
3.45
100
0
0.6
0.6
1.3
0.6
0
100
300
300
0.9
400
千赫
μs
μs
μs
μs
μs
ns
ns
ns
μs
μs
最大
快
模式
民
最大
160
160
3
60%
兆赫
ns
喃
最大
单位
上升和下降时间的CLK信号（20％至80％）
在V占空比CLK
DD
/2
单位
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CDCE913 CDCEL913
5
CDCE913
CDCEL913
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可编程1 - PLL VCXO时钟合成器，具有1.8 V， 2.5 V和3.3 V输出
检查样品：
CDCE913 ， CDCEL913
1
特点
可编程时钟发生器的会员
家庭
–
CDCE913 / CDCEL913 ： 1 - PLL ， 3输出
- CDCE925 / CDCEL925 ： 2 - PLL ， 5输出
- CDCE937 / CDCEL937 ： 3 -PLL ， 7输出
- CDCE949 / CDCEL949 ： 4 -PLL ， 9输出
在系统可编程和EEPROM
- 串行可编程挥发性注册
- 非易失性EEPROM来存储客户
环境
灵活的输入时钟概念
- 外部晶振： 8 MHz至32 MHz的
- 片上VCXO ：拉动范围± 150 ppm的
- 单端LVCMOS高达160 MHz的
自由选择的输出频率高达
230兆赫
低噪声PLL内核
- PLL环路滤波器元件集成
- 低周期抖动（典型值50 PS）
单独的输出电源引脚
- CDCE913 ： 3.3 V和2.5 V
2345
- CDCEL913 ： 1.8 V
灵活的时钟驱动器
- 三种用户自定义控制输入
[ S0 / S1 / S2 ] ，例如。 ， SSC的选择，
开关频率，输出使能，或
掉电
- 生成高度精确的时钟为
视频，音频， USB ， IEEE1394 ， RFID ，
蓝牙 ，无线局域网，以太网和GPS
- 产生共同的时钟频率
使用TI-达芬奇，OMAP ， DSP的
- 可编程SSC调制
- 启用0 -PPM时钟发生器
1.8 V器件电源
宽温度范围-40 ° C至85°C
包装采用TSSOP
为了方便开发和编程工具包
PLL设计和编程（ TI Pro的时钟 ）
应用
D- TV，STB ， IP -STB ， DVD播放器， DVD刻录机，
打印机
V
DD
V
CTR
GND
V
DDOUT
LV
CMOS
晶体或
时钟输入
VCXO
XO
LVCMOS
3
EEPROM
程序设计
和
控制寄存器
PLL
与SSC
Y1
分频器
和
产量
控制
LV
CMOS
Y2
S2 / S1 / S0或
SDA / SCL
LV
CMOS
Y3
鑫/ CLK
S0
V
DD
V
CTR
GND
V
DDOUT
V
DDOUT
1
2
3
4
5
6
7
14
13
12
11
10
9
8
XOUT
S1/SDA
S2/SCL
Y1
GND
Y2
Y3
1
2
3
4
5
请注意，一个重要的通知有关可用性，标准保修，并在得克萨斯州的关键应用程序使用
仪器的半导体产品和免责条款及其出现在此数据表的末尾。
达芬奇， OMAP ，亲时钟是德州仪器的商标。
Bluetooth是Bluetooth SIG的商标。
I
2
C是飞利浦电子公司的商标。
以太网是Xerox Corporattion的商标。
版权所有 2007-2010 ，德州仪器
PRODUCTION数据信息为出版日期。
产品符合占德州条款规范
仪器标准保修。生产加工过程中不
不一定包括所有参数进行测试。
CDCE913
CDCEL913
SCAS849E - 2007年6月 - 修订2010年3月
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这个集成电路可以被ESD损坏。德州仪器建议所有集成电路与处理
适当的预防措施。如果不遵守正确的操作和安装程序，可以造成损坏。
ESD损害的范围可以从细微的性能下降，完成设备故障。精密集成电路可能会更
容易受到伤害，因为很小的参数变化可能导致设备不能满足其公布的规格。
描述
该CDCE913和CDCEL913是模块化的，基于PLL的低成本，高性能，可编程时钟
合成器，乘法器和除法器。它们产生高达从单个输入频率3输出时钟。每
输出可在系统编程的任何时钟频率高达230 MHz时，使用集成的配置
PLL 。
该CDCx913有单独的输出电源引脚，V
DDOUT
，这是1.8 V的CDCEL913和2.5 V至3.3 V的
CDCE913.
输入接受外部晶振或LVCMOS时钟信号。如果一个外部晶体的情况下，芯片上的负载
电容足以满足大多数应用。负载电容值的可编程范围为020 pF的。
此外，片上的VCXO是可选择的，它允许到外部的输出频率的同步
控制信号，即， PWM信号。
深的M / N分频器比率允许一代的零ppm的音频/视频，网络（WLAN ，蓝牙，
从如以太网， GPS）或接口（ USB ， IEEE1394 ，记忆棒）的时钟， 27 MHz参考输入
频率。
该PLL支持SSC （扩频时钟） 。 SSC可以是中心扩频或向下蔓延时钟是
一种常用的技术，以减少电磁干扰（EMI） 。
基于PLL频率和分频器设置，内部环路滤波器元件的自动
调整，以达到高稳定和优化抖动传递特性。
设备支持的非易失性的EEPROM编写用于设备到应用的容易定制。
它是预设为出厂默认配置（见
默认设备配置
部分） 。它可以是
重新编程为不同的应用程序配置PCB组装，或之前重新编程通过系统
编程。所有的设备设置均通过SDA / SCL总线， 2线串行接口。
三个可编程控制输入， S0，S1和S2中，可用于选择不同的频率，或者改变SSC的
设置降低EMI ，或其它控制功能，如，禁止输出为低电平，输出三态，断电， PLL
旁路等）。
该CDCx913工作在1.8 V环境。它工作在-40 ℃的温度范围内，以85 ℃。
终端功能的CDCE913 ， CDCEL913
终奌站
名字
Y1–Y3
鑫/ CLK
XOUT
V
CTRL
V
DD
V
DDOUT
GND
S0
SDA/S1
SCL/S2
PIN TSSOP14
11, 9, 8
1
14
4
3
6, 7
5, 10
2
13
12
I / O
O
I
O
I
动力
动力
地
I
I / O或I
I
LVCMOS输出
晶体振荡器输入或LVCMOS时钟输入（通过SDA / SCL总线可选）
晶体振荡器的输出（悬空或不使用时拉）
VCXO控制电压（悬空或不使用时拉）
该设备1.8 V电源
CDCEL913 ：
1.8 V电源所有输出
CDCE913 ：
3.3 V或2.5 V电源所有输出
地
用户可编程控制输入S0 ; LVCMOS输入;内部上拉500K
SDA ：
双向串行数据输入/输出（缺省配置） ， LVCMOS的内部
上拉;或
S1:
用户可编程控制输入; LVCMOS输入;内部上拉500K
SCL ：
串行时钟输入端LVCMOS （默认配置） ，内部上拉500K或
S2:
用户可编程控制输入; LVCMOS输入;内部上拉500K
描述
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V
DD
V
CTR
鑫/ CLK
VCXO
PLL 1
与SSC
PLL旁路
Pdiv2
7-Bit
Pdiv3
7-Bit
M2
GND
输入时钟
Pdiv1
10-Bit
V
DDOUT
LV
CMOS
M1
Y1
XO
XOUT
EEPROM
S0
S1/SDA
S2/SCL
程序设计
和
SDA / SCL
注册
MUX1
LVCMOS
LV
CMOS
Y2
LV
CMOS
M3
Y3
绝对最大额定值
在工作自由空气的温度范围内（除非另有说明）
(1)
价值
V
DD
V
I
V
O
I
I
I
O
T
英镑
T
J
(1)
(2)
(3)
电源电压范围
输入电压范围
(2) (3)
单位
V
V
V
mA
mA
°C
°C
-0.5 2.5
-0.5到V
DD
+ 0.5
-0.5到V
DD
+ 0.5
20
50
-65到150
125
输出电压范围
(2)
输入电流（V
I
< 0 ，V
I
＆ GT ; V
DD
)
连续输出电流
存储温度范围
最高结温
强调超越那些在列
绝对最大额定值
可能对器件造成永久性损坏。这些压力额定值
该设备在这些或超出下标明的任何其他条件，仅及功能操作
推荐工作
条件
是不是暗示。暴露于长时间处于最大绝对额定情况下会影响器件的可靠性。
如果输入和输出钳位电流额定值是所观察到的输入和输出负电压额定值可能被超过。
SDA和SCL可以到3.6V的推荐工作条件表中说明。
(2)
封装热阻的TSSOP （ PW ）封装
(1)
在工作自由空气的温度范围内（除非另有说明）
参数
气流
（ LFM ）
0
150
TSSOP14
° C / W
106
93
92
90
85
43
66
1.4
62
T
JA
热阻结到环境
200
250
500
T
JC
T
JB
R
QJT
R
QJB
(1)
(2)
热阻结到外壳
热阻结到董事会
热阻结到顶部
热阻结到下
—
—
—
—
封装的热阻抗的计算按照JESD 51 JEDEC2S2P （高K板） 。
对于最新的封装和订购信息，请参阅封装选项附录本文档的末尾，或见TI
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CDCE913 CDCEL913
CDCE913
CDCEL913
SCAS849E - 2007年6月 - 修订2010年3月
www.ti.com
推荐工作条件
民
V
DD
V
O
V
IL
V
IH
V
I
（脱粒）
喃
1.8
最大
1.9
3.6
1.9
0.3 V
DD
单位
V
V
V
V
V
器件的电源电压
YX输出电源电压CDCE913 ，V
DDOUT
YX输出电源电压CDCEL913 ，V
DDOUT
低电平输入电压LVCMOS
高电平输入电压LVCMOS
输入电压阈值LVCMOS
输入电压范围为S0
输入电压范围S1，S2， SDA，SCL ; V
我（脱粒）
= 0.5 V
DD
输入电压范围CLK
输出电流（ V
DDOUT
= 3.3 V)
输出电流（ V
DDOUT
= 2.5 V)
输出电流（ V
DDOUT
= 1.8 V)
输出负载LVCMOS
工作自由空气的温度
1.7
2.3
1.7
0.7 V
DD
0.5 V
DD
0
0
0
1.9
3.6
1.9
±12
±10
±8
15
–40
85
V
我（多个）
V
我（CLK）
I
OH
/I
OL
C
L
T
A
V
V
mA
pF
°C
推荐的石英/ VCXO规格
(1)
民
f
XTAL
ESR
f
PR
C
0
/C
1
C
L
(1)
(2)
晶振输入频率范围（基本模式）
等效串联电阻
牵引范围（0V
≤
V
CTRL
≤
1.8 V)
(2)
频率控制电压，V
CTRL
Pullability比
片上，在XIN和XOUT负载电容
0
±120
0
±150
V
DD
220
20
pF
8
喃
27
最大
32
100
单位
兆赫
PPM
V
有关VCXO配置，推荐水晶的详细信息，请参阅申请报告（ SCAA085 ） 。
牵引范围取决于晶型，片上晶体负载电容和PCB杂散电容;最小的牵引范围± 120 ppm的
适用于晶体中的申请报告（ SCAA085 ）上市。
EEPROM规格
民
EEcyc
EEret
EEPROM的编程周期
数据保留
100
10
典型值
1000
最大
单位
周期
岁月
4
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CDCE913 CDCEL913
CDCE913
CDCEL913
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时序要求
在电源电压，负载和工作的自由空气的温度范围内推荐
民
CLK_IN要求
f
CLK
t
r
/ t
f
LVCMOS时钟输入频率
PLL旁路模式
PLL模式
0
8
40%
标准
模式
民
SDA / SCL时序要求（见
图12）
f
SCL
t
SU （ START）
t
H（ START）
t
W（ SCLL ）
t
W（ SCLH ）
t
H（ SDA ）
t
SU（ SDA ）
t
r
t
f
t
SU（ STOP）
t
公共汽车
SCL时钟频率
启动安装程序时（ SCL ，SDA前低至高）
开始保持时间（ SDA后低SCL为低电平）
SCL为低电平脉冲持续时间
SCL高电平脉冲持续时间
SDA保持时间（ SDA后SCL为低电平有效）
SDA建立时间
SCL / SDA输入上升时间
SCL / SDA输入下降时间
停止建立时间
一个停止和启动条件之间的总线空闲时间
4
4.7
0
4.7
4
4.7
4
0
250
1000
300
0.6
1.3
3.45
100
0
0.6
0.6
1.3
0.6
0
100
300
300
0.9
400
千赫
ms
ms
ms
ms
ms
ns
ns
ns
ms
ms
最大
快
模式
民
最大
160
160
3
60%
兆赫
ns
喃
最大
单位
上升和下降时间的CLK信号（20％至80％）
在V占空比CLK
DD
/2
单位
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CDCE913
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可编程1 - PLL VCXO时钟合成器，具有1.8 V， 2.5 V和3.3 V输出
检查样品：
CDCE913 ， CDCEL913
1
特点
可编程时钟发生器的会员
家庭
–
CDCE913 / CDCEL913 ： 1 - PLL ， 3输出
- CDCE925 / CDCEL925 ： 2 - PLL ， 5输出
- CDCE937 / CDCEL937 ： 3 -PLL ， 7输出
- CDCE949 / CDCEL949 ： 4 -PLL ， 9输出
在系统可编程和EEPROM
- 串行可编程挥发性注册
- 非易失性EEPROM来存储客户
环境
灵活的输入时钟概念
- 外部晶振： 8 MHz至32 MHz的
- 片上VCXO ：拉动范围± 150 ppm的
- 单端LVCMOS高达160 MHz的
自由选择的输出频率高达
230兆赫
低噪声PLL内核
- PLL环路滤波器元件集成
- 低周期抖动（典型值50 PS）
单独的输出电源引脚
- CDCE913 ： 3.3 V和2.5 V
2345
- CDCEL913 ： 1.8 V
灵活的时钟驱动器
- 三种用户自定义控制输入
[ S0 / S1 / S2 ] ，例如。 ， SSC的选择，
开关频率，输出使能，或
掉电
- 生成高度精确的时钟为
视频，音频， USB ， IEEE1394 ， RFID ，
蓝牙 ，无线局域网，以太网和GPS
- 产生共同的时钟频率
使用TI-达芬奇，OMAP ， DSP的
- 可编程SSC调制
- 启用0 -PPM时钟发生器
1.8 V器件电源
宽温度范围-40 ° C至85°C
包装采用TSSOP
为了方便开发和编程工具包
PLL设计和编程（ TI Pro的时钟 ）
应用
D- TV，STB ， IP -STB ， DVD播放器， DVD刻录机，
打印机
V
DD
V
CTR
GND
V
DDOUT
LV
CMOS
晶体或
时钟输入
VCXO
XO
LVCMOS
3
EEPROM
程序设计
和
控制寄存器
PLL
与SSC
Y1
分频器
和
产量
控制
LV
CMOS
Y2
S2 / S1 / S0或
SDA / SCL
LV
CMOS
Y3
鑫/ CLK
S0
V
DD
V
CTR
GND
V
DDOUT
V
DDOUT
1
2
3
4
5
6
7
14
13
12
11
10
9
8
XOUT
S1/SDA
S2/SCL
Y1
GND
Y2
Y3
1
2
3
4
5
请注意，一个重要的通知有关可用性，标准保修，并在得克萨斯州的关键应用程序使用
仪器的半导体产品和免责条款及其出现在此数据表的末尾。
达芬奇， OMAP ，亲时钟是德州仪器的商标。
Bluetooth是Bluetooth SIG的商标。
I
2
C是飞利浦电子公司的商标。
以太网是Xerox Corporattion的商标。
版权所有 2007-2010 ，德州仪器
PRODUCTION数据信息为出版日期。
产品符合占德州条款规范
仪器标准保修。生产加工过程中不
不一定包括所有参数进行测试。
CDCE913
CDCEL913
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这个集成电路可以被ESD损坏。德州仪器建议所有集成电路与处理
适当的预防措施。如果不遵守正确的操作和安装程序，可以造成损坏。
ESD损害的范围可以从细微的性能下降，完成设备故障。精密集成电路可能会更
容易受到伤害，因为很小的参数变化可能导致设备不能满足其公布的规格。
描述
该CDCE913和CDCEL913是模块化的，基于PLL的低成本，高性能，可编程时钟
合成器，乘法器和除法器。它们产生高达从单个输入频率3输出时钟。每
输出可在系统编程的任何时钟频率高达230 MHz时，使用集成的配置
PLL 。
该CDCx913有单独的输出电源引脚，V
DDOUT
，这是1.8 V的CDCEL913和2.5 V至3.3 V的
CDCE913.
输入接受外部晶振或LVCMOS时钟信号。如果一个外部晶体的情况下，芯片上的负载
电容足以满足大多数应用。负载电容值的可编程范围为020 pF的。
此外，片上的VCXO是可选择的，它允许到外部的输出频率的同步
控制信号，即， PWM信号。
深的M / N分频器比率允许一代的零ppm的音频/视频，网络（WLAN ，蓝牙，
从如以太网， GPS）或接口（ USB ， IEEE1394 ，记忆棒）的时钟， 27 MHz参考输入
频率。
该PLL支持SSC （扩频时钟） 。 SSC可以是中心扩频或向下蔓延时钟是
一种常用的技术，以减少电磁干扰（EMI） 。
基于PLL频率和分频器设置，内部环路滤波器元件的自动
调整，以达到高稳定和优化抖动传递特性。
设备支持的非易失性的EEPROM编写用于设备到应用的容易定制。
它是预设为出厂默认配置（见
默认设备配置
部分） 。它可以是
重新编程为不同的应用程序配置PCB组装，或之前重新编程通过系统
编程。所有的设备设置均通过SDA / SCL总线， 2线串行接口。
三个可编程控制输入， S0，S1和S2中，可用于选择不同的频率，或者改变SSC的
设置降低EMI ，或其它控制功能，如，禁止输出为低电平，输出三态，断电， PLL
旁路等）。
该CDCx913工作在1.8 V环境。它工作在-40 ℃的温度范围内，以85 ℃。
终端功能的CDCE913 ， CDCEL913
终奌站
名字
Y1–Y3
鑫/ CLK
XOUT
V
CTRL
V
DD
V
DDOUT
GND
S0
SDA/S1
SCL/S2
PIN TSSOP14
11, 9, 8
1
14
4
3
6, 7
5, 10
2
13
12
I / O
O
I
O
I
动力
动力
地
I
I / O或I
I
LVCMOS输出
晶体振荡器输入或LVCMOS时钟输入（通过SDA / SCL总线可选）
晶体振荡器的输出（悬空或不使用时拉）
VCXO控制电压（悬空或不使用时拉）
该设备1.8 V电源
CDCEL913 ：
1.8 V电源所有输出
CDCE913 ：
3.3 V或2.5 V电源所有输出
地
用户可编程控制输入S0 ; LVCMOS输入;内部上拉500K
SDA ：
双向串行数据输入/输出（缺省配置） ， LVCMOS的内部
上拉;或
S1:
用户可编程控制输入; LVCMOS输入;内部上拉500K
SCL ：
串行时钟输入端LVCMOS （默认配置） ，内部上拉500K或
S2:
用户可编程控制输入; LVCMOS输入;内部上拉500K
描述
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V
DD
V
CTR
鑫/ CLK
VCXO
PLL 1
与SSC
PLL旁路
Pdiv2
7-Bit
Pdiv3
7-Bit
M2
GND
输入时钟
Pdiv1
10-Bit
V
DDOUT
LV
CMOS
M1
Y1
XO
XOUT
EEPROM
S0
S1/SDA
S2/SCL
程序设计
和
SDA / SCL
注册
MUX1
LVCMOS
LV
CMOS
Y2
LV
CMOS
M3
Y3
绝对最大额定值
在工作自由空气的温度范围内（除非另有说明）
(1)
价值
V
DD
V
I
V
O
I
I
I
O
T
英镑
T
J
(1)
(2)
(3)
电源电压范围
输入电压范围
(2) (3)
单位
V
V
V
mA
mA
°C
°C
-0.5 2.5
-0.5到V
DD
+ 0.5
-0.5到V
DD
+ 0.5
20
50
-65到150
125
输出电压范围
(2)
输入电流（V
I
< 0 ，V
I
＆ GT ; V
DD
)
连续输出电流
存储温度范围
最高结温
强调超越那些在列
绝对最大额定值
可能对器件造成永久性损坏。这些压力额定值
该设备在这些或超出下标明的任何其他条件，仅及功能操作
推荐工作
条件
是不是暗示。暴露于长时间处于最大绝对额定情况下会影响器件的可靠性。
如果输入和输出钳位电流额定值是所观察到的输入和输出负电压额定值可能被超过。
SDA和SCL可以到3.6V的推荐工作条件表中说明。
(2)
封装热阻的TSSOP （ PW ）封装
(1)
在工作自由空气的温度范围内（除非另有说明）
参数
气流
（ LFM ）
0
150
TSSOP14
° C / W
106
93
92
90
85
43
66
1.4
62
T
JA
热阻结到环境
200
250
500
T
JC
T
JB
R
QJT
R
QJB
(1)
(2)
热阻结到外壳
热阻结到董事会
热阻结到顶部
热阻结到下
—
—
—
—
封装的热阻抗的计算按照JESD 51 JEDEC2S2P （高K板） 。
对于最新的封装和订购信息，请参阅封装选项附录本文档的末尾，或见TI
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推荐工作条件
民
V
DD
V
O
V
IL
V
IH
V
I
（脱粒）
喃
1.8
最大
1.9
3.6
1.9
0.3 V
DD
单位
V
V
V
V
V
器件的电源电压
YX输出电源电压CDCE913 ，V
DDOUT
YX输出电源电压CDCEL913 ，V
DDOUT
低电平输入电压LVCMOS
高电平输入电压LVCMOS
输入电压阈值LVCMOS
输入电压范围为S0
输入电压范围S1，S2， SDA，SCL ; V
我（脱粒）
= 0.5 V
DD
输入电压范围CLK
输出电流（ V
DDOUT
= 3.3 V)
输出电流（ V
DDOUT
= 2.5 V)
输出电流（ V
DDOUT
= 1.8 V)
输出负载LVCMOS
工作自由空气的温度
1.7
2.3
1.7
0.7 V
DD
0.5 V
DD
0
0
0
1.9
3.6
1.9
±12
±10
±8
15
–40
85
V
我（多个）
V
我（CLK）
I
OH
/I
OL
C
L
T
A
V
V
mA
pF
°C
推荐的石英/ VCXO规格
(1)
民
f
XTAL
ESR
f
PR
C
0
/C
1
C
L
(1)
(2)
晶振输入频率范围（基本模式）
等效串联电阻
牵引范围（0V
≤
V
CTRL
≤
1.8 V)
(2)
频率控制电压，V
CTRL
Pullability比
片上，在XIN和XOUT负载电容
0
±120
0
±150
V
DD
220
20
pF
8
喃
27
最大
32
100
单位
兆赫
PPM
V
有关VCXO配置，推荐水晶的详细信息，请参阅申请报告（ SCAA085 ） 。
牵引范围取决于晶型，片上晶体负载电容和PCB杂散电容;最小的牵引范围± 120 ppm的
适用于晶体中的申请报告（ SCAA085 ）上市。
EEPROM规格
民
EEcyc
EEret
EEPROM的编程周期
数据保留
100
10
典型值
1000
最大
单位
周期
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时序要求
在电源电压，负载和工作的自由空气的温度范围内推荐
民
CLK_IN要求
f
CLK
t
r
/ t
f
LVCMOS时钟输入频率
PLL旁路模式
PLL模式
0
8
40%
标准
模式
民
SDA / SCL时序要求（见
图12）
f
SCL
t
SU （ START）
t
H（ START）
t
W（ SCLL ）
t
W（ SCLH ）
t
H（ SDA ）
t
SU（ SDA ）
t
r
t
f
t
SU（ STOP）
t
公共汽车
SCL时钟频率
启动安装程序时（ SCL ，SDA前低至高）
开始保持时间（ SDA后低SCL为低电平）
SCL为低电平脉冲持续时间
SCL高电平脉冲持续时间
SDA保持时间（ SDA后SCL为低电平有效）
SDA建立时间
SCL / SDA输入上升时间
SCL / SDA输入下降时间
停止建立时间
一个停止和启动条件之间的总线空闲时间
4
4.7
0
4.7
4
4.7
4
0
250
1000
300
0.6
1.3
3.45
100
0
0.6
0.6
1.3
0.6
0
100
300
300
0.9
400
千赫
ms
ms
ms
ms
ms
ns
ns
ns
ms
ms
最大
快
模式
民
最大
160
160
3
60%
兆赫
ns
喃
最大
单位
上升和下降时间的CLK信号（20％至80％）
在V占空比CLK
DD
/2
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推荐型号
CAT93C8632
CXA3106AQ
CY2SSTV850ZC
C21074108
C3696
CT0.2-P
CY74FCT257CTDE4
C052G102G1CK5CM
CY29775AXI
CTA3F1BSQ61
CS5503-CP
CS5503CP
CAT1321YI-28TE13
CAT28C161S16I-25TE13
C3225C0G2J102KT
CAT32EKT
CY7C1412AV18-167BZI
CYSD2J4A20.000
CWR06JC155JPC
CFU1602
供货商
型号
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封装
单价/备注
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    联系人：杨小姐
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    -
    -
    -
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联系人：朱
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联系人：李小姐/陈先生/李先生【只售原装假一罚百】豪迈兴你值得信赖的供应商！
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