CD54ACT161 ， CD74ACT161
4位同步二进制计数器
SCHS298B - 2000年4月 - 修订2003年3月
D
D
D
D
D
D
D
输入是TTL电压兼容
内部预读的快速计数
携带输出为N位的级联
同步计数
可编程同步
SCR-闭锁耐CMOS工艺
电路设计
超过2 - kV ESD保护每
MIL -STD -883方法3015
CD54ACT161 。 。 。 F封装
CD74ACT161 。 。 。 E或男包
（ TOP VIEW ）
描述/订购信息
CLR
CLK
A
B
C
D
ENP
GND
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
V
CC
RCO
Q
A
Q
B
Q
C
Q
D
耳鼻喉科
负载
在' ACT161设备是4位二进制计数器。这些同步，可预置计数器具有内部
开展先行在高速计数设计的应用程序。同步操作是由具有设置
所有触发器同时计时，以使输出发生变化相互一致时，那么指示
通过计数使能（ ENP ， ENT）输入和内部选通。这种操作模式消除了输出
计数通常与同步（纹波时钟）计数器相关的尖峰。缓冲时钟（ CLK ）
输入触发器的时钟波形的上升（正）边缘的四个触发器。
这些器件完全可编程的;也就是说，它们可以被预先设定为任意数为0至9或15 。
预置是同步的;因此，建立在负载输入端的低电平禁止计数器和原因
的输出以符合下一个时钟脉冲之后设置数据，而不管使能输入水平的变化。
明确的功能是异步的。在清除（ CLR ）输入的低电平将所有四个触发器输出低电平，
不管CLK ，负载（ LOAD ）的水平，或使能输入。
在先行进位电路提供了级联计数器n位不同步应用
额外的门。有助于实现这一功能的是ENP ， ENT和纹波进位输出（ RCO ） 。
无论ENP和ENT要高数，耳鼻喉科前馈，使RCO 。启用RCO产生
当计数为最大的高电平脉冲（9或15 ，带Q
A
高点） 。这种高层次的溢波进位脉冲
可以用来使连续级联级。转换为ENP或耳鼻喉科是允许的，不管
CLK的电平。
专柜设有一间独立的时钟电路。在控制输入（ ENP ， ENT ，或LOAD ）的变化
修改操作模式对计数器的内容没有任何影响，直到时钟发生。的功能
计数器（是否启用，禁用，装载，或计数）由符合条件的单独决定
稳定的建立和保持时间。
订购信息
TA
包装
PDIP - ê
-55 ° C至125°C
55°C
SOIC - M
CDIP - F
管
管
磁带和卷轴
管
订购
产品型号
CD74ACT161E
CD74ACT161M
CD74ACT161M96
CD54ACT161F3A
TOP- SIDE
记号
CD74ACT161E
ACT161M
CD54ACT161F3A
请注意，一个重要的通知有关可用性，标准保修，并且在关键的应用程序中使用
德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
版权
2003年，德州仪器
关于产品符合MIL -PRF- 38535 ，所有参数进行测试
除非另有说明。在所有其他产品，生产
加工不一定包括所有参数进行测试。
PRODUCTION数据信息为出版日期。
产品符合每德州仪器条款规范
标准保修。生产加工并不包括
所有测试参数。
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达拉斯，德克萨斯州75265
1
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功能表
输入
CLR
L
H
H
H
H
H
CLK
X
↑
↑
↑
X
X
ENP
X
X
X
h
l
X
耳鼻喉科
X
X
X
h
X
l
负载
X
l
l
h
h
h
A，B ， C，D
X
l
h
X
X
X
输出
Qn
L
L
H
算
qn
qn
RCO
L
L
注1
注1
注1
L
功能
复位（清）
并行加载
算
抑制
H =水平高， L =水平低，X =无关，H =高电平一个设置之前CLK的时间
低到高的转变， L =低一级建立时间之前CLK低到高的转变， Q =的
引用的输出状态之前CLK低到高的转变，并
↑
= CLK从低到高
过渡。
注1： RCO输出为高时，耳鼻喉科高，并且计数器是在终端计数
(HHHH).
2
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逻辑图（正逻辑）
负载
耳鼻喉科
ENP
9
10
7
LDε
CK =
CLK
CLR
2
1
CK
R
LD
15
RCO
A
3
M1
G2
1 ， 2T / 1C3
G4
3D
4R
M1
G2
1 ， 2T / 1C3
G4
3D
4R
14
QA
13
QB
B
4
C
5
M1
G2
1 ， 2T / 1C3
G4
3D
4R
12
QC
D
6
M1
G2
1 ， 2T / 1C3
G4
3D
4R
11
QD
为简单起见，互补信号LD和CK的路由这个整体逻辑图上未示出。这些信号的用途示
为D的逻辑图/ T触发器。
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逻辑符号，每个D / T触发器
LD （LOAD）
TE （切换使能）
的CK （时钟）
M1
G2
1 ， 2T / 1C3
G4
3D
4R
Q（输出）
D（反向的数据）
R（倒复位）
逻辑图中，每个D / T触发器（正逻辑）
CK
LD
TE
LDε
TG
TG
LDε
D
TG
TG
TG
CK =
CK =
TG
Q
CK =
R
LD和CK的起源是示出在整体设备的逻辑图。
CK =
4
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典型的清晰，预置，计数，并抑制序列
下面的序列图所示：
1.清除输出为零（异步）
2.预设为二进制12
3.计数到13 ，14，15 ， 0 ，1和2
4.禁止
CLR
负载
A
B
C
D
CLK
ENP
耳鼻喉科
QA
QB
QC
QD
RCO
12
13
14
15
0
1
2
抑制
算
预设
数据
输入
数据
输出
ASYNC
明确
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