CD4051B Q1 , Q1 CD4052B , CD4053B Q1
CMOS模拟多路复用器/多路解复用器
采用逻辑电平转换
SCHS354 - 2004年8月
特点
D
匹配的开关特性,
D
D
资格按照用
D
D
D
D
D
D
AEC-Q100
通过汽车应用认证
客户的具体配置控制
可以支持除了用
少将变更核准
数字和模拟信号的大范围
水平
- 数字: 3到20V
- 模拟:
3
20 V
P-P
低导通电阻, 125
(典型值)以上
15 V
P-P
信号输入范围
对于V
DD
V
EE
= 18 V
高关阻力,对信道泄漏
+100
PA(典型值),在V
DD
V
EE
= 18 V
逻辑电平转换为数字
的3到20V的寻址信号
(V
DD
V
SS
= 3 V至20 V ),以模拟开关
信号20 V
P-P
(V
DD
V
EE
= 20 V)
D
D
D
D
D
r
on
= 5
(典型值)的V
DD
V
EE
= 15 V
非常低的静态功耗
在全数字控制输入和电源
的条件下, 0.2
W
(典型值)
在V
DD
V
SS
= V
DD
V
EE
= 10 V
二进制地址解码芯片
5 -V , 10 - V和15 -V的参数等级
100 %测试静态电流为20 V
1μA的18 V过的最大输入电流
全封装温度范围, 100 nA的在
18 V和25℃
先开后合式开关省去了
道重叠
应用
D
模拟和数字复用和
D
D
解复用
模数(A / D)和
数字 - 模拟(D / A)转换
信号门
请与工厂联系获取详细信息。适用于Q100认证数据
请求。
描述/订购信息
该CD4051B , CD4052B和CD4053B模拟多路复用器是数字控制的具有模拟开关
低导通阻抗和非常低的截止漏电流。控制模拟信号的上升到20V
P-P
可以实现
由4.5到20V的数字信号的幅度(如V
DD
V
SS
= 3 V时, V
DD
V
EE
高达13 V可以被控制;
对于V
DD
V
EE
超过13 V时, V电平差异
DD
V
SS
的至少4.5伏是必需的) 。例如,如果
V
DD
= 4.5 V, V
SS
= 0V和V
EE
= -13.5 V,模拟从-13.5 V至4.5 V信号可以通过数字控制
0 V至5 V输入这些多路复用器电路消耗极低的静态功耗在整个V
DD
V
SS
和V
DD
V
EE
电源电压范围内,独立于控制信号的逻辑状态如何。当一个逻辑高电平
(H),是存在于禁止(INH)的输入,所有通道都关闭。
订购信息
TA
SOIC - M
TSSOP - PW
SOIC - M
-40_C到125_C
TSSOP - PW
SOIC - M
TSSOP - PW
包装
2500卷
2000年卷
2500卷
2000年卷
2500卷
2000年卷
订购
产品型号
CD4051BQM96Q1
CD4051BQPWRQ1
CD4052BQM96Q1§
CD4052BQPWRQ1§
CD4053BQM96Q1
CD4053BQPWRQ1§
TOP- SIDE
记号
CD4051Q
CM051BQ
CD4052Q
CD4052Q
CD4053Q
CD4053Q
包装图纸,标准包装数量,热数据,符号和PCB设计准则
可在www.ti.com/sc/package 。
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德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
除非另有说明这个文件包含了生产
数据信息为出版日期。产品符合
每德州仪器标准保修条款的规范。
生产加工并不包括所有的测试
参数。
邮政信箱655303
版权
2004年,德州仪器
达拉斯,德克萨斯州75265
1
SCHS354 - 2004年8月
CD4051B Q1 , Q1 CD4052B , CD4053B Q1
CMOS模拟多路复用器/多路解复用器
采用逻辑电平转换
描述/订购信息(续)
该CD4051B是一个单一的八通道多路复用器,它有三个二进制控制输入端( A,B和C)和一个
禁止输入。这三个二进制信号选择八通道之一被关八的上连接一个
输入到输出端。
该CD4052B是差分四通道多路转换器,它具有两个二进制控制输入( A和B)和一个禁止
输入。这两个二进制输入信号选择四对渠道之一打开及连接模拟
输入到输出。
该CD4053B是三双通道复用器具有三个独立的数字控制输入端( A,B和C)和一个
禁止输入。每个控制输入选择一对通道,它们被连接在一个单极点之一,
双掷配置。
当这些装置被用作多路分解器,在CHANNEL IN / OUT端子输出,并且
公共(COM OUT / IN)的端子的输入端。
CD4051
M或PW包装
( TOP VIEW )
CD4052
M或PW包装
( TOP VIEW )
CHANNEL I / O 4
CHANNEL I / O 6
COM OUT / IN
CHANNEL I / O 7
CHANNEL I / O 5
INH
V
EE
V
SS
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
V
DD
CHANNEL I / O 2
CHANNEL I / O 1
CHANNEL I / O 0
CHANNEL I / O 3
A
B
C
Y通道I / O 0
Y通道I / O 2
COM OUT / IN
Y通道I / O 3
Y通道I / O 1
INH
V
EE
V
SS
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
V
DD
X CHANNEL I / O 2
X CHANNEL I / O 1
COM X OUT / IN
X CHANNEL I / O 0
X CHANNEL I / O 3
A
B
CD4053
M或PW包装
( TOP VIEW )
IN / OUT由
IN / OUT BX
IN / OUT CY
OUT / IN CX或CY
IN / OUT CX
INH
V
EE
V
SS
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
V
DD
OUT / IN BX或
OUT / IN AX或AY
IN / OUT AY
IN / OUT斧
A
B
C
2
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CD4051B Q1 , Q1 CD4052B , CD4053B Q1
CMOS模拟多路复用器/多路解复用器
采用逻辑电平转换
SCHS354 - 2004年8月
功能表
CD4051
输入
INH
L
L
L
L
L
L
L
L
H
C
L
L
L
L
H
H
H
H
X
B
L
L
H
H
L
L
H
H
X
A
L
H
L
H
L
H
L
H
X
ON
通道
0
1
2
3
4
5
6
7
无
X =无关
CD4052
输入
INH
L
L
L
L
H
X =无关
CD4053
输入
INH
L
L
H
X =无关
A或B或C
L
H
X
ON
通道
AX或BX或CX
AY或通过或CY
无
B
L
L
H
H
X
A
L
H
L
H
X
ON
通道
0X , 0Y
1X , 2Y
2X , 2Y
3X , 3Y
无
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3
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CD4051B Q1 , Q1 CD4052B , CD4053B Q1
CMOS模拟多路复用器/多路解复用器
采用逻辑电平转换
逻辑图(正逻辑)
CD4051B
CHANNEL I / O
7
16
VDD
4
6
2
5
5
4
1
3
12
2
15
1
14
0
13
TG
TG
A
11
TG
B
10
逻辑电平
转变
C
9
二进制
to
1-of-8
解码器
同
抑制
TG
3
COM
输出/输入
TG
TG
TG
TG
INH-
6
8
VSS
7
VEE
所有的输入都是由CMOS防护网保护。
CD4052B
X CHANNEL I / O
3
11
2
15
1
14
0
12
TG
16
VDD
TG
TG
TG
13
COM X
3
A
10
B
9
INH-
6
逻辑电平
转变
输出/输入
二进制
to
1-of-4
解码器
同
抑制
TG
TG
TG
TG
1
0
5
1
2
2
4
3
COM
输出/输入
8
VSS
7
VEE
Y通道I / O
所有的输入都是由CMOS防护网保护。
4
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CMOS模拟多路复用器/多路解复用器
采用逻辑电平转换
SCHS354 - 2004年8月
逻辑图(正逻辑) (续)
CD4053B
IN / OUT
16 VDD
cy
3
逻辑电平
转变
二进制
1-of-2
解码器
同
抑制
cx
5
by
1
bx
2
ay
13
ax
12
TG
TG
TG
TG
TG
TG
COM OUT / IN
XC或XY
4
COM OUT / IN
BC或
15
COM OUT / IN
AC或AY
14
A
11
B
10
C
9
INH
6
VDD
8 VSS
7
VEE
所有的输入都是通过标准的CMOS防护网保护。
在工作自由空气的温度绝对最大额定值(除非另有说明)
电源电压范围,V +至V- (电压参考V
SS
终奌站) 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -0.5到20V
直流输入电压范围。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -0.5 V到V
DD
+ 0.5 V
DC输入电流,任何一个输入端。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
±10
mA
封装的热阻抗,
θ
JA
(见注1 ) :男包。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 73 ° C / W
PW包。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 108 ° C / W
最高结温,T
J
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 150°C
引线温度(焊接时) :
在距离1/16
±
1/32英寸( 1.59
±
0,79毫米)的情况下, 10秒最大。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 265℃
存储温度范围,T
英镑
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -65 ℃150 ℃的
超出“绝对最大额定值”列出的强调可能会造成永久性损坏设备。这些压力额定值只,和
该设备在这些或超出下标明的任何其他条件的功能操作“推荐工作条件”不
暗示。暴露于长时间处于最大绝对额定情况下会影响器件的可靠性。
注1 :该封装的热阻抗的计算按照JESD 51-7 。
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5