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AMD - 640芯片组I / O模型
应用说明
AMD- 640 芯片组
I / O模型
介绍
在半导体工艺技术的进步已经允许
集成电路的性能会急剧增加。
输出信号的工作频率从这些从动
电路的不断增加,而该开关转换
这些信号已经降低。这些特殊的特点
高速信号构成挑战系统设计者
负责组件上的布局和布线
印刷电路板(PCB) 。特别地,繁殖
的信号的延迟,必须考虑到确保充分的
建立时间和保持时间,有足够的保证金,存在于信号的
目的地。的信号,此外,由于上升和下降时间
降低,系统的设计者必须确保信号质量
满足系统要求。
确保系统定时和信号质量目标是
之前的PCB制造满足缩短开发
费用和加速时间将产品推向市场的一款产品。这
应用笔记描述的格式和用法
AMD - 640芯片组的I / O缓冲的行为模式,它允许
系统设计者来执行芯片组的模拟的模拟
信号与系统的逻辑接口。这种模式坚持
I / O缓冲信息规范( IBIS ) , 2.1版。
本文件包含有关正在开发的产品,在Advanced Micro Devices公司的信息。该信息是
为了帮助您评估该产品。 AMD保留对本建议修改权利或停止工作
产品,恕不另行通知。
文件编号:
21340
发行日期:
1997年4月
启示录
A
Amendment/0
AMD - 640芯片组I / O模型
21340A / 1997年0月
IBIS模型
概观
IBIS的开发提供了一个规范
半导体制造商的行业标准方法
模拟的I / O缓冲区的模拟行为,但不透露
专有工艺数据。由于IBIS模型的有效性有
成长,所以也有一个接受模拟仿真的数量
IBIS模型。
IBIS用法
造型PCB网
以模拟信号的模拟特征的PCB上的网,所有
净的元素必须被建模以确保模拟器
产生准确的结果。一个由一个信号驱动网,
具有短的切换相对于它的传播过渡
延迟是最好的模型作为传输线。一般
用于判定在传输线作为基准
合适的模型是如下:
T
开关
< 2 (T
PROP
)
其中:
s
s
T
开关
需要一个信号到切换状态的时间
T
PROP
需要一个信号传播时间的
源到目的地
净的来源由芯片组的典型元素包括
芯片组的I / O缓冲器(使用IBIS建模) ,传输线
该模型的PCB迹线,目标接收器(多个) ,并且任何
用于端接组件(参见图1) 。该网
拓扑然后在由目标理解的格式定义的
模拟器。
2
21340A / 1997年0月
AMD - 640芯片组I / O模型
V
CC
AMD- 640芯片组
R
1
司机
A
PCB走线
Z
o
R
2
B
接收器
系统逻辑
+
电压
来源
典型的PCB网图1.建模实例
后模拟器加载的净输入文件,模拟器
可以指示生成在一个上升沿还是下降沿
驱动器输入到(图1点'A')的芯片组驱动程序。这
信号发生器是由电压表示在图1中
源输入到芯片组驱动程序。
建立和保持时间
对于每个信号跳变时,模拟器可以判断
信号传播延迟,从点“A”下点“B”
最坏情况下,典型的,并且最佳情况的条件。传播
延迟下的最坏情况的条件是用来确定是否
设置时间在目的地接收器被满足。同样地,所述
在最好的情况条件progagation延迟来
确定是否满足在目的地接收的保持时间。
图2示出了时必须考虑的定时
判断是否满足信号的建立时间。该
定时被定义如下:
s
s
s
T
是系统时钟的周期
T
SKEW
是时钟之间的最大时钟脉冲相位差即
发射的信号(实线时钟)和时钟
捕获的信号(虚线时钟)
T
抖动
(图2中未示出)的最大偏差
系统时钟的连续周期之间津贴
3
AMD - 640芯片组I / O模型
21340A / 1997年0月
s
T
validmax
是从一个信号的最大有效延迟其
来源
T
propmax
是该信号的最大传播延迟
沿着从源到目的地的PCB走线。这
延迟是由与最坏情况下的仿真得到的
条件。
T
setupmin
是一个信号在所需要的最小设置时间
它的目的地
s
s
T
T
SKEW
T
validmax
信号源
T
propmax
信号目的地
T
setupmin
图2.时序注意事项会议建立时间
为了确保信号的设置时间被满足,则以下
关系必须满足:
T
validmax
+ T
propmax
+ T
setupmin
& LT ;吨
– T
SKEW
– T
抖动
4
21340A / 1997年0月
AMD - 640芯片组I / O模型
图3示出了时必须考虑的定时
判断是否满足信号的保持时间。该
定时被定义如下:
s
s
s
s
T
是系统时钟的周期
T
SKEW
是时钟之间的最大时钟脉冲相位差即
发射的信号(实线时钟)和时钟
捕获的信号(虚线时钟)
T
抖动
(图3中未示出)的最大偏差
系统时钟的连续周期之间津贴
T
validmin
是从信号的最小有效推迟
来源
T
propmin
是信号的最小传播延迟
沿着从源到目的地的PCB走线。这
延迟是由具有最好的情况模拟得到
条件。
T
holdmin
是这样的信号,在所需要的最小保持时间的
目的地
s
s
T
T
SKEW
T
validmin
信号源
T
propmin
信号目的地
T
holdmin
图3.时序注意事项,以满足保持时间
5
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