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初步
Am53C94/Am53C96
高性能SCSI控制器
特色鲜明
s
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s
s
引脚/功能兼容NCR53C94 / 53C96
AMD的专利毛刺EATER
TM
电路上
REQ
确认
输入
每秒同步SCSI 5兆字节
传输速率
每秒DMA传输速率20兆字节
16位DMA接口以及2位奇偶
灵活的三总线结构
通过支持单端SCSI总线
Am53C94
单端和差分SCSI总线
通过Am53C96支持
选择复用或非复用的
地址和数据总线
s
s
s
s
s
s
s
s
先进
器件
高电流驱动器(48 mA)的直接
连接到所述单端SCSI总线
支持断开并重新选择命令
支持具有突发模式DMA操作
8门槛
支持3字节的标记排队为每
SCSI -2规范
支持2组和5个命令识别
按照该SCSI -2规范
先进的CMOS工艺的低功耗
消费
Am53C94在84引脚PLCC封装
Am53C96 100引脚PQFP封装
概述
高性能SCSI控制器( HPSC )有
灵活的三总线结构。该HPSC有一个16位的
DMA接口,一个8位主数据接口和一个8位的
SCSI数据接口。该HPSC被设计为最小化
通过实施共同的SCSI SE-主办干预
quences硬件。片上状态机重
通过执行所需的duces协议开销
从一个命令序列中的响应
主机。选择,小区重选,信息传输和
直接支持断开连接的命令。
16字节FIFO内部进一步帮助最小化
主持参与。该FIFO提供了一个临时stor-
年龄all命令,数据,状态和消息字节为
它们在16位主机数据总线之间传送
和8位的SCSI数据总线。在DMA操作
的FIFO作为缓冲,以允许更大的延迟在DMA中
通道。这允许DMA通道是可持
挂起为较高优先级的操作,诸如DRAM的重新
鲜或接收一个ISDN包。
奇偶DMA总线上是可选的。奇偶校验可以是
产生和检查,或者它可以简单地通过
通过。
在高性专利的毛刺EATER电路
formance SCSI控制器检测到信号的变化
是小于或等于15纳秒,并过滤出来。这是
旨在大幅提高系统性能
和可靠性检测和过滤毛刺,可
导致系统故障。
毛刺EATER电路的实现
确认
REQ
线而已。这些线路经常遇到
许多电气异常而影响系统的运行per-
性能和可靠性。两种最常见的是再
flections和电压尖峰。思考的结果
是由短截线不匹配的大电流的SCSI信号
电缆和端接。这些思考来自AP-变化
折叠术为应用程序,并且可以触发虚假握手
上的信号
确认
REQ
如果线路电压扩增
突地是TTL阈值电平。产生尖峰
通过大电流的SCSI信号切换兼任。上
的控制信号( ACK与
REQ )
他们可以触发假
这会导致数据丢失,另外的数据传输
随机数据,双时钟和降低系统可靠性
的能力。 AMD的毛刺EATER电路有助于维持
通过处理故障卓越的系统性能。
参考下图的下一个页面上。
本文件包含有关正在开发的产品在高级微设备公司的信息旨在信息
帮助您评估该产品。 AMD保留对本建议的产品更改或停止工作,恕不另行通知。
出版#
16506
启示录
C
发行日期:
1993年5月
修订
/0
AMD
初步
毛刺EATER电路在SCSI环境
>15 NS
SCSI环境
<15 NS
有效信号
毛刺
设备无
毛刺EATER电路
确认
or
REQ
输入
毛刺通过为有效信号
AMD的设备与
毛刺EATER电路
确认
or
REQ
输入
毛刺过滤
有效的信号传递
16506C-1
系统框图
4
中央处理器
16
8
ADDR
9
数据
Am53C94/96
9
16
SCSI控制
SCSI数据
DMA
16
DMA
内存
16
16506C-2
2
Am53C94/Am53C96
初步
AMD
系统总线模式DIAGRAMS
BUSMD 1
BUSMD 0
DMAWR
WR
RD
地址总线
A 3–0
8位数据总线
DMA 7-0
DACK
DREQ
主持人
处理器
公共汽车
调节器
Am53C94/96
DMA
调节器
总线模式0
16506C-3
V
DD
BUSMD 1
BUSMD 0
DMAWR
WR
RD
地址总线
A 3–0
数据总线
DMA 15-0
主持人
处理器
公共汽车
调节器
Am53C94/96
DACK
DREQ
16
8
DMA
调节器
16506C-4
总线模式1
Am53C94/Am53C96
3
AMD
初步
系统总线模式DIAGRAMS
V
DD
BUSMD 1
BUSMD 0
WR
RD
ALE
8位数据总线
公元7-0
主持人
处理器
Am53C94/96
16位的数据总线
DMA 15-0
AS0
BHE
DMARD
DMAWR
DREQ
DACK
16506C-5
DMA
调节器
总线模式2
V
DD
BUSMD 1
BUSMD 0
WR
RD
地址总线
A 3–0
8位数据总线
公元7-0
主持人
处理器
Am53C94/96
16位的数据总线
DMA 15-0
DMAWR
DREQ
DACK
DMA
调节器
16506C-6
总线模式3
4
Am53C94/Am53C96
初步
AMD
框图
数据Tranceivers
18
DMA
15-0
DMAP
1-0
DMA控制
4
总线接口单元
8
16× 9的FIFO
(包括奇偶校验)
18
9
SCSI总线
数据+奇偶校验
(单端)
SCSI总线
数据+奇偶校验
方向控制
奇偶校验逻辑
9
AD
7-0
主机控制
CS
BUSMD
1-0
DFMODE
CLK
RESET
6
MUX
SCSI控制
8
注册
银行
SEQUENCER
9
7
SCSI控制
SCSI控制
方向控制
8
SCSI
SEQUENCER
16506C-7
Am53C94/Am53C96
5
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