【6通道SD / ED / HD视频滤波器与电荷泵ADA4424-6特点3标清频道; 18 MHz的典】,IC型号ADA4424-6ARUZ,ADA4424-6ARUZ PDF资料,ADA4424-6ARUZ经销商,ic,电子元器件-51电子网

6通道SD / ED / HD视频滤波器与

电荷泵

ADA4424-6

特点

3标清频道; 18 MHz的典型的1 dB带宽（ BW ）

3 ED / HD通道; 25 MHz或34 MHz的典型1分贝BW

6.2分贝（ 2.042 V / V）的固定增益

板载负电源的输出耦合无

电容器

最小的DC ，输出引脚补偿

Y和C通道的CVBS输出内部求和

对于亮度通道灵活的输入直流偏移消除

D端子（ EIAJ RC- 5237 D5）和S端子（ S1 / S2 ）的支持

可驱动2反向端接的75 Ω视频负载

同时

独立掉电引脚SD和ED / HD节

38引脚TSSOP封装

索尼绿色伙伴环境质量认证

程序兼容

功能框图

+3.3V

VDD3_SD

HD_ENB

SD_ENB

VDD3_HD

+5V

VDD5

D / S

终奌站

控制

S1/S2

S1/S2_OUT

L1_OUT

L2_OUT

L3_OUT

Y_IN

×1

LPF

×2

Y_OUT

CVBS_OUT

C_out

C_IN

MODE0

MODE1

OFFSET_ENB

×1

LPF

OFFSET

取消

FC_SEL

×2

ADA4424-6

HY_IN

×1

LPF

FC_SEL

×2

HY_OUT

应用

DVD播放机和录像机

机顶盒

投影机

个人视频录像机

HPb_IN

×1

LPF

FC_SEL

×2

HPb_OUT

HPR_IN

FC_SEL

SD_ENABLE

HD_ENABLE

×1

LPF

×2

HPR_OUT

VSS_SD

SD_ENB

动力

管理

HD_ENB

电荷泵

VSS_HD

+3.3V

图1 。

概述

该ADA4424-6是一款高性能的视频重建滤波器

专为消费应用而设计。它包括一个

两个五阶巴特沃思标准清晰度（ SD ）部分

过滤器和具有三个五阶的高清晰度（HD）的部

过滤器。在SD部分包含一个内部Y / C夏天CVBS

输出，而HD部分提供了可选择的角落

频率要么扩展定义（ ED）或高清信号。

该ADA4424-6滤波器/缓冲器部分从单一3.3 V工作

供应量。对于D-终端的全面支持（ EIAJ RC- 5237 D5 ）和S1 / S2

信号提供，还有一个专用的5 V电源引脚。

提供了SD和HD的部分独立的使能引脚。

该ADA4424-6的亮度通道（ Y_IN ， HY_IN ）是

能够检测和消除的直流输入偏移到

1.1 V四个不同的检测/取消模式

可用。

在ADA4424-6具有轨至轨输出的输出驱动器

6.2 dB增益。一个板上电荷泵允许输出

摆动高达1.4V的地面之下，省去了大

耦合电容。每路输出可驱动两个75 Ω的

双端接电缆。

该ADA4424-6可在一个38引脚TSSOP封装，工作在

工业级温度范围为-40 ° C至+ 85°C 。

版本C

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www.analog.com

08550-001

VDD3_CP

C1a

C1B C2 / CP_OUT

GND_CP

ADA4424-6

特点................................................. ............................................. 1

应用................................................. ...................................... 1

功能框图............................................... ............... 1

概述................................................ ......................... 1

修订历史................................................ ............................... 2

规格................................................. .................................... 3

绝对最大额定值............................................... ............. 6

热阻................................................ ...................... 6

最大功率耗散............................................... ...... 6

ESD注意事项................................................ .................................. 6

引脚配置和功能说明............................. 7

典型性能特征.............................................. 9

应用信息................................................ .............. 11

CVBS输出................................................ .............................. 11

角落频率选择............................................... ...... 11

输入DC偏移消除.............................................. ..... 11

D端子和S端子支持...................................... 12

掉电............................................... ................................ 13

电荷泵................................................ .............................. 13

印刷电路板（ PCB ）布局....................................... 13

外形尺寸................................................ ....................... 15

订购指南................................................ .......................... 15

修订历史

7月10日 - 修订版。 B到C版

更改为概述部分........................................ 1

5月10日 - 修订版。 A到版本B

变化表1 ，综合性能....................................... 3

切换到订购指南.............................................. .............. 15

12/09 -REV 。 0到版本A

更改表1 .............................................. .............................. 4

更改表2 .............................................. .............................. 5

更改表5 .............................................. ............................ 10

变为表8至表11 ........................................... ........... 11

更改为表12和表13 ........................................... ....... 12

10月9日 - 修订版0 ：初始版

版本C | 16页2

ADA4424-6

特定网络阳离子

DD3

= 3.3 V ，T

= 25 ° C，V

= 2.042 V P-P ，R

= 150 Ω ，直流耦合输出，除非另有说明。其结构如图电荷泵

图18 。

表1中。

参数

整体性能

直流电压增益

输入电压范围内，所有输入

输出电压范围，所有输出

输入偏置电流

输入阻抗

输出电阻

测试条件/评论

所有通道

不包括直流偏移

Y_IN ， HY_IN ，直流耦合

C_IN ， HPb_IN ， HPr_IN ，交流耦合

Y_OUT ， C_OUT ， CVBS_OUT ， HY_OUT ， HPb_OUT ，

HPr_OUT ，直流耦合

L1_OUT ， L2_OUT ， L3_OUT ， S1 / S2_OUT ，直流耦合

F = 100 kHz至6.75 MHz的

F = 148.5兆赫

F = 1 MHz的

F = 1MHz时， V

= 1.4 V P-P

F = 100 kHz到6兆赫，加权

F = 100千赫到5MHz

NTSC

FC_SEL =低（ 0 ）

F = 100 kHz到13.5兆赫

F = 148.5兆赫

F = 1 MHz的

F = 5兆赫，V

= 1.4 V P-P

F = 100 kHz到13.5兆赫，加权

F = 100 kHz到13.5兆赫

FC_SEL =高（ 1 ）

F = 100千赫到30兆赫

Y通道（ HY_OUT ）

P通道（ HPb_OUT ， HPr_OUT ）

F = 148.5兆赫

F = 1 MHz的

F = 10MHz时， V

= 1.4 V P-P

F = 100 kHz至30 MHz时，未加权

F = 100千赫到30兆赫

民

6.0

典型值

6.2

-0.6到+1.4

-1.6到+3.0

800

0.5

10.5

0.00

0.07

0.2

0.5

0.02

0.45

1.5

0.1

1.2

2.2

3.14至3.46

6.1

4.75至5.25

0.01

最大

6.4

单位

kΩ

兆赫

度

兆赫

SD信道动态性能

带内峰值

1 dB带宽

外的带外抑制

相声

总谐波失真

信噪比

群延迟变化

微分增益

微分相位

ED CHANNEL动态性能

带内峰值

1 dB带宽

外的带外抑制

相声

总谐波失真

信噪比

群延迟变化

高清频道动态性能

带内峰值

1 dB带宽

外的带外抑制

相声

总谐波失真

信噪比

群延迟变化

DC特性

工作电压3.3 V电源

静态电源电流， 3.3 V电源

0.1

0.2

主动， SD_ENABLE =高， HD_ENABLE =高，

无负载时，无信号，不包括D / S端子输出

SD禁用， SD_ENABLE =低， HD_ENABLE =高

高清禁用， SD_ENABLE =高， HD_ENABLE =低

这两种禁用， SD_ENABLE =低， HD_ENABLE =低

133

工作电压， 5 V电源

版本C |第16页3

ADA4424-6

参数

静态电源电流，5V电源

测试条件/评论

SD_ENABLE =高， HD_ENABLE =高，

= 100 kΩ的， D1 ， D2，D3 =高， S =高

SD_ENABLE =低， HD_ENABLE =低

ED / HD通道，输出简称

标清频道，输出简称

见表6和表7中

OFFSET_ENB =低

Y_IN = 0 V DC

HY_IN = 0 V DC

OFFSET_ENB =高， MODE1 =高

Y_IN = 1.0 V直流， MODE0 =低

HY_IN = 1.1 V直流， MODE0 =低

Y_IN = 0.33 V DC ， MODE0 =高

HY_IN = 0.33 V DC ， MODE0 =高

OFFSET_ENB =高，模式1 =低

Y_IN = 0 V至1.0 V直流， MODE0 =低

HY_IN = 0 V至1.1 V直流， MODE0 =低

Y_IN = 0 V至1.0 V直流， MODE0 =高

HY_IN = 0 V至1.1 V直流， MODE0 =高

民

典型值

190

最大

200

单位

μA

PSRR

直流偏移

折合到输入端，偏移取消

禁用模式

标清频道

CVBS通道

ED / HD通道

折合到输入端，固定偏移

退订方式

SD固定式偏置模式

ED / HD固定式偏置模式

SD固定的低偏移模式

ED / HD固定低失调模式

折合到输入端，自动偏移

退订方式

SD自动补偿模式

同步采样提示

ED / HD自动补偿模式

同步采样提示

SD自动补偿模式

后肩取样

ED / HD自动补偿模式

后肩取样

FC_SEL输入逻辑低电平

FC_SEL输入逻辑高电平

xD_ENABLE ， OFFSET_ENB ， MODEx

输入逻辑低电平

xD_ENABLE ， OFFSET_ENB ， MODEx

输入逻辑高电平

xD_ENABLE断言时间

xD_ENABLE解除报警时间

xD_ENABLE输入偏置电流

输入 - 输出隔离

D-和S端子输入逻辑

低层

D-和S端子输入逻辑

半山

D-和S端子输入逻辑

高层

D-和S端子输入逻辑公开赛

（高阻）电阻值

D端子（ L1_OUT ， L2_OUT ， L3_OUT ）

低电平输出

D端子（ L1_OUT ， L3_OUT ）中秋节

电平输出

D端子（ L1_OUT ， L2_OUT ， L3_OUT ）

高电平输出

S端子（ S1 / S2_OUT ）低电平

产量

100

+60

+100

+60

100

+100

+90

+100

1.2

2.0

+70

+95

+25

0.6

DD3

0.8

DD3

μA

kΩ

xD_ENABLE =低到高

xD_ENABLE =高后低

残疾人， xD_ENABLE =低

残疾人， xD_ENABLE =低， F = 5兆赫

= 100 kΩ

DD5

= 5.0 V ，R

= 100 kΩ的， D1 ， D2，D3 =低

DD5

= 5.0 V ，R

= 100 kΩ的， D1 ， D3 =中旬或开启

DD5

= 5.0 V ，R

= 100 kΩ的， D1 ， D2，D3 =高

DD5

= 5.0 V ，R

= 100 kΩ的， S =低

6.1

100

0.9

2.7

200

0.0

2.1

4.5

0.0

0.6

1.9

DD3

版本C | 16页4

ADA4424-6

参数

S端子（ S1 / S2_OUT ）半山

产量

S端子（ S1 / S2_OUT ）高层

产量

电荷泵特性

输出电压

输出电压纹波

输出纹波频率

测试条件/评论

DD5

= 5.0 V ，R

= 100 kΩ的， S =中旬或开启

DD5

= 5.0 V ，R

= 100 kΩ的， S =高

所有通道操作; C1 = C2 = 4.7 μF ， C3 = C4 =

1.0 F ，R 1 = 1 Ω （参见图18）

1.66

180

100

mV的P-P

千赫

民

典型值

2.1

4.5

最大

单位

版本C |第16页5