a
特点
14位双端口多路复用DAC
300 MSPS输出更新速率
出色的SFDR和IMD性能
SFDR到奈奎斯特@ 25 MHz输出： 71分贝
内部时钟倍频PLL
差分或单端时钟输入
片上1.2 V参考
采用3.3 V单电源供电
功耗： 155毫瓦@ 3.3 V
48引脚LQFP
应用
通信： LMDS ， LMCS ， MMDS
基站
数字合成器
QAM和OFDM
产品说明
14位， 300 MSPS
高速的TxDAC +
D / A转换器
AD9755
*
功能框图
DVDD
DCOM
AVDD
ACOM
PORT1
LATCH
MUX
PORT2
LATCH
DAC锁存器
I
OUTA
DAC
I
OUTB
CLK +
CLK “
CLKVDD
PLLVDD
CLKCOM
PLL
时钟
倍增器
参考
REFIO
FSADJ
AD9755
RESET LPF DIV0 DIV1 PLLLOCK
该AD9755是一款双通道，端口复用功能，超高速，单
信道， 14位CMOS数模转换器。它集成了一个高质量的14位
的TxDAC +内核，一个参考电压源和数字接口电路
成小的48引脚LQFP封装。该AD9755提供例外
tional交流和直流性能，同时支持更新速率高达
300 MSPS 。
对AD9755进行了优化超高速的应用
系统蒸发散可达300 MSPS ，其中数据传输速率超过这些可能在
一个单一的数据接口端口的DAC 。所述数字接口包括
两个缓冲锁存器以及控制逻辑。这些锁存器
可以是时间以几种方式复用在高速DAC 。
这PLL驱动DAC锁存器在克斯特的速度的两倍
应受施加时钟并能够交错从所述数据
两个输入通道。所得到的输出数据速率的两倍
的两个输入通道。随着PLL禁用，外部
2×时钟可以被提供并且通过内部两个分割。
在CLK输入（ CLK + / CLK- ）可驱动为差分
或单端的，与信号摆幅低至1 V pp的。
该DAC采用分段电流源架构的COM
软硬件就可以为专有开关技术来减少干扰
能源，最大限度地提高动态的精度。差动电流
输出支持单端或差分应用。该
每个差分输出提供一个额定满量程电流
2 mA至20 mA 。
该AD9755是采用先进的低成本制造0.35
m
CMOS工艺。它采用3.6 V单电源3.0 V
并且消耗155 mW的功率。
产品亮点
1. AD9755是一种高引脚兼容系列中的一员
速度的TxDAC + S提供10-， 12-，和14位分辨率。
2.超高速300 MSPS转换速率。
3.双14位锁存，输入复用端口。在AD9755
具有一个灵活的数字接口，允许高速数据
通过一个单或双端口输入的转换。
4.低功耗。完整的CMOS DAC功能的操作上
155毫瓦从3.0 V至3.6 V单电源供电。 DAC的全
目前的规模可以减少为低功耗运行。
5.片上电压参考。该AD9755内置一个1.20 V
温度补偿的带隙基准电压源。
*受保护
受美国专利号5450084 ， 5568145 ， 5689257 ，和5703519 。
其他专利正在申请中。
版本B
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AD9755–SPECIFICATIONS
DC特定网络阳离子
参数
决议
DC精度
1
积分线性误差（ INL ）
微分非线性（ DNL ）
模拟输出
偏移误差
增益误差（无内部参考）
增益误差（带内部参考）
满量程输出电流
2
输出顺从电压范围
输出电阻
输出电容
参考输出
参考电压
参考输出电流
3
参考输入
输入合规范围
参考输入电阻
温度系数
失调漂移
增益漂移（无内部参考）
增益漂移（带内部参考）
参考电压漂移
电源
电源电压
AVDD
DVDD
PLLVDD
CLKVDD
模拟电源电流（I
AVDD
)
4
数字电源电流（I
DVDD
)
4
PLL电源电流（I
PLLVDD
)
4
时钟电源电流（I
CLKVDD
)
4
功耗
4
（ 3 V，I
OUTFS
= 20 mA）的
功耗
5
（ 3 V，I
OUTFS
= 20 mA）的
电源抑制比
6
-AVDD
电源抑制比
6
-DVDD
工作范围
笔记
1
测量我
OUTA
，驾驶虚拟地。
2
标称满量程电流，I
OUTFS
是32 ×的我
REF
电流。
3
外部缓冲放大器，建议以驱动外部负载。
4
100 MSPS F
DAC
与PLL上，女
OUT
= 100 MHz时，所有电源= 3.0 V.
5
300 MSPS F
DAC
.
6
±
5 ％的电力供应的变化。
特定网络阳离子如有更改，恕不另行通知。
(T
民
给T
最大
， AVDD = 3.3V ， DVDD = 3.3 V ， PLLVDD = 3.3 V ， CLKVDD = 3.3 V，I
OUTFS
= 20毫安，除非
另有说明）。
民
14
–5
–3
–0.025
–2
–2
2.0
–1.0
±
2.5
±
1.5
±
0.01
±
0.5
±
0.25
100
5
1.14
1.20
100
1.26
+5
+3
+0.025
+2
+2
20.0
+1.25
典型值
最大
单位
位
最低位
最低位
％ FSR的
％ FSR的
％ FSR的
mA
V
k
pF
V
nA
V
M
PPM的FSR /°C的
PPM的FSR /°C的
PPM的FSR /°C的
PPM /°C的
0.1
1
0
±
50
±
100
±
50
1.25
3.0
3.0
3.0
3.0
3.3
3.3
3.3
3.3
33
3.5
4.5
10.0
155
216
3.6
3.6
3.6
3.6
36
4.5
5.1
11.5
165
+1
+0.04
+85
–1
–0.04
–40
V
V
V
V
mA
mA
mA
mA
mW
mW
％ FSR / V的
％ FSR / V的
°C
–2–
版本B
AD9755
动态规范
参数
动态性能
最大输出更新率（F
DAC
)
输出建立时间（t
ST
）（ 0.1％ ）
1
输出传输延迟（T
PD
)
1
毛刺脉冲
1
输出上升时间（10％ 90 ％）
1
输出下降时间（90％至10％）
1
输出噪声（我
OUTFS
= 20 mA）的
输出噪声（我
OUTFS
= 2 mA）的
AC线性
无杂散动态范围为奈奎斯特
f
DAC
= 100 MSPS ; F
OUT
= 1.00 MHz的
0 dBFS的输出
-6 dBFS的输出
-12 dBFS的输出
f
数据
= 65 MSPS ; F
OUT
= 1.1兆赫
2
f
数据
= 65 MSPS ; F
OUT
= 5.1兆赫
2
f
数据
= 65 MSPS ; F
OUT
= 10.1兆赫
2
f
数据
= 65 MSPS ; F
OUT
= 20.1兆赫
2
f
数据
= 65 MSPS ; F
OUT
= 30.1兆赫
2
f
DAC
= 160 MSPS ; F
OUT
= 1.1兆赫
f
DAC
= 160 MSPS ; F
OUT
= 11.1兆赫
f
DAC
= 160 MSPS ; F
OUT
= 31.1兆赫
f
DAC
= 160 MSPS ; F
OUT
= 51.1兆赫
f
DAC
= 160 MSPS ; F
OUT
= 71.1兆赫
f
DAC
= 300 MSPS ; F
OUT
= 1.1兆赫
f
DAC
= 300 MSPS ; F
OUT
= 26.1兆赫
f
DAC
= 300 MSPS ; F
OUT
= 51.1兆赫
f
DAC
= 300 MSPS ; F
OUT
= 101.1兆赫
f
DAC
= 300 MSPS ; F
OUT
= 141.1兆赫
一个窗口内的无杂散动态范围
f
DAC
= 100 MSPS ; F
OUT
= 1 MHz的; 2 MHz的跨度
0 dBFS的输出
f
DAC
= 65 MSPS ; F
OUT
= 5.02 MHz的; 2 MHz的跨度
f
DAC
= 150 MSPS ; F
OUT
= 5.04 MHz的; 4 MHz的跨度
总谐波失真
f
DAC
= 100 MSPS ; F
OUT
= 1.00 MHz的
T
A
= 25°C
T
民
给T
最大
f
DAC
= 65 MHz的; F
OUT
= 2.00 MHz的
f
DAC
= 160 MHz的; F
OUT
= 2.00 MHz的
多音功率比（八音在110 kHz间隔）
f
DAC
= 65 MSPS ; F
OUT
= 2.00 MHz到2.77 MHz的
0 dBFS的输出
-6 dBFS的输出
-12 dBFS的输出
笔记
1
测量单端成50
负载。
2
单端口模式（ PLL禁用， DIV0 = 1 ， DIV1 = 0 ，端口1的数据） 。
特定网络阳离子如有更改，恕不另行通知。
(T
民
给T
最大
， AVDD = 3.3V ， DVDD = 3.3 V ， PLLVDD = 0 V ， CLKVDD = 3.3 V，I
OUTFS
= 20毫安，
差动变压器耦合输出， 50双端接，除非另有说明。 ）
民
300
11
1
5
2.5
2.5
50
30
典型值
最大
单位
MSPS
ns
ns
的pV -S
ns
ns
PA / ÷赫兹
PA / ÷赫兹
74
84
77
79
79
79
78
74
70
80
77
72
72
69
80
71
67
61
60
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
83.5
93
85
85
dBc的
dBc的
dBc的
–83
–83
–78
–78
–73
–71
dBc的
dBc的
dBc的
dBc的
75
73
70
dBc的
dBc的
dBc的
版本B
–3–
AD9755
数码特定网络阳离子
参数
数字输入
逻辑1
逻辑0
逻辑1电流
逻辑0当前
输入电容
输入建立时间（t
S
), T
A
= 25°C
输入保持时间（t
H
), T
A
= 25°C
锁存脉冲宽度（T
LPW
), T
A
= 25°C
输入建立时间（t
S,
PLLVDD = 0 V ） ，T
A
= 25°C
输入保持时间（t
H,
PLLVDD = 0 V ） ，T
A
= 25°C
CLK到PLLLOCK延迟（T
D
， PLLVDD = 0 V ） ，T
A
= 25°C
锁存脉冲宽度（T
LPW
PLLVDD = 0 V ） ，T
A
= 25°C
PLLOCK （V
OH
)
PLLOCK （V
OL
)
CLK输入量
输入电压范围
共模电压
差分电压
闵CLK频率*
特定网络阳离子如有更改，恕不另行通知。
(T
民
给T
最大
， AVDD = DVDD = PLLVDD = CLKVDD = 3.3 V，I
OUTFS
= 20毫安，除非另有说明。 ）
民
2.1
–10
–10
1.0
1.0
1.5
–1.0
2.5
3.5
1.5
3.0
5
0.5
0.5
–1.5
1.7
4.0
典型值
3
0
最大
单位
V
V
A
A
pF
ns
ns
ns
ns
ns
ns
ns
V
V
V
V
V
兆赫
0.9
+10
+10
0.3
0
0.75
0.5
3
2.25
1.5
1.5
6.25
*敏
CLK频率仅使用内部PLL时适用。当PLL被禁止，没有最低CLK频率。
–4–
版本B
AD9755
绝对最大额定值*
参数
AVDD ， DVDD ， CLKVDD ， PLLVDD
AVDD ， DVDD ， CLKVDD ， PLLVDD
ACOM ， DCOM ， CLKCOM ， PLLCOM
REFIO ， REFLO ， FSADJ
I
OUTA
, I
OUTB
数字数据输入（ DB13至DB0 ）
CLK + / CLK- ， PLLLOCK
DIV0 ， DIV1 ， RESET
LPF
结温
储存温度
焊接温度（ 10秒）
关于
ACOM ， DCOM ， CLKCOM ， PLLCOM
AVDD ， DVDD ， CLKVDD ， PLLVDD
ACOM ， DCOM ， CLKCOM ， PLLCOM
ACOM
ACOM
DCOM
CLKCOM
CLKCOM
PLLCOM
民
–0.3
–3.9
–0.3
–0.3
–1.0
–0.3
–0.3
–0.3
–0.3
–65
最大
+3.9
+3.9
+0.3
AVDD + 0.3
AVDD + 0.3
DVDD + 0.3
CLKVDD + 0.3
CLKVDD + 0.3
PLLVDD + 0.3
150
+150
300
单位
V
V
V
V
V
V
V
V
V
°C
°C
°C
*讲
超出上述绝对最大额定值可能会导致器件永久性损坏。这是一个压力只有额定值。该装置的功能操作
在这些或超出本规范的业务部门所标明的其他条件是不是暗示。如果长期绝对最大额定值
期间可能会影响器件的可靠性。
t
S
端口1
DATA IN
端口2
t
H
数据X
订购指南
数据y
输入CLK
（ PLL使能）
模型
t
LPW
t
PD
数据X
数据y
温度
范围
-40 ° C至+ 85°C
-40 ° C至+ 85°C
包
描述
48引脚LQFP
48引脚LQFP
评价
板
包
选项
ST-48
ST-48
I
OUTA
还是我
OUTB
AD9755AST
AD9755ASTRL
AD9755-EB
t
PD
图1. I / O时序
热特性
热阻
48引脚LQFP
θ
JA
= 91 ° C / W
小心
ESD （静电放电）敏感器件。静电荷高达4000 V容易
积聚在人体和测试设备，可排出而不被发现。虽然
在AD9755具有专用ESD保护电路，永久性的损害可能发生
设备受到高能静电放电。因此，适当的ESD防范措施
建议避免性能下降或功能丧失。
版本B
–5–
QQ：2880707522 复制
