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位置:首页 > IC型号导航 > 首字符A型号页 > 首字符A的型号第1397页 > AD7890BR
a
特点
快速12位ADC,具有5.9的转化。时间
8个单端模拟输入通道
选择输入范围:
10 V的AD7890-10
0 V至4.096 V的AD7890-4
0 V至2.5 V的AD7890-2
允许独立访问多路复用器和ADC
片内采样/保持放大器
片内基准
高速,灵活的串行接口
单电源,低功耗工作( 50毫瓦最大)
掉电模式( 75瓦典型值)
LC MOS 8通道, 12位
串行数据采集系统
AD7890
功能框图
V
DD
MUX SHA
OUT IN
REF OUT /
在REF
2
V
IN1
V
IN2
V
IN3
V
IN4
V
IN5
V
IN6
V
IN7
V
IN8
信号
缩放*
信号
缩放*
信号
缩放*
信号
缩放*
信号
缩放*
信号
缩放*
信号
缩放*
信号
缩放*
采样/保持
MUX
2k
2.5V
参考
C
EXT
CONVST
12-BIT
ADC
输出/控制寄存器
概述
AD7890
该AD7890是一款8通道,12位数据采集系统。
该器件内置一个输入多路复用器,一个片上采样/保持
放大器,高速12位ADC ,一个2.5 V基准电压源和
高速串行接口。该部分从5 V单操作
供应和可接受的模拟输入范围
±
10 V ( AD7890-10 ) ,
0 V至4.096 V ( AD7890-4 )和0 V至2.5 V ( AD7890-2 ) 。
零件上的多路转换器是独立地进行访问。这
允许用户插入一个抗混叠滤波器或信号调节,
如果需要的话,多路复用器和ADC之间。这意味着
一个抗混叠滤波器,可用于所有八个通道。
一个外部电容器的连接,用户可以调整
时间提供给复用器沉降到包括任何外部
延迟滤波器或信号调理电路。
来自AD7890的输出数据通过一个高速提供
双向串行接口端口。该器件内置一个片
控制寄存器,使通道选择的控制,转换
SION启动,并通过串口断电。多功能,高
高速逻辑可以确保轻松连接到单片机的串行端口
控制器以及数字信号处理器。
除了传统直流精度规格,如
线性度,满量程和失调误差时, AD7890还试样
田间的动态性能参数,包括谐波
失真和信号 - 噪声比。
时钟
AGND AGND DGND
CLK
IN
SCLK
TFS RFS
DATA数据SMODE
OUT IN
* NO
结垢AD7890-2
在正常模式下功耗低至30 mW的典型值和
部分可以被放置在一个备用(电源关闭)模式,如果它是不
执行转换所需。在AD7890的制作
ADI公司的线性兼容CMOS ( LC
2
MOS)工艺,
的混合工艺技术,结合精密双极
电路与低功耗CMOS逻辑。该部分是一个可
24引脚,宽0.3" ,塑料或密封双列直插式封装或
24引脚小外形封装( SOIC ) 。
产品亮点
1.完整的12位数据采集系统级单芯片
该AD7890是一款完整的单芯片ADC的结合
8通道多路复用器, 12位ADC , 2.5 V基准电压源和
在单个芯片上的采样/保持放大器。
2.独立访问多路复用器和ADC
的AD7890提供对多路转换器的输出
允许一个抗混叠滤波器的8通道,一个consid-
erable节省了,如果需要的八大抗混叠滤波器
多路转换器在内部连接到ADC 。
3.高速串行接口
该部分提供了用于容易CON-一个高速串行接口
nection微控制器和DSP处理器的串行端口。
版本B
信息ADI公司提供的被认为是准确和
可靠的。但是,没有责任承担由Analog Devices其
使用,也不对第三方专利或其他权利的任何侵犯
这可能是由于它的使用。没有获发牌照以暗示或
否则,在ADI公司的任何专利或专利权。
一个技术的方式, P.O. 9106箱,诺伍德,MA 02062-9106 , U.S.A.
联系电话: 781 / 329-4700
万维网网站: http://www.analog.com
传真: 781 / 326-8703
ADI公司, 2001
AD7890–SPECIFICATIONS
参数
动态性能
信号(噪声+失真)比
2
总谐波失真( THD )
2
峰值谐波或杂散噪声
2
互调失真
二阶条款
三阶条款
通道到通道隔离
2
DC精度
决议
最小分辨率为哪
无失码的保证
相对精度
2
微分非线性
2
正满量程误差
2
满量程误差匹配
4
AD7890-2 , AD7890-4
单极性偏移误差
2
单极性偏移误差匹配
AD7890-10只有
负满量程误差
2
双极性零误差
2
双极性零误差匹配
模拟输入
AD7890-10
输入电压范围
输入阻抗
AD7890-4
输入电压范围
输入阻抗
AD7890-2
输入电压范围
输入电流
MUX OUT输出
输出电压范围
输出电阻
( AD7890-10 , AD7890-4 )
(AD7890-2)
SHA IN输入
输入电压范围
输入电流
参考输出/输入
REF IN输入电压范围
输入阻抗
输入电容
5
REF OUT输出电压
REF OUT错误@ 25∞C
T
给T
最大
REF OUT温度系数
REF OUT输出阻抗
逻辑输入
输入高电压,V
INH
输入低电压,V
INL
输入电流I
IN
输入电容,C
IN5
一个版本
1
70
–78
–79
–80
–80
–80
12
12
±
1
±
1
±
2.5
2
±
2
2
±
2
±
5
2
(V
DD
= 5V , AGND = DGND = 0 V , REF IN = 2.5 V,F
CLK IN
= 2.5 MHz的外部, MUX OUT
连接到SHA IN 。所有规格牛逼
给T
最大
除非另有说明)。
S版
70
–78
–79
–80
–80
–80
12
12
±
1
±
1
±
2.5
2
±
2
2
±
2
±
5
2
单位
分贝分钟
最大分贝
最大分贝
dB典型值
dB典型值
最大分贝
LSB(最大值)
LSB(最大值)
LSB(最大值)
LSB(最大值)
LSB(最大值)
LSB(最大值)
LSB(最大值)
LSB(最大值)
LSB(最大值)
测试条件/评论
使用外部
CONVST 。
任何通道
f
IN
= 10 kHz正弦波,女
样品
= 100千赫
3
f
IN
= 10 kHz正弦波,女
样品
= 100千赫
3
f
IN
= 10 kHz正弦波,女
样品
= 100千赫
3
FA = 9千赫, FB = 9.5千赫,女
样品
= 100千赫
3
B版本
70
–78
–79
–80
–80
–80
12
12
±
0.5
±
1
±
2.5
2
±
2
2
±
2
±
5
2
f
IN
= 1 kHz正弦波
±
10
20
0至4.096
11
02.5
50
02.5
3/5
2
02.5
±
50
2.375/2.625
1.6
10
2.5
±
10
±
20
25
2
2.4
0.8
±
10
10
±
10
20
0至4.096
11
02.5
50
02.5
3/5
2
02.5
±
50
2.375/2.625
1.6
10
2.5
±
10
±
20
25
2
2.4
0.8
±
10
10
±
10
20
0至4.096
11
02.5
200
02.5
3/5
2
02.5
±
50
2.375/2.625
1.6
10
2.5
±
10
±
25
25
2
2.4
0.8
±
10
10
kΩ的分
kΩ的分
nA的最大
千欧分/ kΩ最大值
kΩ最大值
nA的最大
V MIN / V最大
kΩ的分
pF的最大
V NOM
毫伏最大
毫伏最大
PPM /°C的典型值
kΩ的NOM
V分钟
V最大
A
最大
pF的最大
2.5 V
±
5%
电阻连接到内部参考节点
假设V
IN
从低阻抗驱动
V
DD
= 5 V
±
5%
V
DD
= 5 V
±
5%
V
IN
= 0 V到V
DD
–2–
版本B
AD7890
参数
逻辑输出
输出高电压,V
OH
输出低电压,V
OL
串行数据输出编码
AD7890-10
AD7890-4
AD7890-2
转化率
转换时间
采样/保持捕获时间
2, 5
电源要求
V
DD
I
DD
(正常模式)
I
DD
(待机模式)
6
@ 25°C
功耗
普通模式
待机模式@ 25°C
一个版本
1
4.0
0.4
B版本
4.0
0.4
S版
4.0
0.4
单位
V分钟
V最大
测试条件/评论
I
来源
= 200
A
I
SINK
= 1.6毫安
二进制补码
直(自然科学)二进制
直(自然科学)二进制
5.9
2
5
10
15
50
75
5.9
2
5
10
15
50
75
5.9
2
5
10
15
50
75
s
最大
s
最大
V NOM
最大mA
A
典型值
毫瓦MAX
W
典型值
±
对于指定的性能5 %
逻辑输入= 0 V或V
DD
逻辑输入= 0 V或V
DD
一般为30毫瓦
f
CLK IN
= 2.5 MHz时, MUX OUT
连接到SHA IN
笔记
1
温度范围如下: A,B版本: -40 ° C至+ 85°C ; S版: -55 ° C至+ 125°C 。
2
参见术语。
3
平铺的部分外部时钟模式时,此采样率仅仅是可以实现的。
4
满量程误差匹配适用于正的满量程为AD7890-2和AD7890-4 。它适用于正反两方面的满量程为AD7890-10 。
5
样品测试@ 25°C ,以确保合规性。
6
在AD7890-10模拟输入必须为0 V ,实现正确的掉电电流。
特定网络阳离子如有更改,恕不另行通知。
绝对最大额定值*
(T
A
= 25 ° C除非另有说明)
V
DD
到AGND 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -0.3 V至+7 V
V
DD
到DGND 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -0.3 V至+7 V
模拟输入电压至AGND
AD7890-10 , AD7890-4 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
±
17 V
AD7890-2 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -5 V , + 10 V
基准输入电压至AGND 。 。 。 0.3 V到V
DD
+ 0.3 V
数字输入电压至DGND 。 。 。 。 。 0.3 V到V
DD
+ 0.3 V
数字输出电压DGND 。 。 。 。 0.3 V到V
DD
+ 0.3 V
工作温度范围
商业( A,B版本) 。 。 。 。 。 。 。 。 。 。 。 -40 ° C至+ 85°C
扩展(S版) 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -55 ° C至+ 125°C
存储温度范围。 。 。 。 。 。 。 。 。 。 。 -65 ° C至+ 150°C
结温。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 150℃
塑料DIP封装,功率耗散。 。 。 。 。 。 。 。 。 。 450毫瓦
θ
JA
热阻抗。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 105 ° C / W
引线温度(焊接, 10秒) 。 。 。 。 。 。 。 。 。 。 。 。 260℃
CERDIP封装,功率耗散。 。 。 。 。 。 。 。 。 。 。 。 。 。 450毫瓦
θ
JA
热阻抗。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 70 ° C / W
引线温度(焊接, 10秒) 。 。 。 。 。 。 。 。 。 。 。 。 300℃
SOIC封装,功率耗散。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 450毫瓦
θ
JA
热阻抗。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 75 ° C / W
焊接温度,焊接
气相(60秒) 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 215℃
红外( 15秒) 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 220℃
*讲
超出上述绝对最大额定值可能会导致perma-
新界东北损坏设备。这是一个压力只有额定值。的功能操作
器件在这些或以上的运作中列出的任何其他条件
本规范的部分将得不到保证。暴露在绝对最大额定值
长时间条件下可能影响器件的可靠性。
订购指南
模型
AD7890AN-2
AD7890BN-2
AD7890AR-2
AD7890BR-2
AD7890SQ-2
AD7890AN-4
AD7890BN-4
AD7890AR-4
AD7890BR-4
AD7890SQ-4
AD7890AN-10
AD7890BN-10
AD7890AR-10
AD7890BR-10
AD7890SQ-10
温度
范围
-40 ° C至+ 85°C
-40 ° C至+ 85°C
-40 ° C至+ 85°C
-40 ° C至+ 85°C
-55 ° C至+ 125°C
-40 ° C至+ 85°C
-40 ° C至+ 85°C
-40 ° C至+ 85°C
-40 ° C至+ 85°C
-55 ° C至+ 125°C
-40 ° C至+ 85°C
-40 ° C至+ 85°C
-40 ° C至+ 85°C
-40 ° C至+ 85°C
-55 ° C至+ 125°C
线性
错误
±
1 LSB
±
1/2最低位
±
1 LSB
±
1/2最低位
±
1 LSB
±
1 LSB
±
1/2最低位
±
1 LSB
±
1/2最低位
±
1 LSB
±
1 LSB
±
1/2最低位
±
1 LSB
±
1/2最低位
±
1 LSB
选项*
N-24
N-24
R-24
R-24
Q-24
N-24
N-24
R-24
R-24
Q-24
N-24
N-24
R-24
R-24
Q-24
*N
=塑料DIP ; Q = CERDIP ; R = SOIC 。
小心
ESD (静电放电)敏感器件。静电荷高达4000 V容易
积聚在人体和测试设备,可排出而不被发现。
虽然AD7890具有专用ESD保护电路,可能永久的损坏
发生在经受高能量静电放电设备。因此,适当的ESD
预防措施建议,以避免性能下降或功能丧失。
警告!
ESD敏感器件
版本B
–3–
AD7890
时序特性
参数
f
CLKIN3
t
CLK IN LO
t
CLK IN HI
tr
4
tf
4
t
兑换
t
CST
自时钟模式
t
1
t
25
t
3
t
4
t
55
t
6
t
76
t
8
t
9
t
10
t
11
t
12
外部时钟模式
t
13
t
145
t
15
t
16
t
175
t
18
t
196
t
19A6
t
20
t
21
t
22
t
23
1, 2
(V
DD
= 5 V
5 % , AGND = DGND = 0 V , REF IN = 2.5 V,F
CLK IN
= 2.5 MHz的外部, MUX OUT
连接到SHA IN )。
单位
千赫分钟
兆赫最大
ns(最小值)
ns(最小值)
ns(最大值)
ns(最大值)
s
最大
ns(最小值)
ns(最大值)
ns(最大值)
NS NOM
NS NOM
ns(最大值)
ns(最大值)
ns(最大值)
ns(最小值)
ns(最大值)
ns(最小值)
ns(最小值)
ns(最小值)
ns(最小值)
ns(最小值)
ns(最大值)
ns(最小值)
ns(最小值)
ns(最大值)
ns(最小值)
ns(最大值)
ns(最大值)
ns(最小值)
ns(最小值)
ns(最小值)
ns(最小值)
条件/评论
主时钟频率。对于指定的性能
主时钟输入低电平时间
主时钟输入高电平时间
数字输出上升时间。一般为10纳秒
数字输出下降时间。一般为10纳秒
转换时间
CONVST
脉宽
RFS
低到SCLK的下降沿
RFS
低到数据有效延迟
SCLK高脉冲宽度
SCLK低脉冲宽度
SCLK上升沿到数据有效延迟
SCLK上升沿
RFS
延迟
总线释放时间SCLK的上升沿之后
TFS
低到SCLK的下降沿
数据有效到
TFS
下降沿建立时间( A2地址位)
数据有效到SCLK下降沿建立时间
数据有效到SCLK的下降沿保持时间
TFS
到SCLK下降沿保持时间
RFS
低到SCLK下降沿建立时间
RFS
低到数据有效延迟
SCLK高脉冲宽度
SCLK低脉冲宽度
SCLK上升沿到数据有效延迟
RFS
到SCLK下降沿保持时间
总线释放时间的上升沿之后
RFS
总线释放时间SCLK的上升沿之后
TFS
低到SCLK下降沿建立时间
数据有效到SCLK下降沿建立时间
数据有效到SCLK的下降沿保持时间
TFS
到SCLK下降沿保持时间
在T限制
, T
最大
(A ,B ,S版本)
100
2.5
0.3
×
t
CLK IN
0 3
×
t
CLK IN
25
25
5.9
100
t
CLK IN HI
+ 50
25
t
CLK IN HI
t
CLK IN LO
20
40
50
0
t
CLK IN
+ 50
0
20
10
20
20
40
50
50
35
20
50
90
20
10
15
40
笔记
1
在-25 ℃下的样品进行测试,以确保遵守。所有的输入信号是从1.6V的电压电平中指定与指定tR = tF = 5纳秒(10%至90%的5伏),并定时
2
请参阅图8至图11 。
3
在AD7890的产品测试和f
CLK IN
在2.5兆赫。它是由特性保证在100 kHz的工作。
4
用10 %和感兴趣的波形90 %的点指定。
5
这些数字是测量图1所示的负载电路,并定义为所需的输出时间跨越0.8V或2.4V。
6
这些数字是从所采取的数据输出来改变0.5V的所测量的时间推导的时装载有图1中的电路测量的数目是再
外推回除去的充电或放电的50 pF电容的效果。这意味着,在TIM荷兰国际集团的特性所给出的时间是真正的公交车
放弃部分的时间,因此是独立的外部总线负载电容。
1.6mA
输出
+2.1V
50pF
200 A
图1.负载电路的访问时间和总线释放时间
–4–
版本B
AD7890
引脚功能描述
1
2
助记符
AGND
SMODE
描述
模拟地。对于采样/保持,比较器和DAC的参考地。
控制输入。确定是否部分工作在它的外部时钟(从)或自时钟
(主)串行模式。与SMODE在逻辑低电平时,器件处于与自同步串行模式
RFS
和SCLK为输出。这种自我时钟模式是很有用的,用于连接到移位寄存器或
DSP处理器的串行端口。与SMODE在逻辑高电平时,是在它的外部时钟
与SCLK串行模式和
RFS
作为输入。这个外部时钟模式是用于连接有用
微控制器如8XC51和68HCxx和用于连接到所述的串行端口
DSP处理器的串行端口。
数字地。数字电路的接地参考。
外部电容。一个外部电容连接到这个引脚来确定的长度
内部脉冲(见
CONVST
输入和控制寄存器部分) 。该引脚上的大电容
延长脉冲,以允许通过外部抗混叠滤波器或信号稳定时间延迟
调理电路。
转换的开始。边沿触发逻辑输入。低到这个输入高电平的跳变放采样/保持
为保持状态,并启动转换提供的内部脉冲超时(见控制
寄存器部分) 。如果内部脉冲激活时
CONVST
变高时,采样/保持不会
进入保持状态,直到脉冲时间了。如果内部脉冲超时时
CONVST去
高,
的上升沿
CONVST
驱动采样/保持进入保持状态,启动转换。
时钟输入。外部TTL兼容的时钟应用到该输入引脚来提供时钟源
对于转换序列。在自同步串行模式下, SCLK输出源于此
CLK IN引脚。
串行时钟输入。在外部时钟(从)模式(见串行接口部分)这是一个
外部施加的串行时钟,它用于对串行数据加载到控制寄存器和访问
从输出寄存器的数据。在自时钟(主)模式下,内部串行时钟,这是
从时钟输入( CLK IN)得到的,在这脚出现。再次,这是用来加载串行数据
控制寄存器,并从输出寄存器访问数据。
发送帧同步脉冲。低电平有效逻辑输入后,预计串行数据
落入此信号的边沿。
接收帧同步脉冲。在外部时钟模式下,该引脚为低电平有效
输入与
RFS
作为选通或成帧脉冲从输出访问的串行数据从外部提供
注册。在自时钟模式下,它是在内部生成的活性低输出
并且提供了一个选通或成帧脉冲用于从所述输出寄存器的串行数据。对于应用程序
其中要求的数据被传输,并在同一时间接收到的,
RFS
TFS
连接在一起。
串行数据输出。十六位的串行数据被提供有一个前导零,前三个
控制寄存器的地址位和12位转换数据。串行数据是在有效
后SCLK下降沿边缘的16边
RFS
变低。从ADC输出编码为2的
补充的AD7890-10和直接二进制为AD7890-4和AD7890-2 。
串行数据输入。要装入串行数据到控制寄存器在此输入提供。第一
串行数据的5位被加载到控制寄存器在SCLK的第一个五年下降沿后
TFS
变低。在随后的SCLK边缘串行数据被忽略,而
TFS
仍然很低。
正电源电压, 5 V
±
5%.
多路输出。多路复用器的输出出现在此引脚。输出电压范围
从该输出为0 V至2.5 V的标称模拟输入范围所选择的信道。该
该输出的输出阻抗标称值为3.5 kΩ的。如果没有外部的抗混叠滤波器需要
MUX OUT应该连接到SHA IN 。
采样/保持输入。输入到芯片上的跟踪/保持被施加到该引脚。它是一个高阻抗
输入并将输入电压范围为0 V至2.5V。
模拟地。对于采样/保持,比较器和DAC的参考地。
模拟量输入通道1。单端模拟输入。模拟输入范围为
±
10 V ( AD7890-10 ) ,
0 V至4.096 V ( AD7890-4 )和0 V至2.5 V ( AD7890-2 ) 。该信道将被转换选择
用A0 ,A1和A2中的位控制寄存器。多路转换器保证了突破直至─
使操作。
–5–
3
4
DGND
C
EXT
5
CONVST
6
CLK IN
7
SCLK
8
9
TFS
RFS
10
数据输出
11
DATA IN
12
13
V
DD
复用器输出
14
15
16
SHA IN
AGND
V
IN1
版本B
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