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a
特点
高输入采样率
65 MSPS的单通道真
32.5 MSPS分集通道实
32.5 MSPS单通道复
NCO频率转换
最差杂散-100 dBc的更好
调整分辨率优于0.02赫兹
二阶级联积分梳状滤波器FIR
线性相位,固定系数
可编程抽取率: 2,3 。 。 。 16
五阶级联积分梳状滤波器FIR
线性相位,固定系数
可编程抽取率: 1 , 2 , 3 。 。 。 32
可编程抽选RAM系数FIR滤波器
高达每秒130亿丝锥
256 20位可编程系数
可编程抽取率: 1 , 2 , 3 。 。 。 32
双向同步电路
相位对齐军士
同步数据输出时钟
串行或并行输出的基带
引脚可选串行或并行
系列作品与SHARC , ADSP- 21xx系列,其他大多数
DSP的
16 - bit并行端口,交错I和Q输出
两个独立的控制和配置端口
通用的P端口,串行端口
3.3 V CMOS优化流程
JTAG边界扫描
概述
REAL ,
DUAL REAL ,
或复杂
输入
65 MSPS数字接收
信号处理器
AD6620
功能框图
I
CIC
过滤器
I
FIR
滤波器
I
产量
格式
串行或
并行
输出
Q
COS
-sin
Q
Q
军士
SYNC
电路
JTAG
PORT
P
或串行
控制
窄带和宽带载波进行萃取。该
基于RAM的架构可轻松重新配置的多
模式的应用。
该抽取滤波器去除不需要的信号和噪声
感兴趣的信道。当感兴趣的信道占用
带宽比输入信号更小,这个拒绝和失
带外噪声被称为“处理增益。 ”通过使用大decima-
化的因素,这个“处理增益”可以提高信噪比
ADC 36分贝以上。此外,可编程RAM
系数滤波器允许抗锯齿,匹配滤波和
静态均衡功能,可以在一个单一的,成本相结合
有效的过滤。
输入端口接收一个16位的尾数,一个3位的指数,
和A / B选择引脚。这允许直接连接的
AD6600 , AD6640 , AD9042和其他大多数高速ADC 。
提供了三种输入模式:单通道真,单
渠道复杂,多样性和实时信道。
当用交错采样配对,如AD6600 ,
在AD6620可以处理的多样性两个数据流
通道实时输入模式。每个通道都具有共同处理
赫伦特频率转换和输出的采样时钟。此外
灰中,提供了外部同步引脚,以方便
其中相干频率转换和输出采样时钟
几个AD6620s 。这些功能可以简化系统的设计
与分集天线或天线阵列。
单位包装在一个80引脚PQFP (塑料四方扁平封装)
并规定工作在工业级温度范围
( -40 ° C至+ 85°C ) 。
的AD6620是数字接收机具有四个级联信号 -
处理元素:一个频率变换器,双固定
系数抽取滤波器,以及一个可编程系数
抽取滤波器。所有的输入都是3.3 V LVCMOS兼容。
所有输出LVCMOS和5 V TTL兼容。
例如ADC实现更高的采样率和动态范围,
变得越来越有吸引力来完成最终的IF级
在数字域中的接收机。数字中频处理少
昂贵,更容易制造,更准确,更
挠性比可比较的高选择性的模拟阶段。
在AD6620通道分集接收机抽取设计
弥合高速ADC和一般用途之间的差距
构成的DSP 。高分辨率的NCO允许单个载波来
可以从一个高速数据流中选择。高动态范围
具有广泛的抽取率,允许抽取滤波器
第0版
信息ADI公司提供的被认为是准确和
可靠的。但是,没有责任承担由Analog Devices其
使用,也不对第三方专利或其他权利的任何侵犯
这可能是由于它的使用。没有获发牌照以暗示或
否则,在ADI公司的任何专利或专利权。
一个技术的方式, P.O. 9106箱,诺伍德,MA 02062-9106 , U.S.A.
联系电话: 781 / 329-4700
万维网网站: http://www.analog.com
传真: 781 / 326-8703
ADI公司, 1998年
AD6620
目录
架构
概述。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1
架构。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 2
规格/时序。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 4
绝对最大额定值。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 11
说明测试级别。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 11
订购指南。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 11
引脚功能描述。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 12
引脚配置。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 13
输入数据端口。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 15
输出数据端口。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 18
频率转换。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 20
2级级联积分
梳状滤波器。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 21
五阶级联积分
梳状滤波器。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 23
RAM系数滤波器。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 25
控制寄存器和片上RAM 。 。 。 。 。 。 。 27
烧写AD6620 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 29
微创控制。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 31
串行口控制。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 34
JTAG边界扫描。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 36
应用。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 37
外形尺寸。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 43
如图1所示, AD6620 ,主要有四个信号亲
cessing阶段:一个频率变换器,双级联积分
梳状FIR滤波器( CIC 2 , CIC5 ) ,以及RAM系数FIR
滤波器( RCF ) 。多种模式都支持时钟数据
流入和流出的芯片。编程和控制accom-
通过串口与微处理器接口plished 。
数据输入到芯片可以是实数或复数。如果输入数据
是真实的,它的时钟可以作为一个单独的通道或交错
与第二通道。双声道输入模式,称为
多样性通道实时,通常用于分集接收机
应用程序。输入数据移入16位并行的话,
IN [ 15:0] 。这个词可能会与指数的输入位组合
EXP [2:0 ]时, AD6620被驱动通过浮点或
增益范围的模拟 - 数字转换器,如AD6600 。
频率转换完成了32位复数
数控振荡器( NCO ) 。输入真实数据
这个阶段被分离成同相( I)和正交(Q)的
组件。这一阶段从数字转换的输入信号
中频(IF )至基带。相位和振幅
抖动可以片上启用以提高寄生性能
士官的。相位偏移字可用于创建一个已知的
多个AD6620s之间的相位关系。
以下频率转换为固定系数,高速
抽取滤波器是由一个编程降低采样速率
2与16之间梅布尔比例,这是一个二阶,级联
如图CIC2如图1 (注积分梳状FIR滤波器:
1在CIC2抽取需要2倍或更高的时钟到
AD6620 ) 。的数据速率到该级等于输入数据
率,女
SAMP
。数据速率从CIC2 ,女的
SAMP2
,由下式确定
的抽取因子,男
CIC2
.
RCF
EXP [2:0 ]
IN [ 15:0]
3
16
输入
数据
交错
DE-
交错
CIC5
M
CICS
f
SAMP5
23
23
f
SAMP2
产量
缩放,S
OUT
多路复用器
I- RAM
256 20
C- RAM
256 20
Q- RAM
256 20
M
RCF
频率
3
翻译者
I 18
16
Q 18
EXP
缩放
缩放
CIC2
M
CICS
多路复用器
缩放
军士
DV
OUT
I / Q
OUT
多路复用器
A / B
OUT
EXPLNV ,
ExpOff
OFFSET
CLK
A / B
RESET
定时
SYNC NCO
SYNC CIC
SYNC RCF
SYNC
I / O
RCF系数
抽头数
抽取因子
CIC2 , CIC5
抽取因子地址偏移
f
SAMP
比例因子
产量
NCO频率
规模
相位偏移
因素
抖动
同步面膜
控制寄存器
输入模式
微创和
REAL ,双通道, COMPLEX
串行访问
固定或带有指数的
SYNC M / S
并行
16
串行
JTAG
TRST
TCK TMS
TDI
TDO
微处理器接口
D [ 7 : 0 ] A [ 2 : 0 ]
CS
DTACK
( W / R) (R / D ) ( RDY )
读/写
DS
MODE PAR / SER
并行
输出
串行I / O
16
OUT [ 15:0]
SCLK
SDI
SDO
SDFS
SDFE
SBM
WL [1 :0]的
AD
SDIV [3 :0]的
图1.框图
–2–
第0版
AD6620
以下CIC 2是第二固定系数抽取滤波器。
该过滤器, CIC5 ,由一台可编程进一步降低采样速率
从1到32的数据速率进行CIC5 ,女的梅布尔比
SAMP5
,是
由M的抽取因子确定
CIC5
和M
CIC2
.
每投阶段是一个FIR滤波器,其响应由定义
抽取率。这些过滤器的目的是为了减少
所述输入信号的数据速率,以使最终的滤波器级,一
FIR RAM系数加总产品滤波器( RCF ) ,可calcu-
每个输出后期更多的抽头。如图1中所示,片上的多
路器同时允许CIC滤波器,如果多速率时钟被绕过
被使用。
第四个阶段是加总产品的FIR滤波器编程
梅布尔20位系数,抽取率可编程
从1到32的RAM系数FIR滤波器( RCF图
1 )可以处理最多256个抽头。
为AD6620的整个滤波器响应的复合
所有三个级联抽取滤波器: CIC2 , CIC5和RCF 。
每个相继的滤波器级能够更窄的过渡
带宽,但需要更大数量的CLK的周期,以
计算输出。更抽取在所述第一滤波器级的意志
减少整体的功耗。数据出来通过
并行端口或串行接口。
图2示出了AD6620的基本功能:选择
和过滤从一个宽的输入频谱的单个信道。该
频率变换器“曲调”所需的载波为基带。
CIC2和CIC5有固定顺序的反应;在RCF滤波器
提供了锐利的转变。更多细节稍后提供
该数据表的部分。
宽带输入谱
C'
D'
利益"IMAGE"的信号
B'
A'
A
(–f
SAMP /
2至f
SAMP /
2)
信号
利息
C
D
B
–f
S
/2
–3f
S
/8
–5f
S
/16
–f
S
/4
–3f
S
/16
–f
S
/8
–f
S
/16
DC
f
S
/16
f
S
/8
3f
S
/16
f
S
/4
5f
S
/16
3f
S
/8
f
S
/2
图2a。宽带输入频谱(例如,从高速ADC 30兆赫)
NCO "TUNES"信号到基带
频率转换后
A
B
C
D
D'
C'
B'
A'
–f
S
/2
–3f
S
/8
–5f
S
/16
–f
S
/4
–3f
S
/16
–f
S
/8
–f
S
/16
DC
f
S
/16
f
S
/8
3f
S
/16
f
S
/4
5f
S
/16
3f
S
/8
f
S
/2
图2b 。频率转换(如单1 MHz信道调整到基带)
CIC2 , CIC5 ,和RCF
0
–10
–20
–30
–40
–50
dBc的
–60
–70
–80
–90
–100
–110
–120
–130
频率
图2c 。基带信号进行抽取和CIC2 , CIC5 , RCF过滤
第0版
–3–
AD6620–SPECIFICATIONS
推荐工作条件
参数
VDD
T
环境
TEST
水平
I
IV
3.0
–40
AD6620AS
典型值
3.3
+25
最大
3.6
+85
单位
V
°C
电气特性
参数(条件)
逻辑输入
1, 2, 3, 4, 5, 6, 7
(不是5 V宽容)
逻辑兼容性
逻辑“1”的电压
逻辑“0”电压
逻辑“1”的当前
逻辑“0”的当前
输入电容
逻辑输出
2, 4, 7, 8, 9, 10, 11
逻辑兼容性
逻辑“1”的电压(我
OH
= 0.5 mA)的
逻辑“0”电压(我
OL
= 1.0 mA)的
IDD供电电流
CLK = 20 MHz的
12
CLK = 65 MHz的
13
复位模式
14
功耗
CLK = 20 MHz的
12
CLK = 65 MHz的
13
复位模式
14
温度
+25°C
TEST
水平
AD6620AS
典型值
3.3 V CMOS
I
I
I
I
V
2.0
–0.3
1
1
4
VDD + 0.3
0.8
10
10
V
V
A
A
pF
最大
单位
I
I
V
I
I
V
I
I
2.4
3.3 V CMOS / TTL
VDD - 0.2
0.2
0.4
52
167
V
V
mA
mA
mA
mW
mW
mW
227
1
170
550
750
3.3
笔记
1
输入专用管脚: CLK ,
RESET ,
[15 : 0 ] , EXP [ 2 : 0 ] , A / B , PAR / SEL 。
2
双向引脚: SYNC_NCO , SYNC_CIC , SYNC_RCF 。
3
Microinterface输入引脚:
DS
(RD) ,读/写(WR) ,
CS 。
4
Microinterface双向引脚: A [ 2 : 0] , D [ 7 : 0 ] 。
5
JTAG输入引脚:
TRST ,
TCK , TMS , TDI 。
6
串行模式输入引脚: SDI , SBM , WL [ 1 : 0 ] , AD , SDIV [ 3 : 0 ] 。
7
串行模式双向引脚: SCLK , SDFS 。
8
输出引脚: OUT [ 15 : 0 ] , DV
OUT
, A / B
OUT
I / Q
OUT
.
9
Microinterface输出引脚:
DTACK
( RDY ) 。
10
JTAG输出引脚: TDO 。
11
串行模式输出引脚: SDO , SDFE 。
12
条件IDD @ 20MHz的。 M
CIC2
= 2, M
CIC5
= 2, M
RCF
= 1,交替的正和负的满量程的4 RCF抽头。
13
条件IDD @ 65兆赫。 M
CIC2
= 2, M
CIC5
= 2, M
RCF
= 1,交替的正和负的满量程的4 RCF抽头。
14
在复位的IDD条件( RESET = 0 ) 。
特定网络阳离子如有更改,恕不另行通知。
–4–
第0版
AD6620
时序特性
(C
参数(条件)
CLK时序要求:
t
CLK
CLK周期
CLK宽度低
t
CLKL
t
CLKH
CLK宽高
复位时序要求:
t
器RES1
RESET
宽度低
输入数据时序要求:
t
SI
输入
1
到CLK建立时间
t
HI
输入
1
到CLK保持时间
并行输出开关特性:
t
DPR
CLK至OUT [ 15:0]上升延迟
CLK至OUT [ 15:0]秋季延迟
t
DPF
t
DPR
CLK为DV
OUT
上升延时
t
DPF
CLK为DV
OUT
秋季延迟
CLK到我
QOUT
上升延时
t
DPR
t
DPF
CLK到我
QOUT
秋季延迟
t
DPR
CLK到A
布特
上升延时
t
DPF
CLK到A
布特
秋季延迟
同步定时要求:
t
SY
SYNC
2
到CLK建立时间
t
HY
SYNC
2
到CLK保持时间
SYNC开关特性:
t
DY
CLK到SYNC
3
延迟时间
串行输入时序:
t
SSI
SDI到SCLKt建立时间
SDI到SCLKt保持时间
t
恒指
t
HSRF
SDFS到SCLKu保持时间
t
SSF
SDFS到SCLKt建立时间
4
t
HSF
SDFS到SCLKt保持时间
4
串行帧输出时序:
t
DSE
SCLKu到SDFE延迟时间
t
SDFEH
SDFE宽高
t
DSO
SCLKu到SDO延迟时间
SCLK开关特性, SBM = “ 1 ” :
SCLK周期
3
t
SCLK
t
SCLKL
SCLK宽度低
t
SCLKH
SCLK宽高
t
SCLKD
CLK到SCLK延迟时间
串行
帧定时, SBM =“1” :
t
DSF
SCLKu到SDFS延迟时间
t
SDFSH
SDFS宽高
SCLK时序要求, SBM
=
“0”:
t
SCLK
SCLK周期
t
SCLKL
SCLK宽度低
t
SCLKH
SCLK宽高
负载
= 40 pF的所有输出)
温度
TEST
水平
I
IV
IV
I
IV
IV
IV
IV
IV
IV
IV
IV
IV
IV
IV
IV
V
IV
IV
IV
IV
IV
IV
V
IV
I
V
V
V
IV
V
I
IV
IV
15.4
7.0
7.0
30.0
–1.0
6.5
8.0
7.5
6.5
5.5
7.0
6.0
7.0
5.5
–1.0
6.5
7.0
1.0
2.0
4.0
1.0
2.0
3.5
t
SCLK
4.5
2
×
t
CLK
6.5
1.0
t
SCLK
15.4
0.4
×
t
SCLK
0.4
×
t
SCLK
11.0
11.0
23.5
19.5
19.5
19.0
11.5
19.5
13.5
19.5
13.5
AD6620AS
典型值
最大
单位
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
0.5
×
t
CLK
0.5
×
t
CLK
0.5
×
t
SCLK
0.5
×
t
SCLK
13.0
4.0
0.5
×
t
SCLK
0.5
×
t
SCLK
笔记
1
说明书中涉及: IN [ 15:0] ,EXP [ 2:0] ,A / B 。
2
规范适用于: SYNC_NCO , SYNC_CIC , SYNC_RCF 。
3
SCLK周期会
2
×
t
CLK
当AD6620的串行总线主控制器( SBM = 1 )根据SDIV字。
4
SDFS建立和保持时间必须得到满足,甚至当配置为输出,因为在内部的信号进行采样垫。
特定网络阳离子如有更改,恕不另行通知。
第0版
–5–
a
特点
高输入采样率
67 MSPS的单通道真
33.5 MSPS分集通道实
33.5 MSPS单通道复
NCO频率转换
最差杂散-100 dBc的更好
调整分辨率优于0.02赫兹
二阶级联积分梳状滤波器FIR
线性相位,固定系数
可编程抽取率: 2,3 。 。 。 16
五阶级联积分梳状滤波器FIR
线性相位,固定系数
可编程抽取率: 1 , 2 , 3 。 。 。 32
可编程抽选RAM系数FIR滤波器
高达每秒1.34亿丝锥
256 20位可编程系数
可编程抽取率: 1 , 2 , 3 。 。 。 32
双向同步电路
相位对齐军士
同步数据输出时钟
串行或并行输出的基带
引脚可选串行或并行
系列作品与SHARC
, ADSP- 21xx系列,其他大多数
DSP的
16 - bit并行端口,交错I和Q输出
两个独立的控制和配置端口
通用的P端口,串行端口
3.3 V CMOS优化流程
JTAG边界扫描
概述
REAL ,
DUAL REAL ,
或复杂
输入
67 MSPS数字接收
信号处理器
AD6620
功能框图
I
CIC
过滤器
I
FIR
滤波器
I
产量
格式
串行或
并行
输出
Q
Q
Q
COS
-sin
AD6620
军士
SYNC
电路
JTAG
PORT
P
或串行
控制
窄带和宽带载波进行萃取。该
基于RAM的架构可轻松重新配置的多
模式的应用。
该抽取滤波器去除不需要的信号和噪声
感兴趣的信道。当感兴趣的信道占用
带宽比输入信号更小,这个拒绝和失
带外噪声被称为“处理增益。 ”通过使用大抽取
因素,这种“处理增益”可以提高信噪比
ADC 36分贝以上。此外,可编程RAM
系数滤波器允许抗锯齿,匹配滤波和
静态均衡功能,可以在一个单一的,成本相结合
有效的过滤。
输入端口接收一个16位的尾数,一个3位的指数,
和A / B选择引脚。这允许直接连接的
AD6600 , AD6640 , AD6644 , AD9042和大多数其他高端
高速ADC 。提供了三种输入模式:单通道
真正的单通道复杂和多样性通道实时。
当用交错采样配对,如AD6600 ,
在AD6620可以处理的多样性两个数据流
通道实时输入模式。每个通道都具有相干处理
耳鼻喉科频率转换和输出的采样时钟。此外,
提供外部同步引脚,以方便统一
在几个频率转换和输出采样时钟
AD6620s 。这些功能可以简化系统的设计
分集式天线或天线阵列。
单位包装在一个80引脚PQFP (塑料四方扁平封装)
并规定工作在工业级温度范围
( -40 ° C至+ 85°C ) 。
的AD6620是数字接收机具有四个级联信号 -
处理元素:一个频率变换器,双固定
系数抽取滤波器,以及一个可编程系数
抽取滤波器。所有的输入都是3.3 V LVCMOS兼容。
所有输出LVCMOS和5 V TTL兼容。
例如ADC实现更高的采样率和动态范围,
变得越来越有吸引力来完成最终的IF级
在数字域中的接收机。数字中频处理少
昂贵,更容易制造,更准确,更
挠性比可比较的高选择性的模拟阶段。
在AD6620通道分集接收机抽取设计
弥合高速ADC和一般用途之间的差距
构成的DSP 。高分辨率的NCO允许单个载波来
可以从一个高速数据流中选择。高动态范围
具有广泛的抽取率,允许抽取滤波器
SHARC是ADI公司的注册商标。
REV 。一
信息ADI公司提供的被认为是准确和
可靠的。但是,没有责任承担由Analog Devices其
使用,也不对第三方专利或其他权利的任何侵犯该
可能是由于它的使用。没有获发牌照以暗示或以其他方式
在ADI公司的任何专利或专利权。
一个技术的方式, P.O. 9106箱,诺伍德,MA 02062-9106 , U.S.A.
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ADI公司, 2001
AD6620
目录
架构
概述。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1
架构。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 2
规格。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 4
时序。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。五
绝对最大额定值。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 11
说明测试级别。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 11
订购指南。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 11
引脚功能描述。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 12
引脚配置。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 13
输入数据端口。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 15
输出数据端口。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 18
频率转换。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 19
二阶级联积分
梳状滤波器。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 21
五阶级联积分
梳状滤波器。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 23
RAM系数滤波器。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 25
控制寄存器和片上RAM 。 。 。 。 。 。 。 27
烧写AD6620 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。三十
访问协议。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 31
微创控制。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 32
串行口控制。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 35
JTAG边界扫描。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 37
应用。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 38
外形尺寸。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 44
如图1所示, AD6620 ,主要有四个信号亲
cessing阶段:一个频率变换器,双级联积分
梳状FIR滤波器( CIC 2 , CIC5 ) ,以及RAM系数FIR
滤波器( RCF ) 。多种模式都支持时钟数据
流入和流出的芯片。编程和控制accom-
通过串口与微处理器接口plished 。
数据输入到芯片可以是实数或复数。如果输入数据
是真实的,它的时钟可以作为一个单独的通道或交错
与第二通道。双声道输入模式,称为
多样性通道实时,通常用于分集接收机
应用程序。输入数据移入16位并行的话,
IN [ 15:0] 。这个词可能会与指数的输入位组合
EXP [2:0 ]时, AD6620被驱动通过浮点或
增益范围的模拟 - 数字转换器,如AD6600 。
频率转换完成了32位复数
数控振荡器( NCO ) 。输入真实数据
这个阶段被分离成同相( I)和正交(Q)的
组件。这一阶段从数字转换的输入信号
中频(IF )至基带。相位和振幅
抖动可以片上启用以提高寄生性能
士官的。相位偏移字可用于创建一个已知的
多个AD6620s之间的相位关系。
以下频率转换为固定系数,高速
抽取滤波器是由一个编程降低采样速率
2与16之间梅布尔比例,这是一个二阶,级联
如图CIC2如图1 (注积分梳状FIR滤波器:
1在CIC2抽取需要2倍或更高的时钟到
AD6620 ) 。的数据速率到该级等于输入数据
率,女
SAMP
。数据速率从CIC2 ,女的
SAMP2
,由下式确定
的抽取因子,男
CIC2
.
RCF
3
16
输入
数据
交错
DE-
交错
CIC5
M
CICS
f
SAMP5
23
23
f
SAMP2
军士
EXPLNV ,
ExpOff
RCF系数
抽头数
抽取因子
CIC2 , CIC5
抽取因子地址偏移
f
SAMP
比例因子
产量
NCO频率
规模
相位偏移
因素
抖动
同步面膜
控制寄存器
输入模式
微创和
REAL ,双通道, COMPLEX
串行访问
固定或带有指数的
SYNC M / S
产量
缩放,S
OUT
DV
OUT
I / Q
OUT
多路复用器
并行
16
串行
A / B
OUT
多路复用器
I- RAM
256 18
C- RAM
256 20
Q- RAM
256 18
M
RCF
EXP [2:0 ]
IN [ 15:0]
频率
3
翻译者
I 18
16
Q 18
EXP
缩放
缩放
CIC2
M
CICS
多路复用器
缩放
OFFSET
CLK
A / B
RESET
定时
SYNC NCO
SYNC CIC
SYNC RCF
SYNC
I / O
JTAG
TRST
TCK TMS
TDI
TDO
微处理器接口
D [ 7 : 0 ] A [ 2 : 0 ]
CS
读/写
DS DTACK
( W / R) (R / D ) ( RDY )
MODE PAR / SER
并行
输出
串行I / O
16
OUT [ 15:0]
SCLK
SDI
SDO
SDFS
SDFE
SBM
WL [1 :0]的
AD
SDIV [3 :0]的
图1.框图
–2–
REV 。一
AD6620
以下CIC 2是第二固定系数抽取滤波器。
该过滤器, CIC5 ,由一台可编程进一步降低采样速率
从1到32的数据速率进行CIC5 ,女的梅布尔比
SAMP5
,是
由M的抽取因子确定
CIC5
和M
CIC2
.
每投阶段是一个FIR滤波器,其响应由定义
抽取率。这些过滤器的目的是为了减少
所述输入信号的数据速率,以使最终的滤波器级,一个FIR
加总的副产物的RAM系数滤波器(RCF ) ,可以计算出
每个输出更多的抽头。如图1中所示,片上multiplex-
ERS让双方CIC滤波器,如果多速率时钟被绕过
被使用。
第四个阶段是加总产品的FIR滤波器编程
梅布尔20位系数,抽取率可编程
从1到32的RAM系数FIR滤波器( RCF图
1 )可以处理最多256个抽头。
为AD6620的整个滤波器响应的复合
所有三个级联抽取滤波器: CIC2 , CIC5和RCF 。每
连续的过滤阶段能够更窄的过渡频带 -
宽度,但需要更多数量的CLK的周期来计算
的输出。更抽取在所述第一滤波器级将最小化
整体功耗。数据出来通过并行端口
或一个串行接口。
图2示出了AD6620的基本功能:选择
和过滤从一个宽的输入频谱的单个信道。该
频率变换器“曲调”所需的载波为基带。
CIC2和CIC5有固定顺序的反应;在RCF滤波器
提供了锐利的转变。更多细节稍后提供
该数据表的部分。
宽带输入谱
C'
D'
利益"IMAGE"的信号
B'
A'
A
(–f
SAMP /
2至f
SAMP /
2)
信号
利息
C
D
B
–f
S
/2
–3f
S
/8
–5f
S
/16
–f
S
/4
–3f
S
/16
–f
S
/8
–f
S
/16
DC
f
S
/16
f
S
/8
3f
S
/16
f
S
/4
5f
S
/16
3f
S
/8
f
S
/2
图2a。宽带输入频谱(例如,从高速ADC 30兆赫)
NCO "TUNES"信号到基带
频率转换后
A
B
C
D
D'
C'
B'
A'
–f
S
/2
–3f
S
/8
–5f
S
/16
–f
S
/4
–3f
S
/16
–f
S
/8
–f
S
/16
DC
f
S
/16
f
S
/8
3f
S
/16
f
S
/4
5f
S
/16
3f
S
/8
f
S
/2
图2b 。频率转换(例如,单人1 MHz信道调整到基带)
CIC2 , CIC5 ,和RCF
0
–10
–20
–30
–40
–50
dBc的
–60
–70
–80
–90
–100
–110
–120
–130
频率
图2c 。基带信号进行抽取和CIC2 , CIC5 , RCF过滤
REV 。一
–3–
AD6620–SPECIFICATIONS
推荐工作条件
参数
VDD
T
环境
TEST
水平
I
IV
3.0
–40
AD6620AS
典型值
3.3
+25
最大
3.6
+85
单位
V
°C
电气特性
参数(条件)
逻辑输入
1, 2, 3, 4, 5, 6, 7
(不是5 V宽容)
逻辑兼容性
逻辑“1”的电压
逻辑“0”电压
逻辑“1”的当前
逻辑“0”的当前
输入电容
逻辑输出
2, 4, 7, 8, 9, 10, 11
逻辑兼容性
逻辑“1”的电压(我
OH
= 0.5 mA)的
逻辑“0”电压(我
OL
= 1.0 mA)的
IDD供电电流
CLK = 20 MHz的
12
CLK = 65 MHz的
13
复位模式
14
功耗
CLK = 20 MHz的
12
CLK = 65 MHz的
13
复位模式
14
温度
25°C
TEST
水平
AD6620AS
典型值
3.3 V CMOS
I
I
I
I
V
2.0
–0.3
1
1
4
VDD + 0.3
0.8
10
10
V
V
A
A
pF
最大
单位
I
I
V
I
I
V
I
I
2.4
3.3 V CMOS / TTL
VDD - 0.2
0.2
0.4
52
167
V
V
mA
mA
mA
mW
mW
mW
227
1
170
550
750
3.3
笔记
1
输入专用管脚: CLK ,
RESET ,
[15 : 0 ] , EXP [ 2 : 0 ] , A / B , PAR / SEL 。
2
双向引脚: SYNC_NCO , SYNC_CIC , SYNC_RCF 。
3
Microinterface输入引脚:
DS
(RD) ,读/写(WR) ,
CS 。
4
Microinterface双向引脚: A [ 2 : 0] , D [ 7 : 0 ] 。
5
JTAG输入引脚:
TRST ,
TCK , TMS , TDI 。
6
串行模式输入引脚: SDI , SBM , WL [ 1 : 0 ] , AD , SDIV [ 3 : 0 ] 。
7
串行模式双向引脚: SCLK , SDFS 。
8
输出引脚: OUT [ 15 : 0 ] , DV
OUT
, A / B
OUT
I / Q
OUT
.
9
Microinterface输出引脚:
DTACK
( RDY ) 。
10
JTAG输出引脚: TDO 。
11
串行模式输出引脚: SDO , SDFE 。
12
条件IDD @ 20MHz的。 M
CIC2
= 2, M
CIC5
= 2, M
RCF
= 1,交替的正和负的满量程的4 RCF抽头。
13
条件IDD @ 65兆赫。 M
CIC2
= 2, M
CIC5
= 2, M
RCF
= 1,交替的正和负的满量程的4 RCF抽头。
14
在复位的IDD条件( RESET = 0 ) 。
特定网络阳离子如有更改,恕不另行通知。
–4–
REV 。一
AD6620
时序特性
(C
参数(条件)
CLK时序要求:
t
CLK
CLK周期
CLK周期
t
CLK
CLK宽度低
t
CLKL
t
CLKH
CLK宽高
复位时序要求:
t
器RES1
RESET
宽度低
输入数据时序要求:
输入
2
到CLK建立时间
t
SI
t
HI
输入
2
到CLK保持时间
并行输出开关特性:
t
DPR
CLK至OUT [ 15:0]上升延迟
CLK至OUT [ 15:0]秋季延迟
t
DPF
t
DPR
CLK为DV
OUT
上升延时
t
DPF
CLK为DV
OUT
秋季延迟
CLK智商
OUT
上升延时
t
DPR
t
DPF
CLK智商
OUT
秋季延迟
t
DPR
CLK为AB
OUT
上升延时
t
DPF
CLK为AB
OUT
秋季延迟
同步定时要求:
t
SY
SYNC
3
到CLK建立时间
t
HY
SYNC
3
到CLK保持时间
SYNC开关特性:
t
DY
CLK到SYNC
4
延迟时间
串行输入时序:
t
SSI
SDI到SCLKt建立时间
SDI到SCLKt保持时间
t
恒指
t
HSRF
SDFS到SCLKu保持时间
t
SSF
SDFS到SCLKt建立时间
5
t
HSF
SDFS到SCLKt保持时间
5
串行帧输出时序:
t
DSE
SCLKu到SDFE延迟时间
t
SDFEH
SDFE宽高
t
DSO
SCLKu到SDO延迟时间
SCLK开关特性, SBM = “ 1 ” :
t
SCLK
SCLK周期
4
t
SCLKL
SCLK宽度低
t
SCLKH
SCLK宽高
t
SCLKD
CLK到SCLK延迟时间
串行
帧定时, SBM =“1” :
t
DSF
SCLKu到SDFS延迟时间
t
SDFSH
SDFS宽高
SCLK时序要求, SBM
=
“0”:
t
SCLK
SCLK周期
t
SCLKL
SCLK宽度低
t
SCLKH
SCLK宽高
负载
= 40 pF的所有输出)
温度
TEST
水平
I
I
IV
IV
I
IV
IV
IV
IV
IV
IV
IV
IV
IV
IV
IV
IV
V
IV
IV
IV
IV
IV
IV
V
IV
I
V
V
V
IV
V
I
IV
IV
14.93
1
15.4
7.0
7.0
30.0
–1.0
6.5
8.0
7.5
6.5
5.5
7.0
6.0
7.0
5.5
–1.0
6.5
7.0
1.0
2.0
4.0
1.0
2.0
3.5
t
SCLK
4.5
2
×
t
CLK
6.5
1.0
t
SCLK
15.4
0.4
×
t
SCLK
0.4
×
t
SCLK
11.0
11.0
23.5
19.5
19.5
19.0
11.5
19.5
13.5
19.5
13.5
AD6620AS
典型值
最大
单位
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
0.5
×
t
CLK
0.5
×
t
CLK
0.5
×
t
SCLK
0.5
×
t
SCLK
13.0
4.0
0.5
×
t
SCLK
0.5
×
t
SCLK
笔记
1
本规范适用于VDD > = 3.3 V.吨
CLKL
和T
CLKH
仍然适用。
2
说明书中涉及: IN [ 15:0] ,EXP [ 2:0] ,A / B 。
3
规范适用于: SYNC_NCO , SYNC_CIC , SYNC_RCF 。
4
SCLK周期会
2
×
t
CLK
当AD6620的串行总线主控制器( SBM = 1 )根据SDIV字。
5
SDFS建立和保持时间必须得到满足,甚至当配置为输出,因为在内部的信号进行采样垫。
特定网络阳离子如有更改,恕不另行通知。
REV 。一
–5–
a
特点
高输入采样率
67 MSPS的单通道真
33.5 MSPS分集通道实
33.5 MSPS单通道复
NCO频率转换
最差杂散-100 dBc的更好
调整分辨率优于0.02赫兹
二阶级联积分梳状滤波器FIR
线性相位,固定系数
可编程抽取率: 2,3 。 。 。 16
五阶级联积分梳状滤波器FIR
线性相位,固定系数
可编程抽取率: 1 , 2 , 3 。 。 。 32
可编程抽选RAM系数FIR滤波器
高达每秒1.34亿丝锥
256 20位可编程系数
可编程抽取率: 1 , 2 , 3 。 。 。 32
双向同步电路
相位对齐军士
同步数据输出时钟
串行或并行输出的基带
引脚可选串行或并行
系列作品与SHARC
, ADSP- 21xx系列,其他大多数
DSP的
16 - bit并行端口,交错I和Q输出
两个独立的控制和配置端口
通用的P端口,串行端口
3.3 V CMOS优化流程
JTAG边界扫描
概述
REAL ,
DUAL REAL ,
或复杂
输入
67 MSPS数字接收
信号处理器
AD6620
功能框图
I
CIC
过滤器
I
FIR
滤波器
I
产量
格式
串行或
并行
输出
Q
Q
Q
COS
-sin
AD6620
军士
SYNC
电路
JTAG
PORT
P
或串行
控制
窄带和宽带载波进行萃取。该
基于RAM的架构可轻松重新配置的多
模式的应用。
该抽取滤波器去除不需要的信号和噪声
感兴趣的信道。当感兴趣的信道占用
带宽比输入信号更小,这个拒绝和失
带外噪声被称为“处理增益。 ”通过使用大抽取
因素,这种“处理增益”可以提高信噪比
ADC 36分贝以上。此外,可编程RAM
系数滤波器允许抗锯齿,匹配滤波和
静态均衡功能,可以在一个单一的,成本相结合
有效的过滤。
输入端口接收一个16位的尾数,一个3位的指数,
和A / B选择引脚。这允许直接连接的
AD6600 , AD6640 , AD6644 , AD9042和大多数其他高端
高速ADC 。提供了三种输入模式:单通道
真正的单通道复杂和多样性通道实时。
当用交错采样配对,如AD6600 ,
在AD6620可以处理的多样性两个数据流
通道实时输入模式。每个通道都具有相干处理
耳鼻喉科频率转换和输出的采样时钟。此外,
提供外部同步引脚,以方便统一
在几个频率转换和输出采样时钟
AD6620s 。这些功能可以简化系统的设计
分集式天线或天线阵列。
单位包装在一个80引脚PQFP (塑料四方扁平封装)
并规定工作在工业级温度范围
( -40 ° C至+ 85°C ) 。
的AD6620是数字接收机具有四个级联信号 -
处理元素:一个频率变换器,双固定
系数抽取滤波器,以及一个可编程系数
抽取滤波器。所有的输入都是3.3 V LVCMOS兼容。
所有输出LVCMOS和5 V TTL兼容。
例如ADC实现更高的采样率和动态范围,
变得越来越有吸引力来完成最终的IF级
在数字域中的接收机。数字中频处理少
昂贵,更容易制造,更准确,更
挠性比可比较的高选择性的模拟阶段。
在AD6620通道分集接收机抽取设计
弥合高速ADC和一般用途之间的差距
构成的DSP 。高分辨率的NCO允许单个载波来
可以从一个高速数据流中选择。高动态范围
具有广泛的抽取率,允许抽取滤波器
SHARC是ADI公司的注册商标。
REV 。一
信息ADI公司提供的被认为是准确和
可靠的。但是,没有责任承担由Analog Devices其
使用,也不对第三方专利或其他权利的任何侵犯该
可能是由于它的使用。没有获发牌照以暗示或以其他方式
在ADI公司的任何专利或专利权。
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AD6620
目录
架构
概述。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1
架构。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 2
规格。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 4
时序。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。五
绝对最大额定值。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 11
说明测试级别。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 11
订购指南。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 11
引脚功能描述。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 12
引脚配置。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 13
输入数据端口。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 15
输出数据端口。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 18
频率转换。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 19
二阶级联积分
梳状滤波器。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 21
五阶级联积分
梳状滤波器。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 23
RAM系数滤波器。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 25
控制寄存器和片上RAM 。 。 。 。 。 。 。 27
烧写AD6620 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。三十
访问协议。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 31
微创控制。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 32
串行口控制。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 35
JTAG边界扫描。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 37
应用。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 38
外形尺寸。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 44
如图1所示, AD6620 ,主要有四个信号亲
cessing阶段:一个频率变换器,双级联积分
梳状FIR滤波器( CIC 2 , CIC5 ) ,以及RAM系数FIR
滤波器( RCF ) 。多种模式都支持时钟数据
流入和流出的芯片。编程和控制accom-
通过串口与微处理器接口plished 。
数据输入到芯片可以是实数或复数。如果输入数据
是真实的,它的时钟可以作为一个单独的通道或交错
与第二通道。双声道输入模式,称为
多样性通道实时,通常用于分集接收机
应用程序。输入数据移入16位并行的话,
IN [ 15:0] 。这个词可能会与指数的输入位组合
EXP [2:0 ]时, AD6620被驱动通过浮点或
增益范围的模拟 - 数字转换器,如AD6600 。
频率转换完成了32位复数
数控振荡器( NCO ) 。输入真实数据
这个阶段被分离成同相( I)和正交(Q)的
组件。这一阶段从数字转换的输入信号
中频(IF )至基带。相位和振幅
抖动可以片上启用以提高寄生性能
士官的。相位偏移字可用于创建一个已知的
多个AD6620s之间的相位关系。
以下频率转换为固定系数,高速
抽取滤波器是由一个编程降低采样速率
2与16之间梅布尔比例,这是一个二阶,级联
如图CIC2如图1 (注积分梳状FIR滤波器:
1在CIC2抽取需要2倍或更高的时钟到
AD6620 ) 。的数据速率到该级等于输入数据
率,女
SAMP
。数据速率从CIC2 ,女的
SAMP2
,由下式确定
的抽取因子,男
CIC2
.
RCF
3
16
输入
数据
交错
DE-
交错
CIC5
M
CICS
f
SAMP5
23
23
f
SAMP2
军士
EXPLNV ,
ExpOff
RCF系数
抽头数
抽取因子
CIC2 , CIC5
抽取因子地址偏移
f
SAMP
比例因子
产量
NCO频率
规模
相位偏移
因素
抖动
同步面膜
控制寄存器
输入模式
微创和
REAL ,双通道, COMPLEX
串行访问
固定或带有指数的
SYNC M / S
产量
缩放,S
OUT
DV
OUT
I / Q
OUT
多路复用器
并行
16
串行
A / B
OUT
多路复用器
I- RAM
256 18
C- RAM
256 20
Q- RAM
256 18
M
RCF
EXP [2:0 ]
IN [ 15:0]
频率
3
翻译者
I 18
16
Q 18
EXP
缩放
缩放
CIC2
M
CICS
多路复用器
缩放
OFFSET
CLK
A / B
RESET
定时
SYNC NCO
SYNC CIC
SYNC RCF
SYNC
I / O
JTAG
TRST
TCK TMS
TDI
TDO
微处理器接口
D [ 7 : 0 ] A [ 2 : 0 ]
CS
读/写
DS DTACK
( W / R) (R / D ) ( RDY )
MODE PAR / SER
并行
输出
串行I / O
16
OUT [ 15:0]
SCLK
SDI
SDO
SDFS
SDFE
SBM
WL [1 :0]的
AD
SDIV [3 :0]的
图1.框图
–2–
REV 。一
AD6620
以下CIC 2是第二固定系数抽取滤波器。
该过滤器, CIC5 ,由一台可编程进一步降低采样速率
从1到32的数据速率进行CIC5 ,女的梅布尔比
SAMP5
,是
由M的抽取因子确定
CIC5
和M
CIC2
.
每投阶段是一个FIR滤波器,其响应由定义
抽取率。这些过滤器的目的是为了减少
所述输入信号的数据速率,以使最终的滤波器级,一个FIR
加总的副产物的RAM系数滤波器(RCF ) ,可以计算出
每个输出更多的抽头。如图1中所示,片上multiplex-
ERS让双方CIC滤波器,如果多速率时钟被绕过
被使用。
第四个阶段是加总产品的FIR滤波器编程
梅布尔20位系数,抽取率可编程
从1到32的RAM系数FIR滤波器( RCF图
1 )可以处理最多256个抽头。
为AD6620的整个滤波器响应的复合
所有三个级联抽取滤波器: CIC2 , CIC5和RCF 。每
连续的过滤阶段能够更窄的过渡频带 -
宽度,但需要更多数量的CLK的周期来计算
的输出。更抽取在所述第一滤波器级将最小化
整体功耗。数据出来通过并行端口
或一个串行接口。
图2示出了AD6620的基本功能:选择
和过滤从一个宽的输入频谱的单个信道。该
频率变换器“曲调”所需的载波为基带。
CIC2和CIC5有固定顺序的反应;在RCF滤波器
提供了锐利的转变。更多细节稍后提供
该数据表的部分。
宽带输入谱
C'
D'
利益"IMAGE"的信号
B'
A'
A
(–f
SAMP /
2至f
SAMP /
2)
信号
利息
C
D
B
–f
S
/2
–3f
S
/8
–5f
S
/16
–f
S
/4
–3f
S
/16
–f
S
/8
–f
S
/16
DC
f
S
/16
f
S
/8
3f
S
/16
f
S
/4
5f
S
/16
3f
S
/8
f
S
/2
图2a。宽带输入频谱(例如,从高速ADC 30兆赫)
NCO "TUNES"信号到基带
频率转换后
A
B
C
D
D'
C'
B'
A'
–f
S
/2
–3f
S
/8
–5f
S
/16
–f
S
/4
–3f
S
/16
–f
S
/8
–f
S
/16
DC
f
S
/16
f
S
/8
3f
S
/16
f
S
/4
5f
S
/16
3f
S
/8
f
S
/2
图2b 。频率转换(例如,单人1 MHz信道调整到基带)
CIC2 , CIC5 ,和RCF
0
–10
–20
–30
–40
–50
dBc的
–60
–70
–80
–90
–100
–110
–120
–130
频率
图2c 。基带信号进行抽取和CIC2 , CIC5 , RCF过滤
REV 。一
–3–
AD6620–SPECIFICATIONS
推荐工作条件
参数
VDD
T
环境
TEST
水平
I
IV
3.0
–40
AD6620AS
典型值
3.3
+25
最大
3.6
+85
单位
V
°C
电气特性
参数(条件)
逻辑输入
1, 2, 3, 4, 5, 6, 7
(不是5 V宽容)
逻辑兼容性
逻辑“1”的电压
逻辑“0”电压
逻辑“1”的当前
逻辑“0”的当前
输入电容
逻辑输出
2, 4, 7, 8, 9, 10, 11
逻辑兼容性
逻辑“1”的电压(我
OH
= 0.5 mA)的
逻辑“0”电压(我
OL
= 1.0 mA)的
IDD供电电流
CLK = 20 MHz的
12
CLK = 65 MHz的
13
复位模式
14
功耗
CLK = 20 MHz的
12
CLK = 65 MHz的
13
复位模式
14
温度
25°C
TEST
水平
AD6620AS
典型值
3.3 V CMOS
I
I
I
I
V
2.0
–0.3
1
1
4
VDD + 0.3
0.8
10
10
V
V
A
A
pF
最大
单位
I
I
V
I
I
V
I
I
2.4
3.3 V CMOS / TTL
VDD - 0.2
0.2
0.4
52
167
V
V
mA
mA
mA
mW
mW
mW
227
1
170
550
750
3.3
笔记
1
输入专用管脚: CLK ,
RESET ,
[15 : 0 ] , EXP [ 2 : 0 ] , A / B , PAR / SEL 。
2
双向引脚: SYNC_NCO , SYNC_CIC , SYNC_RCF 。
3
Microinterface输入引脚:
DS
(RD) ,读/写(WR) ,
CS 。
4
Microinterface双向引脚: A [ 2 : 0] , D [ 7 : 0 ] 。
5
JTAG输入引脚:
TRST ,
TCK , TMS , TDI 。
6
串行模式输入引脚: SDI , SBM , WL [ 1 : 0 ] , AD , SDIV [ 3 : 0 ] 。
7
串行模式双向引脚: SCLK , SDFS 。
8
输出引脚: OUT [ 15 : 0 ] , DV
OUT
, A / B
OUT
I / Q
OUT
.
9
Microinterface输出引脚:
DTACK
( RDY ) 。
10
JTAG输出引脚: TDO 。
11
串行模式输出引脚: SDO , SDFE 。
12
条件IDD @ 20MHz的。 M
CIC2
= 2, M
CIC5
= 2, M
RCF
= 1,交替的正和负的满量程的4 RCF抽头。
13
条件IDD @ 65兆赫。 M
CIC2
= 2, M
CIC5
= 2, M
RCF
= 1,交替的正和负的满量程的4 RCF抽头。
14
在复位的IDD条件( RESET = 0 ) 。
特定网络阳离子如有更改,恕不另行通知。
–4–
REV 。一
AD6620
时序特性
(C
参数(条件)
CLK时序要求:
t
CLK
CLK周期
CLK周期
t
CLK
CLK宽度低
t
CLKL
t
CLKH
CLK宽高
复位时序要求:
t
器RES1
RESET
宽度低
输入数据时序要求:
输入
2
到CLK建立时间
t
SI
t
HI
输入
2
到CLK保持时间
并行输出开关特性:
t
DPR
CLK至OUT [ 15:0]上升延迟
CLK至OUT [ 15:0]秋季延迟
t
DPF
t
DPR
CLK为DV
OUT
上升延时
t
DPF
CLK为DV
OUT
秋季延迟
CLK智商
OUT
上升延时
t
DPR
t
DPF
CLK智商
OUT
秋季延迟
t
DPR
CLK为AB
OUT
上升延时
t
DPF
CLK为AB
OUT
秋季延迟
同步定时要求:
t
SY
SYNC
3
到CLK建立时间
t
HY
SYNC
3
到CLK保持时间
SYNC开关特性:
t
DY
CLK到SYNC
4
延迟时间
串行输入时序:
t
SSI
SDI到SCLKt建立时间
SDI到SCLKt保持时间
t
恒指
t
HSRF
SDFS到SCLKu保持时间
t
SSF
SDFS到SCLKt建立时间
5
t
HSF
SDFS到SCLKt保持时间
5
串行帧输出时序:
t
DSE
SCLKu到SDFE延迟时间
t
SDFEH
SDFE宽高
t
DSO
SCLKu到SDO延迟时间
SCLK开关特性, SBM = “ 1 ” :
t
SCLK
SCLK周期
4
t
SCLKL
SCLK宽度低
t
SCLKH
SCLK宽高
t
SCLKD
CLK到SCLK延迟时间
串行
帧定时, SBM =“1” :
t
DSF
SCLKu到SDFS延迟时间
t
SDFSH
SDFS宽高
SCLK时序要求, SBM
=
“0”:
t
SCLK
SCLK周期
t
SCLKL
SCLK宽度低
t
SCLKH
SCLK宽高
负载
= 40 pF的所有输出)
温度
TEST
水平
I
I
IV
IV
I
IV
IV
IV
IV
IV
IV
IV
IV
IV
IV
IV
IV
V
IV
IV
IV
IV
IV
IV
V
IV
I
V
V
V
IV
V
I
IV
IV
14.93
1
15.4
7.0
7.0
30.0
–1.0
6.5
8.0
7.5
6.5
5.5
7.0
6.0
7.0
5.5
–1.0
6.5
7.0
1.0
2.0
4.0
1.0
2.0
3.5
t
SCLK
4.5
2
×
t
CLK
6.5
1.0
t
SCLK
15.4
0.4
×
t
SCLK
0.4
×
t
SCLK
11.0
11.0
23.5
19.5
19.5
19.0
11.5
19.5
13.5
19.5
13.5
AD6620AS
典型值
最大
单位
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
0.5
×
t
CLK
0.5
×
t
CLK
0.5
×
t
SCLK
0.5
×
t
SCLK
13.0
4.0
0.5
×
t
SCLK
0.5
×
t
SCLK
笔记
1
本规范适用于VDD > = 3.3 V.吨
CLKL
和T
CLKH
仍然适用。
2
说明书中涉及: IN [ 15:0] ,EXP [ 2:0] ,A / B 。
3
规范适用于: SYNC_NCO , SYNC_CIC , SYNC_RCF 。
4
SCLK周期会
2
×
t
CLK
当AD6620的串行总线主控制器( SBM = 1 )根据SDIV字。
5
SDFS建立和保持时间必须得到满足,甚至当配置为输出,因为在内部的信号进行采样垫。
特定网络阳离子如有更改,恕不另行通知。
REV 。一
–5–
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