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12
½
LED
恒流驱动芯片
A8012
芯片概述
A8012
是专为LED显示应用所设计的恒流
驱动芯片，12个输出通道的电流可由一外
挂电阻调整。每通道最大输出承受电压高
达40V，可串接12颗LED芯片。芯片工½
电压范围½广，可从5V到24V，串行数据
/输出的时钟频率可达40MHz。 过温断
电功½则可保护芯片避免在高温环境½用
下而毁损。
恒流输出：
0 40毫安（以一外挂电阻
调整)
芯片工½电压：5V~24V
快速的电流输出响应：
200ns(最小值)
电流精确度:
o
±3%(通道与通道之间)
o
±6%(芯片与芯片之间)
串行数据输入/输出
所有控制讯号均为串行输入/输出
运行环境温度：
-40 ° C至85°C
过温保护功½
封装½式：
24 SSOP ， PDIP 24
应用
芯片特色
12
个恒流输出通道
最大输出承受电压：40V
芯片可直接串接，不需要
7805、74245
最大时钟频率：40MHz
护栏管/½条灯
侧光/直下式
LED
背光板
户内/外
LED
视频/讯息显示屏
LED
装饰与照明
功½方块图
提升泰克公司
第1页
vsc1.0
2009年3月
最大工½范围
特性
工½电压
输入电压
输出电流
输出电压
消耗功率
热阻值
静电放电（ HBM）的
工½温度
存放温度
符号
l
V
DD
V
IN
I
O
V
OUT
P
D
R
号（j -a）的
-
T
A
T
英镑
最大工½范围
27
7
45
-0.4 ~ 45.0
1.42
70.45
2K
-40 ~ 85
-55 ~ 150
单½
V
V
毫安/通道
V
W
℃/
W
V
℃
℃
推荐工½参数
特性
工½电压
输出电压
输出电流
输入时钟频率
锁存信号（ LAB_I
)脉波½度
时钟信号（ CLK_I
)脉波½度
致½信号(ENB_I
)脉波½度
符号
V
DD
V
OUT
I
OUT
f
CLK
tw
(L)
tw
（CLK）
tw
(E)
条件
-
OUT
0
= OUT
11
每个DC电路
串联的
-
I
OUT
= 20mA下
最小值
4.5
1.0
0
-
25
12.5
200
一般值
-
-
-
-
-
-
-
最大值
24.0
40.0
40
40M
-
-
-
单½
V
V
毫安/通道
Hz
ns
ns
ns
电气特性
特性
工½电压
输出电压
工½电流
输入电压-高电平(“H”
级）
输入电压-½电平(“L”
级）
输出电压-高电平(“H”
级）
输出电压-½电平(“L”
级）
输出漏电流
输出电流
输出电流差异(通道间)
输出电流 对 输出电压 之变
异率
输出电流 对 工½电压 之变
异率
过温断电起始温度
下拉电阻
上拉电阻
符号
V
DD
V
OUT
I
DD
V
IH
V
IL
V
OH
V
OL
I
OL
I
OUT1
ΔI
O
ΔI
O(2)
ΔI
O(3)
Tj
R
IN -L
R
IN -H
条件
-
OUT
0
= OUT
11
没有数据传输，
所有输出关闭
R
EXT
= 890Ω
-
-
I
OH
= -8mA
I
OL
= 8毫安
V
OH
= 40V ，输出
0
Out
11
R
EXT
=
V
OUT
=1.0V
V
DD
=5~24V
890Ω
-
-
-
芯片温度
LAB_I
ENB_I （至V50 ）
最小
4.5
-
-
2.0
GND
2.4
-
-
-
-
-
-
-
-
-
一般
-
-
-
-
-
-
-
-
20.0
-
±2
±2
-
150k
150k
最大
24.0
40.0
8
5.5
0.8
-
0.4
1
-
±3
±6
±6
150
-
-
单½
V
V
mA
V
V
V
V
A
mA
%
%/V
%/V
℃
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vsc1.0
2009年3月
交流特性
特性
时钟高电平脉冲宽度
数据输入建立时间
数据输入保持时间
LAB_I脉冲宽度时间
LAB_I设置输入法
ENB_I脉冲宽度
不要耽误时间
OUTN延迟时间
逻辑信号输入到输出
延迟时间
符号
tw
（CLK）
TSU
(D)
th
(D)
tw
(L)
TSU
(L)
tw
(E)
tp
LH ，
tp
HL
tp
LH2,
tp
HL2
td
LH ，
td
HL
条件
-
DI - CLK_I
CLK_I - DI
-
CLK_I - LAB_I
-
CLK_I - DO
( C
负载
= 100pF的）
ENB_I - OUTn的
CLK_I - CLK_O
LAB_I - LAB_O
ENB_I - ENB_O
( C
负载
= 100pF的）
最小
12.5
5
5
25
25
200
-
-
-
一般
-
-
-
-
-
-
-
-
-
最大
-
-
-
-
-
-
10
50
10
单½
ns
ns
ns
ns
ns
ns
ns
ns
ns
脚½图
EXT
摹ND
简B _I
LK _I
LA B _I
DI
ü T0
ü T1
ü T2
ü T3
单位的T4
ü T5
1
2
3
4
24
23
22
21
5
6
7
8
9
10
11
12
20
19
18
17
16
15
14
13
VD
V 50
简B _O
LK _O
LA B _O
DO
ü牛逼11
ü牛逼10
ü T9
ü T8
ü T7
ü T6
A 8012
脚½定义
引脚数
1
2
3
4
5
6
7
8
引脚名称
REXT
GND
ENB_I
CLKΔI
LAB_I
DI
OUT0
OUT1
I / O
I
G
I
I
I
I
O
O
描述
外挂电阻端，外挂电阻应接于
REXT
脚管与
GND
端之间
接地端
恒流输出致½开关，½
ENB_I
设定为½,所有恒流输出启动，½
ENB_I
设定为高,所有恒流输出关闭
串行时钟讯号输入端
串行数据锁存输入端
串行数据输入端
恒流输出端
0
恒流输出端
1
提升泰克公司
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2009年3月
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
OUT2
OUT3
OUT4
OUT5
OUT6
OUT7
OUT8
OUT9
OUT10
OUT11
DO
LAB_O
CLK_O
ENB_O
V50
VDD
O
O
O
O
O
O
O
O
O
O
O
O
O
O
O
P
恒流输出端
2
恒流输出端
3
恒流输出端
4
恒流输出端
5
恒流输出端
6
恒流输出端
7
恒流输出端
8
恒流输出端
9
恒流输出端
10
恒流输出端
11
串行数据输出端
串行数据锁存输出端
串行时钟讯号输出端
串行恒流输出致½开关输出
芯片
5V
工½电源端，1μF 电容器接
GND 。
操½电源端
真值表
CLKΔI
LAB_I
H
L
H
X
X
ENB_I
L
L
L
L
H
串行输入
Dn
Dn+1
Dn+2
Dn+3
Dn+3
OUT0 .. OUT5 ... OUT11
DN ... DN - 5 ... DN- 11
没有变化
DN + 2 ... DN - 3 ... DN- 9
DN + 2 ... DN - 3 ... DN- 9
关闭
串行输出
Dn-12
Dn-11
Dn-10
Dn-9
Dn-9
时序图解
n = 0
1
2
3
4
5
6
7
8
9
10
11
H
LK _我
L
H
DI
L
H
LAB_I
L
H
ENB_I
L
H
ü T0
L
H
ü T1
L
H
ü T2
L
H
ü T11
L
H
DO
L
提升泰克公司
第4页
vsc1.0
2009年3月
输出与输入等效电路
1.启用
端
V50
ENB_I
GND
R（ UP ）
2. LATCH
端
3.时钟，串行输入
端
V50
CLKΔI
DI
GND
4.串行输出
端
5.时钟输出
端
6.启用-OUT
端
7. LATCH -OUT
端
8. OUT0到OUT11
端
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2009年3月
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