74F533八路透明锁存器带3态输出
1988年4月
修订后的2000年10月
74F533
八路透明锁存器具有三态输出
概述
该74F533包括八个锁存器具有三态输出
公交组织系统的应用。触发器
出现透明的数据时，锁存使能（ LE ）是
HIGH 。当LE为低电平，数据即满足设置
次被锁。数据出现在总线上，当输出
使能（OE ）为LOW 。当OE为高电平的总线输出是
高阻抗状态。该74F533是一样的
74F373 ，不同之处在于输出被反相。
特点
s
八个锁存器在一个封装
s
总线接口3态输出
s
该74F373倒版本
订购代码：
订单号
74F533SC
74F533SJ
74F533PC
包装数
M20B
M20D
N20A
包装说明
20引脚小外形集成电路（ SOIC ） ， JEDEC MS- 013 ，宽0.300
20引脚小外形封装（ SOP ） ， EIAJ TYPE II ， 5.3毫米宽
20引脚塑料双列直插式封装（ PDIP ） ， JEDEC MS- 001 ，宽0.300
在磁带和卷轴可用的设备也。通过附加的后缀字母“X”的订货代码指定。
逻辑符号
IEEE / IEC
接线图
2000仙童半导体公司
DS009548
www.fairchildsemi.com
74F533
单位装载/扇出
U.L.
引脚名称
D
0
–D
7
LE
OE
O
0
–O
7
数据输入
锁存使能输入（高电平有效）
输出使能输入（低电平有效）
补充三态输出
描述
HIGH / LOW
1.0/1.0
1.0/1.0
1.0/1.0
150/40 (33.3)
输入I
IH
/I
IL
输出I
OH
/I
OL
20
A/
0.6毫安
20
A/
0.6毫安
20
A/
0.6毫安
3毫安/ 24毫安（20 mA）的
功能表
输入
LE
H
H
L
X
H
=
高电压电平
L
=
低电压电平
X
=
非物质
功能说明
产量
D
H
L
X
X
O
L
H
O
0
Z
该74F533包含八个D型锁存器带3态
输出缓冲器。当锁存使能（ LE ）输入为高电平，
在D个数据
n
输入端进入锁存器。在此条件下
锁存器是透明的，也就是说，锁存器输出将改变
说明每一次的D输入的变化。当LE为低电平时，
锁存器存储，这是存在于D中的信息
输入高至低跳变之前的准备时间
的LE 。的三态缓冲器由所述输出控制
启用（ OE ）输入。当OE为低电平时，缓冲器中的
双态模式。当OE为高电平的缓冲器是处于高
阻抗模式，但这并不与进入干涉
新数据进入锁存器。
OE
L
L
L
H
逻辑图
请注意，该图仅用于逻辑操作的理解提供的，不应该被用来估计的传播延迟。
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2
74F533
物理尺寸
英寸（毫米），除非另有说明
20引脚小外形集成电路（ SOIC ） ， JEDEC MS- 013 ，宽0.300
包装数M20B
5
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54F 74F533八路透明锁存器具有三态输出
1995年5月
54F 74F533
八路透明锁存器具有三态输出
概述
在' F533由八个锁存器与三态输出
对于总线组织系统应用的触发器出现
透明的，当锁存使能数据（ LE ）为高电平
当LE为低电平，满足了安装时间的数据
锁存的数据出现在总线上，当输出使能
（OE）为LOW当OE为高电平的总线输出是在高
阻抗状态的“ F533是一样的” F373 EX-
概念，即输出翻转
特点
Y
Y
Y
Y
八个锁存器在一个封装
三态输出的总线接口
在“ F373倒版本
保证最低4000V的ESD保护
广告
74F533PC
军事
包
数
N20A
包装说明
20引脚（ 0 300广角）模压双列直插式
20引脚陶瓷双列直插式
20引脚（ 0 300广角）模压小外形JEDEC
20引脚（ 0 300广角）模压小外形EIAJ
20引脚Cerpack
20引脚陶瓷无引线芯片载体C型
54F533DM （注2）
74F533SC （注1 ）
74F533SJ （注1 ）
54F533FM （注2）
54F533LM （注2）
J20A
M20B
M20D
W20A
E20A
注1
也可在13盘使用后缀设备
e
SCX和SJX
注2
军用级设备与环境和老化处理中使用的后缀
e
DMQB FMQB和LMQB
逻辑符号
IEEE IEC
连接图
引脚分配
对于DIP SOIC和Flatpak
引脚分配
对于LCC
TL F 9548 - 3
TL F 9548-4
TL F 9548 - 2
TL F 9548-1
TRI- STATE是美国国家半导体公司的注册商标。
C
1995年全国半导体公司
TL F 9548
RRD - B30M75印制在U S A
单位荷载扇出
54F 74F
引脚名称
描述
UL
高低
10 10
10 10
10 10
150 40 (33 3)
输入I
IH
I
IL
输出I
OH
I
OL
20
mA
b
0 6毫安
20
mA
b
0 6毫安
20
mA
b
0 6毫安
b
3毫安24毫安（20 mA）的
D
0
–D
7
LE
OE
O
0
–O
7
数据输入
锁存使能输入（高电平有效）
输出使能输入（低电平有效）
补充三态输出
功能表
输入
产量
D
H
L
X
X
O
L
H
O
0
Z
LE
H
H
L
X
OE
L
L
L
H
H
e
高电压电平
L
e
低电压电平
X
e
非物质
功能说明
在' F533包含八个D型锁存与TRI -STATE
输出缓冲器当锁存使能（ LE ）输入为高电平
在D个数据
n
输入端进入锁存器在此状态下
锁存器是透明的国际能源署（IEA）锁存器输出将改变
说明它的每一个D输入转换时间当LE为低电平时，
锁存器存储存在的D输入信息
提出的高到低的跳变之前的准备时间
LE的该三态缓冲器由所述输出控制
启用（ OE ）输入当OE是低电平的缓冲区中
双态模式当OE为高电平时的缓冲区中高
阻抗模式，但这并不与进入干涉
新的数据进入锁存器
逻辑图
TL F 9548 - 5
请注意，该图仅用于逻辑操作的理解提供的，不应该被用来估计的传播延迟
2
AC电气特性
74F
符号
参数
民
t
PLH
t
PHL
t
PLH
t
PHL
t
PZH
t
PZL
t
PHZ
t
PLZ
传播延迟
D
n
与O
n
传播延迟
LE与O
n
输出使能时间
输出禁止时间
40
25
50
30
20
20
15
15
T
A
E A
25 C
V
CC
E A
5 0V
C
L
e
50 pF的
典型值
67
44
71
47
59
56
34
27
最大
90
70
11 0
70
10 0
75
65
55
54F
T
A
V
CC
e
米尔
C
L
e
50 pF的
民
40
25
50
30
20
20
15
15
最大
12 0
90
14 0
90
12 5
10 5
85
75
74F
T
A
V
CC
e
COM
C
L
e
50 pF的
民
40
25
50
30
20
20
15
15
最大
10 0
80
13 0
80
11 0
85
70
65
ns
ns
ns
ns
单位
AC操作要求
74F
符号
参数
T
A
E A
25 C
V
CC
E A
5 0V
民
t
s
(H)
t
s
(L)
t
h
(H)
t
h
(L)
t
w
(H)
建立时间高或低
D
n
以LE
保持时间高或低
D
n
以LE
LE脉冲宽高
20
20
30
30
60
最大
54F
T
A
V
CC
e
米尔
民
20
20
30
30
60
最大
74F
T
A
V
CC
e
COM
民
20
20
30
30
60
最大
ns
ns
ns
单位
订购信息
设备号被用于形成一个简化采购的代码，其中一个包类型和温度范围内是部分
定义如下
74F
温度范围：家庭
74F
e
广告
54F
e
军事
设备类型
封装代码
P
e
塑料DIP
D
e
陶瓷DIP
F
e
Flatpak
L
e
无引线芯片载体（ LCC ）
S
e
小外形封装SOIC JEDEC
SJ
e
小外形EIAJ SOIC
533
S
C
X
特殊变化
X
e
设备出货量在13卷轴
QB
e
军工级器件
环境和老化
处理运管
温度范围
C
e
商用（ 0℃至
a
70 C)
M
e
军事（
b
55 ℃
a
125 C)
4
74F533八路透明锁存器带3态输出
1988年4月
修订后的1999年8月
74F533
八路透明锁存器具有三态输出
概述
该74F533包括八个锁存器具有三态输出
公交组织系统的应用。触发器
出现透明的数据时，锁存使能（ LE ）是
HIGH 。当LE为低电平，数据即满足设置
次被锁。数据出现在总线上，当输出
使能（OE ）为LOW 。当OE为高电平的总线输出是
高阻抗状态。该74F533是一样的
74F373 ，不同之处在于输出被反相。
特点
s
八个锁存器在一个封装
s
总线接口3态输出
s
该74F373倒版本
订购代码：
订单号
74F533SC
74F533SJ
74F533PC
包装数
M20B
M20D
N20A
包装说明
20引脚小外形集成电路（ SOIC ） ， JEDEC MS- 013 ，宽0.300
20引脚小外形封装（ SOP ） ， EIAJ TYPE II ， 5.3毫米宽
20引脚塑料双列直插式封装（ PDIP ） ， JEDEC MS- 001 ，宽0.300
在磁带和卷轴可用的设备也。通过附加的后缀字母“X”的订货代码指定。
逻辑符号
IEEE / IEC
接线图
1999仙童半导体公司
DS009548
www.fairchildsemi.com
74F533
单位装载/扇出
U.L.
引脚名称
D
0
–D
7
LE
OE
O
0
–O
7
描述
HIGH / LOW
数据输入
锁存使能输入（高电平有效）
输出使能输入（低电平有效）
补充三态输出
1.0/1.0
1.0/1.0
1.0/1.0
150/40 (33.3)
输入I
IH
/I
IL
输出I
OH
/I
OL
20
A/0.6
mA
20
A/0.6
mA
20
A/0.6
mA
3
毫安/ 24毫安（20 mA）的
功能表
输入
LE
H
H
L
X
H
=
高电压电平
L
=
低电压电平
X
=
非物质
功能说明
产量
D
H
L
X
X
O
L
H
O
0
Z
该74F533包含八个D型锁存器带3态
输出缓冲器。当锁存使能（ LE ）输入为高电平，
在D个数据
n
输入端进入锁存器。在此条件下
锁存器是透明的，也就是说，锁存器输出将改变
说明每一次的D输入的变化。当LE为低电平时，
锁存器存储，这是存在于D中的信息
输入高至低跳变之前的准备时间
的LE 。的三态缓冲器由所述输出控制
启用（ OE ）输入。当OE为低电平时，缓冲器中的
双态模式。当OE为高电平的缓冲器是处于高
阻抗模式，但这并不与进入干涉
新数据进入锁存器。
OE
L
L
L
H
逻辑图
请注意，该图仅用于逻辑操作的理解提供的，不应该被用来估计的传播延迟。
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2
74F533
物理尺寸
英寸（毫米），除非另有说明
20引脚小外形集成电路（ SOIC ） ， JEDEC MS- 013 ，宽0.300
包装数M20B
20引脚小外形封装（ SOP ） ， EIAJ TYPE II ， 5.3毫米宽
包装数量M20D
5
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