10位65MSPS模数转换芯片ADC10065的原理和应用
发布时间:2008/5/28 0:00:00 访问次数:627
关键词:adc10065;adc;差分输入;图像采集
1 adc10065的主要特点
adc10065是美国国家半导体公司推出的一款低功耗、单电源供电的cmos 模数转换器。该芯片在3v单电源供电时,能以65msps的采样速率将模拟信号转为精确的10 位数字信号,而功耗仅为68.4mw,其备用模式时的功耗仅为14.1mw。adc10065片内采用具有数据纠错功能的差分总线结构。因而可在最小的功耗条件下提供极优秀的动态性能。该器件可广泛应用于超声波和图像采集、蜂窝基站/通信接收机、声纳/雷达、xdsl、无线局域网、数据采集系统以及dsp 前端。
adc10065的主要特性如下:
●3v单电源供电;
●满标度输入摆幅可在2.0 vp-p,1.5 vp-p,0或 1.0 vp-p四种输入信号中选择;
●具有400mhz-3db的输入频宽;
●具有静态工作模式;
●带有片内基准源和采样保持放大电路;
●具有二进制补码数据格式输出;
●可调整的输出驱动适合2.5v和3.3v系列的逻辑器件接口。
下面是adc10065的主要参数:
●分辨率:10bits;
●转换速率:65msps;
●fpbw(全功率带宽):400mhz
●dnl(差分非线性):±0.3 lsb;
●snr(信噪比fin=32mhz) :59.3db ;
●sfdr(无差错动态范围fin=32mhz时):-80db;
●数据延迟:6个时钟周期;
●参考电压:+3.0v;
●65mhz时的功耗为:68.4mw。
图2
2 引脚功能
图1为adc10065的引脚排列,该器件采用28脚tssop封装,各引脚的基本功能如下(括号中为引脚号):
vin-,vin+(12,13):模拟信号输入端。在1.2v参考电压下,满标度输入摆幅为1.0vp-p。单端操作时,vin+可与vcom连接。
vref(6):参考电压(1.5v)引脚,使用时应通过一个1μf的旁路电容连接到vssa。
vreft,vcom,vrefb(7,4,8):vreft和vrefb仅为高阻抗参考旁路管脚,而vcom则可用作设置输入公用电压vcm,这三个引脚都应当连接0.1μf的旁路电容。
clk(1):数字时钟输入端。输入频率范围为10mhz~65mhz,输入在时钟的上升沿有效。
df(15):该引脚为高电平时,输出为二进制补码,该脚低电平时,输出为偏移二进制码。
stby(28):静态备用模式管脚。高电平时,该器件转到备用模式。
irs(5):输入范围选择管脚。该脚接vdda时, 满标度输入摆幅为2vp-p,接vssa时为1.5vp-p,悬空时为1vp-p。
d0~d9(16~20,23~27):数据输出端。d0是二进制输出数据的最低有效位,d9是最高有效位。
vdda(2,9,10):模拟电源正极。需与一个3v的直流电源相连并连接一0.1μf的旁路电容到模拟地。电容应紧靠这些引脚,距离不超过1cm处。同时还应并联一4.7μf的电容到模拟地。
关键词:adc10065;adc;差分输入;图像采集
1 adc10065的主要特点
adc10065是美国国家半导体公司推出的一款低功耗、单电源供电的cmos 模数转换器。该芯片在3v单电源供电时,能以65msps的采样速率将模拟信号转为精确的10 位数字信号,而功耗仅为68.4mw,其备用模式时的功耗仅为14.1mw。adc10065片内采用具有数据纠错功能的差分总线结构。因而可在最小的功耗条件下提供极优秀的动态性能。该器件可广泛应用于超声波和图像采集、蜂窝基站/通信接收机、声纳/雷达、xdsl、无线局域网、数据采集系统以及dsp 前端。
adc10065的主要特性如下:
●3v单电源供电;
●满标度输入摆幅可在2.0 vp-p,1.5 vp-p,0或 1.0 vp-p四种输入信号中选择;
●具有400mhz-3db的输入频宽;
●具有静态工作模式;
●带有片内基准源和采样保持放大电路;
●具有二进制补码数据格式输出;
●可调整的输出驱动适合2.5v和3.3v系列的逻辑器件接口。
下面是adc10065的主要参数:
●分辨率:10bits;
●转换速率:65msps;
●fpbw(全功率带宽):400mhz
●dnl(差分非线性):±0.3 lsb;
●snr(信噪比fin=32mhz) :59.3db ;
●sfdr(无差错动态范围fin=32mhz时):-80db;
●数据延迟:6个时钟周期;
●参考电压:+3.0v;
●65mhz时的功耗为:68.4mw。
图2
2 引脚功能
图1为adc10065的引脚排列,该器件采用28脚tssop封装,各引脚的基本功能如下(括号中为引脚号):
vin-,vin+(12,13):模拟信号输入端。在1.2v参考电压下,满标度输入摆幅为1.0vp-p。单端操作时,vin+可与vcom连接。
vref(6):参考电压(1.5v)引脚,使用时应通过一个1μf的旁路电容连接到vssa。
vreft,vcom,vrefb(7,4,8):vreft和vrefb仅为高阻抗参考旁路管脚,而vcom则可用作设置输入公用电压vcm,这三个引脚都应当连接0.1μf的旁路电容。
clk(1):数字时钟输入端。输入频率范围为10mhz~65mhz,输入在时钟的上升沿有效。
df(15):该引脚为高电平时,输出为二进制补码,该脚低电平时,输出为偏移二进制码。
stby(28):静态备用模式管脚。高电平时,该器件转到备用模式。
irs(5):输入范围选择管脚。该脚接vdda时, 满标度输入摆幅为2vp-p,接vssa时为1.5vp-p,悬空时为1vp-p。
d0~d9(16~20,23~27):数据输出端。d0是二进制输出数据的最低有效位,d9是最高有效位。
vdda(2,9,10):模拟电源正极。需与一个3v的直流电源相连并连接一0.1μf的旁路电容到模拟地。电容应紧靠这些引脚,距离不超过1cm处。同时还应并联一4.7μf的电容到模拟地。
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