基于AD6620和TMS320C6x的软件无线电接收子系统
发布时间:2008/5/27 0:00:00 访问次数:808
     王 乘 武汉大学电信学院(430072)倪 亮
     来源:《电子技术应用》
     摘要:介绍了一种数字中频软件无线电接收机的结构,并通过一个实例说明它的具体设计和实现方式。
    
    
     关键词:数字下变频器
     数字信号处理器 软件无线电
     软件无线电以其极强的灵活性和开放性代表着无线通信系统的发展趋势。其想想是以一个通用、标准、模块化的硬件平台为依托,通过软件编程实现无线通信系统的各种功能。
     软件无线电提倡功能软件化,要求减少模拟环节。对接收机而言,则要求模/数转换尽可能靠近天线。在现阶段,由于各种关键器件发展水平的限制,高频信号的直接数字化及其数据处理在成本上还不合算,因此数字中频软件无线电加上少量的高频模拟前端正成为理想软件无线电的一种经济、适用的选择。本数字中频接收子系统是基于数字下变频器ddcad6620和数字信号处理器dsptms320c6701构建的。
     1 总体设计
     1.1 系统组成与信号处理流程
     系统基本结构如图1所示。单片机实现数字下变频器的引导和初始化;高速adc根据频率源encode输入的时钟信号对输入信号进行过采样,并通过并行数据线向数字下变频器输出采样结果;数字下变频器根据单片机输入的数据设定数控振荡器nco频率值、抽样率以及数字滤波器系数,据此对采样数据进行下变频、降低数据率和低通滤波处理,并通过串口将数据提供给dsp进行处理。
     下面以一个实例说明信号处理流程。假设输入的中频信号的中心频率为456khz,带宽为20khz,fl、fh分别表示频率下限和上,fl为446khz,fh为466khz。
     如果如用nyquist带通采样定理采样并设采样频率为fs,则要求:
     fs=2(fl+fh)/(2n+1)
     其中,n的取值应满足,fs≥2(fh-fl)时的n
     最大值。
     取n为20,则带通取样频率为40.53khz。如图2所示,(a)表示原始信号频谱,(b)表示以40.53khz的采样频率采样后的信号频谱。对于处理信号而言,由于实际的20khz带外还存在递减的干扰信号,倘若以40.53khz采样率进行采样,就会出现较强的频谱混叠。
     若用adc对信号进行20mhz过采样,则如图2(c)所示,相邻信号频谱之间的间隔大大加宽,可充分避免频谱混叠。
     本系统采用高速a/d转换芯片进行20mhz高速采样,输出的数据率为20mbps。在目前的技术条件下,倘若过高的数据率直接输出给dsp,会占用dsp很多不必要的开销,所以需加入数字下变频器,在dsp前端将数据率降低。数字下变频器的主要功能有3个:(1)变频,将感兴趣的信号的中心频率变至零中频;(2)滤波,滤除带外干扰信号;(3)数率转换,通过降低数率,提供利于后续电路处理的低速数据。
     1.2 硬件电路设计
     系统的硬件电路设计如图3所示。
     /数模转换器采用的是ad公司生产的ad6600[1],它具有同时处理两路信号的能力。系统中main
     input向数/模转换器ad6600输入中频模拟信号,encode给ad6600提供20msps的采样时钟。ad6600采样后的结果通过并行数据线输出给数字下变频器,并行数据线包括11位数据线和3位rssi信号线(指数位)。
    
    
    
     数字下变频器选用ad公司生产的ad6620[2]。如图3所示,ad6620的时钟信号是通过clk由ad6600提供的。ad6600和ad6620都有两个数据通路a和b,具有同时处理两路信号的能力,它们通过a/b选择线协调相互间的工作模式。当ad6600只有一路信号需处理时,a/d
     王 乘 武汉大学电信学院(430072)倪 亮
     来源:《电子技术应用》
     摘要:介绍了一种数字中频软件无线电接收机的结构,并通过一个实例说明它的具体设计和实现方式。
    
    
     关键词:数字下变频器
     数字信号处理器 软件无线电
     软件无线电以其极强的灵活性和开放性代表着无线通信系统的发展趋势。其想想是以一个通用、标准、模块化的硬件平台为依托,通过软件编程实现无线通信系统的各种功能。
     软件无线电提倡功能软件化,要求减少模拟环节。对接收机而言,则要求模/数转换尽可能靠近天线。在现阶段,由于各种关键器件发展水平的限制,高频信号的直接数字化及其数据处理在成本上还不合算,因此数字中频软件无线电加上少量的高频模拟前端正成为理想软件无线电的一种经济、适用的选择。本数字中频接收子系统是基于数字下变频器ddcad6620和数字信号处理器dsptms320c6701构建的。
     1 总体设计
     1.1 系统组成与信号处理流程
     系统基本结构如图1所示。单片机实现数字下变频器的引导和初始化;高速adc根据频率源encode输入的时钟信号对输入信号进行过采样,并通过并行数据线向数字下变频器输出采样结果;数字下变频器根据单片机输入的数据设定数控振荡器nco频率值、抽样率以及数字滤波器系数,据此对采样数据进行下变频、降低数据率和低通滤波处理,并通过串口将数据提供给dsp进行处理。
     下面以一个实例说明信号处理流程。假设输入的中频信号的中心频率为456khz,带宽为20khz,fl、fh分别表示频率下限和上,fl为446khz,fh为466khz。
     如果如用nyquist带通采样定理采样并设采样频率为fs,则要求:
     fs=2(fl+fh)/(2n+1)
     其中,n的取值应满足,fs≥2(fh-fl)时的n
     最大值。
     取n为20,则带通取样频率为40.53khz。如图2所示,(a)表示原始信号频谱,(b)表示以40.53khz的采样频率采样后的信号频谱。对于处理信号而言,由于实际的20khz带外还存在递减的干扰信号,倘若以40.53khz采样率进行采样,就会出现较强的频谱混叠。
     若用adc对信号进行20mhz过采样,则如图2(c)所示,相邻信号频谱之间的间隔大大加宽,可充分避免频谱混叠。
     本系统采用高速a/d转换芯片进行20mhz高速采样,输出的数据率为20mbps。在目前的技术条件下,倘若过高的数据率直接输出给dsp,会占用dsp很多不必要的开销,所以需加入数字下变频器,在dsp前端将数据率降低。数字下变频器的主要功能有3个:(1)变频,将感兴趣的信号的中心频率变至零中频;(2)滤波,滤除带外干扰信号;(3)数率转换,通过降低数率,提供利于后续电路处理的低速数据。
     1.2 硬件电路设计
     系统的硬件电路设计如图3所示。
     /数模转换器采用的是ad公司生产的ad6600[1],它具有同时处理两路信号的能力。系统中main
     input向数/模转换器ad6600输入中频模拟信号,encode给ad6600提供20msps的采样时钟。ad6600采样后的结果通过并行数据线输出给数字下变频器,并行数据线包括11位数据线和3位rssi信号线(指数位)。
    
    
    
     数字下变频器选用ad公司生产的ad6620[2]。如图3所示,ad6620的时钟信号是通过clk由ad6600提供的。ad6600和ad6620都有两个数据通路a和b,具有同时处理两路信号的能力,它们通过a/b选择线协调相互间的工作模式。当ad6600只有一路信号需处理时,a/d