的LatticeECP / EC系列数据手册
架构
2004年11月
初步数据表
体系结构概述
在的LatticeECP -DSP以及LatticeEC 架构包含的逻辑块阵列通过可编包围
竹叶提取I / O单元（ PIC ） 。逻辑块的行之间的穿插是行的sysMEM嵌入式RAM块
（ EBR） ，如图2-1和2-2所示。此外，的LatticeECP -DSP支持DSP模块的附加行作为
如图2-2所示。
有两种类型的逻辑块，所述可编程功能单元（ PFU）和可编程功能单元
而RAM / ROM （ PFF ） 。该PFU包含构建块的逻辑，算术，RAM，ROM和注册功能
系统蒸发散。该PFF块包含逻辑，算术和ROM功能的积木。这两个PFU和PFF块
对于灵活性，允许复杂的设计可以快速实施，英法fi ciently进行了优化。逻辑模块
排列成二维阵列。只有一种类型的块时，每行中使用。在PFU块的输出用
侧行。所述芯的其余部分由行PFF块的散布有排PFU块组成。对于每一个
三行PFF块有一排PFU块。
每个PIC块包括2个PIO （PIO对）与它们各自的sysIO接口。在左边的PIO对和
该设备的右边缘可以CON组fi gured的LVDS发送/接收对。的sysMEM EBRS是大型专用快
存储器块。他们可以是CON连接gured为RAM或ROM 。
该PFU ， PFF ，PIC和EBR块排列成一个二维网格的行和列中所示
图2-1 。这些块被以许多垂直和水平的路由信道资源相连。的地方，
路由软件工具自动分配这些布线资源。
在含有的sysMEM块的行的端部是在SYSCLOCK锁相环（ PLL）的块。这些
锁相环有乘法，除法和相移功能;它们被用于管理的相位关系
时钟。在的LatticeECP / EC架构提供高达每台设备4个PLL 。
在家庭中的每个设备都有一个JTAG端口与内部逻辑分析仪（ ispTRACY ）的能力。该SYSCONFIG
端口允许串行或并行设备CON组fi guration 。在的LatticeECP / EC器件使用1.2V为核心的电压
年龄。
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2-1
Architecture_01.3
