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ISLA112P50
工作原理
功能说明
该ISLA112P50是基于12位， 250MSPS A / D转换器
芯，它利用一个流水线逐次逼近
体系结构（图26） 。输入电压是由一个捕获
采样保持放大器（SHA） ，并转换为电荷的单元。
专有的电荷域技术被用来依次
输入比较一系列参考收费。决定
制作过程中的逐次逼近型操作确定
数字码对每个输入值。该转换器管道
要求12的样品，以产生一个结果。数字误差
校正也适用，从而导致17个时钟总延迟
周期。这是显而易见的，以用户为的开始之间的延迟
转换和数据上可用的数字输出。
该器件包含了精心两个核心的A / D转换器
匹配的传输特性。这些内核的时钟频率上
备用时钟边缘，导致采样率加倍。
时间交织A / D系统可以表现出不理想的文物
频域，如果个人的核心A / D特性
没有很好地匹配。增益，偏移和歪斜时序不匹配
是首要关心的问题。
Intersil的交错引擎（ I2E ）执行自动交叉
校准的失调，增益和采样时间偏移不匹配
核心位A / D之间。该I2E电路还调整实时
对温度和电压变化。
残余的增益和采样时间偏移不匹配导致
基本的形象马刺在f
奈奎斯特
± f
IN
。偏移量不匹配
创建于DC马刺和f的倍数
奈奎斯特
.
电源电压斜坡，并且启动校准时的
模拟和数字电源电压高于阈值。该
以下条件必须被粘附到用于电
校准成功执行：
一个频率稳定的转换时钟必须被施加到
CLKP / CLKN引脚
DNC引脚不能连接
SDO （引脚66 ）要高
RESETN （引脚25 ）必须开始低
SPI通信不得尝试
用户启动的复位可在随后的事件调用
上述条件不能满足上电时。
引脚3,4 ，和SDO需要外部4.7kΩ上拉至OVDD 。如果
这些引脚上电时，校准拉低外部
将无法正确执行。
之后，电源稳定的内部POR释放
RESETN和一个内部上拉就拉大，这将启动
校准序列。如果随后用户启动的复位
需要的话， RESETN引脚应连接到漏极开路
驱动程序在扣除其高阻抗状态的驱动强度
比0.5毫安。
校准序列上的上升沿启动
RESETN ，如图27，超范围输出的（OR）被设置
高一旦RESETN被拉低，并保持该状态，直到
校准完成。在输出或恢复正常
操作在那个时间，因此重要的是，在模拟输入是
转换器的满量程范围内，观察过渡。如果
输入的是一个超量程条件或PIN将保持高，
而且它不会是能够检测校准结束
周期。
开机校准
如前所述，芯进行自校准的
启动。内部上电复位（POR）电路检测
时钟
GENERATION
INP
SHA
客栈
2.5-BIT
FL灰
6-STAGE
1.5-BIT/STAGE
3-STAGE
1-BIT/STAGE
3-BIT
FL灰
1.25V
+
–
数字
错误
更正
LVDS / LVCMOS
输出
图26. A / D内核框图
14
FN7604.2
2011年8月1日
