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集成
电路
系统公司
ICS85301
2:1
D
。微分
-
TO
-LVPECL M
ULTIPLEXER
R
ECOMMENDATIONS FOR
U
NUSED
I
NPUT
P
插件
I
NPUTS
:
PCLK / nPCLK我
NPUT
:
如果不需要使用差分输入，
无论是PCLK和nPCLK引脚可以悬空。虽然
不是必需的，但对于额外的保护，一个1kΩ电阻器
被捆扎从PCLK到地面。
T
发芽
为
3.3V LVPECL
安输出
ANCE技术应该被用于最大化操作
次数最小化信号失真。
图3A和
3B
显示这只是推荐了两款不同的布局
作为指导。其它合适的时钟布局可能存在的，它
将建议董事会设计师模拟
以保证所有印刷电路和时钟的兼容性
组件的工艺变化。
下面示出的时钟布局拓扑结构是一个典型termi-
国家的LVPECL输出。这两种不同的布局men-
tioned建议仅作为指导方针。
FOUT和nFOUT低阻抗跟随输出，
产生ECL / LVPECL兼容的输出。因此，之三
minating电阻（直流电流路径接地）或电流
源，必须使用功能。这些输出
设计用于驱动50Ω传输线。匹配阻抗
Z
o
= 50Ω
3.3V
125Ω
125Ω
FOUT
鳍
Z
o
= 50Ω
Z
o
= 50Ω
FOUT
50Ω
1
RTT =
Z
((V
OH
+ V
OL
) / (V
CC
– 2)) – 2
o
50Ω
V
CC
- 2V
RTT
鳍
Z
o
= 50Ω
84Ω
84Ω
F
IGURE
3A 。 LVPECL
安输出
T
发芽
F
IGURE
3B 。 LVPECL
安输出
T
发芽
85301AK
www.icst.com/products/hiperclocks.html
10
REV 。一2006年1月16日
