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初步
集成
电路
系统公司
ICS843252-04
F
EMTO
C
锁
C
RYSTAL
-
TO
-
3.3V LVPECL
LOCK
G
enerator
R
ECOMMENDATIONS FOR
U
NUSED
I
NPUT和
O
安输出
P
插件
I
NPUTS
:
O
UTPUTS
:
C
RYSTAL
I
NPUT
:
如果不需要使用晶体振荡器的
输入时，两个XTAL_IN和XTAL_OUT可以悬空。
虽然不是必需的，但对于额外的保护，一个1kΩ
电阻器可连接从XTAL_IN到地面。
REF_CLK我
NPUT
:
如果不需要使用参考时钟的，
它可以悬空。虽然不是必需的，但对于附加的
保护，一个1kΩ电阻可以从REF_CLK被捆绑
地面上。
LVCMOS
ONTROL
P
插件
:
所有的控制引脚具有内部上拉或下拉功能;另外
不需要性，但可以额外添加
保护。一个1kΩ电阻都可以使用。
LVPECL
安输出
所有未使用的LVPECL输出可以悬空。我们
建议没有一丝连接。的两侧
差分输出对应该要么被悬空
终止。
T
发芽FOR
3.3V LVPECL
安输出
下面示出的时钟布局拓扑结构是一个典型的终止
对于LVPECL输出。提到的两个不同的布局是
建议仅作为指导。
FOUT和nFOUT低阻抗跟随输出，
产生ECL / LVPECL兼容的输出。因此，端端接
荷兰国际集团电阻器（直流电流路径接地）或电流源
必须用于功能性。这些输出被设计成
驱动50Ω传输线。匹配阻抗技术
应使用以最大化操作次数最小化
信号失真。
图3A和3B
显示两个不同的布局
这些建议仅作为指导。其它合适的时钟
布局可能存在，它会建议董事会
设计师模拟，以保证兼容所有印刷
电路和时钟组件的工艺变化。
3.3V
Z
o
= 50Ω
FOUT
鳍
125Ω
Z
o
= 50Ω
FOUT
125Ω
Z
o
= 50Ω
50Ω
1
Z
((V
OH
+ V
OL
) / (V
CC
– 2)) – 2
o
50Ω
V
CC
- 2V
RTT
鳍
Z
o
= 50Ω
84Ω
84Ω
RTT =
F
IGURE
3A 。 LVPECL
安输出
T
发芽
F
IGURE
3B 。 LVPECL
安输出
T
发芽
843252AG-04
www.icst.com/products/hiperclocks.html
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REV 。一2006年1月25日
