HMC987LP5E
v01.0512
低噪声1:9扇出缓冲器
DC - 8 GHz的
典型应用
在适用于：
特点
超低本底噪声： -166 DBC /赫兹@ 2 GHz的
宽带： DC - 8 GHz的工作频率
灵活的输入接口：
LVPECL，LVDS ， CML ， CMOS兼容
AC或DC耦合
片内匹配50或150 Ω （ 100/300 Ω的Diff ）。
多个输出驱动器：
多达8个差分或16个单端LVPECL
输出：
800 mVpp的50Ω单端（ 3 DBM FO）
一个可调电源CML / RF输出：
-9 3 DBM单端
串行或并行控制，硬件芯片使能
掉电电流< 1微安
32引线5x5的毫米SMT封装25毫米
2
时钟分配 - SMT
SONET ，光纤通道，千兆以太网时钟分配
ADC / DAC时钟分配
低偏移和抖动时钟或数据扇出
无线/有线通信
电平转换
高性能仪器仪表
医学影像
单端至差分转换
工作原理图
概述
在1至9的扇出缓冲器被设计用于低噪声
时钟分配。它被用于产生相对
方波输出，上升/下降时间< 100 ps的。该
低偏移和抖动输出，加上其
快速上升/下降时间，导致可控的低噪声
下游电路，如混频器的切换，
通道ADC / DAC或SerDes器件。本底噪声
是在这些应用中，当特别重要
时钟网络带宽足够宽，以允许
方波的开关。的驱动在2 GHz ，输出
在有-166 DBC / Hz的噪声层，对应的
到0.6 ASEC / rtHz的抖动密度 - 或50飞秒以上8
GHz带宽。
输入级可驱动单端或
差异，在各种信号格式（CML ，
LVDS ， LVPECL或CMOS ） ， AC或DC耦合。该
输入级还采用了可调节的输入阻抗。
它有8个LVPECL输出和1 CML输出
可调式摆动/功率电平3 dB的步长。
各个输出级可以启用或禁用
为了节省功耗使用时，要么不要求
硬件控制引脚，或在一个串行端口的控制
界面。
1
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