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的PSoC
3 ： CY8C32系列
数据表
6.4.1驱动模式
每个GPIO和SIO引脚都可单独配置成中列出的8驱动模式之一
表6-6 。
三个配置位
用于每个销（DM [2 ：0]） [ 2：0 ]寄存器，并在PRTxDM设置。
图6-11
示出基于每个8的简化视图销
驱动模式。
表6-6
显示了基于端口的数据I / O引脚的驱动状态寄存器的值或数字阵列信号，如果旁路模式
选择。请注意，实际的I / O引脚的电压由所选择的驱动模式和负载在所述销的组合来确定。为
例如，如果一个GPIO引脚被配置为电阻上拉模式和驱动为高，而销是浮动的，在所述测量的电压
针是高逻辑状态。如果同一个GPIO引脚在外部接地，则电压不可测量的引脚为逻辑低状态。
图6-11 。驱动模式
VDDIO
VDDIO
DR
PS
针
DR
PS
针
DR
PS
针
DR
PS
针
0.
高阻抗
类似物
1.高阻抗
数字
VDDIO
2.电阻
引体向上
VDDIO
3.电阻
下拉
VDDIO
DR
PS
针
DR
PS
针
DR
PS
针
DR
PS
针
4.开漏
,
硬盘低
5.漏极开路
,
高驱动器
6.强劲动力
7.电阻
上拉和下拉
表6-6 。驱动模式
图
0
1
2
3
4
5
6
7
驱动模式
高阻抗模拟
高阻抗数字
电阻上拉
[13]
电阻下拉
[13]
开漏驱动器低
开漏输出，驱动大
强大的驱动器
电阻上拉和下拉
[13]
PRTxDM2
0
0
0
0
1
1
1
1
PRTxDM1
0
0
1
1
0
0
1
1
PRTxDM0
0
1
0
1
0
1
0
1
的PRTxDR = 1
高Z
高Z
清晰度高（ 5K ）
强高
高Z
强高
强高
清晰度高（ 5K ）
的PRTxDR = 0
高Z
高Z
小强
RES低（ 5K ）
小强
高Z
小强
RES低（ 5K ）
记
13.电阻上拉和下拉不可用SIO在稳压输出模式。
文件编号： 001-56955修订版*
119第37页
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