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CY23FP12-002
表1.可编程功能
（续）
CON组fi guration
INV CLKB2
INV CLKB4
拉下启用
FBK下拉启用
FBK SEL
描述
生成的CLKB2输出反相时钟。当此选项
编程， CLKB2和CLKB3将成为免费对。
生成的CLKB4输出反相时钟。当此选项
编程， CLKB4和CLKB5将成为免费对。
使能/禁止内部下拉所有输出
默认
非反转
非反转
启用
启用/禁用反馈通路内部下拉（同时适用于启用
内部和外部反馈拓扑）
内部和外部反馈拓扑之间选择
国内
下表列出了独立的功能，它可被分配给四个S1和S2的组合。当一个特定的
S1和S2的组合被选择时，该装置假定的配置（其本质上是一组在给定的函数
表2）
那
已被预先分配给该特定组合。
对于S1 / S2组合表2.可编程功能
功能
描述
默认
启用
启用
启用
启用
启用
启用
输出使能CLKB [ 5 ： 4 ]启用/禁用CLKB [ 5 ： 4 ]输出对
输出使能CLKB [ 3 ： 2 ]启用/禁用CLKB [ 3 ： 2 ]输出对
输出使能CLKB [ 1 ： 0 ]启用/禁用CLKB [ 1 ： 0 ]输出对
输出使能CLKA [ 5 ： 4 ]启用/禁用CLKA [ 5 ： 4 ]输出对
输出使能CLKA [ 3 ： 2 ]启用/禁用CLKA [ 3 ： 2 ]输出对
输出使能CLKA [ 1 ： 0 ]启用/禁用CLKA [ 1 ： 0 ]输出对
自动关机启用启用/禁用自动断电电路，监控的参考时钟上升沿启动
边缘和关断器件的情况下引用“失败”。此故障被触发
通过下面一组极限参考频率的漂移。这种自动断电电路
内部关闭时的一个输出的一个或多个被配置为直接驱动
从基准时钟。
PLL掉电
M[7:0]
N[7:0]
X[6:0]
关闭时，该设备被配置为一个非PLL扇出缓冲器中的锁相环。
SEE
表4
第6页
分配一个8位值参考分频器-M 。除法器可以是任何整数值见
表4
从1到256;然而， PLL输入频率不能大于10兆赫以下。
第6页
分配一个8位值反馈分频器-N 。除法器可以是任何整数值见
表4
从1到256;然而， PLL输入频率不能大于10兆赫以下。
第6页
分配一个7位的值来输出分频器-X 。除法器可以是任何整数值
从5到130除以1,2,3，和4中预先编程的设备上，并且可以是
通过适当的输出多路复用器设置激活。
PLL的输出和基准时钟作为时钟源之间进行选择
输出分频器。
SEE
表4
第6页
SEE
表4
第6页
分频器源
CLKA54来源
CLKA32来源
CLKA10来源
CLKB54来源
CLKB32来源
CLKB10来源
自主选择一个出八种可能的输出分频器将连接到见
表4
在CLKA5和CLKA4对。请参阅
表3
对分频器的值的列表6页。第6页
自主选择一个出八种可能的输出分频器将连接到见
表4
在CLKA3和CLKA2对。请参阅
表3
对分频器的值的列表6页。第6页
自主选择一个出八种可能的输出分频器将连接到见
表4
在CLKA1和CLKA0对。请参阅
表3
对分频器的值的列表6页。第6页
自主选择一个出八种可能的输出分频器将连接到见
表4
在CLKB5和CLKB4对。请参阅
表3
对分频器的值的列表6页。第6页
自主选择一个出八种可能的输出分频器将连接到见
表4
在CLKB3和CLKB2对。请参阅
表3
对分频器的值的列表6页。第6页
自主选择一个出八种可能的输出分频器将连接到见
表4
在CLKB1和CLKB0对。请参阅
表3
对分频器的值的列表6页。第6页
文件编号： 38-07644牧师* B
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