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图6 。
写时序
CS
t
CS
SK
DI
1
0
1
A
N
...
A0
D
N
...
D0
DO
高阻抗
忙
准备
t
WP
图7 。
WRAL时序
(1 ),( 2 )
CS
t
CS
SK
DI
1
0
0
0
1
...
D
N
...
D0
DO
高阻抗
忙
准备
t
WP
注意事项：
1.仅对在V
CC
= 4.5V至5.5V 。
2.至少需要9个时钟周期。
网络连接gure 8 。
ERASE时序
t
CS
CS
查
状态
待机
SK
DI
1
1
1
A
N
A
N-1
A
N-2
...
A0
t
SV
t
DF
高阻抗
准备
DO
高阻抗
忙
t
WP
8
AT93C46A
0539K–SEEPR–2/07
